KR101010784B1 - 트렐리스 디코더를 위한 메모리 관리 알고리즘 - Google Patents
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- 238000000034 method Methods 0.000 claims abstract description 54
- 238000012545 processing Methods 0.000 claims description 23
- 230000004044 response Effects 0.000 claims 12
- 150000001875 compounds Chemical class 0.000 claims 3
- 238000003672 processing method Methods 0.000 claims 3
- 239000002131 composite material Substances 0.000 claims 1
- 230000003111 delayed effect Effects 0.000 claims 1
- 230000007704 transition Effects 0.000 claims 1
- 230000008569 process Effects 0.000 abstract description 20
- 230000009467 reduction Effects 0.000 abstract description 4
- 230000006978 adaptation Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 9
- 238000013459 approach Methods 0.000 description 5
- 230000001934 delay Effects 0.000 description 5
- 230000008901 benefit Effects 0.000 description 4
- 238000013461 design Methods 0.000 description 3
- 230000008859 change Effects 0.000 description 2
- 238000004891 communication Methods 0.000 description 2
- 230000006872 improvement Effects 0.000 description 2
- 230000009471 action Effects 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 230000009977 dual effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000009897 systematic effect Effects 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/25—Error detection or forward error correction by signal space coding, i.e. adding redundancy in the signal constellation, e.g. Trellis Coded Modulation [TCM]
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/37—Decoding methods or techniques, not specific to the particular type of coding provided for in groups H03M13/03 - H03M13/35
- H03M13/39—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes
- H03M13/41—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes using the Viterbi algorithm or Viterbi processors
- H03M13/4161—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes using the Viterbi algorithm or Viterbi processors implementing path management
- H03M13/4169—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes using the Viterbi algorithm or Viterbi processors implementing path management using traceback
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/37—Decoding methods or techniques, not specific to the particular type of coding provided for in groups H03M13/03 - H03M13/35
- H03M13/39—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes
- H03M13/3944—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes for block codes, especially trellis or lattice decoding thereof
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/37—Decoding methods or techniques, not specific to the particular type of coding provided for in groups H03M13/03 - H03M13/35
- H03M13/39—Sequence estimation, i.e. using statistical methods for the reconstruction of the original codes
- H03M13/3961—Arrangements of methods for branch or transition metric calculation
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/65—Purpose and implementation aspects
- H03M13/6502—Reduction of hardware complexity or efficient processing
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M13/00—Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
- H03M13/65—Purpose and implementation aspects
- H03M13/6502—Reduction of hardware complexity or efficient processing
- H03M13/6505—Memory efficient implementations
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
- H04L1/0045—Arrangements at the receiver end
- H04L1/0054—Maximum-likelihood or sequential decoding, e.g. Viterbi, Fano, ZJ algorithms
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/004—Arrangements for detecting or preventing errors in the information received by using forward error control
- H04L1/0056—Systems characterized by the type of code used
- H04L1/0059—Convolutional codes
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N21/00—Selective content distribution, e.g. interactive television or video on demand [VOD]
- H04N21/20—Servers specifically adapted for the distribution of content, e.g. VOD servers; Operations thereof
- H04N21/23—Processing of content or additional data; Elementary server operations; Server middleware
- H04N21/238—Interfacing the downstream path of the transmission network, e.g. adapting the transmission rate of a video stream to network bandwidth; Processing of multiplex streams
- H04N21/2383—Channel coding or modulation of digital bit-stream, e.g. QPSK modulation
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- H—ELECTRICITY
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N21/00—Selective content distribution, e.g. interactive television or video on demand [VOD]
- H04N21/40—Client devices specifically adapted for the reception of or interaction with content, e.g. set-top-box [STB]; Operations thereof
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- H04N21/438—Interfacing the downstream path of the transmission network originating from a server, e.g. retrieving encoded video stream packets from an IP network
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Abstract
Description
개선된 APTFT 알고리즘 |
레지스터 교환 알고리즘 |
잔존 메모리 깊이는 T |
잔존 메모리 깊이는 T |
레이턴시는 T |
레이턴시는 T |
메모리 사이즈는 T*N |
메모리 사이즈는 T*N |
메모리는 랜덤 액세스 메모리 |
메모리는 컴플렉스, 듀얼포트, 더하기 2 대 1 멀티플렉서, 더하기 개별 메모리 소자들간의 상호접속 |
트렐리스 브랜치당 메모리 판독/기록 동작은 2*N |
트렐리스 브랜치당 메모리 판독/기록 동작은 N*T |
전력 소모는 비교적 적음 |
전력 소모는 비교적 큼 |
역추적/순방향 추적 유닛에서의 추가적 제어 |
추가적 제어 없음 |
개선된 APTFT 알고리즘 |
k-포인터 짝수 알고리즘 |
잔존 메모리 깊이는 T |
잔존 메모리 깊이는 T |
레이턴시는 T |
레이턴시는 2*T*k/(k-1) |
메모리 사이즈는 T*N |
메모리 사이즈는 2*T*N*k/(k-1) |
스테이트 포인터의 수는 3*N+1 |
스테이트 포인터의 수는 k |
개선된 APTFT 알고리즘 |
원-포인터 알고리즘 |
잔존 메모리 깊이는 T |
잔존 메모리 깊이는 T |
레이턴시는 T |
레이턴시는 T*(k+1)/(k-1) |
메모리 사이즈는 T*N |
메모리 사이즈는 T*N*(k+1)/(k-1) |
각각의 트렐리스 브랜치에 대한 메모리 판독/기록 동작은 2*N |
각각의 트렐리스 브랜치에 대한 메모리 판독/기록 동작은 (k+1)*N |
판독/기록 제어의 속도는 동일 |
판독 제어는 기록 제어보다 k배 더 빠름 |
트렐리스 스테이트 업데이트 포인터의 수는 3*N+1 |
트렐리스 스테이트 업데이트 포인터의 수는 1 |
Claims (26)
- 트렐리스(trellis) 인코딩된 데이터 패킷들의 그룹들을 포함하는 데이터를 프로세싱하고 트렐리스 디코딩된 데이터를 제공하기 위한 시스템으로서,상기 인코딩된 데이터 패킷들에 응답하여 트렐리스 스테이트 변환들(trellis state transitions)에 연관된 결정 데이터를 생성하기 위한 수단;상기 결정 데이터에 응답하여, 스테이트 변환 트렐리스에 의하여 결정된 바대로의, 선행 트렐리스 스테이트들(antecedent trellis states)의 시퀀스를 식별하기 위한 역추적(traceback) 네트워크 - 상기 선행 트렐리스 스테이트들은 데이터 패킷들의 시퀀스에 대해 식별됨 -;상기 선행 트렐리스 스테이트들로부터 희망 트렐리스 스테이트 경로를 선택하기 위한 수단;각각의 새로운 트렐리스 브랜치에서 상기 희망 트렐리스 스테이트 경로를 지속적으로 업데이트하기 위한 수단; 및상기 식별된 선행 트렐리스 스테이트들의 시퀀스에 응답하여 상기 트렐리스 디코딩된 데이터를 제공하기 위한 수단을 포함하는 데이터 프로세싱 및 제공 시스템.
- 제1항에 있어서,상기 선행 트렐리스 스테이트들은 상기 데이터 패킷들의 시퀀스에 대해 트렐리스를 통하여 전경로 역추적(all-path traceback)을 수행하기 위한 수단에 따라 식별되고,각각의 새로운 트렐리스 브랜치에서 상기 희망 트렐리스 스테이트 경로를 지속적으로 업데이트하기 위한 수단은, 트렐리스를 통하여 전경로 순방향 추적(all-path forward trace)을 수행하기 위한 수단에 의해 얻어진 각각의 트렐리스 브랜치와 연관된 데이터에 응답하여 한 에포크(an epoch)에 걸쳐 각각의 새로운 트렐리스 브랜치에서 그 값이 업데이트되는 순방향 추적 포인터에 따라 수행되는 데이터 프로세싱 및 제공 시스템.
- 삭제
- 제2항에 있어서,상기 희망 트렐리스 스테이트 경로는 모든 트렐리스 스테이트들 중 최소 메트릭 경로인 데이터 프로세싱 및 제공 시스템.
- 제2항에 있어서,상기 전경로 순방향 추적을 수행하기 위한 수단은,각각의 트렐리스 스테이트 경로에 대한 제1 포인터 - 상기 제1 포인터는 제1 포인터 값을 가지며, 상기 제1 포인터 값은 한 에포크의 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 업데이트됨 -; 및각각의 트렐리스 스테이트 경로에 대한 제2 포인터 - 상기 제2 포인터는 제2 포인터 값을 가지며, 상기 제2 포인터 값은 에포크 경계에서 업데이트됨 -를 더 포함하며,각각의 에포크는 T/2이고, 역추적 간격 T는 트렐리스 인코딩된 데이터 시퀀스 내에 존재하는(residing) 디코딩된 데이터 시퀀스의 잔존 메모리 깊이(survivor memory depth)를 정의하는 데이터 프로세싱 및 제공 시스템.
- 제5항에 있어서,상기 순방향 추적 포인터는 상기 제1 포인터 값 및 상기 제2 포인터 값 모두에 지속적으로 응답하며, 이에 의해 상기 순방향 추적 포인터는 한 에포크 동안 각각의 트렐리스 브랜치에서 지속적으로 업데이트되는 데이터 프로세싱 및 제공 시스템.
- 제6항에 있어서,상기 제2 포인터는 상기 제1 포인터의 값으로 각각의 에포크의 종료 시에 한 번 업데이트되며, 상기 제1 포인터는 그 후에 리세트되는 데이터 프로세싱 및 제공 시스템.
- 제7항에 있어서,상기 데이터 프로세싱 및 제공 시스템에 의하여 출력된 각각의 디코딩된 비트는 T인 연관 메모리 깊이(associated memory depth)를 갖는 데이터 프로세싱 및 제공 시스템.
- 제8항에 있어서,상기 순방향 추적 포인터는 각각의 새로운 트렐리스 브랜치에서 2개의 이전 에포크로부터 상기 희망 트렐리스 스테이트 경로를 지속적으로 식별하는 데이터 프로세싱 및 제공 시스템.
- 제2항에 있어서,상기 역추적 네트워크는,입력 인코딩된 데이터를, 한번에 한 에포크 동안 데이터 도착의 순서로 버퍼 메모리 유닛내에 기록하기 위한 수단;이후의 에포크 동안 상기 버퍼 메모리 유닛으로부터 상기 데이터를 판독하고 이를 상기 전경로 역추적 유닛으로 보내기 위한 수단;상기 전경로 역추적 유닛이 상기 버퍼 메모리 유닛으로부터 판독된 데이터로 상기 트렐리스를 통하여 역추적함에 따라, 상기 전경로 역추적 유닛으로부터 디코딩된 시퀀스 메모리 유닛으로 디코딩된 출력들을 보내기 위한 수단;한번에 하나의 에포크에 대해, 도착의 역순으로 상기 디코딩된 시퀀스 메모리 유닛으로부터 상기 디코딩된 데이터를 판독하기 위한 수단;N개의 디코딩된 시퀀스들 중 하나를 선택하기 위하여 상기 디코딩된 시퀀스 메모리 유닛으로부터의 디코딩된 데이터 출력들을 멀티플렉싱하기 위한 수단 - 여기서, N은 상기 트렐리스에서의 스테이트들의 수임 -; 및상기 순방향 추적 포인터의 값에 따라 멀티플렉서 유닛에 의해 상기 디코딩된 시퀀스 메모리로부터 디코딩된 데이터 출력 샘플을 선택하기 위한 수단을 더 포함하는 데이터 프로세싱 및 제공 시스템.
- 트렐리스 인코딩된 데이터 패킷들의 그룹들을 포함하는 데이터를 프로세싱하기 위한 방법으로서,상기 데이터에 응답하여 트렐리스 스테이트 변환들과 연관된 결정 데이터를 생성하는 단계;상기 결정 데이터에 응답하여 스테이트 변환 트렐리스에 따라 선행 트렐리스 스테이트들의 시퀀스를 식별하는 단계;각각의 트렐리스 브랜치의 특성들에 응답하여 희망 트렐리스 스테이트 경로를 선택하는 단계;각각의 새로운 트렐리스 브랜치에서 상기 희망 트렐리스 스테이트 경로를 지속적으로 업데이트하는 단계; 및상기 식별된 선행 트렐리스 스테이트들의 시퀀스에 응답하여 트렐리스 디코딩된 데이터를 제공하는 단계를 포함하는 데이터 프로세싱 방법.
- 제11항에 있어서,에포크 경계들 사이에서의 희망 트렐리스 스테이트 경로 선택들을 업데이트하는 단계를 더 포함하고, 각각의 에포크는 T/2이고, 역추적 간격 T는 트렐리스 인코딩된 데이터 시퀀스 내에 존재하는 디코딩된 데이터 시퀀스의 잔존 메모리 깊이를 정의하는 데이터 프로세싱 방법.
- 제12항에 있어서,한 에포크의 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 희망 트렐리스 스테이트 경로를 업데이트 및 선택하는 단계를 더 포함하는 데이터 프로세싱 방법.
- 제13항에 있어서,복수의 트렐리스 디코딩된 데이터 시퀀스를 식별하는 단계; 및한 에포크 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 업데이트되는 복합 포인터(composite pointer)로 상기 복수의 트렐리스 디코딩된 데이터 시퀀스 중 하나를 식별하는 단계를 더 포함하는 데이터 프로세싱 방법.
- 제14항에 있어서,제1 포인터의 도움으로 복수의 트렐리스 디코딩된 데이터 시퀀스를 식별하는 단계;한 에포크 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 상기 제1 포인터와 연관된 값을 업데이트하는 단계;제2 포인터의 도움으로 복수의 트렐리스 디코딩된 데이터 시퀀스를 식별하는 단계; 및상기 제1 또는 제2 포인터와 연관된 값이 업데이트될 때마다 상기 복합 포인터와 연관된 값을 업데이트하는 단계를 더 포함하는 데이터 프로세싱 방법.
- 제15항에 있어서,각각의 에포크 경계에서 상기 제2 포인터와 연관된 값을 상기 제1 포인터와 연관된 값으로 대체하고, 그 후에 상기 제1 포인터를 리세트하는 단계를 더 포함하는 데이터 프로세싱 방법.
- 인코딩된 심볼들을 디코딩하기 위한 복수의 트렐리스 브랜치 및 트렐리스 스테이트를 갖는 트렐리스 디코더로서,트렐리스 스테이트 변환들과 연관된 결정 데이터를 생성하기 위한 수단;스테이트 변환 트렐리스에 의하여 결정된 바대로의, 복수의 선행 트렐리스 스테이트 시퀀스를 지연된 결정 데이터로 식별함으로써 복수의 트렐리스 디코딩된 데이터 시퀀스를 제공하기 위한 수단 - 상기 스테이트 변환 트렐리스는 N개의 스테이트를 가짐 -; 및상기 결정 데이터로 선행 트렐리스 스테이트들을 식별함으로써 업데이트된 포인터로 상기 복수의 트렐리스 디코딩된 데이터 시퀀스 중 하나를 식별하기 위한 수단 - 상기 포인터는 각각의 트렐리스 브랜치와 연관된 데이터에 응답하여 한 에포크에 걸쳐 각각의 트렐리스 브랜치에서 지속적으로 업데이트되고, 한 에포크는 역추적 간격 T의 서브간격들임 -을 포함하는 트렐리스 디코더.
- 제2항에 있어서,상기 전경로 순방향 추적을 수행하기 위한 수단은,각각의 트렐리스 스테이트 경로에 대한 제1 포인터 P1 - 상기 제1 포인터는 제1 포인터 값을 가지며, 상기 제1 포인터 값은 한 에포크 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 업데이트됨 -; 및각각의 트렐리스 스테이트 경로에 대한 추가적인 q-1 포인터들 Pj(j=2,3,...,q) - 상기 포인터들은 포인터 값들을 가지며, 각각의 포인터 값은 에포크 경계에서 업데이트됨 -;를 더 포함하고,각각의 에포크는 역추적 간격 T의 서브간격으로서 T/q의 지속 기간을 가지며, 여기서 q는 2보다 크거나 2와 같은 정수이고, q는 T보다 작거나 T와 같으며, 상기 역추적 간격 T는 트렐리스 인코딩된 데이터 시퀀스 내에 존재하는 디코딩된 데이터 시퀀스의 잔존 메모리 깊이를 정의하는 데이터 프로세싱 및 제공 시스템.
- 제18항에 있어서,상기 순방향 추적 포인터는 모든 q 포인터들의 값들에 지속적으로 응답하며, 이에 의해 상기 순방향 추적 포인터는 한 에포크 동안 각각의 트렐리스 브랜치에서 지속적으로 업데이트되는 데이터 프로세싱 및 제공 시스템.
- 제19항에 있어서,각각의 포인터 Pj(j=3,...,q)는 포인터 Pj-1의 값으로 각각의 에포크의 종료 시 한 번 업데이트되고, 포인터 P2는 상기 포인터 P1의 값으로 각각의 에포크의 종료 시 한 번 업데이트되며, 상기 제1 포인터 P1은 그 후에 리세트되는 데이터 프로세싱 및 제공 시스템.
- 제20항에 있어서,상기 데이터 프로세싱 및 제공 시스템에 의하여 출력된 데이터의 시퀀스 내에 존재하는 각각의 디코딩된 비트는 T인 연관 메모리 깊이를 갖는 데이터 프로세싱 및 제공 시스템.
- 제21항에 있어서,상기 순방향 추적 포인터는 각각의 새로운 트렐리스 브랜치에서 q의 이전 에포크들로부터 상기 희망 트렐리스 스테이트 경로를 지속적으로 식별하는 데이터 프로세싱 및 제공 시스템.
- 트렐리스 인코딩된 데이터 패킷들의 그룹들을 포함하는 데이터를 프로세싱하고 트렐리스 디코딩된 데이터를 제공하기 위한 시스템으로서,상기 인코딩된 데이터 패킷들에 응답하여 트렐리스 스테이트 변환들과 연관된 결정 데이터를 생성하기 위한 수단;상기 결정 데이터에 응답하여, 스테이트 변환 트렐리스에 의하여 결정된 바대로의, 선행 트렐리스 스테이트들의 시퀀스를 식별하기 위한 역추적 네트워크;상기 선행 트렐리스 스테이트들로부터 희망 트렐리스 스테이트 경로를 선택하기 위한 수단;상기 희망 트렐리스 스테이트 경로를 업데이트하기 위한 수단; 및상기 식별된 선행 트렐리스 스테이트들의 시퀀스에 응답하여, 상기 트렐리스 디코딩된 데이터를 제공하기 위한 수단을 포함하고,상기 역추적 네트워크는,트렐리스를 통하여 전경로 역추적을 수행하기 위한 수단; 및트렐리스를 통하여 전경로 순방향 추적을 수행하기 위한 수단을 더 포함하고,상기 전경로 순방향 추적을 수행하기 위한 수단은,각각의 트렐리스 스테이트 경로에 대한 제1 포인터 P1 - 상기 제1 포인터는 제1 포인터 값을 가지고, 상기 제1 포인터 값은 한 에포크의 지속 기간에 걸쳐 각각의 새로운 트렐리스 브랜치에서 업데이트됨 -; 및각각의 트렐리스 스테이트 경로에 대한 추가적인 q-1 포인터들 Pj(j=2,3,..., q) - 이 포인터들은 포인터 값들을 가지며, 각각의 포인터 값은 에포크 경계에서 업데이트됨 -를 더 포함하며,각각의 에포크는 역추적 간격 T의 서브간격으로서 T/q의 지속 기간을 가지며, q는 2보다 크거나 2와 같은 정수이고, q는 T보다 작거나 T와 같으며, 상기 역추적 간격 T는 트렐리스 인코딩된 데이터 시퀀스 내에 존재하는 디코딩된 데이터 시퀀스의 잔존 메모리 깊이를 정의하는 데이터 프로세싱 및 제공 시스템.
- 제23항에 있어서,복합 순방향 추적 포인터는 상기 제1 포인터 및 상기 추가적인 q-1 포인터들의 값들에 응답하고, 상기 복합 순방향 추적 포인터는 각각의 에포크 경계에서 업데이트되는 데이터 프로세싱 및 제공 시스템.
- 제24항에 있어서,각각의 포인터 Pj(j=3,...,q)는 포인터 Pj-1의 값으로 각각의 에포크의 종료 시 한 번 업데이트되고, 포인터 P2는 상기 포인터 P1의 값으로 각각의 에포크의 종료 시 한 번 업데이트되며, 상기 제1 포인터 P1은 그 후에 리세트되는 데이터 프로세싱 및 제공 시스템.
- 삭제
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US37324602P | 2002-04-17 | 2002-04-17 | |
US60/373,246 | 2002-04-17 | ||
PCT/US2003/007166 WO2003090361A1 (en) | 2002-04-17 | 2003-03-10 | A memory management algorithm for trellis decoders |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20040099452A KR20040099452A (ko) | 2004-11-26 |
KR101010784B1 true KR101010784B1 (ko) | 2011-01-25 |
Family
ID=29251004
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020047016609A KR101010784B1 (ko) | 2002-04-17 | 2003-03-10 | 트렐리스 디코더를 위한 메모리 관리 알고리즘 |
Country Status (9)
Country | Link |
---|---|
US (1) | US7149952B2 (ko) |
EP (1) | EP1495547A4 (ko) |
JP (1) | JP4191053B2 (ko) |
KR (1) | KR101010784B1 (ko) |
CN (1) | CN1647391B (ko) |
AU (1) | AU2003218034A1 (ko) |
BR (1) | BR0309218A (ko) |
MX (1) | MXPA04010142A (ko) |
WO (1) | WO2003090361A1 (ko) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
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A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
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