KR100954971B1 - 비동기 복제 방지 검출기 - Google Patents

비동기 복제 방지 검출기 Download PDF

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톰슨 라이센싱 에스.에이.
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Abstract

비디오 시스템(100)은 적어도 하나의 타이밍 신호에 따라서 복합 동기화 신호 내 의사-동기화 펄스를 검출하도록 동작하는 검출 회로(200A 내지 200C)를 포함한다. 타이밍 회로(200D 내지 200F)는 복합 동기화 신호 내 동기화 정보를 사용함이 없이 적어도 하나의 타이밍 신호를 발생시키도록 동작한다.
Figure R1020047009202
타이밍 회로, 의사-동기화 펄스, 비동기 복제 방지 검출기, 타이밍 신호, 비트 패턴

Description

비동기 복제 방지 검출기{Asynchronous copy protection detector}
본 발명은 일반적으로, 비디오 시스템에 관한 것이며, 특히, 그 중에서도, 수평 및/또는 수직 동기화 신호들을 사용하지 않고 비디오 신호들에서 의사-동기화 펄스들의(pseudo-synchronization pulses) 존재를 검출할 수 있는 이와 같은 비디오 시스템들에 사용하기 위한 비동기 복제 방지 검출기에 관한 것이다.
허가되지 않은 비디오 복사본들의 제조를 방지하기 위하여 비디오 산업에서 복제 방지 기술들이 종종 사용된다. 한 가지 이와 같은 복제 방지 기술은 각 비디오 필드의 특정 라인들 상에 의사-동기화 펄스들을 삽입하는 것을 포함한다. 이와 같은 펄스들을 포함하는 비디오 정보가 복제될 때, 이 펄스들은 최종 복제본에 동기화 문제들이 발생되도록 한다. 상술된 유형의 복제 방지를 가능하게 한 제품들은, 예를 들어, 매크로비전(Macrovision)과 같은 회사들로부터 상업적으로 이용가능하다.
많은 비디오 시스템들에서, 기록 처리를 금지시키기 위해 비디오 신호들 내에 의사-동기화 펄스들의 존재를 검출하는 것이 필요하다. 예를 들어, 일부 비디오 시스템들은 특정 신호 처리 기능들 동안에 비디오 신호들로부터 이와 같은 의사-동기화 펄스들을 스트립(strip)할 수 있다. 그러나, 이로부터 스트립되는 이와 같은 의사-동기화 펄스들을 갖는 비디오 신호들이 기록 동작을 위하여 비디오 시스템으로부터 출력되면, 의사-동기화 펄스들은 임의의 최종 복제본이 복제 방지되도록 우선 비디오 신호들에 재삽입되어야 한다. 따라서, 비디오 시스템들이 종종 비디오 신호들 내에서 이와 같은 의사-동기화 펄스들의 존재를 검출할 필요가 있다.
특정의 기존 비디오 시스템들에서, 의사-동기화 펄스들의 존재를 검출하는 회로가 포함된다. 특히, 특정 비디오 시스템들은 수평 위상 고정 회로("Horizontal Phase Locked Loops(HPLLs)"), 라인 카운터들, 및 수직 동기화 검출기들과 같은 수평 및 수직 동기화 회로를 갖는 비디오 처리 집적 회로들("ICs")을 포함한다. 이와 같은 동기화 회로는, 예를 들어, 필립스 모델 SAF7113H 비디오 입력 프로세서 IC에 포함된다. 이 유형의 IC에 포함되는 동기화 회로는 복합 비디오 신호에 포함되는 수평 및 수직 동기화 신호들을 사용한다. 따라서, 이와 같은 회로는 의사-동기화 펄스들의 검출을 상대적으로 간단하게 하도록 하는데, 그 이유는 수평 및 수직 동기화 신호들이 안정한 기준 타이밍 포인트들을 제공하기 때문이다. 그러나, 의사-동기화 펄스들의 검출이 상술된 유형의 동기화 회로가 없는 비디오 시스템에 요구될 때, 이와 같은 회로를 부가하는 비용은 엄청날 수 있다.
따라서, 상술된 문제들을 피하여 비용이 드는 회로를 요구하거나, 또는 복합 동기화 신호에 포함된 수평 및/또는 수직 동기화 신호들을 사용하지 않고, 비디오 신호들 내에서 의사-동기화 펄스들의 존재를 검출할 수 있는 비디오 시스템이 필요하게 된다. 본 발명은 이들 및 다른 문제를 해결한다.
삭제
본 발명에 따르면, 비디오 시스템은 검출 회로 및 타이밍 회로를 포함한다. 검출 회로는 적어도 하나의 타이밍 신호에 따라서 복합 동기화 신호 내에서 의사-동기화 펄스들을 검출하도록 동작한다. 타이밍 회로는 복합 동기화 신호 내의 동기화 정보를 사용하지 않고 적어도 하나의 타이밍 신호를 발생시키도록 동작한다.
본 발명의 상술된 및 그외 다른 특징들 및 이점들 및 그것들을 달성하는 방법이 더욱 명백해질 것이며, 본 발명은 첨부된 도면들과 관련하여 취해진 본 발명의 실시예들의 후속하는 설명을 참조함으로써 보다 잘 이해될 것이다.
도 1은 본 발명의 원리들에 따른 비동기 복제 방지 검출기를 포함한 예시적인 비디오 시스템을 도시한 도면.
도 2는 도 1의 비동기 복제 방지 검출기의 제 1 예시적인 검출 회로를 도시한 도면.
도 3은 도 1의 비동기 복제 방지 검출기의 제 2 예시적인 검출 회로를 도시한 도면.
도 4는 도 1의 비동기 복제 방지 검출기의 제 3 예시적인 검출 회로를 도시한 도면.
도 5a 내지 도 5c는 도 1의 비동기 복제 방지 검출기의 예시적인 타이밍 회로들을 도시한 도면.
도 6은 의사-동기화 펄스들을 포함한 복합 동기화 신호를 도시한 예시적인 도면.
본 명세서에 기재된 예들은 본 발명의 바람직한 실시예들을 예시한 것이며, 이러한 예들은 임의의 방식으로 본 발명의 범위를 제한하는 것으로 해석되지는 말아야 한다.
이하, 도면들, 특히 도 1을 참조하면, 본 발명의 원리들에 따른 비동기 복제 방지 검출기(200)를 포함한 예시적인 비디오 시스템(100)이 도시되어 있다. 도 1의 비디오 시스템(100)은, 예를 들어, 텔레비젼 신호 수신기, 셋톱 박스, 비디오 카세트 레코더("VCR"), 디지털 비디오 디스크("DVD") 플레이어, 비디오 게임 박스, 휴대용 비디오 레코더("PVR") 또는 비디오 처리 기능을 가진 임의의 다른 시스템으로서 구현될 수 있다.
도 1에서, 비디오 시스템(100)은 외부 소스(도시되지 않음)로부터 비디오 신호를 수신하고 이로부터 복합 동기화 신호를 추출하도록 동작한다. 비디오 시스템(100)은 복합 동기화 신호, DIG_SYNC를 수신하여 처리하기 위한 비동기 복제 방지 검출기(200)를 포함하여, 그 내에서 의사-동기화 펄스들의 존재를 검출하도록 한다. 본원에 전술된 바와 같이, 이와 같은 의사-동기화 펄스들은 종종 복제 방지를 제공하는 수단으로서 비디오 신호들에 인코딩된다. 비동기 복제 방지 검출기(200)는 검출 동작의 결과들을 나타내는 출력 신호 MV_FOUR_FIELD를 발생시킨다. 본원에 설명될 것처럼, 비동기 복제 방지 검출기(200)는 검출 회로들(200A 내지 200C) 및 타이밍 회로들(200D 내지 200F)을 포함한다. 비동기 복제 방지 검출기(200)는, 예를 들어, 적어도 하나의 IC들상에 포함될 수 있다. 도 1에 명백하게 도시되지 않았지만, 비디오 시스템(100)은 또한, 다른 IC들 및 다른 전기 및 비전기 구성요소들과 같은 다른 구성요소들을 포함할 수 있다.
본원에 설명될 것처럼, 비동기 복제 방지 검출기(200)는 비디오 시스템(100)이 복합 동기화 신호 내에서 동기화 정보를 사용하지 않고 복합 동기화 신호 내의 의사-동기화 펄스들의 존재를 검출하게 한다. 즉, 비동기 복제 방지 검출기(200)의 동작은 수평 및/또는 수직 동기화 신호들에 종래의 방식으로 고정되는 위상 및/또는 주파수가 아니다. 따라서, 의사-동기화 펄스들은 가령, HPLLs, 라인 카운터들 및 수직 동기화 검출기들과 같은 값비싼 수평 및/또는 수직 동기화 회로를 사용하지 않고 검출될 수 있다.
단지 예시 및 설명을 위하여, 비동기 복제 방지 검출기(200)는 본원에서 특정 복제 방지 방식을 검출하기 위해 기재되며, 여기에서 의사-동기화 펄스들은 각 비디오 필드의 8개의 연속적인 라인들(예를 들어, 필드 1의 라인 10 내지 17, 및 필드 2의 라인 273 내지 280)에 삽입된다. 그러나, 본 발명의 원리들은 이 특정 복제 방지 방식의 검출에만 국한되지 않는다. 따라서, 당업자는 본 발명의 원리들이 또한, 의사-동기화 펄스들이 비디오 필드당 상이한 수의 라인들 상에 삽입되는 것들과 같은 다른 복제 방지 방식들을 검출하는데 사용될 수 있다는 것을 인지할 것이다.
도 2를 참조하면, 도 1의 비동기 복제 방지 검출기(200)의 제 1 예시적인 검출 회로(200A)가 도시되어 있다. 도 1에서, 회로(200A)는 저역 통과 필터/서브샘플러(subsampler)로서 동작하고, 승산기(21), 가산기(22), 리미터(limiter)(23), D-형 플립 플롭(24), 제산기(25), 감산기(26), 비교기(27) 및 D-형 플립 플롭(28)을 포함한다. 도 2에서, 신호 라인들 위의 수들은 일 실시예에서 대응하는 신호 라인상에 전송되는 비트들의 수를 나타낸다. 이들 수들은 임의의 방식으로 제한하고자 하는 것은 아니다. 또한, 도 2에서, 이에 인접한 별표("*")를 지닌 신호 라인들은 부호가 없는 신호들(즉, + 또는 - 표시자를 갖지 않은 신호들)을 표시한다.
예시적인 동작 모드에서, 승산기(21)는 동기화("sync") 슬라이서(slicer)(도시되지 않음)와 같은 소스로부터 복합 동기화 신호, 즉 DIG_SYNC 신호를 수신한다. 비디오 기술 분야에 알려진 바와 같이, 복합 동기화 신호는 수평 및 수직 동기화 신호들을 포함하고, 아날로그 비디오 신호의 표준 구성요소이다. 예시적인 실시예에 따르면, DIG_SYNC 신호는 각 수평 라인 동안에 5㎲ 동안 논리 하이(high) 상태 및 60㎲ 동안 논리 로우(low) 상태를 나타내는 펄스열(pulse train)로서 표시되는 1-비트 신호이다. 예를 들어, DIG_SYNC 신호는 27MHz 클록 주파수에 따라서 승산기(21)에 입력될 수 있다.
승산기(21)는 DIG_SYNC 신호를 16값으로써 승산하여 승산된 신호를 발생시키고 출력한다. 가산기(22)는 승산기(21)로부터 승산된 신호를 수신하고 이에 피드백 신호를 가산함으로써, 합 신호를 발생시켜 출력한다. 리미터(23)는 가산기(22)로부터의 합 신호를 수신하고 이에 대한 제한 동작을 수행하여, 제한된 값을 갖는 출력 신호를 발생시킨다. 일 실시예를 따르면, 리미터(23)의 출력 신호는 511(즉, 29-1)의 값으로 제한된다. D-형 플립 플롭(24)은 리미터(23)의 출력 신호를 수신하고, 27MHz의 예시적인 클록 주파수에 따라서 클록(clock)됨으로써, 출력 신호를 제공한다. 제산기(25)는 D-형 플립 플롭(24)으로부터 출력 신호를 수신하고, 일 실시예에 따라서, 이의 값을 16으로 제산함으로써, 제산된 신호를 발생시켜 출력한다. 감산기(26)는 D-형 플립 플롭(24)으로부터 출력 신호 및 제산기(25)로부터 제산된 신호를 수신하고, D-형 플립 플롭의 출력 신호의 값으로부터 제산된 신호의 값을 감산함으로써, 피드백 신호를 발생시켜 가산기(22)로 출력한다. 비교기(27)는 또한, 제산기(25)로부터 제산된 신호를 수신하고, 일 실시예를 따라서, 제산된 신호의 값이 8보다 크거나 같은지를 결정한다. 제산된 신호의 값이 8보다 크거나 같다면, 비교기(27)는 논리 하이 상태를 지닌 출력 신호를 발생시킨다. D-형 플립 플롭(28)은 비교기(27)로부터 출력 신호를 수신하고 subsample_en 신호에 따라서 클록됨으로써, 회로(200A)의 출력 신호인 서브샘플링된 신호를 출력한다. subsample_en 신호에 관한 보다 상세한 내용이 본원에서 도 5a를 참조하여 후술될 것이다.
도 3을 참조하면, 도 1의 비동기 복제 방지 검출기(200)의 제 2 예시적인 검출 회로(200B)가 도시되어 있다. 도 3에 도시된 바와 같이, 회로(200B)는 정합 필터(31), AND 게이트(32), 업 카운터(33), 비교기(34), 인버터(35) 및 D-형 플립 플롭(36)을 포함한다. 도 3에서, 신호 라인들 위의 도시된 수는 예시적인 실시예에서 대응하는 신호 라인상에 전송되는 비트들의 수를 표시한다. 이들 수는 임의의 방식으로든 제한되려고 의도되지 않는다. 또한, 도 3에서, 이에 인접한 별표("*")를 지닌 신호 라인들은 부호가 없는 신호(즉, + 또는 - 표시자를 갖지 않은 신호)를 표시한다.
예시적인 동작 모드에서, 정합 필터(31)는 도 2의 비동기 복제 방지 검출기(200)의 회로(200A)로부터 출력된 서브샘플링된 신호를 수신한다. 정합 필터(31)는 subsample_en 신호에 따라서 서브샘플링된 신호의 순차적인 비트를 미리 정해진 비트 패턴들과 비교한다. 특히, 미리 정해진 비트 패턴들 각각은 2 의사-동기화 펄스들의 존재에 대응하는 신호 프로파일(profile)을 표시한다. 일 실시예를 따르면, 미리 정해진 비트 패턴들은 다음 비트 시퀀스: "00X1X000X1X000", "00X1X0000X1X00" 및 "00X1X00000X1X0"을 포함하는데, 여기서 "X"는 "don't care" 논리 상태를 표시한다. 따라서, 서브샘플링된 신호의 순차적인 비트들이 미리 정해진 비트 패턴들의 1에 대응할 때, 정합 필터(31)는 논리 하이 상태에서 출력 신호를 발생시켜 2 의사-동기화 펄스들이 주어진 수평 라인 구간 내에서 검출된다는 것을 나타낸다.
AND 게이트(32)는 정합 필터(31)로부터 출력 신호, subsample_en 신호 및 피드백 신호를 수신하며 이에 대해 논리 AND 연산을 수행하여 출력 신호를 발생시킨다. 예시적인 실시예에 따르면, 2 의사-동기화 펄스들이 수평 라인 구간에 통상적으로 대응하는 주어진 시간 구간 내에서 검출된다는 것을 정합 필터(31)의 출력 신호가 나타낼 때, AND 게이트(32)는 논리 하이 상태에서 출력 신호를 발생시킨다. 업 카운터(32)는 AND 게이트(32)로부터 출력 신호를 수신하고, 예시적인 실시예에 따라서, AND 게이트(32)로부터 수신된 논리 하이 신호들의 수를 카운트하여 대응하는 카운트 신호를 출력한다. 특히, 업 카운터(33)로부터 출력되는 카운트 신호는 수평 라인 구간에 통상적으로 대응하는 주어진 시간 구간 내에서 2 의사-동기화 펄스들을 정합 필터(31)가 검출하는 횟수를 나타내는 카운트 값을 갖는다. 업 카운터(33)는 수평 라인 구간을 통상적으로 표시하는 line_en 신호에 따라서 리셋(reset)된다. line_en 신호에 관한 부가적인 상세 내용은 본원에서 도 5b를 참조하여 후술될 것이다.
비교기(34)는 업 카운터(33)로부터 카운트 신호를 수신하고, 예시적인 실시예에 따르면, 카운트 신호로 표시되는 카운트 값을 2의 값과 비교한다. 즉, 비교기(34)는 정합 필터(31)가 수평 라인 구간에 통상적으로 대응하는 주어진 시간 구간 내에서 2 의사-동기화 펄스들을 2회 검출하는지를 결정한다. 비교기(34)는 업카운터(33)의 카운트 신호로 표시된 카운트 값이 2와 동일할 때 논리 하이 상태로 출력 신호를 발생시킨다. 인버터(35)는 비교기(34)의 출력 신호를 수신하여 반전시키고, 그에 의해 피드백 신호를 발생시켜 AND 게이트(32)로 출력한다.
D-형 플립 플롭(36)은 또한, 비교기(34)의 출력 신호를 수신하고, line_en 신호에 따라서 클록됨으로써, 회로(200B)의 출력 신호인 mv_line 신호를 출력한다. 예시적인 실시예에 따르면, mv_line 신호는 수평 라인 구간에 통상적으로 대응하는 주어진 시간 구간 동안 2 의사-동기화 펄스들이 2회 검출될 때 논리 하이 상태를 나타낸다.
도 4를 참조하면, 도 1의 비동기 복제 방지 검출기(200)의 제 3 예시적인 검출 회로(200C)가 도시되어 있다. 도 4에 도시된 바와 같이, 회로(200C)는 제한 업/다운 카운터(41), 비교기(42), SR-형 플립 플롭(43), 및 D-형 플립 플롭(44)을 포함한다. 도 4에서, 신호 라인들 위에 도시된 수는 예시적인 실시예에서 대응하는 신호 라인 상에 전송되는 비트들의 수를 나타낸다. 이들 수는 어떤 방식으로 제한되려고 의도되지는 않는다. 또한, 도 4에서, 이에 인접한 별표("*")를 지닌 신호 라인은 부호가 없는 신호들(즉, + 또는 - 표시자를 갖지 않는 신호들)을 나타낸다.
예시적인 동작 모드에서, 제한 업/다운 카운터(41)는 도 3의 비동기 복제 방지 검출기(200)의 회로(200B)로부터 출력되는 mv_line 신호를 수신한다. 제한 업/다운 카운터(41)는 line_en 신호에 의해 인에이블되고 mv_line 신호의 논리 상태에 기초하여 상향으로 또는 하향으로 카운트한다. 예시적인 실시예에 따르면, 제한 업/다운 카운터(41)는 mv_line 신호가 논리 하이 상태를 나타내는 각 시간 구간마다 1씩 상향으로 카운트하고, mv_line 신호가 논리 로우 상태를 나타내는 각 시간 구간마다 1씩 하향으로 카운트한다. 더욱이, 제한 업/다운 카운터(41)의 카운트 값은 0 내지 7의 값으로 제한되는 것이 바람직하다. 제한 업/다운 카운터(41)는 그의 카운팅 동작을 나타내는 카운트 값을 갖는 카운트 신호를 발생시켜 출력한다.
비교기(42)는 제한 업/다운 카운터(41)로부터 카운트 신호를 수신하고, 예시적인 실시예에 따르면, 카운트 신호로 표시되는 카운트 값을 6의 값과 비교한다. 비교기(42)는 제한 업/다운 카운터(41)의 카운트 신호로 표시되는 카운트 값이 6보다 크거나 같을 때 논리 하이 상태로 출력 신호를 발생시킨다. SR-형 플립 플롭(43)은 "S" 단자에서 비교기(42)의 출력 신호 및 "R" 단자에서 four_field_en 신호를 수신하고, 이에 따라서 출력 신호를 발생시킨다. four_field_en 신호는 통상적으로 4 필드 구간을 나타낸다. 본원의 four_field_en 신호에 관한 부가적인 상세 내용은 도 5c를 참조하여 후술될 것이다.
D-형 플립 플롭(44)은 SR-형 플립 플롭(43)의 출력 신호를 수신하고, four-field_en 신호에 따라서 클록됨으로써, 비동기 복제 방지 검출기(200)의 출력 신호인 MV_FOUR_FIELD 신호를 출력한다. 예시적인 실시예에 따르면, MV_FOUR_FIELD 신호는 66.75 밀리초마다 갱신되고, 제한 업/다운 카운터(41)의 카운트 값이 4 필드 측정 구간 동안 언제나 6과 동일하거나 이를 초과할 때 논리 하이 상태를 나타낸다. 본 발명의 원리를 따르면, MV_FOUR_FIELD 신호가 논리 하이 상태일 때, 의사-동기화 펄스는 각 비디오 필드의 8개의 연속적인 라인들에 제공되는 것으로 가정된다.
도 5a 내지 도 5c를 참조하면, 도 1의 비동기 복제 방지 검출기(200)의 예시적인 타이밍 회로들(200D 내지 200F)이 각각 도시되어 있다. 도 5a 내지 도 5c에 도시된 바와 같이, 타이밍 회로들(200D 내지 200F)은 subsample_en 신호, line_en 신호 및 four_field_en 신호 각각을 발생시키는 회로를 포함한다. 타이밍 회로들(200D 내지 200F)에 관한 부가적인 상세 내용이 후술된다.
도 5a에서, 타이밍 회로(200D)는 업 카운터(51), 비교기(52), 및 D-형 플립 플롭(53)을 포함한다. 예시적인 실시예에 따르면, 업 카운터(51)는 27MHz 클록 주파수에 따라서 상향 카운팅 동작을 수행함으로써, 카운트 값을 나타내는 카운트 신호를 발생시킨다. 비교기(52)는 업 카운터(51)로부터 카운트 신호를 수신하고, 카운트 신호로 표시되는 카운트 값을 31의 값과 비교한다. 예시적인 실시예에 따르면, 비교기(52)는 업 카운터(51)의 카운트 신호로 표시되는 카운트 값이 31과 동일할 때 논리 하이 상태로 출력 신호를 발생시킨다. D-형 플립 플롭(53)은 비교기(52)로부터 출력 신호를 수신하고, 예시적인 실시예에 따르면, 27MHz 클록 주파수에 따라서 클록됨으로써, subsample_en 신호를 출력한다. 이러한 방식으로, subsample_en 신호는 27MHz 클록 주파수의 32번째 클록 사이클 마다 논리 하이 상태를 나타낸다.
도 5b에서, 타이밍 회로(200E)가 업 카운터(54), 비교기(55) 및 AND 게이트(56)를 포함한다. 일 실시예를 따르면, 업 카운터(54)는 도 5a의 타이밍 회로(500)에 의해 발생되는 subsample_en 신호에 따라서 모듈로-54 카운팅 동작을 수행함으로써, 카운트 값을 나타내는 카운트 신호를 발생시킨다. 특히, 업 카운터(54)는 subsample_en 신호가 논리 하이 상태를 나타낼 때마다 1씩 상향으로 카운트함으로써, 반복된 방식(즉, 0, 1, 2, ...53, 0, 1... 53, 0, 1....)으로 0 내지 53을 카운트한다. 비교기(55)는 업 카운터(54)로부터 카운트 신호를 수신하고, 카운트 신호로 표시되는 카운트 값을 53의 값과 비교한다. 비교기(54)는 업 카운터(54)의 카운트 신호로 표시되는 카운트 값이 53과 동일할 때 논리 하이 상태로 출력 신호를 발생시킨다. AND 게이트(56)는 비교기(55)로부터 출력 신호 및 subsample_en 신호를 수신하고, 이에 대해 논리 AND 연산을 수행함으로써, line_en 신호를 발생시킨다. 이 방식으로, line_en 신호는 subsample_en 신호가 논리 하이 상태를 나타내는 매 54번째 마다 논리 하이 상태를 나타냄으로써, 비디오 필드의 1 라인에 대응하는 구간에 근사한다.
도 5c에서, 타이밍 회로(200F)는 업 카운터(57), 비교기(58), 및 AND 게이트(59)를 포함한다. 예시적인 실시예에 따르면, 업 카운터(57)는 도 5b의 타이밍 회로(540)에 의해 발생된 line_en 신호에 따라서 모듈로-1043 카운팅 동작을 수행함으로써, 카운트 값을 나타내는 카운트 신호를 발생시킨다. 특히, 업 카운터(57)는 line_en 신호가 논리 하이 상태를 나타낼 때마다 1씩 상향으로 카운트함으로써, 반복된 방식(즉, 0,1,2,...1042,0,1...1042,0,1,...)으로 0 내지 1042를 카운트한다. 비교기(58)는 업 카운트(57)로부터 카운트 신호를 수신하고, 카운트 신호로 표시되는 카운트 값을 1042의 값과 비교한다. 비교기(58)는 업 카운터(57)의 카운트 신호로 표시되는 카운트 값이 1042와 동일할 때 논리 하이 상태로 출력 신호를 발생시킨다. AND 게이트(59)는 비교기(58)로부터 출력 신호 및 line_en 신호를 수신하고 이에 대해 논리 AND 연산을 수행함으로써, four_field_en 신호를 발생시킨다. 이 방식으로, four_field_en 신호는 line_en 신호가 논리 하이 상태를 나타내는 매 1043번째마다 논리 하이 상태를 나타냄으로써 4 비디오 필드들에 대응하는 구간에 근사한다.
도 6을 참조하면, 의사-동기화 펄스들을 포함한 복합 동기화 신호의 예시적인 도면(600)이 도시되어 있다. 특히, 도 6은 수평 동기화 펄스(601) 및 다수의 의사-동기화 펄스들(602)을 포함한 비디오의 1 수평 라인에 대한 복합 동기화 신호를 도시한 것이다. 본원에 서술된 바와 같이, 이와 같은 의사-동기화 펄스들(602)은 본 발명에 따라서 검출될 수 있다. 특히, 본 발명은 복합 동기화 신호 내에서 동기화 정보를 사용함이 없이 복합 동기화 신호에서 그런 의사-동기화 펄스들(602)을 검출하는데 유용하다. 따라서, 의사-동기화 펄스들은 HPLL들, 라인 카운터들 및 수직 동기화 검출기들과 같은 값비싼 수평 및/또는 수직 동기화 회로를 사용하지 않고도 검출될 수 있다. 본 발명이 라인 및 필드 구간들에 근사하는 타이밍 신호들을 발생시키지만, 이와 같은 타이밍 신호들은 수평 및/또는 수직 동기화 신호들에 결코 고정되지 않는다.
본원에 서술된 발명은 특히, 디스플레이 디바이스들을 갖거나 갖지 않는 각종 비디오 시스템들에 적용될 수 있다. 따라서, 본원에 사용된 표현 "비디오 시스템"은 텔레비젼 세트들 또는 디스플레이 디바이스를 포함하는 모니터들, 및 셋-톱 박스, VCR, DVD 플레이어, 비디오 게임 박스, PVR, 또는 디스플레이 디바이스를 포함할 수 없는 다른 비디오 시스템과 같은 시스템들 또는 장치들을 포함하는 다양한 유형들의 시스템들 또는 장치들을 포함하려고 의도되지만, 이에 제한되지는 않는다.
본 발명은 바람직한 설계를 갖는 것으로서 설명되었지만, 본 발명은 본 개시의 사상 및 범위 내에서 추가적으로 변형될 수 있다. 그러므로, 본 출원은 일반적인 원리들을 사용하여 본 발명에 대한 임의의 변형들, 사용들 또는 적응들을 포괄하도록 의도된 것이다. 또한, 본 출원은, 본 개시로부터의 이러한 벗어남들을, 본 발명이 속하고 첨부된 청구항들의 한계 내에 속하는 이 분야에서 알려지거나 통상 실행되는 것으로서 포괄하려고 의도된다.

Claims (21)

  1. 비디오 시스템(100)에 있어서,
    적어도 2개의 타이밍 신호들에 따라서 복합 동기화 신호 내의 의사-동기화 펄스들을 검출하도록 동작하는 검출 회로(200A 내지 200C)로서, 상기 검출 회로에 의한 의사-동기화 펄스들의 검출은 상기 복합 동기화 신호 내의 동기화 정보를 사용하여 발생된 타이밍 신호들과 독립적인, 상기 검출 회로(200A 내지 200C), 및
    상기 적어도 2개의 타이밍 신호들을 발생시키도록 동작하는 타이밍 회로(200D 내지 200F)를 포함하고,
    상기 적어도 2개의 타이밍 신호들은 상기 복합 동기화 신호 내의 동기화 정보를 사용하지 않고 발생되는, 비디오 시스템(100).
  2. 제 1 항에 있어서,
    상기 검출 회로(200A 내지 200C)는 상기 의사-동기화 펄스들을 나타내는 적어도 하나의 미리 정해진 비트 패턴을 검출하도록 동작하는 필터(31)를 포함하는, 비디오 시스템(100).
  3. 제 1 항에 있어서,
    상기 검출 회로(200A 내지 200C)는 비디오 필드의 복수의 연속적인 라인들의 각각에서 의사-동기화 펄스들을 검출하도록 동작하는, 비디오 시스템(100).
  4. 제 1 항에 있어서,
    상기 적어도 2개의 타이밍 신호들은 복수의 타이밍 신호들을 포함하는, 비디오 시스템(100).
  5. 제 4 항에 있어서,
    상기 타이밍 신호들 중 하나(line_en)는 비디오 필드의 한 라인에 대응하는 구간인, 비디오 시스템(100).
  6. 제 4 항에 있어서,
    상기 타이밍 신호들 중 하나(four_line_en)는 복수의 비디오 필드들에 대응하는 구간인, 비디오 시스템(100).
  7. 삭제
  8. 비동기 검출기(200)에 있어서,
    적어도 2개의 타이밍 신호들에 따라서 복합 동기화 신호 내의 의사-동기화 펄스들을 검출하기 위한 검출 수단(200A 내지 200C)으로서, 상기 검출 수단에 의한 의사-동기화 펄스들의 검출은 상기 복합 동기화 신호 내의 동기화 정보를 사용하여 발생된 타이밍 신호들과 독립적인, 상기 검출 수단(200A 내지 200C), 및
    상기 적어도 2개의 타이밍 신호들을 발생시키기 위한 수단(200D 내지 200F)을 포함하고,
    상기 적어도 2개의 타이밍 신호들은 상기 복합 동기화 신호 내의 동기화 정보를 사용하지 않고 발생되는, 비동기 검출기(200).
  9. 제 8 항에 있어서,
    상기 검출 수단(200A 내지 200C)은 상기 의사-동기화 펄스들을 나타내는 적어도 하나의 미리 정해진 비트 패턴을 검출하기 위한 수단(31)을 포함하는, 비동기 검출기(200).
  10. 제 8 항에 있어서,
    상기 검출 수단(200A 내지 200C)은 비디오 필드의 복수의 연속적인 라인들의 각각에서 의사-동기화 펄스들을 검출하는, 비동기 검출기(200).
  11. 제 8 항에 있어서,
    상기 적어도 2개의 타이밍 신호들은 복수의 타이밍 신호들을 포함하는, 비동기 검출기(200).
  12. 제 11 항에 있어서,
    상기 타이밍 신호들 중 하나(line_en)는 비디오 필드의 한 라인에 대응하는 구간인, 비동기 검출기(200).
  13. 제 11 항에 있어서,
    상기 타이밍 신호들 중 하나(four_field_en)는 복수의 비디오 필드들에 대응하는 구간인, 비동기 검출기(200).
  14. 삭제
  15. 비디오 시스템에서 복제 방지 방식을 비동기적으로 검출하기 위한 방법에 있어서,
    적어도 2개의 타이밍 신호들에 따라서 복합 동기화 신호 내 상기 복제 방지 방식과 관련된 의사-동기화 펄스들을 검출하는 단계로서, 검출 회로에 의한 의사-동기화 펄스들의 검출은 상기 복합 동기화 신호 내 동기화 정보를 사용하여 생성된 타이밍 신호들과 독립적인, 상기 검출 단계, 및
    상기 복합 동기화 신호 내 동기화 정보를 사용하지 않고 상기 적어도 2개의 타이밍 신호들을 발생시키는 단계를 포함하는, 검출 방법.
  16. 제 15 항에 있어서,
    상기 검출 단계는 상기 의사-동기화 펄스들을 나타내는 적어도 하나의 미리 정해진 비트 패턴을 검출하는 단계를 포함하는, 검출 방법.
  17. 제 15 항에 있어서,
    상기 검출 단계는 비디오 필드의 복수의 연속적인 라인들 각각에서 의사-동기화 펄스들을 검출하는 단계를 포함하는, 검출 방법.
  18. 제 15 항에 있어서,
    상기 적어도 2개의 타이밍 신호들은 복수의 타이밍 신호들을 포함하는, 검출 방법.
  19. 제 18 항에 있어서,
    상기 타이밍 신호들 중 하나(line_en)는 비디오 필드의 한 라인에 대응하는 구간인, 검출 방법.
  20. 제 18 항에 있어서,
    상기 타이밍 신호들 중 하나(four_field_en)는 복수의 비디오 필드들에 대응하는 구간인, 검출 방법.
  21. 삭제
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