KR100298958B1 - 압축 비디오 신호용 동기화 장치 - Google Patents

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Abstract

본 발명은 다층 압축된 비디오 신호의 트랜스포트 또는 다중화 층과 같은 신호의 중간층의 동기화를 발생하기 위한 장치에 관한 것으로, 모듈로 K 카운터(23)의 카운트 값 같은 시간 스탬프 기준을 포함하고, 신호가 회로를 전환시킴에 따라 각각의 (예를 들어, 다중화)회로의 전환 시간에 의해 갱신될 수도 있는 차동 시간 스탬프를 공급하기 위한 장치(13, 23, 25)를 시스템의 인코딩 단에서 구비한다. 시스템의 수신단에서, 카운터(27)는 제어된 수신기 클록 신호에 응답하고 이 카운터의 카운트 값은 트랜스포트층에 삽입된 시간 스탬프가 도달하면 샘플링된다. 시간 스탬프 및 차동 시간 스탬프는 신호로부터 회복되어 보정된 시간 스탬프를 형성하기 위해 결합된다. 수신기 카운터의 연속 샘플링된 카운트 값들의 차이는 대응되는 연속 보정된 시간 스탬프의 차이에 비교되어 수신기 클록 신호를 제어하는 신호를 공급한다.

Description

압축 비디오 신호용 동기화 장치{SYNCHRONIZATION ARRANGEMENT FOR A COMPRESSED VIDEO SIGNAL}
본 발명은 클록 신호가 인코딩 장치의 클록 신호로 주파수 로크(lock)된 신호 압축 해제 장치에서 클록 신호를 제공하기 위한 방법 및 장치에 관한 것이다.
압축 비디오 신호의 발생 및 전송 시스템은 동기의 여러 레벨, 즉 보다 적절히 말하자면 비동기로 동작할 수 있다. 예컨대, 실제 압축 장치는 적어도 부분적으로는 비디오 신호의 수직 프레임율에 동기화될 것이고, 또한 칼라 부반송파에도 동기화될 수 있다. 비디오 신호가 일단 압축되어 MPEG1 과 같은 특정 신호 프로토콜로 형성되면 전송용 트랜스포트 패킷으로 처리될 수 있다. 트랜스포트 패킷은 다른 비디오 또는 데이타 소스의 패킷으로 시분할 다중화될 수도 있다. 패킷화 및 다중화는 상호 동기적인 방식으로 수행되거나 수행되지 않을 수도 있는데, 압축 동작에 동기적이거나 동기적이지 않을 수도 있다. 이후 트랜스포트 패킷은 (다중화되었든 되지 않았든)데이타 전송용 모뎀에 공급될 수 있다. 이 모뎀은 상기한 시스템과 동기적으로 동작할 수도 동작하지 않을 수도 있다.
완전히 다중화되어 전송된 압축 신호의 수신기에서, 다양한 서브 시스템은 일반적으로 시스템의 인코딩단에서 상대 역기능 소자와 동기적으로 동작한다. 이경우 동기 동작은 대체로 각 서브 시스템이 그 대응 서브 시스템의 동일 주파수에 매우 근접하게 동작함을 의미할 수도 있다. 예컨대, 압축 해제기는 압축기에서 비디오 신호 소스에 의해 공급되는 바와 같은 동일 프레임의 비율로 비디오 신호를 공급해야 하고, 관련 오디오에 동기화되어야 한다. 시스템의 비디오/오디오 압축 해제부의 동기화는 신호의 각 세그먼트에 대한 생성/재생의 상대 시간을 표시하는 표시 시간 스탬프(presentation time stamp)를 인코더에서 압축 비디오/오디오 신호에 삽입함으로써 수행될 수 있다. 이와 같은 표시 시간 기준(PTR)은 동기화 목적과 적절한 순차화 및 연속성을 위한 관련 오디오 및 비디오 신호의 타이밍을 비교하는데 사용될 수 있다.
수신기 모뎀은 물론 정확한 주파수에서 전송 모뎀으로서 동작해야 한다. 수신기 모뎀은 일반적으로 동기 클록 신호를 발생하기 위해 전송 반송파 주파수에 응답하는 위상 동기 루프(PLL)를 포함한다.
다중화 및/또는 트랜스포트 패킷화 장치의 동기화는 다음 두 이유로 인해 다소 더 복잡한 경향이 있다. 첫째는 다중화된 데이타가 산발적으로 도달될 수도 있는 점이다. 둘째는 레이트 버퍼링(rate buffering)이 보통 모뎀과 압축 해제기 사이에 이용되는 점인데, 레이트 버퍼가 오버플로나 언드플로 상태에 있지 않고 제조 가격을 최소화하도록 가능한 한 작게 유지되게 하는 제한이 보장되는 규정을 만들어야 한다.
본 발명은 다층 압축 비디오 신호의 트랜스포트 또는 다중화층과 같은 중간층의 신호의 동기화를 설정하기 위해 압축된 비디오 신호에 상이한 시간 코드 또는 카운트 값을 삽입하는 장치 및 시스템에 관한 것이다. 시스템의 인코딩단의 한 실시예에서, 모듈로 K 카운터는 시스템 클록에 응답하여 클록되고, 이 카운터에 의해 공급되는 카운트 값들 중 선택된 값은 일정 스케줄에 따라 트랜스포트층에서 신호에 삽입된다. 사전 압축된 비디오 신호가 신호에 포함되는 경우 사전 압축된 카운트 값을 표시하는 값을 포함하도록 규정된다. 다른 실시예에 따르면, 압축된 비디오 신호가 큐잉(queue)을 이룰 수 있는 신호 전송 위치에서, 시스템 클록 주파수의 클록 펄스를 카운트하는데 있어서 신호가 지연되는 시간을 측정하고, 상기 트랜스포트 패킷의 차동 카운트 값을 지연 측정할 때의 값으로 액세스하고 갱신하도록 규정된다. 시스템의 수신단의 구현에 있어서, 시스템의 인코딩 단의 카운터와 유사한 카운터는 카운트 값을 공급하도록 제어 수신기 클록 신호에 응답하고, 이들 카운트 값은 트랜스포트층에 삽입된 카운트 값의 도달에 따른 시간에서 샘플링된다. 전송된 카운트 및 차동 카운트 값은 수신된 트랜스포트층으로부터 액세스되고, 수신기 클록 신호를 제어하는 신호를 발생하기 위해 수신기 카운트 값으로 사용된다.
제1도는 본 발명을 구현하는 클록 회복 장치를 포함하는 압축된 비디오 인코딩/디코딩 시스템의 블록도.
제2도는 상이한 소스로부터 다중화 데이타의 발생을 표시하기에 유용한 신호 다중화 장치의 블록도.
제3도 및 제5도는 전송된 압축 비디오 데이타용 클록 회복 장치의 대체 실시예의 블록도.
제4도는 다중화된 신호에 포함되는 타이밍 기준을 증가하기 위한 시스템을 구비한 신호 다중화 장치의 블록도.
제6도 및 7도는 트랜스포트 블록 및 보조 신호 트랜스포트 블록도.
제8도는 제2도의 트랜스포트 프로세서의 동작에 대한 흐름도.
<도면의 주요 부분에 대한 부호의 설명>
13 : 트랜스포트 프로세서
23 : 카운터
25 : 래치
27 : 시스템 클록 발생기
50 : 비디오 인코더
52 : 클록 PCR 발생기
53 : 트랜스포트 프로세서
본 발명이 구현될 수 있는 전형적인 시스템으로 압축 디지탈 비디오 신호 전송 장치가 제1도에 예시된다. 이 시스템에서, 소스(10)로부터의 비디오 신호는 이산 코사인 변환을 이용하는 움직임 보상된 예측 인코더를 포함할 수 있다. 압축 소자(11)는 포맷 형성기(12)에 결합된다. 이 포맷 형성기는 국제 표준화 기구 (Organisation Internationale De Normalisation)에 의해 개발된 표준 MPEG 과 같은 임의의 신호 프로토콜에 따라 압축 비디오 신호와 다른 보조 데이터를 정렬한다. 표준화 신호는 트랜스포트 프로세서(13)에 인가되고, 이 트랜스포트 프로세서(13)는 신호를 데이터 패킷으로 분할하며 전송을 위한 임의의 잡음 방지를 제공하기 위해 임의의 다른 데이터를 부가한다. 균일하지 않은 비율로 발생하는 것이 일반적인 트랜스포트 패킷은 비교적 협대역폭을 갖는 전송 채널의 효율적 이용에 도움이 되는 비교적 일정한 비율로 출력 데이터를 제공하는 레이트 버퍼(14)에 인가된다. 버퍼링된 데이터는 신호 전송을 수행하는 모뎀(15)에 결합된다.
시스템 클록(22)은 적어도 트랜스포트 프로세서를 포함하는 많은 장치를 동작시키는 클록 신호를 공급한다. 이 클록은 예컨대 27 MHz 와 같은 고정 주파수에서 동작할 것이다. 그러나, 본 명세서에 도시된 바와 같이, 이 클록은 타이밍 정보를 발생하기 위해 사용된다. 시스템 클록은 예컨대 모듈로 230을 카운트하도록 배열될 수도 있는 카운터(23)의 클록 입력에 결합된다. 카운터에 의해 출력된 카운트 값은 2개의 래치(24, 25)에 인가된다. 래치(24)는 각 프레임 구간이 발생할 때 카운트 값을 래치하도록 비디오 소스에 의해 조정된다. 이들 카운트 값은 표시 시간 스탬프(PTR)로 지시되어, 관련 오디오 및 비디오 정보의 립동기화(lip- synchronization)를 제공하도록 수신기에 의해 사용된다. 래치(25)는 일정 스케줄에 따라 카운트 값을 래치하도록 트랜스포트 프로세서(13)(또는 시스템 제어기 (21))에 의해 조정된다. 이들 카운트 값은 프로그램 클록 기준(PCR)으로 지시되어, 각 보조 트랜스포트 패킷에 보조 데이타로서 삽입된다.
시스템 제어기(21)는 가변 처리 소자를 조정하도록 프로그래밍된 가변 상태장치이다. 제어기(21), 압축 소자(11) 및 트랜스포트 프로세서(13)는 처리 소자들간에 적절한 상호 통신이 제공되는 한 공통 클록 장치를 통해 동기적으로 동작하거나 동작하지 않을 수 있다.
제1도의 소자(16-26)는 전송 시스템의 수신단을 구성하는데, 모뎀(16)은 모뎀(15)의 역기능을 수행한다. 모뎀(16)의 데이타는 시스템 프로토콜에 따라 압축된 비디오 신호를 레이트 버퍼(17)에 공급하는 역트랜스포트 프로세서(18)에 인가된다. 이후 레이트 버퍼(17)는 압축된 비디오 신호를 요구에 따라 압축 해제기(19)에 공급한다. 압축된 비디오 신호에 응답하는 압축 해제기는 장치(20)상에 디스플레이하거나 적절한 장치에 저장하기 위해 압축되지 않은 비디오 신호를 발생한다.
역트랜스포트 프로세서(18)는 또한 보조 트랜스포트 데이타 및 제어 신호의 PCR 을 시스템 클록 발생기(27)에 공급한다. 이러한 신호에 응답하는 클록 발생기는 적어도 트랜스포트 프로세서의 동작에 동기화되는 시스템 클록 신호를 발생한다. 이 시스템 클록 신호는 적절한 처리 소자의 타이밍을 제어하도록 수신기 시스템 제어기(26)에 인가된다.
전송 모뎀(15)에 포함될 수 있는 장치가 제2도에 예시된다. 이 모뎀은 다수의 소스로부터 데이타를 수신할 수 있는데, 이들 소스의 데이타는 모두 공통 전송 채널을 통해 전송될 것이다. 이는 다양한 소스의 다양한 신호들을 시분할 다중화함으로써 수행될 수 있다. 또한, 다중화는 층형으로 이루어질 수 있다. 예컨대, 비디오 프로그램(Pi)은 다른 스튜디오에서 발생하여 제1 멀티플렉서(55)에 결합된다. 이들 프로그램은 공지된 기법에 따라 시분할 다중화되어 소스 신호(S1)로써 공급된다.
신호(S1) 및 다른 소스의 다른 소스 신호(Si)는 신호(Si)가 공지 기법과 일정 스케줄에 따라 시분할 다중화되는 제2층 멀티플렉서(56)에 인가된다. 결국, 추가의 다중화 형태가 각각의 프로그램 자체 내에 존재할 수도 있다. 다중화는 프로그램 데이타에 삽입되는 상업용이나 라이브(live) 제품의 세그먼트들 사이에 삽입되는 저장된 데이타의 형태를 취할 수 있다. 후자의 경우, 상업용 또는 저장된 데이타는 각각의 PTR 및 PCR 에 의해 사전 인코딩되는 것으로 가정한다. 이 경우, 저장된 데이타의 PTR 및 PCR 은 라이브 데이타의 실시간 PTR 및 PCR 에 무관하다. PTR 에 대해서는, 비디오 압축 해제기가 새로운 신호로 재초기화 하도록 지시하는 파라미터를 비디오 신호가 포함할 것이므로 대체로는 문제점이 발생하지 않는다. 반대로, 저장된 실시간 PCR 사이의 상호관계가 부족하면, 수신기 시스템의 레이트 버퍼 및 역트랜스포트 프로세서 소자가 붕괴되어 동기화에 손실이 생긴다.
제2도에서, 트랜스포트 프로세서(53)는 개별 멀티플렉서(55, 56)에 대한 동작이 유사한 다중화 장치를 포함한다고 가정한다.
다중화된 시스템에는 또다른 문제점이 있다. 데이타가 다수의 소스로부터 동시에 도달하는 경우 각 다중화 위치에서 데이타를 손실하지 않기 위해, 멀티플렉서 내부에 어느 정도의 신호 버퍼링을 공급할 필요가 있다. 이들 버퍼는 T±δt 의 지연을 부과하는데, 여기서 δt 는 지터 성분을 표시한다. 한 프로그램은 100개(문제점을 강조하기 위해 과장된 수)의 멀티플렉서를 통과하고 각 다중화마다 1 sec±1 ㎲ec 의 지연이 가산되는 것으로 가정한다. 100 sec 의 지연은 압축된 비디오 및 PTR 이 동일 지연의 영향을 받았기 때문에 그다지 중요하지 않다. ±100 ㎲ec 의 지터가 조절되어야 하고, 그렇지 않으면 디코더 버퍼가 오버플로우 상태로 되거나 언더플로우 상태로 될 수 있다.
수신기 클록 재생기의 제1 실시예가 제3도에 예시된다. 이 실시예에서, 수신기 레이트 버퍼에서 발생할 수도 있는 가변 지연을 제거하기 위해 트랜스포트 프로세서는 신호 경로에서 레이트 버퍼(17) 앞에 배치될 수도 있다. 수신기 모뎀의 데이타는 역트랜스포트 프로세서(32) 및 보조 패킷 검출기(31)에 결합된다. 역트랜스포트 프로세서(32)는 각 트랜스포트 패킷 패이로드로부터 트랜스포트 헤더 데이타를 분리한다. 트랜스포트 헤더 데이타에 응답하여, 프로세서(32)는 압축 해제 장치(도시되지 않음)에 비디오 신호 패이로드(본 명세서에서는 서비스 데이타 1 로 지정됨)를 인가하고, 적절한 보조 데이타 처리 소자(도시되지 않음)에 보조 데이타(서비스 데이타 2 로 지정됨)를 인가한다. 보조 데이타에 있는 PCR 은 경로 선택되어 메모리 소자(34)에 저장된다. PCR 을 포함하는 보조 트랜스포트 패킷을 지정하는 코드워드를 인식하도록 배열된 매칭 필터일 수도 있는 보조 패킷 검출기(31)는 그러한 데이타를 포함하는 트랜스포트 패킷의 발생에 대해 제어 펄스를 생성한다. 제어 펄스는 국부 카운터(36)에 의해 동시에 나타나는 카운트 값을 래치(35)에 저장하기 위해 이용된다. 국부 카운터(36)는 전압 제어 발진기(37)에 의해 공급되는 펄스를 카운트하도록 배열된다. 카운터(36)는 인코더의 상대 카운터(카운터(23))와 동일한 수의 모듈로를 카운트하도록 배열된다.
전압 제어 발진기(37)는 클록 제어기(39)에 의해 공급되는 저역 통과 필터링된 에러 신호에 의해 제어된다. 에러 신호는 다음과 같이 발생한다. 우선, 시간 n 에 도달하는 PCR 을 PCRn 으로 지정하고, 래치(35)에 동시에 래치되는 카운트 값을 Ln 으로 지정한다. 클록 제어기는 PCR 및 L 의 연속값을 읽어 그 차이에 비례하는 에러 신호(E)를 형성한다:
E ⇒ ｜PCRn- PCRn-1｜ - ｜Ln- Ln-1｜
에러 신호(E)는 이 차이를 등화시키는 주파수로 전압 제어 발진기(37)를 조정하기 위해 이용된다. 클록 제어기(39)에 의해 생성된 에러 신호는 펄스폭 변조된 신호의 형태일 수도 있는데, 아날로그 소자에 저역 통과 필터(38)를 구현함으로써 아날로그 에러 신호로 될 수도 있다.
이 시스템에는, 시스템의 두 단에 있는 카운터들이 동일 주파수 또는 심지어 그 배수를 카운트 한다는 구속이 따른다. 이에 따라, 전압 제어 발진기의 공칭 주파수가 인코더의 시스템 클록의 주파수와 매우 근접해야 할 것이 제안된다.
상기한 방법은 다소 빠른 동기화를 제공하지만 장기간 에러를 발생할 수도 있다. 장기간 에러(LTE:Long Term Error)는 다음 차이에 비례한다
LTE ⇒ ｜Ln- L0｜ - ｜PCRn- PCR0｜
여기서, PCRo및 Lo는 최초 발생한 PCR 및 수신기 카운터의 해당 래치 값이다. 명목상, 에러 신호(E, LTE)는 이산적 단계로 변한다. 이러한 모든 점에 따라, 시스템이 일단 동기화되면 에러 신호는 0 점 주변에서 한 유닛으로 디서할 것이다. 바람직한 동기화 방법은 한 유닛의 떨림이 에러 신호(E)에서 발생할 때까지 에러 신호(E)를 사용하여 전압 제어 발진기의 제어를 초기화한 후, 전압 제어 발진기를 제어하도록 장기간 에러 신호(LTE)의 사용으로 스위칭하는 것이다.
다중화 처리에서 발생하는 지연(T ± δt)을 조절하기 위해, 인코더의 트랜스포트 프로세서는 가변 지연에 관련된 정보를 포함하는 보조 트랜스포트 패킷내에 보조 필드를 생성한다. 각 다중화 위치에서 이 가변 지연 정보를 변경하기 위한 규정이 만들어진다. 이하 제6도 및 제7도를 참조하라. Advanced Television Research Consortium (ATRC)에서 발표한 HDTV 시스템에 사용되는 유형의 트랜스포트 패킷이 제6도에서 예시적으로 도시되어 있다. 이 트랜스포트 패킷은 다른 무엇보다도 패킷 내에 포함된 패이로드가 관련되는 서비스를 지시하는 일반 식별자를 갖는 프리픽스를 포함한다. 필드 CC는 에러 체크용으로 구비되는 연속성 체크값이다. HD 필드는 특히 패이로드를 정의하는 서비스 특정 헤더이다. 예컨대, 텔레비전 프로그래밍을 위해 특정 헤더가 지정되면, 그러나 서비스 유형의 트랜스포트 패킷에 대한 각 패이로드는 오디오 데이타, 비디오 데이타, 또는 관련 보조 데이타를 포함할 수도 있다. 따라서 HD 필드는 특정 패킷에 대한 특정 패이로드 유형을 지시한다.
보조 데이타를 포함하는 트랜스포트 패킷이 제7도에 예시된다. 보조 트랜스포트 패킷의 패이로드는 각 그룹에 포함되는 데이타량과 현재 시스템 요구에 따라 하나 이상의 보조 그룹을 포함할 수도 있다. 제7도에 예시된 트랜스포트 패킷에는프로그램 클록 기준에 관련된 데이타를 포함하는 두 보조 그룹(AUX1, AUX2)이 있다. 보조 그룹(AUX1)은 가변 지연에 관련되는 데이타를 포함하고 그룹(AUX2) 은 se' 당 PCR 을 포함한다. 각 그룹은 보조 그룹 프리픽스 및 보조 데이타 블록을 포함한다. 프리픽스는 필드(MF, CFF, AFID, AFS)를 포함한다. MF 필드는 패킷 내 데이타가 변경 가능한 지를 지시하는 1 비트의 필드이다(변경 가능하면 1 이고 아니면 0 임). CFF 는 이 그룹에 대해 보조 데이타가 정의되었는 지를 지시하는 1 비트의 필드이다. AFID 는 그룹에 포함된 보조 데이타의 유형, 예를들면 시간 코드, 스크램블 키, 카피라이트 등을 식별하는 6 비트의 필드이다. AFS 는 그룹에 포함되는 보조 데이타의 바이트 수를 한정하는 8 비트의 필드이다.
AUX1 그룹은 변경 가능한 것으로 도시되고 AUX2 그룹은 변경 가능 하지 않게 도시된다. AUX2 데이타는 PCR 데이타, 즉, 프로그램 클록 기준으로 도시된다.
AUX1 데이타는 본 명세서에서 미분 프로그램 클록 기준에 대한 두문자어인 DPCR 로 지시된다. PCR 데이타는 인코더의 트랜스포트 프로세서를 제어하는 스케줄러의 제어에 따라 획득된다. DPCR 은 제4도를 참조로 설명되는 바와 같이 획득된다.
제4도의 장치는 제2도에 도시된 멀티플렉서 회로 중 하나에 대한 예시적 장치이다. FIFO형의 버퍼 저장부(67)는 각 입력 버스에 관련된다. 데이타는 프로그램 데이타가 도달하면 저장되고 멀티플렉서는 상이한 입력 버스에 동시에 액세스된다. 이후 멀티플렉서의 스케줄에 따라 프로그램 데이타는 버퍼 저장부(67)로부터 판독된다.
프로그램 데이타의 각 트랜스포트 패킷은 PCR 및 DPCR 데이타가 있는 보조 그룹을 포함한다. PCR 데이타 값은 보조 타이밍 정보가 있는 트랜스포트 패킷의 타이밍에 대해 정해지는 점을 상기하자. 멀티플렉서에 의해 출력되는 경우 PCR 데이타는 다중화 처리 시 신호의 내용으로 인해 유도되는 임의의 지연에 의해 에러 상태에 있을 수도 있다. 버퍼 저장부를 전환할 때 걸리는 지연 시간(T ±δt)은 상기 에러를 연속 보정하도록 DPCR 데이타를 변경하기 위해 사용된다. DPCR 데이타가 있는 트랜스포트 패킷의 발생을 검출하도록 배열된 보조 패킷 검출기(61)는 프로그램 데이타 입력 버스에 결합된다. 이 검출기는 국부 클록 발생기(60)의 펄스를 카운트하는 카운터(62)를 리셋 및 인에이블시키는 작용을 한다. 국부 클록 발생기(60)는 주파수가 인코더 시스템의 클록 주파수에 매우 근접하거나 제3도 또는 제5도 장치의 동작과 같이 인코더 클록에 주파수 로크될 수도 있는 수정 발진기로 존재할 수 있다. 추가의 보조 패킷 검출기(63)는 버퍼 저장부(67)의 출력 버스에 결합되어, DPCR 데이타를 갖는 보조 패킷이 버퍼에서 나타나면 카운터(62)의 현재 카운트값 출력을 래치(68)에 저장하도록 배열된다. 여기서, 카운터의 출력은 클록 주파수의 사이클 단위로, 특정 패킷의 버퍼를 통한 전환 시간의 카운트 값을 나타낼 것이다. 하나 이상의 보조 패킷이 버퍼(67)를 동시 전환시키도록 다수의 보조 패킷이 매우 가깝게 발생하면 보조 패킷은 최초로 발생하는 패킷을 검출하여 응답하도록 배열되어야 하는 점을 상기하자.
보조 패킷 검출기(61)는 또한, 보조 패킷에 포함되는 DPCR 값을 저장하도록 래치(64)를 조정하기 위해 인가되는 제어 신호를 공급한다. 이 값은 가산기(65)의제1 입력 포트에 인가된다. 래치(68)에 저장된 국부 카운트 값은 가산기(65)의 제2 입력 포트에 인가된다.
가산기(65)는 갱신된 DPCR 값(DPCR')을 공급하기 위해 국부 카운트 값과 현재 보조 패킷의 DPCR 데이타를 가산한다. 버퍼(67)의 프로그램 데이타와 가산기(65)의 출력은 2 대 1 멀티플렉서(66)의 각 입력 포트에 결합된다. 멀티플렉서(66)는 프로그램 데이타를 정상적으로 통과시키기 위해 보조 패킷 검출기(63)에 의해 조정된다. 그러나, 프로그램 데이타에 포함된 DPCR 데이타가 버퍼에서 나타나면, 멀티플렉서(66)는 가산기로부터 갱신된 DPCR' 데이타를 통과시킨 후 버퍼(67)로부터 데이타를 통과시키기 위해 스위칭백 되도록 조정된다.
멀티플렉서(66)가 가산기로부터 데이타를 통과시키도록 조정되면, 가산기의 출력 신호는 DPCR 데이타가 버퍼에서 나타나는 경우 카운터(62)의 카운트 값과 보조 패킷에 있는 DPCR 데이타의 합에 해당한다. 따라서, 멀티플렉서(66)에 의해 DPCR 데이타로 대체된 데이타는 버퍼(67)의 전환 시간을 보정한 이전 DPCR 데이타이다. 바람직하게는, 보조 패킷 검출기가 보조 그룹의 적절한 변경자 플래그(MF)에 따라 프로그램 데이타를 단지 변경시키기만 하도록 프로그래밍되는 점을 상기하자.
제2도로 돌아가서, 트랜스포트 프로세서(53)는 DPCR 보조 그룹을 설정하고, 새로운 프로그램에 해당하는 DPCR 데이타에 대한 0 값을 정상적으로 삽입한다. 그러나, 디지탈 저장 매체(51)로부터 저장된 데이타는 라이브 데이타의 세그먼트들 사이에 삽입될 수도 있고 이 삽입된 데이타는 PCR 및 DPCR 코드로 사전 인코딩될수도 있는 점을 상기하자. 트랜스포트 프로세서(53)가 저장된 데이타를 라이브 데이타의 세그먼트들 사이에 삽입한다면, 이 트랜스포트 프로세서(53)는 저장된 데이타의 PCR 코드를 액세스하여 카운터(23) 및/또는 래치(25)에 의해 동시에 나타나는 카운트 값에서 상기 PCR 값을 감산한다. 이후 트랜스포트 프로세서는 저장된 데이타의 보조 패킷내 DPCR 값과 상기 차이를 가산한다. 라이브 데이타 사이에 삽입되어 저장된 데이타의 새로운 DPCR 값은 이제 현재 시간에 대한 기준을 포함한다. 이 처리는 설명할 필요가 없는 제8도의 흐름도에 예시된다.
수신기의 DPCR 데이타에 대한 사용은 제5도에 예시된다. 제5도에서, 제3도의 소자와 동일 부호로 지정된 소자들은 소자(32)의 기능이 변경된 점을 제외하면 유사하며 또한 유사 기능을 수행한다. 상기 변경은 관련 보조 그룹에 도달하는 해당 PCR 및 DPCR 값을 가산하도록 배열된 감산기(45)를 포함하는 것에 관계된다. 가산기에 의해 공급되는 합은 다중화로 인한 임의의 전환 지연에 의해 증가되는 원래의 PCR 값에 해당한다. 이 합은 시스템 클록 동기화를 위한 보정된 PCR' 값과 같이 클록 제어기(39)에서 이용 가능한 메모리(46)에 배치된다.
카운트 값 및 차동 카운트 값을 갖는 트랜스포트 패킷을 포함하는 상기 트랜스포트 패킷의 소스와, 제어 신호에 응답하고 수신기 시스템 클록을 제공하는 제어 발진기와, 상기 수신기 시스템 클록 모듈로 K 의 펄스를 카운트하도록 배열되는 수신기 카운터와, 상기 카운트 값을 포함하는 트랜스포트 패킷의 발생에 응답하고 상기 수신기 카운터에 의해 출력되는 카운트 값을 저장하기 위한 수단과, 상기 트랜스포트 패킷으로부터 카운트 값 및 차동 카운트 값을 복원하고, 상기 수신기 카운터에 의해 출력되어 연속적으로 저장된 카운트 값과 상기 트랜스포트 패킷으로부터 해당되는 상기 카운트 값 및 차동 카운트 값에 응답하여 상기 제어 발진기를 제어하는 상기 제어 신호를 생성하기 위한 수단을 구비함으로써, 다층 압축 비디오 신호의 트랜스포트 또는 다중화층과 같은 중간층의 신호의 동기화를 설정할 수 있다.

Claims (7)

  1. 압축 비디오 신호의 트랜스포트 패킷 중 식별 가능한 패킷이 인코딩 시스템 클록의 모듈로 K(K 는 양의 정수) 펄스를 카운트하도록 배열된 카운터로부터 주기적으로 획득되는 카운트 값을 포함하는 프로그램 클록 기준을 갖는 상기 트랜스포트 패킷에서 발생하는 압축된 신호를 처리하고, 상기 트랜스포트 패킷에 의해 유도되는 증가 지연 및 상기 압축된 비디오 신호로 다중화되는 사전 압축된 신호 데이타의 프로그램 클록 기준 중 하나에 관련되는 차동 카운트 값을 포함하는 압축 비디오 신호 수신 시스템의 적어도 일부분을 동기화하는 장치에 있어서,
    상기 카운트 값 및 차동 카운트 값을 갖는 트랜스포트 패킷을 포함하는 상기 트랜스포트 패킷의 소스와;
    제어 신호(E)에 응답하고 수신기 시스템 클록을 제공하는 제어 발진기(37)와;
    상기 수신기 시스템 클록 모듈로 K 의 펄스를 카운트하도록 배열되는 수신기 카운터(36)와;
    상기 카운트 값을 포함하는 트랜스포트 패킷의 발생에 응답하고 상기 수신기 카운터에 의해 출력되는 카운트 값을 저장하기 위한 수단(31, 35)과;
    상기 트랜스포트 패킷으로부터 카운트 값 및 차동 카운트 값을 복원하고, 상기 수신기 카운터에 의해 출력되어 연속적으로 저장된 카운트 값과 상기 트랜스포트 패킷으로부터 해당되는 상기 카운트 값 및 차동 카운트 값에 응답하여 상기 제어 발진기를 제어하는 상기 제어 신호(E)를 생성(38, 39)하기 위한 수단(32)을 구비하는 것을 특징으로 하는 동기화 장치.
  2. 제1항에 있어서, 상기 제어 신호(E)를 생성하기 위한 수단은,
    상기 카운트 값 및 차동 카운트 값을 결합하여 보정된 카운트 값을 형성하는 수단과;
    상기 제어 신호(E)를 계산하기 위한 수단을 포함하며, 제어 신호(E)는 E = f(｜CPCRn- CPCRn-1｜ - ｜RCVn- RCVn-1｜) 에 비례하는데, 여기서 CPCRn및 CPCRn-1은 연속 보정된 카운트 값들이고 RCVn및 RCVn-1은 상기 수신기 클록부에 의해 출력되어 저장된 해당 카운트 값인 것을 특징으로 하는 동기화 장치.
  3. 제2항에 있어서, 상기 카운트 값 및 차동 카운트 값을 결합하기 위한 수단은 가산기를 구비하는 것을 특징으로 하는 동기화 장치.
  4. 제1항에 있어서, 상기 식별 가능한 트랜스포트 패킷은 각각의 트랜스포트 패킷이 상기 카운트 값을 포함하는지의 여부를 식별하는 헤더 데이타를 포함하고, 상기 카운트 값을 갖는 트랜스포트 패킷의 발생에 응답하는 상기 수단은 상기 헤더 데이타를 검출하기 위한 매칭된 필터를 구비하는 것을 특징으로 하는 동기화 장치.
  5. 제1항에 있어서, 상기 트랜스포트 패킷으로부터 카운트 값 및 차동 카운트 값을 복원하기 위한 수단은,
    각 트랜스포트 패킷의 헤더 데이타에 응답하여 타이밍 신호를 발생하기 위한 제어기와;
    상기 타이밍 신호와 상기 트랜스포트 패킷에 응답하여, 일정 위치에서 발생하는 상기 트랜스포트 패킷의 데이타를 선택적으로 통과시키기 위한 디멀티플렉서와;
    상기 디멀티플렉서에 의해 선택적으로 통과된 데이타를 저장하기 위한 메모리 수단을 구비하는 것을 특징으로 하는 동기화 장치.
  6. 제1항에 있어서, 상기 제어 신호(E)를 저역 통과 필터링하기 위한 장치를 추가로 구비하는 것을 특징으로 하는 동기화 장치.
  7. 제1항에 있어서, 상기 식별 가능한 트랜스포트 패킷은 각각의 트랜스포트 패킷이 상기 카운트 값을 포함하는지의 여부를 식별하는 헤더 데이타를 포함하고, 상기 카운트 값을 갖는 트랜스포트 패킷의 발생에 응답하는 수단은 상기 헤더 데이타를 검출하기 위한 매칭된 필터를 포함하고;
    상기 트랜스포트 패킷으로부터 카운트 값 및 차동 카운트 값을 회복하기 위한 상기 수단은 각 트랜스포트 패킷의 헤더 데이타에 응답하여 타이밍 신호를 발생하기 위한 제어기와;
    상기 타이밍 신호와 상기 트랜스포트 패킷에 응답하여 상기 트랜스포트 패킷의 일정 위치에서 발생하는 상기 트랜스포트 패킷의 데이타를 선택적으로 통과시키기 위한 디멀티플렉서와;
    상기 디멀티플렉서에 의해 선택적으로 통과된 데이타를 저장하기 위한 메모리 수단을 구비하는 것을 특징으로 하는 동기화 장치.
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