KR100199310B1 - Fm주파수 변조기의 주파수 조정 회로 - Google Patents

Fm주파수 변조기의 주파수 조정 회로 Download PDF

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Abstract

적은 수의 외부 단자 및 IC 핀을 갖는 FM 변조기의 주파수 조정 회로는 비선형 D/A 변환기, 전류 발생기 회로 및 에미터 결합형 멀티바이브레이터를 포함한다. 상기 디지탈 주파수 조정 신호에 따라 최적의 아날로그 저항치를 제공하기 위한 비선형 D/A 변환기는 Kn(K는 1 K 2이고, n은 연속한 자연수이다)에 의해 가중된 다수의 저항을 포함한다. 상기 전류 발생기는 상기 비선형 D/A 변환기의 출력 저항치에 따라 전류(ΔI)를 발생시킨다. 상기 멀티바이브레이터의 발진 주파수는 IO/4CRΔI(IO는 동작 전류원의 전류치를 표시하고, C는 캐패시터의 캐패시턴스를 표시하며, R은 저항의 저항치를 표시하고, ΔI는 저항을 통해 흐르는 전류를 표시한다)에 비례하여 결정된다. 상기 발진 주파수가 ΔI에 따라 조정될 때, 주파수 편이치는 거의 선형적으로 변화되어 쉽게 조정을 행할 수 있다.

Description

FM 주파수 변조기의 주파수 조정 회로
제1도는 종래의 FM 변조기의 주파수 조정 회로를 도시하는 회로도.
제2도는 제1도에 도시된 회로에 나타나는 신호의 파형을 도시하는 개략도.
제3도는 본 발명에 따른 FM 변조기의 주파수 조정 회로를 도시하는 회로도.
제4도는 제3도에 도시된 동기 신호 하단 주파수 조정 회로를 도시하는 회로도.
제5도는 제3도에 도시된 회로에서의 전류치와 디지탈 신호와의 관계를 도시하는 그래프.
제6도는 제3도에 도시된 회로에서의 주파수 편이와 디지탈 신호와의 관계를 도시하는 그래프.
제7도는 제3도에 도시된 회로에 사용된 비선형 D/A 변환기를 도시하는 회로도.
제8도는 제7도에 도시된 비선형 D/A 변환기를 사용할 때의 주파수 편이의 변화를 도시하는 그래프.
* 도면의 주요부분에 대한 부호의 설명
1, 5, 6 : 트랜지스터 2 : 입력 단자
3 : 전원 4, 7 : 가변 저항
8 : 비선형 D/A 변환기 9 내지 13 : 제1 내지 제5 저항
14 내지 18 : 제1 내지 제5 스위치 19 : 전류 발생 수단
24 : FM 변조기
본 발명은 FM(Frequency Modulation) 변조기의 주파수 조정 회로에 관한 것으로, 특히 작은 수의 외부 부품 및 IC 핀을 갖는 FM 변조기의 주파수 조정 회로에 관한 것이다.
종래, 멀티바이브레이터형의 발진 회로가 공지되어 있다. 이 종류의 발진 회로가 FM 변조기용으로 사용될 때, 입력 전압과 발진 주파수 사이에 충분한 선형성이 존재해야 한다. 예를 들면, VTR(Video Tape Recorder)에 있어서, 이 선형성이 나쁘면, 재생된 비디오 신호에 왜곡이 발생되어 재생된 화질의 열화를 발생할 수 있다.
제1도에는 일본국 특허 공보 소59-30337호에 기재된 바와 같이, 에미터 결합형 멀티바이브레이터를 사용하는 발진 회로와 함께 종래의 FM 변조기의 주파수 조정 회로가 도시되어 있다 이 발진 회로에 있어서, 발진 주파수(FO)는 다음과 같이 표현된다.
여기에서, IO는 트랜지스터(1)의 콜렉터 전류를 표시하고, C는 2개의 A점과 B점 사이에 접속된 캐패시터의 캐패시턴스를 표시하며, ΔV는 A점 또는 B점에서 얻어진 파형의 파고치를 나타낸다. 접속점(p 및 q)에서의 전위가 각각 Ea 및 Eb라고 가정하면, 점A 및 점B에서 얻어진 전압의 파고치(ΔV)는 다음과 같이 표현된다.
그러므로, 식(1)에서 캐패시턴스(C) 및 파고치(ΔV)는 일정해지고, 발진 주파수(FO)는 콜렉터 전류(IO)와 비례한다.
제1도에 있어서, 비디오 신호(휘도 신호)는 입력 단자(2)에 인가된다. C점 및 D점에서의 DC 전위가 동일하게 되도록 전원(3)의 값이 결정된다. 제1 가변 저항(4)는 무 입력 신호시에, 즉 제1도에서의 전류치(IO)에서 발진 주파수를 결정한다. 전류(IO)는 트랜지스터(5)를 경유하여 트랜지스터(6)으로 흐른다. 따라서, 전류(IO)는 트랜지스터(6)과 전류 미러 관계로 접속된 트랜지스터(1)에도 흐른다. 그 결과, 발진 회로는 일정 주파수(FO)에서 발진한다. 비디오 신호가 무 입력 신호 상태(예를 들면, 0V)로부터 인가될 때, 신호 전류는 제2 가변 저항(7)로 흘러, 트랜지스터의 에미터 전류를 변화시킨다. 따라서, 가변 전류분은 전류(IO)를 가산 또는 감산하여 발진 주파수를 변화시킨다. 이 때, D점에서의 전압은 변하지 않기 때문에, 발진 주파수는 비디오 신호에 따라 정확하게 변화될 수 있다.
그러나, 제1도의 주파수 조정 방법에 있어서, 가변 저항이 필요하기 때문에, 제조 공정에서의 조정 작업이 필요하고, IC의 외부 부품 및 핀이 필요하게 된다.
따라서, 본 발명의 목적은 IC에 접속된 소정의 외부 부품 및 여분의 핀을 필요로 하지 않고 FM 변조기의 주파수 조정을 용이하게 행하고, 제조 공정을 단순화할 수 있는 FM 변조기의 주파수 조정 회로를 제공하기 위한 것이다.
본 발명에 따른 주파수 변조기의 주파수 조정 회로는(a) 디지탈 주파수 조정 신호에 따라 아날로그 저항치를 갖는 Kn(n은 연속한 자연수이다)에 의해 가중되는 다수의 저항을 포함하는 비선형 D/A 변환기, (b) 비선형 D/A 변환기의 저항치에 따라 전류(ΔI)를 발생하기 위해 비선형 D/A 변환기에 접속되는 전류 발생기 수단, 및(c) IO/4CRΔI(IO는 동작 전류원의 전류치를 표시하고, C는 캐패시터의 캐패시턴스를 표시하며, R은 저항의 저항치를 표시하고, ΔI는 저항을 통해 흐르는 전류를 표시한다)에 비례하게 결정된 발진 주파수를 갖는 발진 신호를 발생시키기 위해 전류 발생기 수단에 접속되는 에미터 결합형 멀티바이브레이터를 포함하고, 에미터 결합형 멀티바이브레이터의 발진 주파수는 전류 발생기 수단의 출력 전류(ΔI)에 따라 조정된다.
주파수 조정 회로에 있어서, K는 1K2 범위에서 양호하게 설정된다.
주파수 조정 회로에 있어서, 비선형 D/A 변환기는 병렬로 접속된 Kn에 의해 가중된 저항 및 각각의 저항에 직렬로 접속된 다수의 스위치 수단을 포함할 수 있고, 저항의 한단은 전류 발생기 수단에 접속된다.
주파수 조정 회로에 있어서, 스위치 수단의 ON 또는 OFF 중 하나는 재핑(zapping)에 의해 결정될 수 있다.
더욱이, 스위치 수단은 전원, Kn에 의해 가중된 저항 및 접지에 각각 접속되는 베이스 단자, 콜렉터 단자 및 에미터 단자를 갖는 스위치 트랜지스터, 역 바이어스로 되도록 스위치 트랜지스터에 병렬로 접속되는 다이오드, 및 다이오드의 한 단에 접속되는 조정 패드를 포함하고, 상기 디지탈 주파수 조정 신호는 상기 스위치 트랜지스터가 턴 온 또는 턴 오프되도록 조정 패드에 인가된다.
주파수 조정 회로에 있어서, 디지탈 주파수 조정 신호는 주파수 편이의 조정신호이다.
본 발명에 따르면, Kn(n은 연속한 자연수이다)에 의해 가중된 다수의 저항을 포함하는 비선형 D/A 변환기를 사용함으로써, 에미터 결합형 멀티바이브레이터의 변조 감도는 FM 변조기의 주파수 조정을 행하도록 조정된다.
본 발명의 목적, 특징 및 장점은 이하 도면에 따른 상세한 설명으로부터 명백하게 되고, 종래 실시예에 관해 기재된 부분과 동일 부분은 동일 참조 번호를 사용하며, 이에 대한 설명은 생략한다.
제3도는 본 발명에 따른 FM 변조기의 주파수 조정 회로의 한 실시예를 도시한 것이다.
제3도에 도시한 바와 같이, 최적의 저항치를 제공하기 위한 비선형 D/A 변환기(8)은 디지탈 주파수 조정 신호에 응답하여 각각 개방되거나 폐쇄되는 직렬로 접속된 제1 내지 제5 저항(9 내지 13) 및 제1 내지 제5 스위치(14 내지 18)로 구성된다. 전류 발생기(19)는 최소치 전류를 발생하기 위한 제1 연산 증폭기(20), 비선형 D/A 변환기(8)의 출력 저항치에 따라 전류를 발생하기 위한 제2 연산 증폭기(21) 및 제2 연산 증폭기(21)의 출력 전류 및 제1 연산 증폭기(20)으로부터 출력되는 최소치 전류를 혼합하기 위한 제1 및 제2 전류 미러 회로(22 및 23)을 포함한다. FM변조기(24)에 있어서, 저항(25) 양단의 전압은 전류 발생기(19)의 출력 전류(ΔI)에 따라 변함으로써, 발진 감도(발진 주파수/조정 신호의 변화)가 변한다. 고정형 저항(26)은 FM 변조기(24)의 주파수 편이를 결정하고, 동기 신호 하단 주파수 조정 회로(27)은 FM 변조기(24)의 중심 주파수를 결정하기 위한 전류를 발생한다.
제3도에 있어서, FM 변조기(24)의 발진 주파수가 조정될 때, 먼저 주파수 편이의 조정(화상 신호의 경우, 1MHz 폭)이 행해진 다음, 중심 주파수의 조정(중심 주파수는 동기 신호의 선단치이고, 본 발명에서 3.4 MHz로 결정된다)은 원하는 특성을 얻도록 행해진다.
즉, 식(1) 및 식(2)로부터 FM 변조기(24)의 발진 주파수(FO)는 다음과 같이 얻어진다.
식(3)에 있어서, IO는 다음과 같이 표현된다.
여기에서, Icar는 무 입력 신호(예를 들면, 0V)(동기 하단 주파수)의 전류를 표시하고, IDEV는 신호 인가시의 편차 전류를 표시한다. 또한,
로 표현된다. 식(4) 및 식(5)를 식(3)에 대입함으로써, 발진 주파수(FO)는 다음과 같이 얻어진다.
이 실시예에 있어서, 캐패시턴스(C), 저항치(Rb) 및 전류치(IDEV)는 고정치로 결정되고, 전류(ΔI)에 의해 고정치의 변화분을 조정함으로써, 발진 주파수는 교정값으로 복원된다. 이렇게 하여, 주파수 편이의 조정이 행해진다. 그 후, 전류(Icar)은 중심 주파수를 결정하도록 조정된다. 그 결과, 원하는 주파수 특성을 얻을 수 있다.
다음에, 상술한 조정을 상세히 후술하겠다.
제3도에 있어서, 주파수 편이를 결정하기 위한 저항(26)는 고정치를 갖는다.
이제, 최대 레벨의 신호가 입력 단자(2)에 인가될 때, 편차 전류가 IDEV1이라고 가정하면, 주파수 편이(FDEV)는 다음과 같이 얻어진다.
그 다음, 전류(ΔI)의 값은 식(7)의 값이 정확하게 1 MHz가 되도록 결정된다.
전류(ΔI)는 제1 연산 증폭기(20)의 출력 전류 및 제2 연산 증폭기(21)의 출력 전류를 부가함으로써 계산되고, 최대 발진 주파수 폭(약 1.2 MHz)을 결정한다 즉, 제1 연산 증폭기(20)의 기준 전원의 전압으로부터 트랜지스터(29)의 전압 VBE(베이스와 에미터 간의 전압)을 감산하므로써 구해진 전압과 저항(30)에 의해 결정된 전류(ΔI)는 트랜지스터(29)의 콜렉터로 흐른다. 조정의 초기 상태에 있어서, 비선형 D/A 변환기(8)의 제1 내지 제5 스위치(14 내지 18)은 모두 폐쇄된다. 그러므로, 비선형 D/A 변환기(8)의 제1 내지 제5 저항(9 내지 13)에 의해 결정된 최대 전류(ΔI2)는 제2 연산 증폭기(21)의 트랜지스터(31)의 콜렉터로 흐른다.
이 경우에 있어서, 저항(32)에 흐르는 전류는 전류(ΔI1)과 비교하여 무시할 수 있는 값이다. 전류(ΔI2)는 제1 및 제2 전류 미러 회로(22 및 23)을 통해 흐르고, 전류(ΔI1)에 가산된다.
이 상태로부터, 제1 내지 제5 스위치(14 내지 18)은 개방되어 전류(ΔI2)을 감소시킴으로써 출력 전류(ΔI)가 감소되어 저항(25)에 흐르는 전류가 감소된다. 전압 강하를 감소시킴으로써, 식(7)의 분모가 감소되고, 따라서 주파수 편이가 크게 된다.
제1 내지 제5 스위치(14 내지 18)이 모두 폐쇄될 때, 식(7)의 값이 약 800 KHz가 되도록 비선형 D/A 변환기(8)의 저항치를 결정한다. 따라서, 비디오 신호(조정용 테스트 신호)의 최대 진폭을 입력 단자(2)에 인가함으로써, 상술한 800 KHz의 주파수 변화는 출력 단자(33)에서 발생된다. 그 다음, 상술한 800 KHz의 주파수는 마이크로컴퓨터 등과 같은 조정 회로를 사용하고, 그 에러치에 따라 변함으로써 소정의 값인 1 MHz와 비교되고, 제1 내지 제5 스위치(14 내지 18)은 개방된다. 그러므로, 전류(ΔI2)는 감소되고, 더욱이 전류(ΔI1)를 감소시켜 식(7)의 값을 증가시킨다 증가된 값 상태에 있어서, 상술한 주파수 편이 조정을 위한 비교가 다시 행해지고, 에러치가 있는 경우, 상술한 전류(ΔI)는 더 감소된다. 식(7)의 값이 1 MHz로 되기까지 이 동작은 반복된다.
따라서, 제3도에 도시된 FM 변조기(24)의 주파수 편이는 1 MHz로 정확하고 자동적으로 조정된다. 따라서, 주파수 편이 조정 후, 식(6)에서의 중심 주파수를 설정하기 위한 전류(Icar)은 원하는 특성을 얻도록 동기 신호 하단 주파수 조정 회로(27)에 의해 결정된다.
이 실시예에 있어서, 비선형 D/A 변환기(8) 및 동기 신호 하단 주파수 조정 회로(27)은 IC 내에 구성되고, 재핑에 의해 조정됨으로써, IC에 접속되는 외부 부품은 필요하지 않게 된다.
재핑에 관하여, 다이오드는 IC 내의 패드에 접속되고, 패드로부터 다이오드로 흐르는 과전류를 발생시킴으로써, 다이오드는 2개의 상이한 전압을 얻도록 파괴되거나, 파괴되지 않게 제조된다. 2개의 전압에 따라 트랜지스터 스위치는 턴 온 또는 턴 오프된다.
제4도는 제3도에 도시된 동기 신호 하단 주파수 조정 회로(27)의 한 실시예를 도시한 것이다. 제1 내지 제5 저항(34 내지 38)의 인자치는 2n(n은 연속한 자연수이다)으로 결정되고, 디지탈 조정 신호에 의해 제1 내지 제5 저항(34 내지 38)에 각각 직렬로 접속된 제1 내지 제5 스위치(39 내지 43)은 폐쇄되어 선형 전류치를 얻는다. 이 동작은 제5도에 도시된다. 각 스위치는 조정 신호(0)에 의해 개방되고, 조정 신호(1)에 의해 폐쇄되며, 디지탈 조정 신호의 5 비트[(0, 0, 0, 0, 0) 내지(1, 1, 1, 1, 1)]는 제1 내지 제5 스위치(39 내지 43)에 인가되고, 전류 흐름은 거의 선형적으로 증가한다(실제로, 미시적으로는 층계 형태). 제4도에 도시된 회로에 흐르는 전류는 식(6)의 분자에 존재하는 전류(Icar)에 대응하기 때문에, 전류는 점차적으로 증가되어 주파수 조정을 행할 수 있다.
반면에, 제4도에 도시된 비선형 D/A 변환기(8)의 저항치가 제3도에 도시된 비선형 D/A 변환기(8)의 저항치와 동일한 값, 즉 k=2로 결정되고, 비선형 D/A 변환기(8)이 동작될 때, 식(7)의 값(IDEV)은 제5도에 도시한 바와 같은 선형 형태로 변하지 않고, 제6도에 도시된 비선형 형태로 변한다. 이것은 출력 전류(ΔI2)에 따라 변하는 전류 발생기(19)의 출력 전류가 식(7)의 분모에 존재하기 때문이다. 그러므로, 단위당 조정량은 일정하지 않게 되어 정확한 조정을 행할 수 없다.
따라서, 본 발명은 제5도에 도시한 바와 같이, 식(7)의 값이 선형적으로 변하도록 전류(ΔI)가 변하는 비선형 D/A 변환기(8)을 제공한다. 즉, 비선형 D/A 변환기(8)을 구성하는 제1 내지 제5 저항(9 내지 13)의 저항치의 비는 K으로 결정되어 선형 출력치를 얻는다.
제7도는 비선형 D/A 변환기(8)의 한 실시예를 도시한 것이다. 제7도에 도시한 바와 같이, 기준치에 대한 저항치는 10㏀로 결정되고, K는 1.2이다 주파수 편이용 조정 신호는 접지 레벨 또는 개방 형태로 제1 내지 제5 패드(44 내지 48)에 인가된다. 이 경우에 있어서, 제3도에 도시된 제1 내지 제5 스위치(14 내지 18)에 대응하는 제1 내지 제5 트랜지스터(49 내지 53)은 디지탈 조정 신호에 따라 턴 온 또는 턴 오프되어, 각각의 제1 내지 제5 저항(9 내지 13)를 선택한다. 예를 들면, 제1 내지 제5 패드(44 내지 48)이 접지 레벨일 때, 제1 내지 제5 트랜지스터(49 내지 53)은 모두 턴 오프되고, 제1 내지 제5 패드(44 내지 48)이 개방될 때, 제1 내지 제5 트랜지스터(49 내지 53)은 모두 턴 온된다.
제8도는 제7도에 도시된 회로를 사용함으로써 얻어진 주파수 편이의 변화를 도시한 것이다. 제8도에 있어서, 횡축은(1, 1, 1, 1, 0)에서(0, 0, 0, 0, 1)로 변하는 제1 내지 제5 패드(44 내지 48)에 인가된 디지탈 신호(0은 접지 레벨이고, 1은 개방이다)를 표시한다. 이 때, 디지탈 신호(0, 1, 1, 0, 0)에 의해 주파수 편이는 1 MHz로 된다. 제8도로부터 알 수 있는 바와 같이, 제7도에 도시된 회로를 사용함으로써, 거의 선형 주파수 편이를 얻을 수 있다. 이 방법에 있어서, 거의 선형 출력을 얻기 위하여 디지탈 신호를 제1 내지 제5 패드(44 내지 48)에 인가하는 방법이 제8도에 도시되어 있다. 모드(1 내지 30)의 디지탈 신호가 횡축을 따라 좌측에서 우측으로 인가된다. 이들 디지탈 값으로부터 명백해진 바와 같이, 디지탈 신호를 인가하는 순서는 반드시 규칙적이지 않다. 제8도에 도시된 곡선의 선형성을 향상시키기 위하여, K 값이 1에 더 근접하게 되어야 한다. 그러나, 이렇게 될 경우, 제8도에 도시된 디지탈 신호의 인가 순서는 불규칙적으로 되고, 이 불규칙성을 조정하기 위하여 마이크로컴퓨터와 같은 조정 회로의 부하가 증가된다. 또한, 예를 들면 K 값이 약 1.1로 설정될지라도, 저항 사이의 차는 거의 발생하지 않고, 생산시에 발생된 에러의 영향으로 인해 원하는 저항치를 설정할 수 없다. 그러므로, K값에 관해서는, 실제로 본 실시예에서는 1K2로 설정되는 것이 바람직하고, 특히 K=1.2로 설정된다.
다음에, 재핑은 제7도에 따라 후술하겠다. 상술한 바와 같이, 예를 들면 접지 레벨 또는 개방 신호를 제1 내지 제5 패드(44 내지 48)에 인가함으로써, 제8도에 도시한 바와 같이(1, 0, 0, 1, 1)의 디지탈 신호에 대응하는 상태로 설정될 것이다.
이 경우에 있어서, 과전류의 펄스 형태는 제2 및 제3 패드(45 및 46)에 인가되어 제2 및 제3 다이오드(50 및 51)을 파괴한다. 다이오드가 파괴될 때, 양 단자는 단락되고, 제2 및 제3 트랜지스터는 턴 오프된다. 결과적으로, 제2 및 제3 트랜지스터(10 및 11)에서는 전류가 흐르지 않는다. 그 후, 제2 및 제3 패드(44 및 46)은 개방된다.
또한, 제1, 제4 및 제5 패드(44, 47 및 48)은 여전히 개방된다. 따라서, IC 전원의 전압(+Vcc)가 트랜지스터에 공급되는 동안, 제1, 제4 및 제5 트랜지스터(49, 51 및 52)는 조정치를 보유하도록 턴 온으로 유지된다. 제2 및 제3 패드(45 및 46)에 대한 전압 인가는 IC를 몰딩하기 전의 제조 단계에서의 검사 공정시 실행하고, 테스터를 사용함으로써 조정을 행한다. 그러므로, IC 완성 후, 조정이 필요하지 않게 된다.
이 실시예에 있어서, 디지탈 신호의 최소치(0, 0, 0, 0, 0) 및 최대치(1, 1, 1, 1, 1)은 이들 주파수 편이의 변화량이 크기 때문에 사용되지 않는다.
상술한 바와 같이 본 발명에 따르면, FM 변조기의 주파수 조정은 외부 부품이나 및 IC에 접속되는 여분 또는 특정 핀을 필요로 하지 않고 실행할 수 있고, 제조 공정도 단순하게 된다. 특히, 본 발명에 따르면, 주파수 편이의 값은 디지탈 신호에 따라 거의 선형적으로 변경될 수 있어 용이하게 조정이 실행될 수 있다.
본 발명은 양호한 실시예에 대해 상세히 설명되었지만, 본 분야에 숙련된 기술자들이라면 본 발명의 범위를 벗어나지 않고서 양호한 실시예를 여러가지로 변형 및 변경시킬 수 있다. 그러므로, 본 발명은 첨부된 특허 청구의 범위 내에서만 제한한다.

Claims (6)

  1. (a) 디지탈 주파수 조정 신호에 따라 아날로그 저항치를 제공하기 위해 Kn(K는 양의 실수이고, n은 연속한 자연수이다)에 의해 가중되는 다수의 저항을 포함하는 비선형 D/A 변환기 수단, (b) 상기 비선형 D/A 변환기 수단의 저항치에 따라 변하는 전류(ΔI)를 발생시키기 위해 상기 비선형 D/A 변환기 수단에 접속되는 전류 발생기 수단, 및 (c) IO/4CRΔI(IO는 동작 전류원의 전류값을 표시하고, C는 캐패시터의 캐패시턴스를 표시하며, R은 저항의 저항치를 표시하고, ΔI는 저항을 통해 흐르는 전류를 표시한다)에 비례하여 결정된 발진 주파수를 갖는 발진 신호를 발생시키도록 상기 전류 발생기 수단에 접속되는 에미터 결합형 발진 수단을 포함하는 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
  2. 제1항에 있어서, 상기 K는 1 K 2를 만족하는 실수인 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
  3. 제1항에 있어서, 상기 비선형 D/A 변환기 수단은 병렬로 접속된 Kn에 의해 가중되는 저항, 및 상기 각각의 저항에 직렬로 접속되는 다수의 스위치 수단을 포함하고, 상기 각 저항의 한 단이 상기 전류 발생기 수단에 접속되는 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
  4. 제3항에 있어서, 상기 스위치 수단의 ON 또는 OFF중 하나가 재핑(zapping)에 의해 결정되는 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
  5. 제3항에 있어서, 상기 스위치 수단은 전원, Kn에 의해 가중된 저항 및 접지에 각각 접속되는 베이스 단자, 콜렉터 단자 및 에미터 단자를 갖는 스위치 트랜지스터, 역 바이어스로 되도록 상기 스위치 트랜지스터에 병렬로 접속되는 다이오드, 및 상기 다이오드의 한 단에 접속되는 조정 패드를 포함하고, 상기 디지탈 주파수 조정 신호는 상기 스위치 트랜지스터가 턴 온 또는 턴 오프되도록 상기 조정 패드에 인가되는 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
  6. 제5항에 있어서, 상기 디지탈 주파수 조정 신호가 주파수 편이의 조정 신호인 것을 특징으로 하는 FM 변조기의 주파수 조정 회로.
KR1019940001533A 1993-01-28 1994-01-28 Fm주파수 변조기의 주파수 조정 회로 KR100199310B1 (ko)

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