JPS643277B2 - - Google Patents

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JPS643277B2
JPS643277B2 JP57109304A JP10930482A JPS643277B2 JP S643277 B2 JPS643277 B2 JP S643277B2 JP 57109304 A JP57109304 A JP 57109304A JP 10930482 A JP10930482 A JP 10930482A JP S643277 B2 JPS643277 B2 JP S643277B2
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JP
Japan
Prior art keywords
image
memory
control circuit
area
enlargement
Prior art date
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Expired
Application number
JP57109304A
Other languages
English (en)
Other versions
JPS59276A (ja
Inventor
Shintaro Azami
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP57109304A priority Critical patent/JPS59276A/ja
Publication of JPS59276A publication Critical patent/JPS59276A/ja
Publication of JPS643277B2 publication Critical patent/JPS643277B2/ja
Granted legal-status Critical Current

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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/222Studio circuitry; Studio devices; Studio equipment
    • H04N5/262Studio circuits, e.g. for mixing, switching-over, change of character of image, other special effects ; Cameras specially adapted for the electronic generation of special effects
    • H04N5/2628Alteration of picture size, shape, position or orientation, e.g. zooming, rotation, rolling, perspective, translation

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Controls And Circuits For Display Device (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)
  • Image Processing (AREA)
  • Studio Circuits (AREA)

Description

【発明の詳細な説明】 本発明は画像データベース上の2つの画像を組
合せ、新たな画像を作る画像編集回路に関する。
各種の文書或は図形をフアクシミリ装置等によ
つて電気信号に変換し、これを電子的に蓄積して
必要な時期に読み出し利用するという画像データ
ベースの開発が近年盛んになつてきている。この
ような画像データベースの利用が多くなるに従つ
て、画像データベースの有効利用、画像入力手段
の容易化等を狙いとした種々の工夫が為されてい
る。例えば、画像データベース上の画像を一つの
標準画像とし、これに各種の文章を重畳すること
によつて一つの画像を数多く利用しようとする試
みがある。しかし乍ら、2つの画像を組合せるこ
とは、夫々の画像の元の大きさが異なる等むずか
しい問題が多く実現していない。
例えば、上記標準画像の一部を切り取り、この
切取られた部分に他の画像から切取つた画をはめ
込むといつた、切り貼り的な操作によつて新たな
画像を創り出すこと等である。
しかし乍ら従来のこの種の方法では、単なる切
り貼りであつて、画像データベースの有効利用の
観点から機能的に不十分である。即ち、この切り
貼りの際にはめ込む画像の大きさを任意に指定で
きるようにするならば、縮少された画像から切り
出した画像を拡大してはめ込んだり、或は、元の
画像の大きさが若干異なる場合等大きさを調整し
つつはめ込むことが可能になつて、画像データベ
ースの有効利用が図かれる。また画像データベー
スへの画像入力時には画像の大きさに制約を受け
なくなることは明白である。
本発明の目的は上記のように2つの画像を組合
せ、新たな画像を構築する操作を容易にした画像
編集回路を提供することにある。
本発明は、画像データベース上の画像Aおよび
Bを記憶する2つの画像メモリと、夫々の画像メ
モリに対応して画像メモリ上の指定された任意の
領域からデータを読み出す画像メモリ制御回路お
よび該画像メモリから読み出されたデータを指定
する大きさに拡大・縮少する拡大・縮少回路とを
備え、さらに上記拡大・縮少回路で作られる一画
面分のデータを蓄積し、表示装置用データとして
常時出力するリフレツシユメモリと、リフレツシ
ユメモリの書き込みおよび読み出しを制御するリ
フレツシユメモリ制御回路と、画像AおよびBの
任意の領域、および拡大・縮少情報を人為的に投
入するための操作盤と、該操作盤の出力から前記
各回路に必要な制御信号を出力する制御回路とか
ら構成され、画像AおよびBの夫々単独の表示出
力機能および画像Aの任意の領域をリフレツシユ
メモリに記憶した後、画像Bの任意の領域を、画
像Aの指定された領域の大きさに合うよう拡大ま
たは縮少し、上記リフレツシユメモリ上の画像A
の指定された領域に書き込み、表示装置画面を見
ながら画像Bの拡大・縮少率および切出し位置を
最適化しうる制御機能を付加することによつて前
記目的を達成するものである。
本発明の詳細について図面を参照して説明す
る。
第1図は本発明による画像編集回路の一実施例
のブロツク図である。第2図a,bは上記実施例
の動作を説明するための図で、画像データベース
上の画像AおよびBの編集領域A′およびB′と、
表示装置への表示領域A″およびB″を示している。
ここでは編集領域A′に編集領域B′をはめ込む場
合について説明する。
第1図において、画像AまたはBの指示、およ
び夫々の表示装置への表示範囲A″およびB″、編
集領域A′およびB′の指示等に関す情報は凡て操
作盤11上の操作によつて人為的に与えられる。
上記操作による情報は制御回路21に入力され、
各回路の制御に必要な制御信号に変換される。即
ち、画像A(またはB)の読み出しを指示したと
き、端子20を介して画像データベースに対して
当該画像の読み出しを要求する。画像データベー
スから読み出された画像A(またはB)のデータ
が端子30を通して入力されると、画像メモリ3
1(または32)に書き込まれる。画像メモリ3
1(または32)の書き込み動作は制御回路21
の指示により、画像メモリ制御回路41(または
42)が行なう。
ここで先ず画像Aの表示領域A″を端子80に
接続された表示装置に表示する過程について説明
する。操作盤11の操作によつて画像Aの表示領
域A″を表示するよう指示した結果は制御回路2
1に入力される。制御回路21は画像メモリ制御
回路41に対し、表示領域情報を出力し、表示動
作を開始させる。画像メモリ制御回路41は該表
示領域情報に従つて画像メモリ31からデータを
読み出す。画像メモリ31から読み出されたデー
タは拡大・縮少回路51に入力される。拡大・縮
少回路51には制御回路21から拡大・縮少情報
が入力されており、この情報に従つて画像メモリ
31の出力データを拡大・縮少してリフレツシユ
メモリ61に出力する。
リフレツシユメモリ61は表示装置一画面分の
データを蓄積すると同時に常時データを加算回路
81、端子80を介して表示装置に出力してい
る。前記拡大・縮少回路51の出力データはリフ
レツシユメモリ制御回路71の指示によつてリフ
レツシユメモリ61に書込まれる。以上の動作に
よつて画像Aの表示領域A″が端子80に接続さ
れる表示装置に表示される。このとき操作盤11
の操作によつて表示領域は拡大・縮少率を適当に
かえ、編集領域A′を最も見易い位置に表示する
ことができる。
次に表示領域A″中の編集領域A′を概略定める。
即ち、操作盤11の操作によつて編集領域A′の
輪隔を発生し、リフレツシユメモリ61の出力に
同期して加算回路81で画面データに重畳する。
この段階で表示装置には表示領域A″と編集領域
A′が表示される。
一方画像Bに対しても同様の動作により編集領
域B′が決定される。
次に画像AおよびBを組合わせることを考え
る。先ず表示領域A″のデータを前記動作によつ
て指定された拡大率に従つて拡大・縮少し、リフ
レツシユメモリ61に書込む。
次に画像Bの編集領域B′について、丁度編集
領域A′に合うように拡大率を求め、この拡大率
に従つて拡大・縮少回路52で拡大・縮少する。
さらにリフレツシユメモリ制御回路71を制御
し、リフレツシユメモリ61上の編集領域A′に
相当する位置に上記編集領域B′のデータを書込
む。
上記の如くして、表示装置には編集領域A′に
編集領域B′がはめ込まれた形で表示領域A″が表
示される。
ここで表示装置を見ながら編集領域A′および
B′の位置、範囲を調整しつつ最適な組合せを決
定することができる。しかる後、これらの最適化
されたパラメータによつて画像メモリ31の内容
と画像メモリ32の内容とを組合せ、新たな画像
Cとして画像データベースに登録することができ
る。
以上実施例について説明したように、本発明に
よれば表示画面をみながら2つの画像を組合せ、
新たな画像を得ることが容易に行なえる。また、
拡大・縮少回路51,52および画像メモリ制御
回路41,42を制御することによつて、編集領
域A′、B′の拡大・縮少率を水平方向、垂直方向
夫々独立に制御することが可能であり、種々の形
状の編集領域の合成も可能になる。
本発明によれば、画像AおよびBをリフレツシ
ユメモリ上で一たん合成した画面を表示装置に表
示でき、また、両画像の編集領域の位置、大きさ
の画面を見ながら連続的に調整することができ
る。この調整によつて得られた情報をもとに二つ
の画像を組合せ、新たな画像とすることは通常の
手段で容易に行なえる。
【図面の簡単な説明】
第1図は本発明による画像編集回路の一実施例
のブロツク図で、第2図a,bは第1図の動作を
説明するための説明図である。 11……操作盤、20,30……画像データベ
ースに接続される端子、21……制御回路、3
1,32……画像メモリ、41,42……画像メ
モリ制御回路、51,52……拡大・縮少回路、
61……リフレツシユメモリ、71……リフレツ
シユメモリ制御回路、80……表示装置に接続さ
れる出力端子、81……加算回路。

Claims (1)

    【特許請求の範囲】
  1. 1 第一および第二の画像を記憶する2つの画像
    メモリと、この画像メモリのそれぞれに対応し
    て、前記画像メモリ上の指定された任意の領域か
    らデータを読み出す画像メモリ制御回路と、該画
    像メモリから読み出されたデータを指定する大き
    さに拡大・縮少する拡大・縮少回路と、前記拡
    大・縮少回路で作られる一画面分のデータを蓄積
    し、表示装置用データとして常時出力するリフレ
    ツシユメモリと、このリフレツシユメモリの書き
    込みおよび読み出しを制御するリフレツシユメモ
    リ制御回路と、前記第一または第二の画像の任意
    の領域、および拡大・縮少情報を投入するための
    操作盤と、該操作盤の出力から上記画像メモリ制
    御回路と拡大・縮少回路とリフレツシユメモリ制
    御回路に対して必要な制御信号を出力する制御回
    路とを有し、前記第一および第二の画像の夫々単
    独の表示出力機能および第一の画像の任意の領域
    をリフレツシユメモリに記憶した後、第二の画像
    の任意の領域を、前記第一の画像の指定された領
    域の大きさに合うよう拡大または縮少し、前記リ
    フレツシユメモリ上の前記第一の画像の指定され
    た領域に書き込む制御機能を制御回路に付加した
    ことを特徴とする画像編集回路。
JP57109304A 1982-06-25 1982-06-25 画像編集回路 Granted JPS59276A (ja)

Priority Applications (1)

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JP57109304A JPS59276A (ja) 1982-06-25 1982-06-25 画像編集回路

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JP57109304A JPS59276A (ja) 1982-06-25 1982-06-25 画像編集回路

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Publication Number Publication Date
JPS59276A JPS59276A (ja) 1984-01-05
JPS643277B2 true JPS643277B2 (ja) 1989-01-20

Family

ID=14506795

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JP57109304A Granted JPS59276A (ja) 1982-06-25 1982-06-25 画像編集回路

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Also Published As

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JPS59276A (ja) 1984-01-05

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