JPS6394642A - Lsiチツプボンデイング方法 - Google Patents
Lsiチツプボンデイング方法Info
- Publication number
- JPS6394642A JPS6394642A JP23999286A JP23999286A JPS6394642A JP S6394642 A JPS6394642 A JP S6394642A JP 23999286 A JP23999286 A JP 23999286A JP 23999286 A JP23999286 A JP 23999286A JP S6394642 A JPS6394642 A JP S6394642A
- Authority
- JP
- Japan
- Prior art keywords
- lsi
- film
- stitches
- lsi chip
- pad
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000000034 method Methods 0.000 title claims abstract description 9
- 239000000853 adhesive Substances 0.000 claims abstract description 7
- 230000001070 adhesive effect Effects 0.000 claims abstract description 7
- 230000002093 peripheral effect Effects 0.000 claims abstract description 4
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 230000001154 acute effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
- H01L2224/491—Disposition
- H01L2224/4912—Layout
- H01L2224/49171—Fan-out arrangements
Landscapes
- Wire Bonding (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はLSIチップボンディング方法、特に印刷フィ
ルムを利用したLSIチップボンディング方法に関する
。
ルムを利用したLSIチップボンディング方法に関する
。
従来、この種のLSIチップボンディング方法は良く知
られているように、第2図に示すようにボンディングワ
イヤ20の一端をフィルム1上のLSIチップ3のパッ
ドへ、他端をフィルム1の外周に位置するLSIパッケ
ージのステッチ4へそれぞれ接続することにより行って
いる。
られているように、第2図に示すようにボンディングワ
イヤ20の一端をフィルム1上のLSIチップ3のパッ
ドへ、他端をフィルム1の外周に位置するLSIパッケ
ージのステッチ4へそれぞれ接続することにより行って
いる。
上述した従来のボンディング方法は対向するパッドとス
テッチの位置がずれるのに従いボンディングワイヤの布
敷角度が鋭角となって、隣接するステッチと接触する危
険が生じるため、LSI設計時のパッド位置決定に制約
が大きくなり、最適レイアウト設計ができ雉いという欠
点がある。
テッチの位置がずれるのに従いボンディングワイヤの布
敷角度が鋭角となって、隣接するステッチと接触する危
険が生じるため、LSI設計時のパッド位置決定に制約
が大きくなり、最適レイアウト設計ができ雉いという欠
点がある。
本発明の目的は隣接のステッチとボンディングワイヤと
の接触を回避するLSIチップボンディング方法を提供
することにある。
の接触を回避するLSIチップボンディング方法を提供
することにある。
本発明はLSIチップよりも大きな面積を有するフィル
ムと、該フィルム上に印刷され、LSIチップのパッド
に対応する中央位置からLSIパッケージのステッチに
対応する外周位置に向けて放射状に延びる導電性パター
ンと、該フィルムの前記パターンを形成した面に付与し
た粘着手段とを有し、前記パターンのLSIパッド位置
に対応する部分をLSIチップのパッドに、その外周部
をLSIパッケージのステッチに前記パターンによりそ
れぞれ電気的に接続し、該フィルムに粘着手段によりL
SIパッケージのステッチを機械的に固定することを特
徴とするLSIチップボンディング方法である。
ムと、該フィルム上に印刷され、LSIチップのパッド
に対応する中央位置からLSIパッケージのステッチに
対応する外周位置に向けて放射状に延びる導電性パター
ンと、該フィルムの前記パターンを形成した面に付与し
た粘着手段とを有し、前記パターンのLSIパッド位置
に対応する部分をLSIチップのパッドに、その外周部
をLSIパッケージのステッチに前記パターンによりそ
れぞれ電気的に接続し、該フィルムに粘着手段によりL
SIパッケージのステッチを機械的に固定することを特
徴とするLSIチップボンディング方法である。
次に本発明の一実施例について図面を参照して説明する
。
。
第1図は本発明の一実施例である。第1図において、フ
ィルム1の裏面には、LSIチップ3のパッドに対応す
る中央位置からLSIパッケージのステッチ4に対応す
る外周位置に向けて印刷パターン2が放射状に印刷され
ている。LSIチップ3のパッド位置にはパッド用ラン
ド2Aが、LSIパッケージのステッチ4の位置にはス
テッチ用ランド2Bがそれぞれ印刷パターン2上に設け
である。印刷パターン2は隣接するステッチ4との接触
を避けるため、ステッチ用ランド2Bからステッチ4と
平行に引出される。一方、フィルム1の裏面にはLSI
パッケージのステッチ4を貼着する粘着手段5が各ステ
ッチ4に対応して塗布されている。
ィルム1の裏面には、LSIチップ3のパッドに対応す
る中央位置からLSIパッケージのステッチ4に対応す
る外周位置に向けて印刷パターン2が放射状に印刷され
ている。LSIチップ3のパッド位置にはパッド用ラン
ド2Aが、LSIパッケージのステッチ4の位置にはス
テッチ用ランド2Bがそれぞれ印刷パターン2上に設け
である。印刷パターン2は隣接するステッチ4との接触
を避けるため、ステッチ用ランド2Bからステッチ4と
平行に引出される。一方、フィルム1の裏面にはLSI
パッケージのステッチ4を貼着する粘着手段5が各ステ
ッチ4に対応して塗布されている。
実施例において、パッド用ランド2Aはフィルム1上か
ら超音波による圧力が加えられ、各パッド用ランド2人
はLSIチップ3のパッドと電気的に接続される。
ら超音波による圧力が加えられ、各パッド用ランド2人
はLSIチップ3のパッドと電気的に接続される。
一方スチッチ用ランド2Bはフィルム1の裏面に付与さ
れた粘着手段5によりステッチ4と密着し、電気的に接
続される。
れた粘着手段5によりステッチ4と密着し、電気的に接
続される。
以上説明したように本発明はフィルム上に印刷されたパ
ターン形状を適当に設計することにより、従来では制約
を受ける位置関係にあるLSIチップのパッドとLSI
パッケージのステッチとの組合せであっても、隣接する
ステッチとショートするととなく、LSIチップのパッ
ドとLSIパッケージのステッチとの間を接続できる効
果がある。
ターン形状を適当に設計することにより、従来では制約
を受ける位置関係にあるLSIチップのパッドとLSI
パッケージのステッチとの組合せであっても、隣接する
ステッチとショートするととなく、LSIチップのパッ
ドとLSIパッケージのステッチとの間を接続できる効
果がある。
第1図は本発明の一実施例を示す実装図、第2図は従来
のボンディングワイヤによる実′!iA図である。
のボンディングワイヤによる実′!iA図である。
Claims (1)
- (1)LSIチップよりも大きな面積を有するフィルム
と、該フィルム上に印刷され、LSIチップのパッドに
対応する中央位置からLSIパッケージのステッチに対
応する外周位置に向けて放射状に延びる導電性パターン
と、該フィルムの前記パターンを形成した面に付与した
粘着手段とを有し、前記パターンのLSIパッド位置に
対応する部分をLSIチップのパッドに、その外周部を
LSIパッケージのステッチに前記パターンによりそれ
ぞれ電気的に接続し、該フィルムに粘着手段によりLS
Iパッケージのステッチを機械的に固定することを特徴
とするLSIチップボンディング方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23999286A JPS6394642A (ja) | 1986-10-08 | 1986-10-08 | Lsiチツプボンデイング方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP23999286A JPS6394642A (ja) | 1986-10-08 | 1986-10-08 | Lsiチツプボンデイング方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6394642A true JPS6394642A (ja) | 1988-04-25 |
Family
ID=17052861
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP23999286A Pending JPS6394642A (ja) | 1986-10-08 | 1986-10-08 | Lsiチツプボンデイング方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6394642A (ja) |
-
1986
- 1986-10-08 JP JP23999286A patent/JPS6394642A/ja active Pending
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