JPS635607A - 音質制御装置 - Google Patents
音質制御装置Info
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- JPS635607A JPS635607A JP61148687A JP14868786A JPS635607A JP S635607 A JPS635607 A JP S635607A JP 61148687 A JP61148687 A JP 61148687A JP 14868786 A JP14868786 A JP 14868786A JP S635607 A JPS635607 A JP S635607A
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Landscapes
- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＤＳＰ （デジタル信号処理プロセッサ）を
用いた音質制御装置に関する。
用いた音質制御装置に関する。
音声は２０Ｈｚ〜２０ＫＨ２程度の周波数成分を有して
いるので、その周波数帯域内で強調度を任意に変更でき
る機能を利用すれば、音楽の種類や聴取者の好みに合っ
た音質で音楽を楽しむことができる。この種の音質制御
回路にはバス・トレブル、ラウドネス、イコライザ等が
ある。
いるので、その周波数帯域内で強調度を任意に変更でき
る機能を利用すれば、音楽の種類や聴取者の好みに合っ
た音質で音楽を楽しむことができる。この種の音質制御
回路にはバス・トレブル、ラウドネス、イコライザ等が
ある。
第１１図は従来のバス・トレブル回路の説明図で、（ａ
）は回路図、（ｂ）は特性図である。この回路は２つの
可変抵抗ＶＲ１，ＶＲ２を有し、ＶＲ＋を可変すること
で高域の強調度を調整でき、またＶＲ２を可変すること
で低域の強調度を調整できる。
）は回路図、（ｂ）は特性図である。この回路は２つの
可変抵抗ＶＲ１，ＶＲ２を有し、ＶＲ＋を可変すること
で高域の強調度を調整でき、またＶＲ２を可変すること
で低域の強調度を調整できる。
ラウドネス回路は、音圧レベルが低くなると人間の耳の
可聴周波数帯域が狭くなることを補正するもので、通常
ボリウム・コントロールと連動して動作する。第１２図
（ａ）の破線枠内が従来のラウドネス回路で、ＶＲはボ
リウム・コントロール用の可変抵抗である。ラウドネス
回路には切換スイッチＳＷがあり、これを図示のよ゛う
にＯＦＦにしておくと可変抵抗ＶＲの中点が抵抗Ｒで接
地されるので、フラットな特性のままである。これに対
しスイッチＳＷを○Ｎにすると、低域では小容量のコン
デンサＣ１が開放となり、且つ可変抵抗■Ｒの中点が大
容量のコンデンサＣ２と抵抗Ｒで接地される等価回路と
なるため、（ｂｌのようなブースト特性となる。また、
高域ではＣ２が短絡となり、且つＣ１が機能する等価回
路となるため、（Ｃ１のようなブースト特性となる。
可聴周波数帯域が狭くなることを補正するもので、通常
ボリウム・コントロールと連動して動作する。第１２図
（ａ）の破線枠内が従来のラウドネス回路で、ＶＲはボ
リウム・コントロール用の可変抵抗である。ラウドネス
回路には切換スイッチＳＷがあり、これを図示のよ゛う
にＯＦＦにしておくと可変抵抗ＶＲの中点が抵抗Ｒで接
地されるので、フラットな特性のままである。これに対
しスイッチＳＷを○Ｎにすると、低域では小容量のコン
デンサＣ１が開放となり、且つ可変抵抗■Ｒの中点が大
容量のコンデンサＣ２と抵抗Ｒで接地される等価回路と
なるため、（ｂｌのようなブースト特性となる。また、
高域ではＣ２が短絡となり、且つＣ１が機能する等価回
路となるため、（Ｃ１のようなブースト特性となる。
上述した各種の音質制御回路は複合的に使用されること
が多く、この場合従来のアナログ回路方式では各回路を
シリーズに接続して個々に調整するため、音が飽和して
しまうこともある。本発明はＤＳＰ内に各音質制御回路
を構成し、それらの機能を制御用マイクロコンピュータ
から一括制御するようにして音の飽和を防ぎ、またボリ
ューム・ステップ等に応じて音質制御範囲を可変しよう
とするものである。
が多く、この場合従来のアナログ回路方式では各回路を
シリーズに接続して個々に調整するため、音が飽和して
しまうこともある。本発明はＤＳＰ内に各音質制御回路
を構成し、それらの機能を制御用マイクロコンピュータ
から一括制御するようにして音の飽和を防ぎ、またボリ
ューム・ステップ等に応じて音質制御範囲を可変しよう
とするものである。
第１図は本発明の基本構成図（シグナルフロー）で、Ｅ
Ｑはイコライザ部、ＴＢはバス・トレブル部、ＬＤはラ
ウドネス部、■Ｕはボリューム部である。これらはＤＳ
Ｐ内にソフトによって構成されたもので、ＢＰＦ、ＬＰ
Ｆ、ＨＰＦはそれぞれデジタルフィルタによるバンドパ
ス、ローパス、バイパスの各フィルタ、Ｋは掛算器（フ
ィルタ係数）である。
Ｑはイコライザ部、ＴＢはバス・トレブル部、ＬＤはラ
ウドネス部、■Ｕはボリューム部である。これらはＤＳ
Ｐ内にソフトによって構成されたもので、ＢＰＦ、ＬＰ
Ｆ、ＨＰＦはそれぞれデジタルフィルタによるバンドパ
ス、ローパス、バイパスの各フィルタ、Ｋは掛算器（フ
ィルタ係数）である。
イコライザ部ＥＱのバンドパスフィルタにはオーディオ
帯域を５分割するＢＰＦ ＋〜ＢＰＦ ５があり、これ
らと直列に接続された係数に８，１〜Ｋ ＥＣ５を可変
することで、第２図のように各帯域のＡＴＴ（アッテネ
ート）量Ｇ８，１〜Ｇ０，５を例えば±１２ｄＢの範囲
内で制御できる。
帯域を５分割するＢＰＦ ＋〜ＢＰＦ ５があり、これ
らと直列に接続された係数に８，１〜Ｋ ＥＣ５を可変
することで、第２図のように各帯域のＡＴＴ（アッテネ
ート）量Ｇ８，１〜Ｇ０，５を例えば±１２ｄＢの範囲
内で制御できる。
バス・トレブル部ＴＢはバス用のローパスフィルタＬＰ
Ｆ ＋とその係数Ｋ ＴＢｆからなる低域経路と、係数
Ｋ ＴＢ２だけからなる中域経路と、トレブル用のバイ
パスフィルタＨＰＦ ＋とその係数ＫＴＢ３からなる高
域経路とを並列にしたもので、係数ＫＴＩＨＫ ＴＢ３
を可変することで第３図のように低域Ｂ、高域Ｔのゲイ
ンＧＴＢＬ 、Ｃ’ＴＢＨを例えば±１２ｄＢの範囲内
で可変できる（中域は固定）。
Ｆ ＋とその係数Ｋ ＴＢｆからなる低域経路と、係数
Ｋ ＴＢ２だけからなる中域経路と、トレブル用のバイ
パスフィルタＨＰＦ ＋とその係数ＫＴＢ３からなる高
域経路とを並列にしたもので、係数ＫＴＩＨＫ ＴＢ３
を可変することで第３図のように低域Ｂ、高域Ｔのゲイ
ンＧＴＢＬ 、Ｃ’ＴＢＨを例えば±１２ｄＢの範囲内
で可変できる（中域は固定）。
ラウドネス部ＬＤは低域用のローパスフィルタＬＰＦ
２と係数Ｋ ＬＤｌ からなる経路と、中域用の係数Ｋ
ＬＤ２からなる経路と、高域用のバイパスフィルタＨ
ＰＦ ２からなる経路とを並列に接続したもので、後段
のボリューム部ＶＵの設定（中域に対する）に依存して
特性カーブが第４図のように設定される。Ｇ ＬＤＬは
中域に対する低域のゲイン、Ｇ ＬＤＨは中域に対する
高域のゲインである。
２と係数Ｋ ＬＤｌ からなる経路と、中域用の係数Ｋ
ＬＤ２からなる経路と、高域用のバイパスフィルタＨ
ＰＦ ２からなる経路とを並列に接続したもので、後段
のボリューム部ＶＵの設定（中域に対する）に依存して
特性カーブが第４図のように設定される。Ｇ ＬＤＬは
中域に対する低域のゲイン、Ｇ ＬＤＨは中域に対する
高域のゲインである。
ボリューム部ＶＵは係数ＫＶＵを変えることで第５図の
ようにＡＴＴ量を変えることができる。横軸のＶＵステ
ップは例えば回転式ボリュームの回転角に相当し、縦軸
のＣＶＵがゲ、イン（ＡＴＴ量）になる。
ようにＡＴＴ量を変えることができる。横軸のＶＵステ
ップは例えば回転式ボリュームの回転角に相当し、縦軸
のＣＶＵがゲ、イン（ＡＴＴ量）になる。
上述した各回路のゲインを総合すると、低域のゲインＧ
Ｌは ＯＬ ＝ ＭＡＸ（Ｇｇｑｌ、ＧＥｑ２） ＋ ＧＴＢ
Ｌ＋ ＧＬＤＬ＋ ＧＶＵ −■となり、また中域のゲ
インＧＭは Ｇ Ｍ＝ ＧＥＱ ５ ＋Ｇ ＴＢＭ ＋ｃｖｕ
……■となり、さらに高域のゲインＧＨは ＯＨ＝ ＭＡＸ （ＧＥＱ４１ＧＦ、Ｃ５） ＋ＧＴＢ
Ｈ＋ＧＶＵ……■となる。後述する制御用マイクロコン
ピュータは各帯域のトータルゲインＣＬ 、ＧＭ、ＧＨ
が一定値（例えば０ｄＢ）を越えないように管理する。
Ｌは ＯＬ ＝ ＭＡＸ（Ｇｇｑｌ、ＧＥｑ２） ＋ ＧＴＢ
Ｌ＋ ＧＬＤＬ＋ ＧＶＵ −■となり、また中域のゲ
インＧＭは Ｇ Ｍ＝ ＧＥＱ ５ ＋Ｇ ＴＢＭ ＋ｃｖｕ
……■となり、さらに高域のゲインＧＨは ＯＨ＝ ＭＡＸ （ＧＥＱ４１ＧＦ、Ｃ５） ＋ＧＴＢ
Ｈ＋ＧＶＵ……■となる。後述する制御用マイクロコン
ピュータは各帯域のトータルゲインＣＬ 、ＧＭ、ＧＨ
が一定値（例えば０ｄＢ）を越えないように管理する。
各機能の制御ステップとゲインの関係は例えば次の様に
なる。
なる。
表１ （制御ステップ）
上表のＥＱｌ、ＳＴ、 ＥＱ２．ＳＴ、・・・・・・は
イコライザＥＱＩ。
イコライザＥＱＩ。
ＥＱ２．・・・・・・のステップ数を示す。イコライザ
ＥＱ１〜ＥＱ５は第１図のフィルタＢＰＦ＋＝ＢＰＦ５
で区別されるものである。またＴＲＥ、ＳＴはトレブル
ＴＲＥのステップ数を示し、同様にバスＢＡＳのステッ
プ数ＲＡＳ、ＳＴもある。但し、それぞれの状態に応じ
て表２のブースト上唱ＸＸＸ、１ＪＩＴが設定され、各
ステップＸＸＸ、ＳＴは表３の補正ステップＸＸＸ。
ＥＱ１〜ＥＱ５は第１図のフィルタＢＰＦ＋＝ＢＰＦ５
で区別されるものである。またＴＲＥ、ＳＴはトレブル
ＴＲＥのステップ数を示し、同様にバスＢＡＳのステッ
プ数ＲＡＳ、ＳＴもある。但し、それぞれの状態に応じ
て表２のブースト上唱ＸＸＸ、１ＪＩＴが設定され、各
ステップＸＸＸ、ＳＴは表３の補正ステップＸＸＸ。
ＳＳに補正される。
表２（ブースト上よ）
表３ （補正ステップ）
例えば、バスのステップ数ＲＡＳ、ＳＴが３ （＋９ｄ
Ｂ）のときにイコライザＥＱ２のステップＥＱ２．ＳＴ
を２（＋５ｄ１３）にすると低域のトータルゲインが＋
１５ｄＢになる。このとき、ブースト上限ＬＭＴが＋１
２ｄＢに設定されていたら、補正ステップＥＱ２．ＳＳ
のステップ数を１ （＋３ｄＢ）に制限して＋１２ｄ
Ｂを越えないようにする。この制限をした代りに、高域
のゲインを下げて相対的に差をつけてもよい。かかる補
正を各帯域毎に、または全帯域において、更には双方共
に実施してオーバースペックとならないようにする。こ
のようにして、実際の係数は補正ステップＸＸＸ、ＳＳ
から算出される。
Ｂ）のときにイコライザＥＱ２のステップＥＱ２．ＳＴ
を２（＋５ｄ１３）にすると低域のトータルゲインが＋
１５ｄＢになる。このとき、ブースト上限ＬＭＴが＋１
２ｄＢに設定されていたら、補正ステップＥＱ２．ＳＳ
のステップ数を１ （＋３ｄＢ）に制限して＋１２ｄ
Ｂを越えないようにする。この制限をした代りに、高域
のゲインを下げて相対的に差をつけてもよい。かかる補
正を各帯域毎に、または全帯域において、更には双方共
に実施してオーバースペックとならないようにする。こ
のようにして、実際の係数は補正ステップＸＸＸ、ＳＳ
から算出される。
第６図と第７図はこれを示している。第７図は各バンド
毎のトータルゲインＣ，，、ＣＭ、Ｃ，、がＮＢ４上限
とするトータルブースト許容量Ｇａａ。
毎のトータルゲインＣ，，、ＣＭ、Ｃ，、がＮＢ４上限
とするトータルブースト許容量Ｇａａ。
ｃＢＭ、 ”ＢＴ以内になるように補正される様子を示
し Ｎ Ｂ ” ＣｒａＢ≧ＧＬ ・
・・・・・■Ｎ Ｂ ＝ ＧＢ、＞ ｃＭ
・・・・・・■Ｎ Ｂ ＝ Ｇ８Ｔ
≧Ｇ、 ・・・・・・
■また、第６図は全帯域のトータルゲインがＮＴを上限
とする総トータル許容ブースト量Ｃ’ＴＬ以内になるよ
うに補正される様子を示している。
し Ｎ Ｂ ” ＣｒａＢ≧ＧＬ ・
・・・・・■Ｎ Ｂ ＝ ＧＢ、＞ ｃＭ
・・・・・・■Ｎ Ｂ ＝ Ｇ８Ｔ
≧Ｇ、 ・・・・・・
■また、第６図は全帯域のトータルゲインがＮＴを上限
とする総トータル許容ブースト量Ｃ’ＴＬ以内になるよ
うに補正される様子を示している。
ＮＴ±ｃＴｔ、≧ＧＬ十ＧＭ十ＧＨ・・・・・・■〔実
施例〕 第８図は本発明の一実施例を示すオーディオシステムの
ブロック図である。このシステムはＦ Ｍチューナ１、
ＡＭチューナ２、カセットデツキアンプ３を音源とし、
チューナ１．２はいずれもスーパーへテロダイン方式の
ＰＬＬシンセサイザ型である。ＡＮＴはアンテナ、ＲＦ
は高周波段、ＭＩＸは周波数ミキサ段、ＬＯは局部発振
器、ＩＰは中間周波段、ＤＥＴは検波段で、局部発振器
ＬＯの発振周波数は制御用マイクロコンピュータ（ＣＰ
Ｕ）４からの分周比Ｎ値によって変更される。つまり、
局部発振器ＬＯの出力ＡＭＬＯ／ ＦＭＬＯは位相同期
部ＰＬＬ内の可変分周器で１／Ｎに分周された後に位相
比較器で基準周波数ｆｒと比較され、その誤差分がロー
パスフィルタＬＰＦを通過してチューニングバイアスＴ
Ｂとなる。ＬＯ，ＰＬＬ、ＬＰＦは閉ループを構成する
ので１、分周比Ｎ値を変更するとＬＯの周波数はＬＰＦ
の出力ＴＢをＯにするように変化する。
施例〕 第８図は本発明の一実施例を示すオーディオシステムの
ブロック図である。このシステムはＦ Ｍチューナ１、
ＡＭチューナ２、カセットデツキアンプ３を音源とし、
チューナ１．２はいずれもスーパーへテロダイン方式の
ＰＬＬシンセサイザ型である。ＡＮＴはアンテナ、ＲＦ
は高周波段、ＭＩＸは周波数ミキサ段、ＬＯは局部発振
器、ＩＰは中間周波段、ＤＥＴは検波段で、局部発振器
ＬＯの発振周波数は制御用マイクロコンピュータ（ＣＰ
Ｕ）４からの分周比Ｎ値によって変更される。つまり、
局部発振器ＬＯの出力ＡＭＬＯ／ ＦＭＬＯは位相同期
部ＰＬＬ内の可変分周器で１／Ｎに分周された後に位相
比較器で基準周波数ｆｒと比較され、その誤差分がロー
パスフィルタＬＰＦを通過してチューニングバイアスＴ
Ｂとなる。ＬＯ，ＰＬＬ、ＬＰＦは閉ループを構成する
ので１、分周比Ｎ値を変更するとＬＯの周波数はＬＰＦ
の出力ＴＢをＯにするように変化する。
カセットデ・ツキアンプ３は磁気ヘッドＨＤ、イコライ
ザアンプＥＱ ＡＭＰ、フラットアンプＦＬＡＴ
ＡＭＰ、ノイズリダクション・システムＤＯＬＢＹ
（商標）からなり、カセットデツキ（デツキドライバを
含む）５が対となる。ＣＰＵ４に対してはキーバッド・
マトリクス６から音源選択、音量調節、音質制御等の各
種指示を入力できる。
ザアンプＥＱ ＡＭＰ、フラットアンプＦＬＡＴ
ＡＭＰ、ノイズリダクション・システムＤＯＬＢＹ
（商標）からなり、カセットデツキ（デツキドライバを
含む）５が対となる。ＣＰＵ４に対してはキーバッド・
マトリクス６から音源選択、音量調節、音質制御等の各
種指示を入力できる。
７は各音源の動作状態を表示するデイスプレィ、８はＣ
ＰＵ４からの指示で音源切換えを行う切換機能と、選択
された音声信号をデジタル信号に量子化する機能を有す
る１６ビー／ ）のＡ／Ｄ変換器、９はチューナ１．２
の各シグナルレベル（電界強度を示す）をデジタル信号
に量子化してＣＰＵ４に入力する６ビツトのＡ／Ｄ変換
器、１０はＡ／Ｄ変換器８の出力を信号処理するデジタ
ル信号処理プロセッサ（ＤＳＰ） 、１１は量子化され
ているＤＳＰＩＯの出力をアナログ信号に復元する１６
ビツトのＤ／Ａ変換器、ＰＯＷ ＡＭＰはパワーアン
プ、ＳＰはスピーカである。
ＰＵ４からの指示で音源切換えを行う切換機能と、選択
された音声信号をデジタル信号に量子化する機能を有す
る１６ビー／ ）のＡ／Ｄ変換器、９はチューナ１．２
の各シグナルレベル（電界強度を示す）をデジタル信号
に量子化してＣＰＵ４に入力する６ビツトのＡ／Ｄ変換
器、１０はＡ／Ｄ変換器８の出力を信号処理するデジタ
ル信号処理プロセッサ（ＤＳＰ） 、１１は量子化され
ているＤＳＰＩＯの出力をアナログ信号に復元する１６
ビツトのＤ／Ａ変換器、ＰＯＷ ＡＭＰはパワーアン
プ、ＳＰはスピーカである。
第９図はＤＳＰＩＯのアーキテクチャを示す概略構成図
で、プログラムバス２０にはプログラムメモリ （ＲＯ
Ｍ）２１、プログラムカウンタ２２、Ｉ１０インターフ
ェイス２３、クロック発振器２４が接続され、インター
フェイス２３は更に制御用マイクロコンピュータ４やＡ
／Ｄ、Ｄ／Ａ変換器８．１１に接続される。−方、デー
タバス３１にはデータメモリ （ＲＡＭ）２５やアドレ
ス８ビツト２６、或いは乗算器２７、加算器２８、アキ
ュムレータ２９、演算器３０が接続される。
で、プログラムバス２０にはプログラムメモリ （ＲＯ
Ｍ）２１、プログラムカウンタ２２、Ｉ１０インターフ
ェイス２３、クロック発振器２４が接続され、インター
フェイス２３は更に制御用マイクロコンピュータ４やＡ
／Ｄ、Ｄ／Ａ変換器８．１１に接続される。−方、デー
タバス３１にはデータメモリ （ＲＡＭ）２５やアドレ
ス８ビツト２６、或いは乗算器２７、加算器２８、アキ
ュムレータ２９、演算器３０が接続される。
ＤＳＰｌｏで扱う数は１０進数テ０．９９８０４６８７
５〜−１．０、バイナリ数で表示すると０１１１１１１
１１１〜１０００００００００ （符号付２の補数）、
ヘキサ数ではＩＦＦ〜２００である。このＤＳＰＩＯと
ＣＰＵ４の間の通信はアドレス８ビツト、データ１０ビ
ツトのシリアルクロック同期式で、アドレスはＤＳＰプ
ログラム上に定義付けられたＤＳＰ内ＲＡＭアドレスで
ある。データ（係数値）はＤＳＰ内ＲＡＭアドレスで指
示されたアドレスに格納され、ＤＳＰプログラムに従っ
て各種フィルタの係数値として使用される。
５〜−１．０、バイナリ数で表示すると０１１１１１１
１１１〜１０００００００００ （符号付２の補数）、
ヘキサ数ではＩＦＦ〜２００である。このＤＳＰＩＯと
ＣＰＵ４の間の通信はアドレス８ビツト、データ１０ビ
ツトのシリアルクロック同期式で、アドレスはＤＳＰプ
ログラム上に定義付けられたＤＳＰ内ＲＡＭアドレスで
ある。データ（係数値）はＤＳＰ内ＲＡＭアドレスで指
示されたアドレスに格納され、ＤＳＰプログラムに従っ
て各種フィルタの係数値として使用される。
第１０図は制御用マイクロコンピュータ（ＣＰＵ）４の
処理フローである。このＣＰＵ４はキーバッド・マトリ
クス６からの音質制御のＳＷ大入力応じて各ステップを
更新する。これは表１に従うが、０〜０式によって上限
を越えるときは表２゜３によって範囲内（例えば＋１２
〜−１２ｄＢ）の補正をする。これは各バンド毎に、そ
して全体についても行う。但し、ボリューム値が低い捏
上方向に余裕があるので、範囲を変更することができる
。これが範囲更新である。そして、範囲に見合ったテー
ブルから係数を読出して（係数算出）ＤＳＰに送信する
。
処理フローである。このＣＰＵ４はキーバッド・マトリ
クス６からの音質制御のＳＷ大入力応じて各ステップを
更新する。これは表１に従うが、０〜０式によって上限
を越えるときは表２゜３によって範囲内（例えば＋１２
〜−１２ｄＢ）の補正をする。これは各バンド毎に、そ
して全体についても行う。但し、ボリューム値が低い捏
上方向に余裕があるので、範囲を変更することができる
。これが範囲更新である。そして、範囲に見合ったテー
ブルから係数を読出して（係数算出）ＤＳＰに送信する
。
以上述べたように本発明によれば、ハードウェアを全く
変更することなく係数の変更だけで所望の音質、音量特
性を得ることができる。また、これらを−括して制御で
きるため、音の飽和等のオーバースペックを回避するこ
とができる。このためユーザからの過剰な設定要求を排
除したり、メツセージを与えることができ、常に歪のな
い音を演出できる。
変更することなく係数の変更だけで所望の音質、音量特
性を得ることができる。また、これらを−括して制御で
きるため、音の飽和等のオーバースペックを回避するこ
とができる。このためユーザからの過剰な設定要求を排
除したり、メツセージを与えることができ、常に歪のな
い音を演出できる。
第１図は本発明の基本構成図、第２図〜第７図は各部の
特性図、第８図〜第１０図は本発明の一実施例を示す説
明図、第１１図および第１２図は従来の音質制御回路の
説明図である。 図中、４は制御用マイクロコンピュータ、６はキーバッ
ドマトリクス、１０はデジタル信号処理プロセッサ、Ｅ
Ｑはイコライザ部、ＴＢはバス・トレブル部、ＬＤはラ
ウドネス部、ＶＵはボリューム部、ＢＰＦはバンドパス
フィルタ、ＬＰＦはローパスフィルタ、ＨＰＦはバイパ
スフィルタ、Ｋは係数である。 出 願 人 富士通テン株式会社 代理人弁理士 青 柳 稔 →ｆ イコライ７名伜の１１性図 第２図 バス・トレブ）し＠ｐの１１ｄ回 第３図 フウドネス合ｐの竹＋１回 第４図 第５図 第６図
特性図、第８図〜第１０図は本発明の一実施例を示す説
明図、第１１図および第１２図は従来の音質制御回路の
説明図である。 図中、４は制御用マイクロコンピュータ、６はキーバッ
ドマトリクス、１０はデジタル信号処理プロセッサ、Ｅ
Ｑはイコライザ部、ＴＢはバス・トレブル部、ＬＤはラ
ウドネス部、ＶＵはボリューム部、ＢＰＦはバンドパス
フィルタ、ＬＰＦはローパスフィルタ、ＨＰＦはバイパ
スフィルタ、Ｋは係数である。 出 願 人 富士通テン株式会社 代理人弁理士 青 柳 稔 →ｆ イコライ７名伜の１１性図 第２図 バス・トレブ）し＠ｐの１１ｄ回 第３図 フウドネス合ｐの竹＋１回 第４図 第５図 第６図
Claims (1)
- オーディオ帯域を複数に分割して各帯域のゲインを個々
に調整できる音質制御回路をソフト的に複数種類構成し
てそれらをシリーズに接続したデジタル信号処理プロセ
ッサと、該プロセッサに対し各音質制御回路のゲインを
決定する係数を与える制御用マイクロコンピュータと、
該マイクロコンピュータに対し外部から音質制御の指示
を与えるキーマトリクスとを備え、該マイクロコンピュ
ータは各帯域のトータルブースト量または全帯域の総ト
ータルブースト量を一定値以下に抑える補正をして前記
の係数を算出することを特徴とする音質制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61148687A JPH0650810B2 (ja) | 1986-06-25 | 1986-06-25 | 音質制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61148687A JPH0650810B2 (ja) | 1986-06-25 | 1986-06-25 | 音質制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS635607A true JPS635607A (ja) | 1988-01-11 |
| JPH0650810B2 JPH0650810B2 (ja) | 1994-06-29 |
Family
ID=15458355
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61148687A Expired - Fee Related JPH0650810B2 (ja) | 1986-06-25 | 1986-06-25 | 音質制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0650810B2 (ja) |
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-
1986
- 1986-06-25 JP JP61148687A patent/JPH0650810B2/ja not_active Expired - Fee Related
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| JPH0650810B2 (ja) | 1994-06-29 |
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