JPS6336359Y2 - - Google Patents
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- Publication number
- JPS6336359Y2 JPS6336359Y2 JP14339383U JP14339383U JPS6336359Y2 JP S6336359 Y2 JPS6336359 Y2 JP S6336359Y2 JP 14339383 U JP14339383 U JP 14339383U JP 14339383 U JP14339383 U JP 14339383U JP S6336359 Y2 JPS6336359 Y2 JP S6336359Y2
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- Japan
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- 230000006837 decompression Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 4
- 238000000034 method Methods 0.000 description 4
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 2
- 229910002804 graphite Inorganic materials 0.000 description 2
- 239000010439 graphite Substances 0.000 description 2
- 239000003550 marker Substances 0.000 description 2
- 230000006835 compression Effects 0.000 description 1
- 238000007906 compression Methods 0.000 description 1
- 238000013500 data storage Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
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- 230000001360 synchronised effect Effects 0.000 description 1
Description
【考案の詳細な説明】
考案の技術分野
本考案は電子計算機の周辺装置やデータ通信端
末装置として使用されるキヤラクタデイスプレイ
装置、とくに陰極線管（以下CRTと略記する）
上に表示するけい線パターンの表示制御回路に関
する。
末装置として使用されるキヤラクタデイスプレイ
装置、とくに陰極線管（以下CRTと略記する）
上に表示するけい線パターンの表示制御回路に関
する。
従来技術と問題点
キヤラクタデイスプレイ装置は一般に伝送され
てきた文字や記号データ、あるいはけい盤より入
力された文字や記号のデータを記憶装置にいつた
ん蓄積し、これを読み出して文字の形に変換し、
CRTの管面上に繰り返し表示する。このとき、
表示された文字や記号に縦線あるいは横線のけい
線を付したい場合がある。
てきた文字や記号データ、あるいはけい盤より入
力された文字や記号のデータを記憶装置にいつた
ん蓄積し、これを読み出して文字の形に変換し、
CRTの管面上に繰り返し表示する。このとき、
表示された文字や記号に縦線あるいは横線のけい
線を付したい場合がある。
考案の目的
本考案の目的はキヤラクタデイスプレイ装置の
CRT管面上に、文字や図形の表示とあわせてけ
い線も表示せしめることを目的とする。
CRT管面上に、文字や図形の表示とあわせてけ
い線も表示せしめることを目的とする。
考案の構成
本考案のけい線パターンの表示制御回路は、陰
極線管面上に表示せしめる文字図形データを一時
格納するパターンメモリと、個々の文字図形デー
タを表示する単位表示領域のうち、けい線を示す
ための各ドツトを所定数ごとに集合せしめて複数
のグループに分割し、各グループのデータを圧縮
してけい線データとして蓄積するけい線メモリ
と、このけい線メモリより読み出したけい線デー
タを伸長するためにけい線データの各ビツトごと
に所定数のオアゲートを有する伸長手段とを具
え、けい線以外の文字図形データを該オアゲート
の他方の入力に加え、該所定数のオアゲートを同
時に開くことにより圧縮されたけい線データを伸
長するとともに、前記パターンメモリから読み出
された文字図形データが該オアゲートに入力され
文字図形データの読み出しに同期してけい線デー
タを復元して陰極線管面上に文字図形とけい線を
表示するように構成したことを特徴とするもので
ある。
極線管面上に表示せしめる文字図形データを一時
格納するパターンメモリと、個々の文字図形デー
タを表示する単位表示領域のうち、けい線を示す
ための各ドツトを所定数ごとに集合せしめて複数
のグループに分割し、各グループのデータを圧縮
してけい線データとして蓄積するけい線メモリ
と、このけい線メモリより読み出したけい線デー
タを伸長するためにけい線データの各ビツトごと
に所定数のオアゲートを有する伸長手段とを具
え、けい線以外の文字図形データを該オアゲート
の他方の入力に加え、該所定数のオアゲートを同
時に開くことにより圧縮されたけい線データを伸
長するとともに、前記パターンメモリから読み出
された文字図形データが該オアゲートに入力され
文字図形データの読み出しに同期してけい線デー
タを復元して陰極線管面上に文字図形とけい線を
表示するように構成したことを特徴とするもので
ある。
考案の実施例
本考案の制御方式においては、CRT管面上を
第１図に示すように、縦方向を32、横方向を32に
区切り、32×32＝1024の区画を形成し、それらの
区画内に文字を表示する。
第１図に示すように、縦方向を32、横方向を32に
区切り、32×32＝1024の区画を形成し、それらの
区画内に文字を表示する。
各区画は、第２図に示すように縦32、横32のド
ツトの集合（32×32＝1024）で構成され、それら
ドツトの組合せで文字記号を表わす。第２図では
ドツトの組合せで“Ａ”を表示している。
ツトの集合（32×32＝1024）で構成され、それら
ドツトの組合せで文字記号を表わす。第２図では
ドツトの組合せで“Ａ”を表示している。
また、区画内には、８ドツトおきに横８ドツト
からなる横けい線表示部分lH1〜lH4と縦８ドツト
からなる縦けい線表示部分lV1〜lV4を設ける。さ
て、上述の横けい線および縦けい線のけい線パタ
ーンデータは次の如くして圧縮される。
からなる横けい線表示部分lH1〜lH4と縦８ドツト
からなる縦けい線表示部分lV1〜lV4を設ける。さ
て、上述の横けい線および縦けい線のけい線パタ
ーンデータは次の如くして圧縮される。
次にけい線パターンデータの圧縮について述べ
る。
る。
まず、第２図に示す如く、32×32ドツトからな
る各文字領域を縦８ドツト、横32ドツトからなる
４つの部分Ａ〜Ｄに分割しこれを第１領域とす
る。さらに第１領域を構成する部分Ａ〜Ｄの各々
を縦８ドツト、横８ドツトからなる４つの部分
〜に分割し、これを第２領域とする。ここで、
けい線パターンデータは各第１領域ごとに作成さ
れる。そして各第２領域における部分内の横け
い線を構成する８ドツト（たとえばlH1）を１つ
のビツトX0で表わし、部分内の横けい線を構
成する８ビツト（たとえばlH2）を１つのビツト
X1で表わすというように第１領域内の横けい線
をX0〜X3の４ビツトで表現して、８ドツト分の
パターンデータを１ビツトに圧縮し、各第２領域
における各部分〜内に横けい線があればその
ビツトは“１”、なければ“０”と表現する。ま
た、第２領域における部分内の縦けい線を構成
する８ドツト（たとえばlV1）を１つのビツトY0
で表わし、部分内の縦けい線を構成する８ドツ
ト（たとえばlV2）を１つのビツトY1で表わすと
いうように第１領域内の縦けい線をY0〜Y3の４
ビツトで表現して、８ビツト分のパターンデータ
を１ビツトに圧縮し、各第２領域における各部分
〜内に縦けい線があればそのビツトは“１”、
なければ“０”と表現する。そしてこれら横・縦
のけい線データは第３図に示すようなビツト配列
にして、けい線パターンメモリの各アドレスに格
納する。なお、第３図において、Ｐはパリテイビ
ツトである。
る各文字領域を縦８ドツト、横32ドツトからなる
４つの部分Ａ〜Ｄに分割しこれを第１領域とす
る。さらに第１領域を構成する部分Ａ〜Ｄの各々
を縦８ドツト、横８ドツトからなる４つの部分
〜に分割し、これを第２領域とする。ここで、
けい線パターンデータは各第１領域ごとに作成さ
れる。そして各第２領域における部分内の横け
い線を構成する８ドツト（たとえばlH1）を１つ
のビツトX0で表わし、部分内の横けい線を構
成する８ビツト（たとえばlH2）を１つのビツト
X1で表わすというように第１領域内の横けい線
をX0〜X3の４ビツトで表現して、８ドツト分の
パターンデータを１ビツトに圧縮し、各第２領域
における各部分〜内に横けい線があればその
ビツトは“１”、なければ“０”と表現する。ま
た、第２領域における部分内の縦けい線を構成
する８ドツト（たとえばlV1）を１つのビツトY0
で表わし、部分内の縦けい線を構成する８ドツ
ト（たとえばlV2）を１つのビツトY1で表わすと
いうように第１領域内の縦けい線をY0〜Y3の４
ビツトで表現して、８ビツト分のパターンデータ
を１ビツトに圧縮し、各第２領域における各部分
〜内に縦けい線があればそのビツトは“１”、
なければ“０”と表現する。そしてこれら横・縦
のけい線データは第３図に示すようなビツト配列
にして、けい線パターンメモリの各アドレスに格
納する。なお、第３図において、Ｐはパリテイビ
ツトである。
CRT管面上に表示する１画面分のけい線デー
タのけい線メモリへの格納は次の如くして行なわ
れる。
タのけい線メモリへの格納は次の如くして行なわ
れる。
第４図に示す如くけい線メモリの第０番目のア
ドレスAD0には、第０区画における第１領域の
部分Ａの第１ドツトラインA0のけい線パターン
データX0〜X3とY0〜Y3（０，A0）が格納され、
第１番目のアドレスAD1には第１区画における
第１領域の部分Ａの第１ドツトラインA0のけい
線パターンデータX0〜X3とY0〜Y3（１，A1）が
格納され、…第31番目のアドレスAD31には、第
31区画における第１領域の部分Ａの第１ドツトラ
インA0のけい線パターンデータX0〜X3，Y0〜Y3
（31，A0）が格納されるというように横方向にシ
フトさせる。次に第32番目のアドレスAD32に
は、第０区画における第１領域の部分Ａの第２ド
ツトラインA1のけい線パターンデータX0〜X3と
Y0〜Y3（０，A1）が格納され、第33番目のアド
レスAD33には第１区画における第１領域の部分
Ａの第２ドツトラインA1のけい線パターンデー
タX0〜X3とY0〜Y3（１，A1）が格納され、…第
63番目のアドレスAD63には第31区画における第
１領域の部分Ａの第２ドツトラインA1のけい線
パターンデータX0〜X3とY0〜Y3（31，A1）が格
納されるというように横方向にシフトされる。
ドレスAD0には、第０区画における第１領域の
部分Ａの第１ドツトラインA0のけい線パターン
データX0〜X3とY0〜Y3（０，A0）が格納され、
第１番目のアドレスAD1には第１区画における
第１領域の部分Ａの第１ドツトラインA0のけい
線パターンデータX0〜X3とY0〜Y3（１，A1）が
格納され、…第31番目のアドレスAD31には、第
31区画における第１領域の部分Ａの第１ドツトラ
インA0のけい線パターンデータX0〜X3，Y0〜Y3
（31，A0）が格納されるというように横方向にシ
フトさせる。次に第32番目のアドレスAD32に
は、第０区画における第１領域の部分Ａの第２ド
ツトラインA1のけい線パターンデータX0〜X3と
Y0〜Y3（０，A1）が格納され、第33番目のアド
レスAD33には第１区画における第１領域の部分
Ａの第２ドツトラインA1のけい線パターンデー
タX0〜X3とY0〜Y3（１，A1）が格納され、…第
63番目のアドレスAD63には第31区画における第
１領域の部分Ａの第２ドツトラインA1のけい線
パターンデータX0〜X3とY0〜Y3（31，A1）が格
納されるというように横方向にシフトされる。
上述の如き横方向に並ぶ32の区画の第１領域に
おける部分Ａのけい線データの格納が終了したな
らば、第０区画乃至第31区画の第１領域における
部分Ｂのけい線データの格納を上記方法にならつ
て行ない、さらに部分Ｃ、部分Ｄについて行なう
というようにして第０区画乃至第31区画のけい線
データをけい線メモリに格納する。
おける部分Ａのけい線データの格納が終了したな
らば、第０区画乃至第31区画の第１領域における
部分Ｂのけい線データの格納を上記方法にならつ
て行ない、さらに部分Ｃ、部分Ｄについて行なう
というようにして第０区画乃至第31区画のけい線
データをけい線メモリに格納する。
次いで、上述の如き格納方法にならつて、第32
区画乃至第1023区画のけい線データをけい線メモ
リに格納して１画面分のデータ格納を終了する。
区画乃至第1023区画のけい線データをけい線メモ
リに格納して１画面分のデータ格納を終了する。
けい線メモリからけい線データの読み出しは、
リフレツシユメモリ（文字・図形パターンデータ
格納用メモリで、１画面分のパターンデータが格
納される。）の読み出しと同期してアドレスAD0
から順次アドレスAD1というようにけい線デー
タを読み出すわけであるが、この読み出しの順序
はアドレスAD0〜アドレス31を順次１回ずつ読
み出して各区画の第１領域における部分Ａの第１
ドツトラインをCRT上に表示した後、同第２ド
ツトラインに相当するデータすなわちアドレス
AD32〜アドレス63のデータを順次繰り返して７
回読み出して、第２乃至第８ドツトラインを
CRT上に表示する。
リフレツシユメモリ（文字・図形パターンデータ
格納用メモリで、１画面分のパターンデータが格
納される。）の読み出しと同期してアドレスAD0
から順次アドレスAD1というようにけい線デー
タを読み出すわけであるが、この読み出しの順序
はアドレスAD0〜アドレス31を順次１回ずつ読
み出して各区画の第１領域における部分Ａの第１
ドツトラインをCRT上に表示した後、同第２ド
ツトラインに相当するデータすなわちアドレス
AD32〜アドレス63のデータを順次繰り返して７
回読み出して、第２乃至第８ドツトラインを
CRT上に表示する。
第５図は、けい線メモリの任意のアドレスから
読み出したけい線パターンのデータを32ドツトに
展開するための回路図であり、同図中BFはメモ
リから読み出されるけい線パターンデータを一時
ストアするためのバツフアメモリ、Ｒ１〜Ｒ
３２はオアゲート、Ｇ１〜Ｇ４は８個のオア
ゲートからなるオアゲート群、PRD00〜PRD31は
リフレツシユメモリより読み出したビデオ信号で
ある。X0ビツトは各ドツトラインの部分にけ
い線があるか否かを表示するものであるから、オ
アゲートＲ１〜Ｒ８に入力され、８ドツト分
の画素に展開される。オアゲートＲ１〜Ｒ８
にはさらにビデオ信号PRD00〜PRD07が入力され
ており、またオアゲートＲ１の第３入力端子に
はバツフアメモリBFのY0ビツト内容が入力され
ている。X1ビツトは各ドツトラインの部分に
けい線があるか否かを表示するものであるから、
オアゲートＲ９〜Ｒ１６に入力され、８ドツ
ト分の画素を展開される。オアゲートＲ９〜
Ｒ１６にはさらにビデオ信号PRD08〜PRD15が入
力されており、またオアゲートＲ９の第３入力
端子にはバツフアメモリBFのY1ビツト内容が入
力されている。X2ビツトは各ドツトラインの部
分にけい線があるか否かを表示するものである
から、オアゲートＲ１７〜Ｒ２４に入力さ
れ、８ドツト分の画素に展開される。オアゲート
ＯＲ１７〜Ｒ２４にはさらにビデオ信号PRD16
〜PRD23が入力されており、またオアゲートＲ
１７の第３入力端子にはバツフアメモリBFのY2
ビツト内容が入力されている。なお、オアゲート
群Ｇ３はオアゲート群Ｇ１およびＧ２と同
じ構成であるため、第５図においてはその詳細を
省略してある。
読み出したけい線パターンのデータを32ドツトに
展開するための回路図であり、同図中BFはメモ
リから読み出されるけい線パターンデータを一時
ストアするためのバツフアメモリ、Ｒ１〜Ｒ
３２はオアゲート、Ｇ１〜Ｇ４は８個のオア
ゲートからなるオアゲート群、PRD00〜PRD31は
リフレツシユメモリより読み出したビデオ信号で
ある。X0ビツトは各ドツトラインの部分にけ
い線があるか否かを表示するものであるから、オ
アゲートＲ１〜Ｒ８に入力され、８ドツト分
の画素に展開される。オアゲートＲ１〜Ｒ８
にはさらにビデオ信号PRD00〜PRD07が入力され
ており、またオアゲートＲ１の第３入力端子に
はバツフアメモリBFのY0ビツト内容が入力され
ている。X1ビツトは各ドツトラインの部分に
けい線があるか否かを表示するものであるから、
オアゲートＲ９〜Ｒ１６に入力され、８ドツ
ト分の画素を展開される。オアゲートＲ９〜
Ｒ１６にはさらにビデオ信号PRD08〜PRD15が入
力されており、またオアゲートＲ９の第３入力
端子にはバツフアメモリBFのY1ビツト内容が入
力されている。X2ビツトは各ドツトラインの部
分にけい線があるか否かを表示するものである
から、オアゲートＲ１７〜Ｒ２４に入力さ
れ、８ドツト分の画素に展開される。オアゲート
ＯＲ１７〜Ｒ２４にはさらにビデオ信号PRD16
〜PRD23が入力されており、またオアゲートＲ
１７の第３入力端子にはバツフアメモリBFのY2
ビツト内容が入力されている。なお、オアゲート
群Ｇ３はオアゲート群Ｇ１およびＧ２と同
じ構成であるため、第５図においてはその詳細を
省略してある。
X3ビツトは各ドツトラインの部分にけい線
があるか否かを表示するものであるから、オアゲ
ートＲ２５〜Ｒ３２に入力され、８ドツト分
の画素に展開される。オアゲートＲ２５〜Ｒ
３２にはさらにビデオ信号PRD24〜PRD31が入力
されており、またオアゲートＲ２４の第３入力
端子にはバツフアメモリBFのY3ビツト内容が入
力される。
があるか否かを表示するものであるから、オアゲ
ートＲ２５〜Ｒ３２に入力され、８ドツト分
の画素に展開される。オアゲートＲ２５〜Ｒ
３２にはさらにビデオ信号PRD24〜PRD31が入力
されており、またオアゲートＲ２４の第３入力
端子にはバツフアメモリBFのY3ビツト内容が入
力される。
そして各オアゲートＲ１〜Ｒ３２から出力
される出力信号V00〜V31は、たとえばオア回路
でひとまとめにしてCRTのビデオ信号入力端す
なわちカソード電極に加え、これを輝度変調して
CRT管面上に文字パターンに加えてけい線パタ
ーンを表示する。
される出力信号V00〜V31は、たとえばオア回路
でひとまとめにしてCRTのビデオ信号入力端す
なわちカソード電極に加え、これを輝度変調して
CRT管面上に文字パターンに加えてけい線パタ
ーンを表示する。
なお、上記実施例のけい線はいずれも１ドツト
の連続で細いきらいがあるが、たとえば横けい線
の場合には、ドツトラインA0のけい線データを
２回繰り返して読み出して２ドツトの連続したけ
い線とすればよい。なお、この場合、ドツトライ
ンA2のデータは上記ドツトラインA0のけい線デ
ータを２回繰り返して読み出した後６回その読み
出しを繰り返せばよい。
の連続で細いきらいがあるが、たとえば横けい線
の場合には、ドツトラインA0のけい線データを
２回繰り返して読み出して２ドツトの連続したけ
い線とすればよい。なお、この場合、ドツトライ
ンA2のデータは上記ドツトラインA0のけい線デ
ータを２回繰り返して読み出した後６回その読み
出しを繰り返せばよい。
縦けい線を太くしたい場合には、第５図におい
て、Y0ビツトの出力をオアゲート群Ｇ１のオ
アゲートＲ１とＲ２に共に加え、Y1ビツト
の出力をオアゲート群Ｒ２のオアゲートＲ９
とＲ１０に共に加え……という具合に各オアゲ
ート群を構成するオアゲートのうちの２個にＹビ
ツトデータを入力すればよい。
て、Y0ビツトの出力をオアゲート群Ｇ１のオ
アゲートＲ１とＲ２に共に加え、Y1ビツト
の出力をオアゲート群Ｒ２のオアゲートＲ９
とＲ１０に共に加え……という具合に各オアゲ
ート群を構成するオアゲートのうちの２個にＹビ
ツトデータを入力すればよい。
考案の効果
以上詳細に説明したように、本考案はCRTデ
イスプレイ装置のCRT管面上に、文字図形とと
もにけい線も表示することができる。しかもけい
線データを圧縮してメモリに記憶せしめることが
できるので、けい線メモリの容量を大幅に縮少せ
しめることができるほか、圧縮されたけい線デー
タの伸長は簡単なオアゲートの組合せでできるの
で、けい線表示のCRTデイスプレイ装置の構成
を簡単にすることができる。
イスプレイ装置のCRT管面上に、文字図形とと
もにけい線も表示することができる。しかもけい
線データを圧縮してメモリに記憶せしめることが
できるので、けい線メモリの容量を大幅に縮少せ
しめることができるほか、圧縮されたけい線デー
タの伸長は簡単なオアゲートの組合せでできるの
で、けい線表示のCRTデイスプレイ装置の構成
を簡単にすることができる。
第１図はCRT管面上の文字の区画を説明する
ための正面図、第２図はドツトの集合で文字を表
わした状態を示す正面図、第３図はけい線データ
のビツト構成を示す構成図、第４図はけい線メモ
リへのけい線データの格納状態を示す説明図、第
５図は圧縮されたけい線データを伸長するための
ゲート回路の回路図である。 図中、BFはバツフアメモリ、Ｇ１〜Ｇ４
はオアゲート群、Ｒ１〜Ｒ３２はオアゲート
である。
ための正面図、第２図はドツトの集合で文字を表
わした状態を示す正面図、第３図はけい線データ
のビツト構成を示す構成図、第４図はけい線メモ
リへのけい線データの格納状態を示す説明図、第
５図は圧縮されたけい線データを伸長するための
ゲート回路の回路図である。 図中、BFはバツフアメモリ、Ｇ１〜Ｇ４
はオアゲート群、Ｒ１〜Ｒ３２はオアゲート
である。
Claims (1)
- 陰極線管面上に表示せしめる文字図形データを
一時格納するパターンメモリと、個々の文字図形
データを表示する単位表示領域のうち、けい線を
示すための各ドツトを所定数ごとに集合せしめて
複数のグループに分割し、各グループのデータを
圧縮してけい線データとして蓄積するけい線メモ
リと、このけい線メモリより読み出したけい線デ
ータを伸長するためにけい線データの各ビツトご
とに所定数のオアゲートを有する伸長手段とを具
え、けい線以外の文字図形データを該オアゲート
の他方の入力に加え、該所定数のオアゲートを同
時に開くことにより圧縮されたけい線データを伸
長するとともに、前記パターンメモリから読み出
された文字図形データが該オアゲートに入力され
文字図形データの読み出しに同期してけい線デー
タを復元して陰極線管面上に文字図形とけい線を
表示するように構成したことを特徴とするけい線
パターンの表示制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14339383U JPS5984590U (ja) | 1983-09-16 | 1983-09-16 | けい線パタ−ンの表示制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14339383U JPS5984590U (ja) | 1983-09-16 | 1983-09-16 | けい線パタ−ンの表示制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5984590U JPS5984590U (ja) | 1984-06-07 |
| JPS6336359Y2 true JPS6336359Y2 (ja) | 1988-09-27 |
Family
ID=30320083
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14339383U Granted JPS5984590U (ja) | 1983-09-16 | 1983-09-16 | けい線パタ−ンの表示制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5984590U (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2017137905A (ja) * | 2016-02-02 | 2017-08-10 | ポップリベット・ファスナー株式会社 | クリップ、クランプ組立体及び取付構造 |
-
1983
- 1983-09-16 JP JP14339383U patent/JPS5984590U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5984590U (ja) | 1984-06-07 |
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