JPS63299366A - 半導体装置 - Google Patents

半導体装置

Info

Publication number
JPS63299366A
JPS63299366A JP62135085A JP13508587A JPS63299366A JP S63299366 A JPS63299366 A JP S63299366A JP 62135085 A JP62135085 A JP 62135085A JP 13508587 A JP13508587 A JP 13508587A JP S63299366 A JPS63299366 A JP S63299366A
Authority
JP
Japan
Prior art keywords
semiconductor element
wiring
adhesive
tape
substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP62135085A
Other languages
English (en)
Other versions
JP2523641B2 (ja
Inventor
Takao Ochi
岳雄 越智
Hiroaki Fujimoto
博昭 藤本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP62135085A priority Critical patent/JP2523641B2/ja
Publication of JPS63299366A publication Critical patent/JPS63299366A/ja
Application granted granted Critical
Publication of JP2523641B2 publication Critical patent/JP2523641B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/0711Apparatus therefor
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/071Connecting or disconnecting
    • H10W72/0711Apparatus therefor
    • H10W72/07178Means for aligning

Landscapes

  • Wire Bonding (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は半導体装置、特に多端子、狭ピッチのIC,L
SIのパッケージング構造に関するものである。
従来の技術 近年、多端子、狭ピッチ化が急激に進んでいるIC,L
SIを、更に高密度にしかも薄型に実装する方法を開発
することが、よシ小型で高性能な電子機器を開発する必
要上、渇望されている。従来法としてはフリップチップ
方式や、フィルムキャリア方式といった方式が公知であ
る。以下フリップチップ方式については第2図、フィル
ムキャリア方式については第3図を用いてそれぞれ説明
する。まずフリップチップ方式であるが、この方式では
第2図の様に半導体素子12の電極パッド上に形成した
突起電極11と、配線基板17上の導体配線16を位置
合わせし、その状態のまま加熱せしめて、半田づけ固定
することにより、半導体素子イ2と配線基板17との電
気的接続を保持するといった方式である。またフィルム
キャリア方式では、第3図に示した様に、フリップチッ
プ方式と同じく半導体素子22の電極パッド上に突起電
極21を形成させるのだが、この方式では、突起電極2
1と配線基板27上の導体配線26とを、両者の間に可
とう性フィルム24とリード23よシ成るフィルムリー
ド25を介して接続する。
即ち、フィルムリード25のリード23の一端を半導体
素子22の突起電極21と接続し、更にリード23の他
端を配線基板27の導体配線26と接続することによシ
両者間の電気的接続を行うといった方式である。
発明が解決しようとする問題点 しかしながら上記方式にはそれぞれ以下に示す様な問題
点を有する。まずフィリップチップ方式であるが、この
方式では、電気的接続と配線基板上への半導体素子の固
定とを半田づけ固定した位置で行なうので、外部からの
熱や機械的歪によシ、配線基板が膨張したりそったりし
た場合には、半田づけ位置が強固に固定されている為、
その変化に充分に対応できなくなり、接続部や半導体素
子自体の破損をまねく。
またフィルムキャリア方式では、フィルムリードの使用
により配線基板のそシや膨張等の変化に充分対応できる
ものの、反面実装コストが高価になったシ、フィルムリ
ード部分が半導体素子からはみ出した状態で回路基板に
固定されるため、実装面積が大きくなるという欠点があ
る。
問題点を解決するための手段 本発明は、前記問題点を解決するために、半導体素子の
電極と配線基板の導体配線の接続において、電気的接続
を行なわせる部分と、半導体素子を配線基板に固定する
部分とを分離し、配線基板への固定は、絶縁性の樹脂に
よる粘着剤を有する可とう性テープを、半導体素子の電
極を有する側と反対の面及び半導体素子の周囲の配線基
板に渡って粘着することにより行い、電気的接続は電極
と導体配線の接触により行うものである。
作   用 本発明は半導体素子が前記した構造を有することによシ
、温度による配線基板の膨張による歪。
機械的歪等が比較的柔軟性を有する絶縁性テープに吸収
され、半導体素子自体に作用しないので、半導体素子が
損傷されない。
実施例 本発明の第1の実施例を第1図によシ説明する。
まず第1図aの示す様に、突起電極1を有する半導体素
子2の突起電極1を有する側と反対の面を絶縁性の樹脂
による粘着剤3を有する可とう性テープ4の粘着剤を有
する面に粘着させる。可とう性テープ4は、金属、ガラ
ス繊維、樹脂等の素材を用いる。粘着剤3は、ポリイミ
ド系、エポキシ系、シリコン系、アクリル系等の樹脂を
用いる。
次に第2図すの示す様に、半導体素子2の突起電子1と
配線基板Tの導体配線6が一致する様に位置合わせし、
半導体素子2を加圧ツール5を用いて加圧し、突起電極
1と導体配線6を電気的に接続させ、位置ずれが起きな
い様に固定する。配線基板7はセラミック、ガラス、エ
ポキシ等よシ成シ、導体配線は8 Cr−Au 、AI
 、 ITO等よシ成る。
加圧ツール6は第1図すに示した様な構造をとシ、半導
体素子2の大きさに合わせた内部加圧ツール8と外部加
圧ツール9とに分かれており、外部加圧ツール9は内部
加圧ツール8の外周に沿って移動することができる。半
導体素子2の配線基板7への固定及び加圧は、この内の
内部加圧ツール8のみを用いて行う。この状態のまま外
部加圧ツール9を内部加圧ツール8に沿って配線基板7
が存在する側に向けて移動させ、第1図すに示す様に、
絶縁性の樹脂による粘着剤3を有する可とう性テープ4
を半導体素子2を包み込む様に折り曲げ、更に可とう性
のテープ4の配線基板7よシはみ出した部分はカッター
によシ切断削除する。この際、導体配線θ上の粘着剤3
は加圧の際に周囲に押し出され可とう性のテープ4は粘
着剤により配線基板7に粘着されるので、半導体素子2
は配線基板7に完全に固定され、第1図dの様に加圧ツ
ール6による加圧を解除した後も、半導体素子2は配線
基板7から位置ずれを起こしたり、浮きあがることもな
く、突起電極1と導体配線6との電気的接続は保持され
ることになる。
粘着剤3が光硬化型あるいは熱硬化型である場合は、第
1図Cの過程において、加圧ツール6を用いて半導体素
子2及び可とり性のテープ4を配線基板7に加圧、固定
した状態のまま粘着剤3の硬化した後、加圧を除去する
。粘着剤3の硬化は粘着剤3が熱硬化型の場合は、加圧
ツール5に加熱部を取シ付けておき、加熱によシ行い、
また粘着剤3が光硬化型である場合には、加圧ツール6
に設けた光透過部よシ、紫外線を照射させて行う。
この場合、半導体素子2はよシ強固に配線基板7に固定
されることになる。
発明の効果 以上のように、本発明によれば次のような効果を得るこ
とができる。
0)半導体素子の金属突起と配線基板の導体配線との電
気的接続は圧接、半導体素子の配線基板への固定は絶縁
性の樹脂による粘着剤を有する可とう性のテープによシ
行うことによシ、温度による配線基板の膨張による歪9
機械的歪等が半導体素子自体に直接作用しないので、半
導体素子を損傷したシ、電気的接続不良が発生しない。
?) 半導体素子の金属突起と配線基板とは単に圧接し
ているのみであるので、導体配線の材質を特定の材料に
したシ、多層構成にする必要がない。すなわち、作シに
くい導体配線の材料や処理をしにくい導体配線例えばT
i、ITO等の材料とでも電気的接続を容易に得ること
ができる。
(3)半導体素子と配線基板との接続を絶縁性の樹脂に
よる粘着剤分有する可とう性テープの粘着力で、また粘
着剤が光硬化型あるいは熱硬化型の場合はその接着力で
行うので、無硬化や光硬化型の粘着剤を用いて接続を行
う場合は、半導体素子や、配線基板に全く熱が加わらず
、また熱硬化型の粘着剤を用いる場合でも、加熱はせい
ぜい150″C以下であシ、半導体素子や配線基板にか
かる熱ストレスが、はんだづけやAu・Sn合金等の従
来法に比べ極めて小さく、信頼性の高い接続を得ること
が可能となる。
(4)半田づけや合金による接続を行なわないため、接
続時に発生する余剰の半田や、合金等による電極パッド
間や導体配線間の電気的短絡が生じない。
(5)半導体素子を配線基板に圧接し、それを絶縁性樹
脂による粘着剤を有する可とう性テープで固定したシ、
その粘着剤を硬化させたシするのみであるので、簡略で
あり、また、電極と導体配線の接合が一括してできるた
め効率的であシ、実装コストを低減できる。
(6)  可とう性のテープの大きさを大きくしてやれ
ば、半導体素子及び配線基板の導体配線を有する面を可
とう性テープ及びその粘着剤で完全に密閉することがで
き、モールドやコーチイン〜グのかわシとすることがで
きる。
(7)可とう性テープの素材に金属を用いれば、半導体
素子からの放熱を助け、また放熱板を取シ付けることも
容易となる。
(8)更にこの金属製の可とう性テープにアースを取シ
付ければ磁気シールドとしての効果もある。
以上の様に本発明による実用的効果は非常に多大なもの
がある。
【図面の簡単な説明】
第1図は本発明の第1の実施例の半導体装置の組み立て
工程を示す断面図、第2図はフリップチップ方式を示す
断面図、第3図はフィルムキャリア方式を示す断面図で
あろう 1・・・・・・電極、2・・・・・・半導体素子、3・
・・・・・粘着剤、4・・・・・・可とう性テープ、6
・・・・・・加圧ツール、6・・・・・・導体配線、7
・・・・・・配線基板、8・・・・・・外部加圧ツール
、9・・・・・・内部加圧ツール。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第2

Claims (2)

    【特許請求の範囲】
  1. (1)絶縁性基板の導体配線を有する面に半導体素子の
    電極を有する面が、前記導体配線と前記半導体素子の前
    記電極とが一致する様にして配置された状態で、絶縁性
    の樹脂による粘着剤を有する可とう性テープが、前記半
    導体素子の前記電極を有する側と反対の面及び前記半導
    体素子の周囲の前記配線基板に渡って粘着されたことに
    より、前記半導体素子が前記絶縁性基板に固定され、か
    つ前記半導体素子の電極と前記導体配線が接触により電
    気的に接続された構造を有する半導体装置。
  2. (2)絶縁性の樹脂による粘着剤が、光硬化型あるいは
    熱硬化型である特許請求の範囲第1項記載の半導体装置
JP62135085A 1987-05-29 1987-05-29 半導体装置 Expired - Fee Related JP2523641B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP62135085A JP2523641B2 (ja) 1987-05-29 1987-05-29 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP62135085A JP2523641B2 (ja) 1987-05-29 1987-05-29 半導体装置

Publications (2)

Publication Number Publication Date
JPS63299366A true JPS63299366A (ja) 1988-12-06
JP2523641B2 JP2523641B2 (ja) 1996-08-14

Family

ID=15143479

Family Applications (1)

Application Number Title Priority Date Filing Date
JP62135085A Expired - Fee Related JP2523641B2 (ja) 1987-05-29 1987-05-29 半導体装置

Country Status (1)

Country Link
JP (1) JP2523641B2 (ja)

Also Published As

Publication number Publication date
JP2523641B2 (ja) 1996-08-14

Similar Documents

Publication Publication Date Title
US5519936A (en) Method of making an electronic package with a thermally conductive support member having a thin circuitized substrate and semiconductor device bonded thereto
US5773884A (en) Electronic package with thermally conductive support member having a thin circuitized substrate and semiconductor device bonded thereto
US5633533A (en) Electronic package with thermally conductive support member having a thin circuitized substrate and semiconductor device bonded thereto
JPH027180B2 (ja)
JP3269390B2 (ja) 半導体装置
JPS63151033A (ja) 半導体装置の製造方法
JP2658967B2 (ja) 電子パッケージ組立体用支持部材およびこれを用いた電子パッケージ組立体
JP2002026071A (ja) 半導体装置及びその製造方法、回路基板並びに電子機器
JPS6245138A (ja) 電子部品装置の製法
JPH02163950A (ja) 半導体装置の実装体およびその実装方法
JPS63299366A (ja) 半導体装置
JPH01192125A (ja) 半導体装置の実装構造
JP2002324873A (ja) 半導体装置及びその製造方法
JPS6150394A (ja) 実装体
JP2748771B2 (ja) フィルムキャリア半導体装置及びその製造方法
JP3552660B2 (ja) 半導体装置の製造方法
JP3331146B2 (ja) Bga型半導体装置の製造方法
JPH0236556A (ja) ピングリッドアレイおよび半導体素子塔載方法
JP2817425B2 (ja) 半導体装置の実装方法
JP3598058B2 (ja) 回路基板
JP2004146540A (ja) 接続型回路基板ならびに製造方法
JP3019899B2 (ja) マルチチップモジュールの製造方法
JP2822987B2 (ja) 電子回路パッケージ組立体およびその製造方法
JP3106846B2 (ja) 半導体チップ実装基板の製造方法
JP2532543B2 (ja) 半導体装置

Legal Events

Date Code Title Description
R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees