JPS63289689A - デ−タ集録装置 - Google Patents

デ−タ集録装置

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JPS63289689A
JPS63289689A JP62124880A JP12488087A JPS63289689A JP S63289689 A JPS63289689 A JP S63289689A JP 62124880 A JP62124880 A JP 62124880A JP 12488087 A JP12488087 A JP 12488087A JP S63289689 A JPS63289689 A JP S63289689A
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JP
Japan
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signal
data
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unit
output
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JP62124880A
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Chiharu Aoki
千春 青木
Taishin Iwamura
岩村 太信
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Yokogawa Electric Corp
Original Assignee
Yokogawa Electric Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野コ 本発明は、複数のユニットで構成されるデータ集録装置
に関し、特に各ユニットで測定されるデータの同時性と
外部事象との時間的対応の改善に関する。
[従来の技術] 従来より、コンピュータシステム(マイクロプロセッサ
を用いたシステムも含む)であって、中央処理装置(以
下CPUという)の管理下で、複数のユニットが測定デ
ータをあるタイミングでサンプリングし、これをメモリ
に記憶するようにした複数ユニットで構成されたデータ
集録装置はよく知られている。
第6図はこの種の従来のデータ集録装置の一例を示す要
部構成図である。図において、1,2゜3は針側用入出
力カード(これをユニットという)である。ここではユ
ニット数3の場合を例示しである。4はユニット間の同
期をとるための専用の同期バスで、複数のユニットが1
本のバス上に並ぶようにいもする式に接続している。接
続する順番は動作に無関係である。
同期バス4は、3本の信号線(T RG 。
BUSY、EOP)で構成されている。同期バスにおい
て総べてのユニットは電気的に対等であるが、一連の測
定シーケンスではどれか1つのユニットがマスタとなり
、その他はスレーブとなる。
このような構成における動作を第7図のタイムチャート
を参照して次に説明する。まずスレーブの各ユニットに
対してTRG信号を与えて計I!l開始の起動を行う。
スレーブの前処理終了後マスタを起動すると、マスクの
前処理終了後一連の測定シーケンスが開始される。
マスタがTRGラインをアクティブにすると、バス上に
接続されたスレーブのユニットは、BUSYラインをア
クティブにすると同時に計測を開始する。計測の終った
スレーブのユニットから、BUSYラインを非アクティ
ブとする。全スレーブが非アクティブとなるとBUSY
ラインはHレベルとなり、マスクは自分自身が次の計測
を行ってから、TRGラインをアクティブにする。
このようにマスクのTRGラインの出力に同期して全ス
レーブのユニットは一連の計測を行う。
EOPラインは一連の計測を終了するための信号を送る
ラインで、このラインはマスクとスレーブに関係なく、
どのユニットもアクティブにすることができる。一連の
測定シーケンスの終了条件が成立したユニットがあると
、BUSYがHレベルとなるタイミングでこのEOPラ
インがアクティブになる。このラインがアクティブにな
ると、バス上に接続された全ユニットは一連の測定シー
ケンスを終了する。
[51!明が解決しようとする問題点]しかしながら、
この同期バス方式のデータ集録装置では、上述のように
マスクが計測後スレーブに対してTRGで測定開始を指
示し、一番遅いユニットに合わせて動作するものであり
、■高速かつ一定時間間隔の計測が困難であり、■外部
事象との時間的対応がとれない(cpuの処理により可
能ではあるが、動作時間が長くかつ一定ではないため、
正確ではない。測定開始および終了についても同様であ
る。) といった問題があった。
本発明の目的は、このような点に鑑みてなされたもので
、複数のユニット間の測定を高速かつ同時に実行でき、
その時の外部事象と測定データの対応付けが正確かつ容
易に行えるデータ集録装置を提供することにある。
[問題点を解決するための手段] このような目的を達成するために1本発明は、複数の測
定ユニットで構成されるデータ集録装置であって、 前記測定ユニットが、 測定対象から与えられる測定データを取り込む信号入力
回路と、 入出力動作期間を示す信号を外部または内部から受信し
、かつこれを外部に送出するためのドライバ・レシーバ
と、 指定されたチャンネル数だけ各ユニットの入出力動作を
行わせる信号を外部または内部から受信し、かつこれを
外部に送出するためのドライバ・レシーバと、 外部事象に対応した信号を外部または内部から受信し、
かつこれを外部に送出するためのドライバ・レシーバと
、 的記各ドライバ・レシーバの入出力を制御する信号を出
力する入出力制御回路と、 入出力動作期間を示す信号と、指定されたチャンネルだ
け各ユニットの入出力動作を行わせる信号と、事象に対
応した信号とを発生する内部信号発生回路と、 外部事象に対応した信号がアクティブの時は前記信号入
力回路からの測定データに外部事象に対応したマークを
付加して送出し、外部事象に対応した信号が非アクティ
ブの時は前記信号入力回路からの測定データをそのまま
送出するデータ合成回路と、 このデータ合成回路の出力データを記憶するメモリと、 このメモリのデータをCPUに与えるため、およびCP
Uからの命令を前記入出力制御回路に与えるために信号
の授受を行うインタフェースと、各ユニットに前記入出
力動作期間を示す信号と、指定されたチャンネルだけ各
ユニットの入出力動作を行わせる信号と、事象に対応し
た信号とを同時に並行して供給するためのタイミング・
コントロール・バス より構成したことを特徴とする。
[作用] 本発明では、複数のユニットの内1つのユニットをマス
クとし他のユニットはスレーブとして機能させ、各ユニ
ットでの測定シーケンスが同時に開始されるようにする
と共に、データ合成回路においてすべての測定データに
対して外部事象の対応付けを行い得るようにした。
[実施例コ 以下図面を参照して本発明の実施例を詳細に説明する。
第1図は本発明に係るデータ集録装置の一実施例を示す
要部構成図である。図において、10は測定対象で、多
チャンネルの測定点を待つ。
20はデータ集録装置の要部構成図である。21ないし
24はデータ集録ユニットで、バス25に並列に接続さ
れている。26はCPUで、これもバス25に接続にさ
れている。
27はデータ取集のタイミングをIIJ御する信号を伝
達するためのタイミング・コントロール・バスで、各ユ
ニットをいもする式に接続している。
本実施例においては、ユニット21がマスタ、22ない
し24がスレーブであり、各ユニットが独立に動作する
。マスクのユニット21は、スレーブのユニット22な
いし24に対してデータの入出力動作期間を示すR/ 
E (r u n / e n d )信号と、指定さ
れたチャンネル数だけ各ユニットの入出力動作を行わせ
るSMPL (sampling  pulse)信号と、外部事象
に対応したMARK信号をスレーブのユニット22ない
し24に対して送出する。
ユニット24は、独立に動作させるため、タイミング・
コントロール・バス27からの入力およびバスへの出力
を禁止している。なお、その詳細については後述する。
またユニット21ないし24は、バス27からの入力と
出力のそれぞれに対して専用のコネクタを持ち、並列接
続を容易にしている 測定対象1からの被測定信号は、各ユニットにNl、N
2.N3.、、、、Niチャンネル接続され、全体で多
チャンネルのデータ集録を実現する。
m2図は各ユニットの構成の詳細を示す実施例図である
。211,212,213はそれぞれR/E、SM、P
L、MARK信号用のドライバ・レシーバであり、いず
れも同一構成となっている。
その詳細を第3図に示す。
外部から入力されるR/E、SMPL。
MARK信号はターミネータTに接続されている。
内部生成信号(内部で生成したR/E、SMPL。
MARK)を使用するINTモードの場合は、I NT
/EXT信号がHレベルであり、内部生成信号が内部信
号に選ばれる。EXTモードの場合は、INT/EXT
信号がLレベルとなり、外部からの信号が内部信号に選
ばれる。
また外部への出力を行うマスクとなる場合は、OE  
(output  enable) をHレベルとする
ことにより行ねれる。
第2図における214は内部生成回路で、上記R/E、
SMPL、MARK信号を発生する。
215は入出力制御回路で、OEおよびINT/EXT
を各ドライバ・レシーバに出力する。なお、各ドライバ
・レシーバごとに別々のOEおよびINT/T7’Tを
与えるようにしてもよい。
216は被測定信号を変換しく例えばアナログ信号をデ
ィジタル変換するなど)、結果をデータ合成回路217
に送出する信号入力回路である。
データ合成回路217は、信号入力回路216から与え
られる測定データ(DATA)と、ドライバ・レシーバ
213から与えられるマーク(MARK)とを第4図に
示すように合成する。
218はメモリ、219はバスインタフェースである。
メモリ218の内容はバスインタフェース219を介し
てバス25経由でCPU26に読み取られ、またCPU
からの$制御命令がバス25経出でインタフェース21
9を介して入出力制御回路215に与えられる。入出力
制御回路はcpuの命令に従ってOEおよびI N T
 / E X T信号を発生する。
このような構成における動作を次に説明する。
第5図は動作を説明するためのフローチャートである。
このフローに従って以下説明する。
■入出力の動作を判定する。
ユニット21は内部または外部から入力されるR/Eを
チェックする。R/EがHレベルの時は動作期間中であ
り、次のステップ■に移行する。
R/EがLレベルの時は動作終了であり、シーケンス終
了となる。
■前記ステップで動作期間中と判衛されると、SMPL
信号が入力されるのを待つ。
SMPL信号がアクティブの時はステップ■へ、非アク
ティブの時はステップ■へ進む。
■前記ステップ■でSMPL信号がアクティブと判定さ
れると、スキャンが開始される。このスキャン動作は、
各ユニットの信号入力回路216において被測定データ
の測定および変換の動作を意味する。
■各ユニットにおいて、前記ステップ■で集録されたデ
ータにMARKを付加するかどうかの判定を行う。
MARK信号がアクティブの時はステップ■へ、MAR
K信号が非アクティブの時は、ステップ■で得られたデ
ータをそのままメモリ218へ格納する。
■前記ステップ■でMARK信号がアクティブであるこ
とを検出すると、各ユニットにおいては。
データ合成回路217により、ステップ■で得られたデ
ータにMARK (通常1ビツトの信号であるが、複数
ビットの信号であってもよい)を付加する。合成された
データは各ユニット自身のメモリ218に格納される。
■1回のスキャンが終了すると、まだRUN状態である
かどうかの確認を行う。RUN状態である場合は、ステ
ップ■へ戻り、同様な動作を行う。
END状態と判定されるとこのシーケンスは終了する。
以上のようにして、多チャンネルの被測定データが同時
に測定されると共に、外部事象発生時点のデータにはM
ARK信号が付加されて、それぞれメモリに格納される
[発明の効果コ 以上詳細に説明したように、本発明によれば、複数の測
定ユニット間をタイミング・コントロール・バスで並列
に接続することにより、入出力の動作時間およびデータ
集録のタイミングを時間遅れを生じることなく同時に行
うことができる。っまり同期をとることができる。
またMARK信号を用いて総べてのデータに対して外部
事象との対応がとれるので、高速かつ同時性が要求され
るような場合には本発明は特に有効である。
【図面の簡単な説明】
第1図は本発明に係るデータ集録装置の一実施例を示す
要部構成図、第2図はユニットの詳細を示す構成図、第
3図はドライバ・レシーバの実施例図、第4図は動作を
説明するためのタイミングチャート、第5図は動作を説
明するためのフローチャート、第6図は従来のデータ集
録装置の一例を示す要部構成図、第7図は第6図の装置
の動作を示すタイムチャートである。 10・・・測定対象、20・・・データ集録装置、21
〜24・・・データ測定ユニット、25・・・バス、2
6・・・CPU、27・・・タイミング・コントロール
・バス、211,212,213・・・ドライバ・レシ
ーバ、214・・・内部信号発生回路、215・・・入
出力制御回路、216・・・信号入力回路、217・・
・データ合成回路、218・・・メモリ、219・・・
バス・インタフェース。 第1図 27−Za:テ−7Fg・1ミ、1ニット第5図

Claims (1)

  1. 【特許請求の範囲】 複数の測定ユニットで構成されるデータ集録装置であっ
    て、 前記測定ユニットが、 測定対象から与えられる測定データを取り込む信号入力
    回路と、 入出力動作期間を示す信号を外部または内部から受信し
    、かつこれを外部に送出するためのドライバ・レシーバ
    と、 指定されたチャンネル数だけ各ユニットの入出力動作を
    行わせる信号を外部または内部から受信し、かつこれを
    外部に送出するためのドライバ・レシーバと、 外部事象に対応した信号を外部または内部から受信し、
    かつこれを外部に送出するためのドライバ・レシーバと
    、 前記各ドライバ・レシーバの入出力を制御する信号を出
    力する入出力制御回路と、 入出力動作期間を示す信号と、指定されたチャンネルだ
    け各ユニットの入出力動作を行わせる信号と、事象に対
    応した信号とを発生する内部信号発生回路と、 外部事象に対応した信号がアクティブの時は前記信号入
    力回路からの測定データに外部事象に対応したマークを
    付加して送出し、外部事象に対応した信号が非アクティ
    ブの時は前記信号入力回路からの測定データをそのまま
    送出するデータ合成回路と、 このデータ合成回路の出力データを記憶するメモリと、 このメモリのデータをCPUに与えるため、およびCP
    Uからの命令を前記入出力制御回路に与えるために信号
    の授受を行うインタフェースと、各ユニットに前記入出
    力動作期間を示す信号と、指定されたチャンネルだけ各
    ユニットの入出力動作を行わせる信号と、事象に対応し
    た信号とを同時に並行して供給するためのタイミング・
    コントロール・バス より構成し、複数のユニットの内1つのユニットをマス
    タとし他のユニットはスレーブとして機能させ、各ユニ
    ットでの測定シーケンスが同時に開始されるようにする
    と共に、測定データに対しては外部事象の対応付けを行
    い得るようにしたデータ集録装置。
JP62124880A 1987-05-21 1987-05-21 デ−タ集録装置 Granted JPS63289689A (ja)

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JPH0568747B2 JPH0568747B2 (ja) 1993-09-29

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6076533U (ja) * 1983-10-31 1985-05-29 日産車体株式会社 パワ−リクライニングシ−トの停止装置
JPS6137546A (ja) * 1984-07-31 1986-02-22 Nippon Soken Inc パワ−シ−ト装置
JPS61196741U (ja) * 1985-05-31 1986-12-08

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS60125134A (ja) * 1983-12-06 1985-07-04 株式会社東芝 複合発電プラント事故解析装置
JPH065547B2 (ja) * 1985-05-28 1994-01-19 株式会社東芝 デ−タ収集装置

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6076533U (ja) * 1983-10-31 1985-05-29 日産車体株式会社 パワ−リクライニングシ−トの停止装置
JPS6137546A (ja) * 1984-07-31 1986-02-22 Nippon Soken Inc パワ−シ−ト装置
JPS61196741U (ja) * 1985-05-31 1986-12-08

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