JPS63219210A - Fet増幅器 - Google Patents

Fet増幅器

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Publication number
JPS63219210A
JPS63219210A JP5280987A JP5280987A JPS63219210A JP S63219210 A JPS63219210 A JP S63219210A JP 5280987 A JP5280987 A JP 5280987A JP 5280987 A JP5280987 A JP 5280987A JP S63219210 A JPS63219210 A JP S63219210A
Authority
JP
Japan
Prior art keywords
inductance
fet
source
capacitance
band
Prior art date
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Pending
Application number
JP5280987A
Other languages
English (en)
Inventor
Masaru Kunugi
賢 功刀
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
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Publication of JPS63219210A publication Critical patent/JPS63219210A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、マイクロ波帯で、使用される増幅器におい
て、電界効果トランジスタ()’ET)を用いた低雑音
のFET増幅器に関するものである。
〔従来の技術〕
第8図(a)は例えば、文献「X−Band Mono
 1 i th i cSeries Feedbac
k LNA(IEEEMn’−88DECEMBER1
985)Jに示された従来のFET増幅器を示す一例の
回路図である。図において(1)は入力整合回路、(2
)は出力整合回路、(3)はFETであり、(4)はこ
のFET(3)のソース電極に挿入されたインダクタン
スである。第8図(b)は、上記ソースインダクタンス
(4)をマイクロストリップ線路等で構成される分布定
数で表わした図である。
次に動作について説明する。通常、FETの各種パラメ
ーターにおいて、雑音を最小にするインピーダンス(Z
opt)と入力の反射係数を最小にするSoの共役複素
数ギとは異なることが明らかにされている。ところが、
(3)のFETのソース電極に適当なインダクタンス(
4)を挿入することにより、上記のZoptとS:は近
づき、低雑音でかつ低入力v、S、W、Rが同時に実現
できる。
〔発明が解決しようとする問題点〕
従来のFET増幅器は以上のように構成されているので
、ある特定の周波数以上においては、ソースのインダク
タンスの影響により、利得が低下したり、ゲート、ドレ
イン間のアイソレーションが悪化し、不安定動作を起こ
しやすいなどの問題点があった。また、インダクタンス
を形成する分布定数回路の線路長が帯域外のある周波数
でM4長になるとソーンがオープン状態となり、その周
波数における増幅動作が不安定となって発振し易すくな
るなどの問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、所要の周波数帯域外においてもアイソレーシ
ョン悪化あるいは発振現象を防止して安定に動作し、低
雑音、低入力V、S、W、Rを実現できるFET増幅器
を得ることを目的とする。
〔問題点を解決するための手段〕
この発明に係るFET増幅器は、そのPETのソースに
接続されたインダクタンスと直列あるいは並列にキャパ
シタンスを接続したものである。
〔作用〕 この発明におけるソースインダクタンスと直列あるいは
並列に挿入されたキャパシタンスは、その容量を適当に
選択することにより、帯域外の周波数において高周波的
にソースを接地した状態をつくることができ、高域での
アイソレーション不足あるいは発振等の不安定動作を防
止し、広帯域性能のすぐれた増幅作用を行うことができ
る。
〔発明の実施例〕
以下、この発明の一実施例を図について説明する。第1
図において、(1)は入力整合回路、(2)は出力整合
回路、(3)はFETであり、(4)はこのFET(3
)のソース電極に挿入されたインダクタンスであり、(
5a)はこのインダクタンス(4)に直列に挿入された
キャパシタンスである。
次に作用について説明する。前述した通り、FETのソ
ース電極に所要帯域の適当なインダクタンス(4)を入
れることにより、低雑音、低入力■、S1W、Rを同時
に実現することは可能である。しかしながら、所要の帯
域よりも高周波においては、このインダクタンス(4)
が、jWLのインピーダンスをもち、ソースが完全に接
地されているとは見なされなくなり、FETのドレイン
、ゲート間のアイソレーションが悪化する。そこでこの
インダクタンスに直列にキャパシタンス(5a)を適当
な値で入れることにより、j(WL−赤のインピーダン
スになる。したがって、このしとCの値を選択すること
により、ソースを完全に接地したと見ることができ、ア
イソレージロンも改善され、広帯帯で、安定な増幅器を
得ることができる。
なお、上記実施例ではインダクタンス(4)と直列にコ
ンデンサ(5a)を接地して所要の帯域よりも高い周波
数域におけるアイソレージぢン不足を防止する場合につ
いて述べたが、第2図(a)に示すようにインダクタン
ス(4)と並列にコンデンサ(5b)を接続しても低雑
音、低V1S1W1R化とともにFET増幅作用の安定
化を図ることができる。第2図(b)は第2図(a)の
ソースインダクタンス(4)を分布定数で表わした図で
ある。
前述したように所要の帯域よりも低いある周波数におい
ては、このインダクタンス(4)が、V4長に見えた場
合に、ソース電極はオープン状態となり不安定動作とな
る。そこで、第2図のごとくこのインダクタンス(4)
に並列にキャパシタンス(5b)を接続し、その値を最
適に選ぶことにより、帯域外で、ソース電極から見てオ
ープン状態にみえていた周波数でも、高周波的に接地さ
れていることにより、どの周波数においても安定な動作
が保証される。
また、上記実施例では、ソースインダクタンス(4)を
直接接地した2電源で動作するFET増幅器を示したが
、ソースインダクタンス(4)に直列に抵抗が挿入され
た単電源で動作するFET増幅器に関しても、同様の効
果を奏する。
〔発明の効果〕
以上のように、この発明によれば、低雑音、低入力V、
S、W、Rを同時に実現するべく挿入されたソースイン
ダクタンスに直列あるいは並列にキャパシタンスを挿入
したので、広帯域特性にすぐれた、安定なFET増幅器
を得ることができる。
【図面の簡単な説明】
第1図はこの発明の一実施例によるFET増幅器の回路
図、第2図はこの発明の他の実施例を示すFET増幅器
の回路図、第8図は従来のFET増幅器を示す回路図で
ある。(1)は、入力整合回路。 (2)は出力整合回路、(3)はFET、(4)はソー
スインダクタンス、 (5)は、キャパシタンス。 なお、図中、同一符号は同一、又は相当部分を示す。

Claims (1)

    【特許請求の範囲】
  1. 電界効果トランジスタ(FET)により構成され、その
    ソースと基準電位(接地)間にインダクタンスが挿入接
    続されたFET増幅器において、上記インダクタンスと
    直列あるいは並列にキャパシタンスを接続したことを特
    徴とするFET増幅器。
JP5280987A 1987-03-06 1987-03-06 Fet増幅器 Pending JPS63219210A (ja)

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JP5280987A JPS63219210A (ja) 1987-03-06 1987-03-06 Fet増幅器

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JP5280987A JPS63219210A (ja) 1987-03-06 1987-03-06 Fet増幅器

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JPS63219210A true JPS63219210A (ja) 1988-09-12

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ID=12925173

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JP5280987A Pending JPS63219210A (ja) 1987-03-06 1987-03-06 Fet増幅器

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