JPS6316652A - 半導体装置及びその製造方法 - Google Patents
半導体装置及びその製造方法Info
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- JPS6316652A JPS6316652A JP16040286A JP16040286A JPS6316652A JP S6316652 A JPS6316652 A JP S6316652A JP 16040286 A JP16040286 A JP 16040286A JP 16040286 A JP16040286 A JP 16040286A JP S6316652 A JPS6316652 A JP S6316652A
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Landscapes
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- Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置及びその製造方法に関し、例えば、
多結晶の半導体を抵抗体として用い、そのトリミングが
良好に行える構造の半導体装置及びその製造方法に関す
る。
多結晶の半導体を抵抗体として用い、そのトリミングが
良好に行える構造の半導体装置及びその製造方法に関す
る。
不純物を高濃度に含む多結晶半導体、例えば多結晶シリ
コン素子に対して、特定され闇値以上の電流密度で通電
することによって、上記多結晶シリコン素子の抵抗値が
減少し、上記通電を解除すれば上記抵抗値の減少が停止
することが知られている。そして、この多結晶シリコン
素子は、それ以後闇値以上の通電を行わない限り、その
抵抗値の状態が安定に保たれるものである。
コン素子に対して、特定され闇値以上の電流密度で通電
することによって、上記多結晶シリコン素子の抵抗値が
減少し、上記通電を解除すれば上記抵抗値の減少が停止
することが知られている。そして、この多結晶シリコン
素子は、それ以後闇値以上の通電を行わない限り、その
抵抗値の状態が安定に保たれるものである。
したがって、このような高不純物濃度の多結晶シリコン
によって、例えば半導体回路の抵抗体を構成し、この抵
抗体の抵抗値をトリミング調整するようにすれば、上記
半導体回路の定数等が効果的に設定・制御できるもので
ある。すなわち、回路内の組込み設定された高不純物濃
度の多結晶シリコン抵抗体に対して、回路動作状態を監
視しながら例えば数十mAのパルス信号を供給すること
によって、その抵抗値を減少制御するものである。
によって、例えば半導体回路の抵抗体を構成し、この抵
抗体の抵抗値をトリミング調整するようにすれば、上記
半導体回路の定数等が効果的に設定・制御できるもので
ある。すなわち、回路内の組込み設定された高不純物濃
度の多結晶シリコン抵抗体に対して、回路動作状態を監
視しながら例えば数十mAのパルス信号を供給すること
によって、その抵抗値を減少制御するものである。
しかしながら、上記のようにトリミングを行っ゛た場合
、抵抗体中の不純物濃度及び通電する電流密度には上述
の如(闇値があり(多結晶シリコンでは前者はl ×l
Q 21) c!1)−3以上、後者は1×10hA
/ cm以上)又、トリミング可能な範囲は抵抗の初
期値に対する30%程度であるために、抵抗体のパター
ンを工夫しなければ高抵抗が得られない、大幅なトリミ
ング、言い換えると電気的に絶縁に近い状態から短絡に
近い状態へのトリミングが不可能であるという問題があ
る。
、抵抗体中の不純物濃度及び通電する電流密度には上述
の如(闇値があり(多結晶シリコンでは前者はl ×l
Q 21) c!1)−3以上、後者は1×10hA
/ cm以上)又、トリミング可能な範囲は抵抗の初
期値に対する30%程度であるために、抵抗体のパター
ンを工夫しなければ高抵抗が得られない、大幅なトリミ
ング、言い換えると電気的に絶縁に近い状態から短絡に
近い状態へのトリミングが不可能であるという問題があ
る。
そこで本発明は、上記の問題点に鑑みなされたもので、
高抵抗が容易に得られ、大幅なトリミングが可能な多結
晶半導体を提供する事を目的としている。
高抵抗が容易に得られ、大幅なトリミングが可能な多結
晶半導体を提供する事を目的としている。
上記の目的を達成するために、本出願の第1発明である
半導体装置は、所定値以上の不純物濃度を有する多結晶
半導体で、該多結晶半導体内の少なくとも一部に該多結
晶半導体と結びついて絶縁性を示す物質を含む領域を備
える事を特徴としている。
半導体装置は、所定値以上の不純物濃度を有する多結晶
半導体で、該多結晶半導体内の少なくとも一部に該多結
晶半導体と結びついて絶縁性を示す物質を含む領域を備
える事を特徴としている。
本出願の第2発明である半導体装置の製造方法は、所定
値以上の不純物濃度を有する多結晶半導体に通電する手
段を設け、該多結晶半導体内の少なくとも一部に形成さ
れる該多結晶半導体と結びついて絶縁性を示す物質を含
む領域に所定値以上の電流密度で通電する事によって、
該多結晶半導体の抵抗値を調整する。
値以上の不純物濃度を有する多結晶半導体に通電する手
段を設け、該多結晶半導体内の少なくとも一部に形成さ
れる該多結晶半導体と結びついて絶縁性を示す物質を含
む領域に所定値以上の電流密度で通電する事によって、
該多結晶半導体の抵抗値を調整する。
そして、上記のような半導体装置及びその製造方法にお
いては、多結晶半導体と結びついて絶縁性を示す物質の
量に応じて、上記領域とその領域以外の多結晶半導体と
の間の抵抗値は変化し、その量を増す事により高抵抗が
容易に得られる。
いては、多結晶半導体と結びついて絶縁性を示す物質の
量に応じて、上記領域とその領域以外の多結晶半導体と
の間の抵抗値は変化し、その量を増す事により高抵抗が
容易に得られる。
又、その間に所定値(闇値)以上の電流密度で通電する
事により、上記領域における抵抗値がその領域以外の多
結晶半導体内の抵抗値より大きい為に、電流の消費エネ
ルギーがその領域内にて大きくなり、その領域内におけ
る結晶粒間の境界層が広範囲に渡って融解し、そして、
通電を停止して固化させると、不純物の偏析によってそ
の境界層に一電流の通路ができ、もはや上記物質の影響
を受けずにその抵抗値が減少する。
事により、上記領域における抵抗値がその領域以外の多
結晶半導体内の抵抗値より大きい為に、電流の消費エネ
ルギーがその領域内にて大きくなり、その領域内におけ
る結晶粒間の境界層が広範囲に渡って融解し、そして、
通電を停止して固化させると、不純物の偏析によってそ
の境界層に一電流の通路ができ、もはや上記物質の影響
を受けずにその抵抗値が減少する。
以下、図面に示す実施例を用いて本発明を説明する。第
1図は本発明の第1の実施例を示す断面図であり、本発
明を2層配線に適用した例である。
1図は本発明の第1の実施例を示す断面図であり、本発
明を2層配線に適用した例である。
図において、1)はその主表面に絶縁膜としての800
0人〜1μm程度の熱酸化膜13aを有する基板であり
、その熱酸化膜L3a上には不純物として例えばリンを
その濃度が闇値、約lXl0”cm −”以上含んだ第
1の多結晶シリコン層12が回路の配線として形成され
ている。ここで、多結晶シリコンは減圧反応炉により、
例えば炉温600℃、ガス圧0.7 mbarの条件下
でシラン(SiHa)を 5iHn Si +2Hz という反応で熱分解す−る事により、例えば2000人
程度0厚みをもって堆積すればよい。又、その多結晶シ
リコンに添加する不純物としてはリンの他にヒ素、ボロ
ン等であってもよく、又、そのドーピング方法はどの様
な方法でもよく、例えば、多結晶シリコンの堆積時に、
雰囲気中にPH,を混合して行うか、あるいは多結晶シ
リコンの堆積後にその表面にリンをデポジットして、そ
の後1000℃程度の熱により加熱して拡散してもよく
、又、リンイオンをイオン注入法により、例えば加速電
圧1 (lokeV、打ち込み量5 X 101cm−
2の条件下で注入しても良い。尚、イオン注入法を採用
する場合には、その不純物を活性化するために、例えば
1000℃、60分、N2雰囲気中の条件下でアニール
を行う。
0人〜1μm程度の熱酸化膜13aを有する基板であり
、その熱酸化膜L3a上には不純物として例えばリンを
その濃度が闇値、約lXl0”cm −”以上含んだ第
1の多結晶シリコン層12が回路の配線として形成され
ている。ここで、多結晶シリコンは減圧反応炉により、
例えば炉温600℃、ガス圧0.7 mbarの条件下
でシラン(SiHa)を 5iHn Si +2Hz という反応で熱分解す−る事により、例えば2000人
程度0厚みをもって堆積すればよい。又、その多結晶シ
リコンに添加する不純物としてはリンの他にヒ素、ボロ
ン等であってもよく、又、そのドーピング方法はどの様
な方法でもよく、例えば、多結晶シリコンの堆積時に、
雰囲気中にPH,を混合して行うか、あるいは多結晶シ
リコンの堆積後にその表面にリンをデポジットして、そ
の後1000℃程度の熱により加熱して拡散してもよく
、又、リンイオンをイオン注入法により、例えば加速電
圧1 (lokeV、打ち込み量5 X 101cm−
2の条件下で注入しても良い。尚、イオン注入法を採用
する場合には、その不純物を活性化するために、例えば
1000℃、60分、N2雰囲気中の条件下でアニール
を行う。
次に、第1の多結晶シリコン層12を配線層として用い
るために、配線として必要な部分以外を公知のフォトエ
ツチング方法により取り除く。そして、第1の多結晶シ
リコンN12の上に層間絶縁膜13bとしてのS i
O,やPSG等をCVD法等により例えば厚さ5000
人程度0厚みをもって堆積して形成する。
るために、配線として必要な部分以外を公知のフォトエ
ツチング方法により取り除く。そして、第1の多結晶シ
リコンN12の上に層間絶縁膜13bとしてのS i
O,やPSG等をCVD法等により例えば厚さ5000
人程度0厚みをもって堆積して形成する。
次に、通常のフォトリソグラフィ一工程の後、弗酸系の
エツチング液にて後述する第2の多結晶シリコン層15
とのコンタクト部等の層間絶縁膜13bを除去し開口す
る。尚、フォトリソグラフィ一工程は、例えばポジレジ
ストを1μmはど堆積した後、所定のパターンの描かれ
たマスクを通して紫外線で2〜3秒露光し、現像液によ
り怒光部を取り除く。エツチングは例えばSF、を・ノ
チングガスとしたプラズマエツチングによって行う。
エツチング液にて後述する第2の多結晶シリコン層15
とのコンタクト部等の層間絶縁膜13bを除去し開口す
る。尚、フォトリソグラフィ一工程は、例えばポジレジ
ストを1μmはど堆積した後、所定のパターンの描かれ
たマスクを通して紫外線で2〜3秒露光し、現像液によ
り怒光部を取り除く。エツチングは例えばSF、を・ノ
チングガスとしたプラズマエツチングによって行う。
そして、ポジレジストを剥離しない状態で多結晶シリコ
ンと結びついて絶縁性を示す物質、例えば酸素、窒素、
炭素を上記のコンタクト部にイオン注入する。すると、
例えば上記物質として酸素を用いた場合、コンタクト部
における第1の多結晶シリコン層12内には絶縁性を示
すSiOxが形成サレ、そのSiOxの量に応じてその
イオンが注入された領域(以下「高抵抗層」という)1
4の抵抗値が大きくなる。したがって、イオン注入する
物質の量を目的に応じて変える事により、高抵抗層14
の抵抗値が変化するので、その抵抗値は言うまでもなく
、第1の多結晶シリコン層12内の高抵抗14が形成さ
れていない部分における抵抗値より極端に大きな値にま
で大きくする事が可能であり、本実施例においてはその
ような状態にあるものとする。
ンと結びついて絶縁性を示す物質、例えば酸素、窒素、
炭素を上記のコンタクト部にイオン注入する。すると、
例えば上記物質として酸素を用いた場合、コンタクト部
における第1の多結晶シリコン層12内には絶縁性を示
すSiOxが形成サレ、そのSiOxの量に応じてその
イオンが注入された領域(以下「高抵抗層」という)1
4の抵抗値が大きくなる。したがって、イオン注入する
物質の量を目的に応じて変える事により、高抵抗層14
の抵抗値が変化するので、その抵抗値は言うまでもなく
、第1の多結晶シリコン層12内の高抵抗14が形成さ
れていない部分における抵抗値より極端に大きな値にま
で大きくする事が可能であり、本実施例においてはその
ような状態にあるものとする。
そして、酸系の溶液又は有機溶剤にてポジレジストを除
去した後、その上から高抵抗N14に接続するように第
2の多結晶シリコンN15を形成する。尚、その形成に
あたっては、多結晶シリコンの堆積、不純物のドーピン
グ、配線形成のためのフォトエツチング工程等の方法は
第1の多結晶シリコン層12の形成で示したのと同様の
方法を用いればよい。又、本例において、この第2の多
結晶シリコン層15のかわりにアルミやアルミ合金等の
金属を用いて金属層としてもよい。
去した後、その上から高抵抗N14に接続するように第
2の多結晶シリコンN15を形成する。尚、その形成に
あたっては、多結晶シリコンの堆積、不純物のドーピン
グ、配線形成のためのフォトエツチング工程等の方法は
第1の多結晶シリコン層12の形成で示したのと同様の
方法を用いればよい。又、本例において、この第2の多
結晶シリコン層15のかわりにアルミやアルミ合金等の
金属を用いて金属層としてもよい。
そして、第1の多結晶シリコンN12と第2の多結晶シ
リコンJi15との間にトリミング用電源16を電気的
に接続する。このトリミング用電源16は、本実施例で
は本発明のいう多結晶半導体として多結晶シリコンを用
いているので、その多結晶シリコンのトリミングを行え
る電流密度の闇値、I X 106A/cm”以上の電
流を供給できるものであるならば、どのような形式のも
のでもかまわない。ただし、より高精度なトリミングを
行う場合にはパルス出力の出せるものがよい。
リコンJi15との間にトリミング用電源16を電気的
に接続する。このトリミング用電源16は、本実施例で
は本発明のいう多結晶半導体として多結晶シリコンを用
いているので、その多結晶シリコンのトリミングを行え
る電流密度の闇値、I X 106A/cm”以上の電
流を供給できるものであるならば、どのような形式のも
のでもかまわない。ただし、より高精度なトリミングを
行う場合にはパルス出力の出せるものがよい。
そこで、上記構成によると、第1の多結晶シリコン層1
2と第2の多結晶シリコン層15との間には高抵抗[1
4が存在しており、両者間は電気的に略絶縁された状態
にある。そしてこの状態にてトリミング用電源16によ
りその両者間に上記の閾値、I X 10 hA /a
m”以上の電流密度にて通電を行うと、通電電流の消費
エネルギーが高抵抗層14内にて大きくなり、その高抵
抗層14内における結晶粒間の境界層が広範囲に渡って
融解し、そして、通電を停止すると融解した領域は固化
するが、この時、固相から液相への不純物の偏析が生じ
、この結果境界層の一部に不純物濃度の集中部が形成さ
れる。したがって境界層に電流の通路ができ、高抵抗N
14の抵抗値は多少5iOX等の影響は受けるものの、
はとんど第1の多結晶シリコン層12の抵抗値に近い値
まで減少する事が可能となる。尚、高抵抗層14の抵抗
値は第1の多結晶シリコン層12の抵抗値に近い値まで
減少させずに、通電を行う期間、言い換えると高抵抗N
14に与えるエネルギーを調整する事によって任意に調
整可能である。
2と第2の多結晶シリコン層15との間には高抵抗[1
4が存在しており、両者間は電気的に略絶縁された状態
にある。そしてこの状態にてトリミング用電源16によ
りその両者間に上記の閾値、I X 10 hA /a
m”以上の電流密度にて通電を行うと、通電電流の消費
エネルギーが高抵抗層14内にて大きくなり、その高抵
抗層14内における結晶粒間の境界層が広範囲に渡って
融解し、そして、通電を停止すると融解した領域は固化
するが、この時、固相から液相への不純物の偏析が生じ
、この結果境界層の一部に不純物濃度の集中部が形成さ
れる。したがって境界層に電流の通路ができ、高抵抗N
14の抵抗値は多少5iOX等の影響は受けるものの、
はとんど第1の多結晶シリコン層12の抵抗値に近い値
まで減少する事が可能となる。尚、高抵抗層14の抵抗
値は第1の多結晶シリコン層12の抵抗値に近い値まで
減少させずに、通電を行う期間、言い換えると高抵抗N
14に与えるエネルギーを調整する事によって任意に調
整可能である。
以上説明したように、本実施例によると、第1の多結晶
シリコン層12と第2の多結晶シリコン層15との間の
抵抗値を任意に調整する事ができ、又、その抵抗値は第
1の多結晶シリコン層12の抵抗値と比較して極端に大
きい値から、第1の多結晶シリコン層12の抵抗値に近
い値まで減少する事が可能であるので、トリミング用電
源16により通電する事で第1の多結晶シリコンN12
と第2の多結晶シリコン1515とを選択的に電気接続
する事が出来るという効果がある。尚、本実施例を採用
した半導体装置の製造過程において、トリミングを行う
時期はいつでもよく、ウェハ状態の時でも、又、パッケ
ージングを行った後でもトリミング用の端子を設けてお
けばよい。
シリコン層12と第2の多結晶シリコン層15との間の
抵抗値を任意に調整する事ができ、又、その抵抗値は第
1の多結晶シリコン層12の抵抗値と比較して極端に大
きい値から、第1の多結晶シリコン層12の抵抗値に近
い値まで減少する事が可能であるので、トリミング用電
源16により通電する事で第1の多結晶シリコンN12
と第2の多結晶シリコン1515とを選択的に電気接続
する事が出来るという効果がある。尚、本実施例を採用
した半導体装置の製造過程において、トリミングを行う
時期はいつでもよく、ウェハ状態の時でも、又、パッケ
ージングを行った後でもトリミング用の端子を設けてお
けばよい。
次に本発明の第2の実施例の断面図を第2図(alに示
す。図において、21は基板、22は多結晶シリコン層
、23aは熱酸化膜、23bは眉間絶縁膜、24は高抵
抗層、25は多結晶シリコン層又は金属層(本例は後者
とする)であり、各々は第1図に示す実施例と同様の方
法で形成可能であるので、その詳細な説明は省略する。
す。図において、21は基板、22は多結晶シリコン層
、23aは熱酸化膜、23bは眉間絶縁膜、24は高抵
抗層、25は多結晶シリコン層又は金属層(本例は後者
とする)であり、各々は第1図に示す実施例と同様の方
法で形成可能であるので、その詳細な説明は省略する。
本実施例における第1図に示す実施例との相違点は、高
抵抗層24が多結晶シリコン層22内の金属層25との
接続部分に形成されるのではなく、多結晶シリコン層2
2を2分するように形成されている事であり、本実施例
においても第1図に示す実施例と同様の効果が得られる
。又、本発明の第3の実施例の断面図である第2図(b
lに示すように、多結晶シリコン層22aの主表面全面
に高抵抗層24aを形成してもよい。本実施例によると
、図中横方向の抵抗値は言うまでもなく高抵抗F24a
の抵抗値より多結晶シリコン層22aの抵抗値の方が小
さいために、高抵抗層24.aは金属層25より縦方向
に向けて電流の通路が形成される。従ってこの状態にお
いては多結晶シリコン層22aの抵抗値が金属層25間
の抵抗値となる。よって本実施例によると、多結晶シリ
コン層22aおよび高抵抗層24aの抵抗値を任意に調
整しておく事により、金属層25間の抵抗値は選択的に
切換え可能となる。
抵抗層24が多結晶シリコン層22内の金属層25との
接続部分に形成されるのではなく、多結晶シリコン層2
2を2分するように形成されている事であり、本実施例
においても第1図に示す実施例と同様の効果が得られる
。又、本発明の第3の実施例の断面図である第2図(b
lに示すように、多結晶シリコン層22aの主表面全面
に高抵抗層24aを形成してもよい。本実施例によると
、図中横方向の抵抗値は言うまでもなく高抵抗F24a
の抵抗値より多結晶シリコン層22aの抵抗値の方が小
さいために、高抵抗層24.aは金属層25より縦方向
に向けて電流の通路が形成される。従ってこの状態にお
いては多結晶シリコン層22aの抵抗値が金属層25間
の抵抗値となる。よって本実施例によると、多結晶シリ
コン層22aおよび高抵抗層24aの抵抗値を任意に調
整しておく事により、金属層25間の抵抗値は選択的に
切換え可能となる。
次に、第3図(a)に本発明の第4の実施例の断面図、
同図(b)にその等価回路図を示す。図において、31
は例えばP型シリコン基板であり、そのP型シリコン基
板31内は公知の方法により例えばN゛型埋込み層32
、N−型拡散層33、P゛゛拡散N34が形成されてお
り、N−型拡散層33及びP゛型型数散層34てダイオ
ードを構成している。そして、その表面にシリコン酸化
膜35を形成した後、P゛型型数散層34の接続をとる
ためにシリコン酸化膜35を部分的に除去する。そして
、シリコン酸化膜35上にはその不純物濃度が約I X
I Q !0cm−”以上である多結晶シリコン層3
6が形成されている。尚、多結晶シリコン層36内の全
領域には第1図に示す実施例を用いて説明したのと同様
の方法にて多結晶シリコンと結びついて絶縁性を示す物
質、例えば酸素等が導入されている。多結晶シリコン層
36とP゛型型数散層34はアルミニウム電極37によ
り電気接続されている。
同図(b)にその等価回路図を示す。図において、31
は例えばP型シリコン基板であり、そのP型シリコン基
板31内は公知の方法により例えばN゛型埋込み層32
、N−型拡散層33、P゛゛拡散N34が形成されてお
り、N−型拡散層33及びP゛型型数散層34てダイオ
ードを構成している。そして、その表面にシリコン酸化
膜35を形成した後、P゛型型数散層34の接続をとる
ためにシリコン酸化膜35を部分的に除去する。そして
、シリコン酸化膜35上にはその不純物濃度が約I X
I Q !0cm−”以上である多結晶シリコン層3
6が形成されている。尚、多結晶シリコン層36内の全
領域には第1図に示す実施例を用いて説明したのと同様
の方法にて多結晶シリコンと結びついて絶縁性を示す物
質、例えば酸素等が導入されている。多結晶シリコン層
36とP゛型型数散層34はアルミニウム電極37によ
り電気接続されている。
上記の構成によると、上述したように多結晶シリコン層
36の抵抗値は約I X 10”A/am”以上の電流
密度にて通電する事により大幅なトリミングが可能とな
る。ここで、通常のP−ROM等においては情報を書き
込む際に、NiCr、TiW等から成るヒユーズに通電
し、ヒユーズを溶断する事によって行っているが、本実
施例をそのような装置に採用する事により、非破壊で情
報を書き込む事が出来る。又、本発明の第5の実施例の
断面図である第3図(C)に示すように、P゛型型数散
層34多結晶シリコン層36aとをアルミニウム電極3
7を介する事なく直接に接続してもよい。
36の抵抗値は約I X 10”A/am”以上の電流
密度にて通電する事により大幅なトリミングが可能とな
る。ここで、通常のP−ROM等においては情報を書き
込む際に、NiCr、TiW等から成るヒユーズに通電
し、ヒユーズを溶断する事によって行っているが、本実
施例をそのような装置に採用する事により、非破壊で情
報を書き込む事が出来る。又、本発明の第5の実施例の
断面図である第3図(C)に示すように、P゛型型数散
層34多結晶シリコン層36aとをアルミニウム電極3
7を介する事なく直接に接続してもよい。
本実施例によると同図(a)と同様の効果が得られ、さ
らに、高集積化が可能となる。
らに、高集積化が可能となる。
尚、本実施例は上記の第1乃至第5の実施例に限定され
る事なく、その主旨から逸脱しない限り種々変形可能で
あり、例えば本発明のいう多結晶半導体とは多結晶シリ
コンに限定される事なく、その境界層の電気伝導度がそ
の不純物濃度に対して非線形な依存性を有するものであ
れば同等の効果が得られると思われる。そのような場合
、不純物濃度及び通電する電流密度の闇値はその多結晶
半導体によって異なる。
る事なく、その主旨から逸脱しない限り種々変形可能で
あり、例えば本発明のいう多結晶半導体とは多結晶シリ
コンに限定される事なく、その境界層の電気伝導度がそ
の不純物濃度に対して非線形な依存性を有するものであ
れば同等の効果が得られると思われる。そのような場合
、不純物濃度及び通電する電流密度の闇値はその多結晶
半導体によって異なる。
以上、述べた如く本発明によると、多結晶半導体の抵抗
値は、杉結晶半導体と結びついて絶縁性を示す物質の量
に応じて任意に調整可能であり、その値をあらかじめ高
抵抗にしておく事が可能である。
値は、杉結晶半導体と結びついて絶縁性を示す物質の量
に応じて任意に調整可能であり、その値をあらかじめ高
抵抗にしておく事が可能である。
そして闇値以上の電流密度にて通電する事により、その
抵抗値を低減する事ができるので大幅なトリミングが可
能な多結晶半導体を提供できる。
抵抗値を低減する事ができるので大幅なトリミングが可
能な多結晶半導体を提供できる。
そこで、その多結晶半導体を単なる抵抗体として使用す
るだけではなく、電気的に絶縁に近い状態から短絡に近
い状態へ切換えるスイッチ素子として使用できるという
優れた効果がある。
るだけではなく、電気的に絶縁に近い状態から短絡に近
い状態へ切換えるスイッチ素子として使用できるという
優れた効果がある。
第1図は本発明の第1の実施例を示す断面図、第2図(
a)は本発明の第2の実施例を示す断面図、第2図(b
lは本発明の第3の実施例を示す断面図、第3図(a)
は本発明の第4の実施例を示す断面図、第3図(b)は
第3図(、!1)に示す半導体装置の等価回路図、第3
図(C)は本発明の第5の実施例を示す断面図である。 12・・・第1の多結晶シリコン層、14,24゜24
a・・・高抵抗層、15・・・第2の多結晶シリコン層
、22.22a、36.36a・・・多結晶シリコン層
。
a)は本発明の第2の実施例を示す断面図、第2図(b
lは本発明の第3の実施例を示す断面図、第3図(a)
は本発明の第4の実施例を示す断面図、第3図(b)は
第3図(、!1)に示す半導体装置の等価回路図、第3
図(C)は本発明の第5の実施例を示す断面図である。 12・・・第1の多結晶シリコン層、14,24゜24
a・・・高抵抗層、15・・・第2の多結晶シリコン層
、22.22a、36.36a・・・多結晶シリコン層
。
Claims (3)
- (1)所定値以上の不純物濃度を有する多結晶半導体で
、該多結晶半導体内の少なくとも一部に該多結晶半導体
と結びついて絶縁性を示す物質を含む領域を備える事を
特徴とする半導体装置。 - (2)上記多結晶半導体が多結晶シリコンであり、上記
物質が酸素、窒素、炭素のいずれかである特許請求の範
囲第1項記載の半導体装置。 - (3)所定値以上の不純物濃度を有する多結晶半導体に
通電する手段を設け、該多結晶半導体内の少なくとも一
部に形成される該多結晶半導体と結びついて絶縁性を示
す物質を含む領域に所定値以上の電流密度で通電する事
によって、該多結晶半導体の抵抗値を調整する、半導体
装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16040286A JPS6316652A (ja) | 1986-07-08 | 1986-07-08 | 半導体装置及びその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16040286A JPS6316652A (ja) | 1986-07-08 | 1986-07-08 | 半導体装置及びその製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6316652A true JPS6316652A (ja) | 1988-01-23 |
Family
ID=15714167
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16040286A Pending JPS6316652A (ja) | 1986-07-08 | 1986-07-08 | 半導体装置及びその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6316652A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7427802B2 (en) * | 2002-02-11 | 2008-09-23 | Stmicroelectronics S.A. | Irreversible reduction of the value of a polycrystalline silicon resistor |
-
1986
- 1986-07-08 JP JP16040286A patent/JPS6316652A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7427802B2 (en) * | 2002-02-11 | 2008-09-23 | Stmicroelectronics S.A. | Irreversible reduction of the value of a polycrystalline silicon resistor |
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