JPS63160484A - 同期標本化回路 - Google Patents
同期標本化回路Info
- Publication number
- JPS63160484A JPS63160484A JP61306532A JP30653286A JPS63160484A JP S63160484 A JPS63160484 A JP S63160484A JP 61306532 A JP61306532 A JP 61306532A JP 30653286 A JP30653286 A JP 30653286A JP S63160484 A JPS63160484 A JP S63160484A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- analog
- digital
- horizontal synchronizing
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000005070 sampling Methods 0.000 title claims abstract description 22
- 230000001360 synchronised effect Effects 0.000 title abstract description 6
- 238000001514 detection method Methods 0.000 claims description 12
- 238000000926 separation method Methods 0.000 claims description 10
- 238000010586 diagram Methods 0.000 description 11
- 230000000694 effects Effects 0.000 description 3
- 239000013078 crystal Substances 0.000 description 2
- 238000012952 Resampling Methods 0.000 description 1
- 241000012481 Xiha Species 0.000 description 1
Landscapes
- Synchronizing For Television (AREA)
- Picture Signal Circuits (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はアナログテレビジョン信号をディジタル信号に
変換する装置における同期標本化回路に関するものであ
る。
変換する装置における同期標本化回路に関するものであ
る。
従来、アナログテレビジョン信号をアナログ−ディジタ
ル変換器(以下、A/D変換器と呼称する)によりディ
ジタル信号に変換する装置は、サンプリング周波数と水
平同期信号の周波数が非同期の場合、同期分離回路にエ
リ分離されたアナログの水平同期信号とそのアナログの
水平同期信号を上記サンプリング周波数でサンプリング
したディジタルの水平同期信号との位相を同期させるた
めに電圧制御水晶発振器などを用いて同期標本化を行な
ってい丸。
ル変換器(以下、A/D変換器と呼称する)によりディ
ジタル信号に変換する装置は、サンプリング周波数と水
平同期信号の周波数が非同期の場合、同期分離回路にエ
リ分離されたアナログの水平同期信号とそのアナログの
水平同期信号を上記サンプリング周波数でサンプリング
したディジタルの水平同期信号との位相を同期させるた
めに電圧制御水晶発振器などを用いて同期標本化を行な
ってい丸。
上述した従来のアナログテレビジョン信号をA/D変換
器にエリディジタル信号に変換する装置では、サンプリ
ング周波数と水平同期信号の周波数が非同期の場合、同
期分離回路により分離されたアナログの水平同期信号と
そのアナログの水平同期信号をサンプリング周波数でサ
ンプリングしたディジタルの水平同期信号を位相同期さ
せてサンプリング周波数を発生させるために電圧制御水
晶発振器が必要であり、サンプリング周波数もテレビジ
ョン信号に依存するという問題点があった。
器にエリディジタル信号に変換する装置では、サンプリ
ング周波数と水平同期信号の周波数が非同期の場合、同
期分離回路により分離されたアナログの水平同期信号と
そのアナログの水平同期信号をサンプリング周波数でサ
ンプリングしたディジタルの水平同期信号を位相同期さ
せてサンプリング周波数を発生させるために電圧制御水
晶発振器が必要であり、サンプリング周波数もテレビジ
ョン信号に依存するという問題点があった。
本発明の同期標本化回路は、アナログテレビジョン信号
をディジタル信号に変換するA/D変換器と、このA
/ D変換器エリ出力されるディジタル信号を再標本化
するりサンプラ1g1wrと、上記アナログテレビジョ
ン信号を入力とする同期分離回路により分離されたアナ
ログの水平同期信号とそのアナログの水平同期信号をサ
ンプリングしたディジタ、ルの水平同期信号との時間的
ずれを検出するずれ検出回路とを備えてなる工うにした
ものである。
をディジタル信号に変換するA/D変換器と、このA
/ D変換器エリ出力されるディジタル信号を再標本化
するりサンプラ1g1wrと、上記アナログテレビジョ
ン信号を入力とする同期分離回路により分離されたアナ
ログの水平同期信号とそのアナログの水平同期信号をサ
ンプリングしたディジタ、ルの水平同期信号との時間的
ずれを検出するずれ検出回路とを備えてなる工うにした
ものである。
本発明においては、従来のアナログテレビジョン信号を
A/DR換器にエフディジタル信号に変換する装置にお
いて、アナログの水平同期信号とディジタルの水平同期
信号の時間的ずれを検出し、その時間的ずれに応じてサ
ンプル値の重みづけを行い、補間する。
A/DR換器にエフディジタル信号に変換する装置にお
いて、アナログの水平同期信号とディジタルの水平同期
信号の時間的ずれを検出し、その時間的ずれに応じてサ
ンプル値の重みづけを行い、補間する。
以下、図面に基づき本発明の実施例を詳細に説明する。
i1図は本発明の一実施例を示すブロック図である。
図において、1はアナログテレビジョン信号が印加され
る入力端子、2はこの入力端子1エクのアナログテレビ
ジョン信号をディジタル信号に変換するA/D変換器、
3はこのA/D変換器2工り出力されるディジタル信号
を再標本化するりサンプラ回w5%4は上記アナログテ
レビジョン信号L9アナログの水平同期信号rHムを分
離する同期分離回路、5はこの同期分離側w!14にエ
フ分離されたアナログの水平同期信号fHAをクロック
発生回路ILす出力されるサンプリングクロックf8テ
サンプリングするレジスタ、6は上記同期分離4にエフ
分離されたアナログの水平同期信号fHAとこのアナロ
グの水平同期信号fHAをレジスタ5でサンプリングし
たディジタルの水平同期信号fHDとの時間的ずれを検
出するずれ検出I!21路である。
る入力端子、2はこの入力端子1エクのアナログテレビ
ジョン信号をディジタル信号に変換するA/D変換器、
3はこのA/D変換器2工り出力されるディジタル信号
を再標本化するりサンプラ回w5%4は上記アナログテ
レビジョン信号L9アナログの水平同期信号rHムを分
離する同期分離回路、5はこの同期分離側w!14にエ
フ分離されたアナログの水平同期信号fHAをクロック
発生回路ILす出力されるサンプリングクロックf8テ
サンプリングするレジスタ、6は上記同期分離4にエフ
分離されたアナログの水平同期信号fHAとこのアナロ
グの水平同期信号fHAをレジスタ5でサンプリングし
たディジタルの水平同期信号fHDとの時間的ずれを検
出するずれ検出I!21路である。
8はディジタル信号が得られる出力端子である。
そして、クロック発生回路7エジ出力されるサンプリン
グクロックf s uA/ D変換器2に供給されると
共にレジスタ5とずれ検出回路6お工びリサンプラ回路
3にそれぞれ供給され、ま九、このリサンプラ回路3に
はずれ検出回路6の出力が供給される工うに構成されて
いる。
グクロックf s uA/ D変換器2に供給されると
共にレジスタ5とずれ検出回路6お工びリサンプラ回路
3にそれぞれ供給され、ま九、このリサンプラ回路3に
はずれ検出回路6の出力が供給される工うに構成されて
いる。
つぎにこの第1図に示す実施例の動作を説明する。
まず、入力端子1からのアナログテレビジョン信号をA
/D変換器2にエリディジタル信号に変換する。また、
入力端子1からのアナログテレビジョン信号は同期分1
lliIP!回路4にLvアナログの水平同期信号軸ム
が分離される。そして、この分離されたアナログの水平
同期信号fHAはレジスタ5にエリクロック発生回路T
1り出力されるサンプリングクロックfBでサンプリン
グされる。
/D変換器2にエリディジタル信号に変換する。また、
入力端子1からのアナログテレビジョン信号は同期分1
lliIP!回路4にLvアナログの水平同期信号軸ム
が分離される。そして、この分離されたアナログの水平
同期信号fHAはレジスタ5にエリクロック発生回路T
1り出力されるサンプリングクロックfBでサンプリン
グされる。
つぎに、同期分離回路4の出力であるアナログの水平同
期信号fHムとレジスタ5の出力であるディジタルの水
平同期信号fHDの時間的ずれをずれ検出口w+6で検
出する。そして、リサンプラ回路3では、このずれ検出
回路6にエフ検出された時間的ずれをもとに、A/D変
換器2で変換されたディジタル信号を重みづけ演算する
。
期信号fHムとレジスタ5の出力であるディジタルの水
平同期信号fHDの時間的ずれをずれ検出口w+6で検
出する。そして、リサンプラ回路3では、このずれ検出
回路6にエフ検出された時間的ずれをもとに、A/D変
換器2で変換されたディジタル信号を重みづけ演算する
。
第2図はta1図の動作説明に供するアナPグの水平同
期信号f、ムとディジタルの水平同期信号fHDの時間
的ずれを説明する念めの波形図で、(a)は入力水平同
期信号を示したものであり、伽)は同期分離回路4の出
力であるアナログの水平同期信号fHム、(C)はレジ
スタ5の出力であるデジタルの水平同期信号fHDs
(d)はりサンプラ回路3の出力を示したものである。
期信号f、ムとディジタルの水平同期信号fHDの時間
的ずれを説明する念めの波形図で、(a)は入力水平同
期信号を示したものであり、伽)は同期分離回路4の出
力であるアナログの水平同期信号fHム、(C)はレジ
スタ5の出力であるデジタルの水平同期信号fHDs
(d)はりサンプラ回路3の出力を示したものである。
そして、tは時間的ずれを示し、Sはサンプル点を示す
。
。
第3図は第1図におけるずれ検出回路6とリサンプラl
PjIM3に係る部分を抽出した実施例のブロック図で
ある。
PjIM3に係る部分を抽出した実施例のブロック図で
ある。
この第3図において、リサンプラ回路3における3−1
はディジタル信号の入力端、3−2.3−3はレジスタ
、3−4.3−5は乗算器、3−6は加算器、3−7は
重み係数発生回路、3−8はりサンプル信号出力端であ
る。また、ずれ検出回路6における6−1はアナログの
水平同期信号fH^の入力端、6−2はディジタルの水
平同期信号fHDの入力端、6−3はサンプリングクロ
ックf5の入力端、6−4は位相比較器、6−5はカウ
ンタである。そして、CKflクロックを示し、CLR
はクリアを示す。
はディジタル信号の入力端、3−2.3−3はレジスタ
、3−4.3−5は乗算器、3−6は加算器、3−7は
重み係数発生回路、3−8はりサンプル信号出力端であ
る。また、ずれ検出回路6における6−1はアナログの
水平同期信号fH^の入力端、6−2はディジタルの水
平同期信号fHDの入力端、6−3はサンプリングクロ
ックf5の入力端、6−4は位相比較器、6−5はカウ
ンタである。そして、CKflクロックを示し、CLR
はクリアを示す。
まず、ずれ検出I!?J略6においては、入力端6−1
から入力されたアナログの水平同期信号fHAと入力端
6−2から入力されたディジタルの水平同期信号fHD
の位相を位相比較器6−4により比較し、位相が一致し
たとき力9ンタ6−5をクリアする。
から入力されたアナログの水平同期信号fHAと入力端
6−2から入力されたディジタルの水平同期信号fHD
の位相を位相比較器6−4により比較し、位相が一致し
たとき力9ンタ6−5をクリアする。
そして、このアナログの水平同期信号f、ムとディジタ
ルの水平同期信号fHDの位相が一致するまでのディジ
タルの水平同期信号fHDの数をカウンタ6−5で計数
する。
ルの水平同期信号fHDの位相が一致するまでのディジ
タルの水平同期信号fHDの数をカウンタ6−5で計数
する。
つぎに、リサンプラ回路3においては、カウンタ6−5
の計数値をもとに重み係数発生回路3−7より重み係数
にお工び1−K(0≦に51)を発生させる。
の計数値をもとに重み係数発生回路3−7より重み係数
にお工び1−K(0≦に51)を発生させる。
そして、入力端3−1から入力されたディジタル信号は
レジスタ3−2.3−3と乗算器3−4゜3−5および
加算器3−6によりKx、 + (1−K)xlの喰み
づけ演算を行い、出力端3−8に出力される。ただし、
X!はレジスタ3−2の出力であり、xIハレジスタ3
−3の出力である。
レジスタ3−2.3−3と乗算器3−4゜3−5および
加算器3−6によりKx、 + (1−K)xlの喰み
づけ演算を行い、出力端3−8に出力される。ただし、
X!はレジスタ3−2の出力であり、xIハレジスタ3
−3の出力である。
つぎにその具体例を第4図を参照して説明する。
第3図の動作説明に供する具体例を示す説明図である@
4図の(a) 、 (b)において、Xr p X!
1lE3図におけるレジスタ3−3.3−2の各出力を
示し、Sはサンプル点、+rはリサンプラ回路3の出力
を示す。
4図の(a) 、 (b)において、Xr p X!
1lE3図におけるレジスタ3−3.3−2の各出力を
示し、Sはサンプル点、+rはリサンプラ回路3の出力
を示す。
第4図(a) 、 (b)においては、例えば、6ライ
ンおきにサンプル点Sがサンプリングクロックf、のI
クロック分ずれる場合には、リサンプラ回路3の出力金
は各ラインごとにそれぞれ重みづけられて出力される。
ンおきにサンプル点Sがサンプリングクロックf、のI
クロック分ずれる場合には、リサンプラ回路3の出力金
は各ラインごとにそれぞれ重みづけられて出力される。
このラインとりサンプラLl)J路の出力の関係を下記
表に示す。
表に示す。
以上説明した工うに、本発明によれば、従来のアナログ
テレビジョン信号をA/D変換器に1リデイジタル信号
に変換する装置において、アナログの水平同期信号とデ
ィジタルの水平同期信号の時間的ずれを検出し、その時
間的ずれに応じてサンプル値の重みづけを行い、補間す
ることに19tアナログの水平同期信号とディジタルの
水平同期信号の位相を合わせることができるので、実用
上の効果は極めて大である。
テレビジョン信号をA/D変換器に1リデイジタル信号
に変換する装置において、アナログの水平同期信号とデ
ィジタルの水平同期信号の時間的ずれを検出し、その時
間的ずれに応じてサンプル値の重みづけを行い、補間す
ることに19tアナログの水平同期信号とディジタルの
水平同期信号の位相を合わせることができるので、実用
上の効果は極めて大である。
第1図は不発明の一実施例を示すブロック図、taz図
は第1図の動作説明に供するアナログの水平同期信号と
ディジタルの水平同期信号の時間的ずれを説明するため
の波形図、第3図は第1図におけるずれ検出回路とりサ
ンプラ回路に係る部分を抽出して示した゛火廊例のブロ
ック図、第4図はH2S図の動作説明に供する具体例を
示す説明図である。 2・・・・アナログ−ディジタル変換器、3・・・・リ
サンブラ回路、4・・・・同期分離回路、5・・・−レ
ジスタ、6・・・・ずれ検出回路、7・・・・クロック
発生(9)略。
は第1図の動作説明に供するアナログの水平同期信号と
ディジタルの水平同期信号の時間的ずれを説明するため
の波形図、第3図は第1図におけるずれ検出回路とりサ
ンプラ回路に係る部分を抽出して示した゛火廊例のブロ
ック図、第4図はH2S図の動作説明に供する具体例を
示す説明図である。 2・・・・アナログ−ディジタル変換器、3・・・・リ
サンブラ回路、4・・・・同期分離回路、5・・・−レ
ジスタ、6・・・・ずれ検出回路、7・・・・クロック
発生(9)略。
Claims (1)
- アナログテレビジョン信号をディジタル信号に変換する
アナログ−ディジタル変換器と、このアナログ−ディジ
タル変換器より出力されるディジタル信号を再標本化す
るリサンプラ回路と、前記アナログテレビジョン信号を
入力とする同期分離回路により分離されたアナログの水
平同期信号と該アナログの水平同期信号をサンプリング
したディジタルの水平同期信号との時間的ずれを検出す
るずれ検出回路とを備えてなることを特徴とする同期標
本化回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30653286A JP2576104B2 (ja) | 1986-12-24 | 1986-12-24 | 同期標本化回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP30653286A JP2576104B2 (ja) | 1986-12-24 | 1986-12-24 | 同期標本化回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63160484A true JPS63160484A (ja) | 1988-07-04 |
JP2576104B2 JP2576104B2 (ja) | 1997-01-29 |
Family
ID=17958161
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP30653286A Expired - Lifetime JP2576104B2 (ja) | 1986-12-24 | 1986-12-24 | 同期標本化回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2576104B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0810784A2 (en) * | 1996-05-31 | 1997-12-03 | Analog Devices, Inc. | Video decoder |
-
1986
- 1986-12-24 JP JP30653286A patent/JP2576104B2/ja not_active Expired - Lifetime
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0810784A2 (en) * | 1996-05-31 | 1997-12-03 | Analog Devices, Inc. | Video decoder |
EP0810784A3 (en) * | 1996-05-31 | 1999-03-24 | Analog Devices, Inc. | Video decoder |
Also Published As
Publication number | Publication date |
---|---|
JP2576104B2 (ja) | 1997-01-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4994906A (en) | Digital luminance/chrominance separation apparatus | |
JPH0577990B2 (ja) | ||
JPS63160484A (ja) | 同期標本化回路 | |
JPH0638663B2 (ja) | デジタルテレビジョン信号処理装置用のクロック発生回路 | |
JPS63269697A (ja) | 同期標本化回路 | |
EP0486012B1 (en) | Image reduction processing apparatus | |
JP2610416B2 (ja) | Ntscデイジタルクロマ復調回路 | |
JP3500847B2 (ja) | 保護継電装置のサンプリング波形補正装置 | |
KR100261141B1 (ko) | 데이터 송수신시스템의 타이밍 복원장치 | |
JP2968730B2 (ja) | スキュー補正回路 | |
JPH05103347A (ja) | 標準映像信号のための同期信号再発生回路 | |
KR950000207Y1 (ko) | 텔레비젼 수상기의 인터리이브 검출회로 | |
JP2000253417A (ja) | デジタルacc回路 | |
JPH052039B2 (ja) | ||
JPS63144678A (ja) | 位相同期発振回路 | |
SU1383392A1 (ru) | Устройство дл вычислени спектра сигналов | |
JP3470450B2 (ja) | 色差信号復調器 | |
JPH0646814B2 (ja) | Ntsc適応型輪郭抽出フイルタ | |
JPH09205656A (ja) | 映像信号サンプリングレート変換装置 | |
JPS61205023A (ja) | D/a変換出力のグリツチ除去回路 | |
JPS60182280A (ja) | 画像処理装置 | |
JPS639242A (ja) | マルチプレツクス復調装置 | |
JPH04130895A (ja) | ビデオ信号のサンプリング点変換方式 | |
JPH09275575A (ja) | 映像信号処理装置 | |
JPH01293787A (ja) | 遅延誤差補正装置 |