JPS6281850A - 受信デ−タの最小ビツト検出方法 - Google Patents

受信デ−タの最小ビツト検出方法

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Publication number
JPS6281850A
JPS6281850A JP60220297A JP22029785A JPS6281850A JP S6281850 A JPS6281850 A JP S6281850A JP 60220297 A JP60220297 A JP 60220297A JP 22029785 A JP22029785 A JP 22029785A JP S6281850 A JPS6281850 A JP S6281850A
Authority
JP
Japan
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reception data
speed
signal
circuit
received data
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60220297A
Other languages
English (en)
Inventor
Motoi Sawatani
沢谷　基
Yoshinobu Fukuda
福田　吉展
Hiroyuki Sato
弘之 佐藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ando Electric Co Ltd
Original Assignee
Ando Electric Co Ltd
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Publication date
Application filed by Ando Electric Co Ltd filed Critical Ando Electric Co Ltd
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Priority to US06/914,685 priority patent/US4745621A/en
Priority to FR8613845A priority patent/FR2588400A1/fr
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Priority to CA000519760A priority patent/CA1262939A/en
Publication of JPS6281850A publication Critical patent/JPS6281850A/ja
Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L1/00—Arrangements for detecting or preventing errors in the information received
    • H04L1/20—Arrangements for detecting or preventing errors in the information received using signal quality detector
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00—Baseband systems
    • H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
    • H04L25/06—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection
    • H04L25/068—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection by sampling faster than the nominal bit rate

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Power Engineering (AREA)
  • Quality & Reliability (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Dc Digital Transmission (AREA)
  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 （ａ）発明の技術分野 この発明は、データ通信の受信データの中にタイミング
信号がない場合でも、この受信データの信号速度を求め
られるようにした受信データの最小ビット検出方法に関
するものである。
（ｂ）発明の［１的 データ通信で送信されるデータ信号には、通常タイミン
グ信号が含まれており、このタイミング信号から受信デ
ータの信号速度を求めることかできる。
しかし、データ信号の中にはタイミング信号を含んでい
ないものがあり、このようなデータ信号の信号速度を求
めるのは困難であった。
この発明は、タイミング信号か含まれていないデータ信
号を受信する場合でも、受信データのビット数よりもビ
ット数の多いす／ブリング信号により、受信データの信
号速度を求められるようにするものである。
（ｃ１発明の実施例 ます、この発明による実施例の構成図を第１図に示す。
第１図の１はサンプリング信号発生回路、２はラッチ回
路、３はメモリ、４はサーチ回路である。
サンプリング信号発生回路１は、ビット数ｍのす／プリ
ング信号を発生する。
ラッチ回路２は、受（３デ゛−夕をす／ブリノブ（。
号発生回路１の出力パルスです／プリングする。
受信データのビット数がｒｌのとき、ｍ　＞　ｎの関係
になるようにする。
例えば、受信データのｎが９６００ビット／秒のとき、
す／プリング信号のｍを１５０にビット／秒程度にする
。
メモリ３は、ラッチ回路２の出力を一時的に２臆させて
おくためのものである。
サーチ回路４は、メモリ３に記憶されたデータから同し
データが縁り返されている状態をサーチし、最小ビット
を検出する。
次に、第１同各部の実施例の波形図を第２図に示す０ 第２図（ア）は受信データの波形であり、第２図（イ）
はサンプリング信号発生回路１の出力波形である。
第２図（つ）はうｌ子回路２の出力波形であり、受信デ
ータの「１」のところだけが出力として取り出される。
第２図（つ）の信号出力かあるところを「１」とし、信
号出力のないところを「０」として、メモリ３に記憶す
る。
例えば、第２図（つ）で次のような信号出力が出たとす
る。
ｒｏｏｏｏ　１　ｔ　１　ｔ　ｉ　ｉ　ｉ　ｔ　ｔ　ｏ
ｏｏｏｏｏｏ。
００００００００１１１１１００００００００Ｊこの信
号は、「０」が４個、「１」が９個、「０」が２０個、
「１」が９個、ｒＯＪが９個、「１」が５個、「０」が
８個という順序に出てきている。
第１図のサーチ回路４は、メモリ３の出力を入力順に比
較していき、最小ビットのものを残していく。
上の例では、ビット数が４→９→２０→９→９呻５→８
と変化しているが、最初の４を除き、最小ビットは５と
いうことになる。
この発明は、例示の信号の最小ビットをサンプリングパ
ルスの５倍と判定する。す／プリングパルスの時間は既
知なので、受信データの信号速ｊ１をこれから知ること
ができる。
なお、受信データが複数あり、信号速度があらかしめ分
かっているが、どの受信データか不明なような場合は、
サーチ回路４の出力からどの受信データかを判別するこ
とができるように、受信データに対応したビット数のサ
ンプリングパルスを出せるようにしておけばよい。
（ｄ１発明の効果 この発明によれば、受信データのビット数ｎよりも大き
いビット数ｍのサップリンパルスで受（Ｊｊデータをす
／ブリノブし、す／ブリング出力から最小ビットをサー
チし、この最小ビットから受信データの信号速度を求め
るようにしているので、タイミング信号を含まない受信
データでも信号速度を知ることができる。
【図面の簡単な説明】
第１図はこの発明による実施例の構成図、第２図は第１
図の実施例の波形図。 １・・・・・・す／ブリング信号発生回路、２・・・・
・・ラッチ回路、３・・・・・・メモリ、４・・・・・
・サーチ回路。

Claims (1)

  1. 【特許請求の範囲】 １　ビット数ｍのサンプリング信号を発生するサンプリ
    ング信号発生回路と、 ビット数ｎの受信データを前記サンプリング信号でサン
    プリングするラッチ回路と、 前記ラッチ回路の出力を記憶するメモリと、前記メモリ
    の出力から最小ビットをサーチするサーチ回路とを備え
    、 ｍ≫ｎとし、前記サーチ回路でサーチされた最小ビット
    から受信データの信号速度を求めることを特徴とする受
    信データの最小ビット検出方法。
JP60220297A 1985-10-04 1985-10-04 受信デ−タの最小ビツト検出方法 Pending JPS6281850A (ja)

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US06/914,685 US4745621A (en) 1985-10-04 1986-10-02 Method of and apparatus for detecting minimum bit number of received data
FR8613845A FR2588400A1 (fr) 1985-10-04 1986-10-03 Procede et dispositif de detection d'un nombre minimum de bits dans une donnee recue
DE19863633788 DE3633788A1 (de) 1985-10-04 1986-10-03 Verfahren und vorrichtung zur erfassung einer minimalen bitanzahl von empfangenen daten
CA000519760A CA1262939A (en) 1985-10-04 1986-10-03 Method of and apparatus for detecting minimum bit number of received data

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FR (1) FR2588400A1 (ja)

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FR2588400A1 (fr) 1987-04-10
DE3633788A1 (de) 1987-04-30
CA1262939A (en) 1989-11-14
US4745621A (en) 1988-05-17

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