JPS627770B2 - - Google Patents
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- Publication number
- JPS627770B2 JPS627770B2 JP11752280A JP11752280A JPS627770B2 JP S627770 B2 JPS627770 B2 JP S627770B2 JP 11752280 A JP11752280 A JP 11752280A JP 11752280 A JP11752280 A JP 11752280A JP S627770 B2 JPS627770 B2 JP S627770B2
- Authority
- JP
- Japan
- Prior art keywords
- pulse width
- noise
- circuit
- switching
- transformer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
- H02M3/325—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
- Power Conversion In General (AREA)
Description
【発明の詳細な説明】
本発明は種々の電子機器に用いて好適なスイツ
チング電源回路に関する。
チング電源回路に関する。
斯の種スイツチング電源回路として例えば第１
図に示すようなものが従来提案されている。すな
わち第１図において、電源プラグ１はヒユーズ
２、電源スイツチ３を介してブリツジ整流・平滑
回路４に接続され、整流・平滑回路４の出力端の
一方はトランス５の巻線５ａ、コイル６及びスイ
ツチングトランス７の１次巻線７ａを介してスイ
ツチング素子例えばトランジスタ８のコレクタに
接続され、整流・平滑回路４の出力端の他方はト
ランス５の巻線５ｂを介してトランジスタ８のエ
ミツタに接続される。
図に示すようなものが従来提案されている。すな
わち第１図において、電源プラグ１はヒユーズ
２、電源スイツチ３を介してブリツジ整流・平滑
回路４に接続され、整流・平滑回路４の出力端の
一方はトランス５の巻線５ａ、コイル６及びスイ
ツチングトランス７の１次巻線７ａを介してスイ
ツチング素子例えばトランジスタ８のコレクタに
接続され、整流・平滑回路４の出力端の他方はト
ランス５の巻線５ｂを介してトランジスタ８のエ
ミツタに接続される。
また巻線５ａ，５ｂの出力端間にコンデンサ
９，１０が直列接続され、コンデンサ９，１０の
共通接続点が破線で示すICのシールドケースに
接続される。更にコイル６の前後にコンデンサ１
１，１２が設けられる。そしてトランス５、コン
デンサ９，１０によりスイツチングノイズのコモ
ンノイズすなわち大地と＋Ｂ電源または大地とセ
ツトのアース間に生じるノイズを減少するための
フイルタを構成し、一方トランス５、コイル６、
コンデンサ１１，１２によりスイツチングノイズ
のノーマルノイズすなわちライン間に生じるノイ
ズを減少するためのフイルタを構成する。また電
源側より混入する外乱ノイズにもコモンノイズと
ノーマルノイズがあり、夫々上述のフイルタによ
り減少される。
９，１０が直列接続され、コンデンサ９，１０の
共通接続点が破線で示すICのシールドケースに
接続される。更にコイル６の前後にコンデンサ１
１，１２が設けられる。そしてトランス５、コン
デンサ９，１０によりスイツチングノイズのコモ
ンノイズすなわち大地と＋Ｂ電源または大地とセ
ツトのアース間に生じるノイズを減少するための
フイルタを構成し、一方トランス５、コイル６、
コンデンサ１１，１２によりスイツチングノイズ
のノーマルノイズすなわちライン間に生じるノイ
ズを減少するためのフイルタを構成する。また電
源側より混入する外乱ノイズにもコモンノイズと
ノーマルノイズがあり、夫々上述のフイルタによ
り減少される。
またコンデンサ１２の両端に抵抗器１３，１４
が直列接続され、これらの抵抗器１３，１４で分
割された入力電圧がパルス幅制限回路１５に供給
される。このパルス幅制限回路１５は入力電圧を
検出し、トランジスタ８にドライバ１６を介して
パルス幅変調器１７から供給されるパルス幅変調
信号のデユーテイレシオの最大値を制限する。つ
まりパルス幅変調信号のデユーテイレシオは０％
から100％まで可変し得るが、その両端まで作動
するとトランジスタ８が正常な動作をし得ないの
で、通常そのデユーテイレシオの最大値が例えば
50％、37.5％、31.3％等となるようにパルス幅制
限回路１５から制限パルスを加え、所定のデユー
テイレシオを有するパルス幅変調信号を得るよう
にしている。
が直列接続され、これらの抵抗器１３，１４で分
割された入力電圧がパルス幅制限回路１５に供給
される。このパルス幅制限回路１５は入力電圧を
検出し、トランジスタ８にドライバ１６を介して
パルス幅変調器１７から供給されるパルス幅変調
信号のデユーテイレシオの最大値を制限する。つ
まりパルス幅変調信号のデユーテイレシオは０％
から100％まで可変し得るが、その両端まで作動
するとトランジスタ８が正常な動作をし得ないの
で、通常そのデユーテイレシオの最大値が例えば
50％、37.5％、31.3％等となるようにパルス幅制
限回路１５から制限パルスを加え、所定のデユー
テイレシオを有するパルス幅変調信号を得るよう
にしている。
パルス幅変調器１７は、電源投入時始動用抵抗
器２２を介して供給されるキツク電流で動作開始
するもので、トランス７の３次巻線７ｃを介して
抵抗器１８，１９により検出した直流出力電圧の
一部を誤差検出回路２０で基準電圧と比較して得
た誤差信号により、その出力側に現われるパルス
幅を制御してパルス幅変調信号を発生する。この
パルス幅変調信号は上述の制限パルスによりその
デユーテイレシオの最大値を規制された上でドラ
イバ１６を介してトランジスタ８のベースに供給
され、もつてトランジスタ８のオン時間が制御さ
れ、整流・平滑回路２１の出力側には常に安定し
た直流出力電圧が得られる。
器２２を介して供給されるキツク電流で動作開始
するもので、トランス７の３次巻線７ｃを介して
抵抗器１８，１９により検出した直流出力電圧の
一部を誤差検出回路２０で基準電圧と比較して得
た誤差信号により、その出力側に現われるパルス
幅を制御してパルス幅変調信号を発生する。この
パルス幅変調信号は上述の制限パルスによりその
デユーテイレシオの最大値を規制された上でドラ
イバ１６を介してトランジスタ８のベースに供給
され、もつてトランジスタ８のオン時間が制御さ
れ、整流・平滑回路２１の出力側には常に安定し
た直流出力電圧が得られる。
ところで上述の如き構成をなす従来のスイツチ
ング電源回路の場合、パルス幅制限回路１５の入
力信号として抵抗器１３，１４で分割した電圧を
使用しているが、単に分割しただけではスイツチ
ングノイズがパルス幅制限回路１５の入力側に混
入し誤動作を生じるので抵抗器１４と並列にコン
デンサ２３を接続している。このため抵抗器１３
とコンデンサ２３の時定数によりパルス幅制限回
路１５の入力信号に遅れが生じてパルス幅制限回
路１５の動作が不完全なものとなる。
ング電源回路の場合、パルス幅制限回路１５の入
力信号として抵抗器１３，１４で分割した電圧を
使用しているが、単に分割しただけではスイツチ
ングノイズがパルス幅制限回路１５の入力側に混
入し誤動作を生じるので抵抗器１４と並列にコン
デンサ２３を接続している。このため抵抗器１３
とコンデンサ２３の時定数によりパルス幅制限回
路１５の入力信号に遅れが生じてパルス幅制限回
路１５の動作が不完全なものとなる。
そこで本発明ではコンデンサ２３を用いること
なくパルス幅制限回路１５の動作を完全なものと
なし得るスイツチング電源回路を提供するもので
ある。
なくパルス幅制限回路１５の動作を完全なものと
なし得るスイツチング電源回路を提供するもので
ある。
以下本発明の一実施例を第２図に基づいて詳し
く説明する。なお第２図において第１図と対応す
る部分には同一符号を付し、その詳細説明は省略
する。
く説明する。なお第２図において第１図と対応す
る部分には同一符号を付し、その詳細説明は省略
する。
本実施例では直列接続された抵抗器１３及び１
４をコンデンサ１１の両端に接続する。つまり外
乱ノイズを減少するフイルタとスイツチングノイ
ズを減少するフイルタの間よりパルス幅制限回路
１５の入力信号を取り出す。そして第１図の回路
で用いたコンデンサ２３は本実施例では削除す
る。その他は第１図の構成と同様である。
４をコンデンサ１１の両端に接続する。つまり外
乱ノイズを減少するフイルタとスイツチングノイ
ズを減少するフイルタの間よりパルス幅制限回路
１５の入力信号を取り出す。そして第１図の回路
で用いたコンデンサ２３は本実施例では削除す
る。その他は第１図の構成と同様である。
斯る構成により、スイツチングノイズのノーマ
ルノイズはトランス５、コイル６、コンデンサ１
１，１２により防止され、外乱ノイズのノーマル
ノイズはトランス５、コンデンサ１１により防止
され、スイツチングノイズ及び外乱ノイズのコモ
ンノイズは共にトランス５、コンデンサ９，１０
により防止される。
ルノイズはトランス５、コイル６、コンデンサ１
１，１２により防止され、外乱ノイズのノーマル
ノイズはトランス５、コンデンサ１１により防止
され、スイツチングノイズ及び外乱ノイズのコモ
ンノイズは共にトランス５、コンデンサ９，１０
により防止される。
そしてパルス幅制限回路１５にはコイル６、コ
ンデンサ１２の時定数回路（例えば10μＨ，100
μＦで32μＳの時定数）の前より抵抗器１３，１
４によつて入力電圧を分圧し、入力信号として供
給するようにしているので、第１図の如くスイツ
チングノイズが混入してパルス幅制限回路１５が
誤動作することもなく、しかもパルス幅制限回路
１５への入力信号の信号系には第１図の如き信号
遅延要因が介在せず、入力信号に遅れを生じるこ
ともないのでパルス幅制限回路１５の動作は完全
なものとなる。
ンデンサ１２の時定数回路（例えば10μＨ，100
μＦで32μＳの時定数）の前より抵抗器１３，１
４によつて入力電圧を分圧し、入力信号として供
給するようにしているので、第１図の如くスイツ
チングノイズが混入してパルス幅制限回路１５が
誤動作することもなく、しかもパルス幅制限回路
１５への入力信号の信号系には第１図の如き信号
遅延要因が介在せず、入力信号に遅れを生じるこ
ともないのでパルス幅制限回路１５の動作は完全
なものとなる。
上述の如く本発明によれば、入力側に異なる性
質のノイズ防止用の第１及び第２のフイルタすな
わち外乱ノイズ防止用のフイルタ及びスイツチン
グノイズ防止用のフイルタの間よりスイツチング
素子へ供給するパルス幅変調信号のパルス幅を制
限する信号を取り出すようにしたので、入力電圧
に対する追従性が向上されてパルス幅制限回路１
５の動作も完全なものとなり、もつて全体として
誤動作のない安定した動作特性を得ることができ
る。
質のノイズ防止用の第１及び第２のフイルタすな
わち外乱ノイズ防止用のフイルタ及びスイツチン
グノイズ防止用のフイルタの間よりスイツチング
素子へ供給するパルス幅変調信号のパルス幅を制
限する信号を取り出すようにしたので、入力電圧
に対する追従性が向上されてパルス幅制限回路１
５の動作も完全なものとなり、もつて全体として
誤動作のない安定した動作特性を得ることができ
る。
また従来回路で使用されていたコンデンサ２３
を削除できるのでコスト的にも廉価となる。
を削除できるのでコスト的にも廉価となる。
なお上述の実施例において、トランス５の巻線
５ａ，５ｂの一端とコンデンサ９，１０の一端の
間に夫々コイルが挿入されている場合でも同様に
本発明を適用できる。
５ａ，５ｂの一端とコンデンサ９，１０の一端の
間に夫々コイルが挿入されている場合でも同様に
本発明を適用できる。
第１図は従来回路の一例を示す回路構成図、第
２図は本発明の一実施例を示す回路構成図であ
る。 ５はトランス、６はコイル、８はスイツチング
用トランジスタ、９，１０，１１，１２はコンデ
ンサ、１３，１４は抵抗器、１５はパルス幅制限
回路、１７はパルス幅変調器である。
２図は本発明の一実施例を示す回路構成図であ
る。 ５はトランス、６はコイル、８はスイツチング
用トランジスタ、９，１０，１１，１２はコンデ
ンサ、１３，１４は抵抗器、１５はパルス幅制限
回路、１７はパルス幅変調器である。
Claims (1)
- １ 出力信号に応じて変化するパルス幅変調信号
をスイツチング素子に供給して一定の直流出力電
圧を得るスイツチング電源回路において、入力側
に異なる性質のノイズ防止用の第１及び第２のフ
イルタを設け、上記第１及び第２のフイルタの間
より上記パルス幅変調信号に関連する制御信号を
取り出すようにしたことを特徴とするスイツチン
グ電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11752280A JPS5743568A (en) | 1980-08-26 | 1980-08-26 | Switching power source circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11752280A JPS5743568A (en) | 1980-08-26 | 1980-08-26 | Switching power source circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5743568A JPS5743568A (en) | 1982-03-11 |
| JPS627770B2 true JPS627770B2 (ja) | 1987-02-19 |
Family
ID=14713852
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11752280A Granted JPS5743568A (en) | 1980-08-26 | 1980-08-26 | Switching power source circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5743568A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5992588U (ja) * | 1982-12-14 | 1984-06-23 | 株式会社京三製作所 | スイツチング・レギユレ−タ回路 |
-
1980
- 1980-08-26 JP JP11752280A patent/JPS5743568A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5743568A (en) | 1982-03-11 |
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