JPS6255564A - 不用デ−タサプレス機能付ロジツクアナライザ - Google Patents

不用デ−タサプレス機能付ロジツクアナライザ

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Publication number
JPS6255564A
JPS6255564A JP60195532A JP19553285A JPS6255564A JP S6255564 A JPS6255564 A JP S6255564A JP 60195532 A JP60195532 A JP 60195532A JP 19553285 A JP19553285 A JP 19553285A JP S6255564 A JPS6255564 A JP S6255564A
Authority
JP
Japan
Prior art keywords
circuit
data
logic analyzer
display
time
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP60195532A
Other languages
English (en)
Inventor
Tomiji Suzuki
鈴木 富二
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP60195532A priority Critical patent/JPS6255564A/ja
Publication of JPS6255564A publication Critical patent/JPS6255564A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は論理回路のデータ収集用測定器に関し。
特に論理回路のデータトレースを有効に活用できるよう
にした不用データサプレス機能付きのロジックアナライ
ザに関する。
(従来技術) 従来この種のロジックアナライザは、第2図に示す如き
構成を有し、メモリ容量の関係により第3図て示すよう
にサンプリング時間Tでサンプリングを行い、トリ°ガ
データを検出した時点の前後合せてIKバイト程程度管
表示するという方法をとっている。なお第2図で10は
測定端子、11゜は操作部、12は制御回路、13Vi
デ一タ収集回路、14は収集データの記憶回路、15は
表示回路、16はディスプレイである。
(発明が解決しようとする問題点) 上述した従来のロジックアナライザでは、トリガデータ
間隔が長くなった場合、表示範囲内定1デ一タ分しか表
示できず、サンプル時間Tt−犬きくすれば長い時間ト
レース可能になるがサンプル時間が大きいためデータを
検出できなかったり、あるいはデータの詳細がみれない
といった欠点があった。
本発明は、従来のロジックアナライザに不用データのサ
プライ機能を付加することにより上述の欠点を解決し、
必要データ部分のみを集めて1画面に表示させ得るよう
にした不用データサブレス機能付ロジックアナライザを
提供するものである。
(間頭点を解決するための手段) 本発明に係る不用データサプレス機能付ロジックアナラ
イザは、不用データのサプライ(削除)指示を管理する
手段と、有効データ部分の判断を行う手段と、従来のロ
ジックアナライザの記憶回路即ち従来の収集データ記憶
回路より有効データを引き出す手段と、この引き出しデ
ータを記憶する手段と、サプライ指示により情報ルート
の切り替えを行う切替手段とを有して成るものである。
(実施例) 次に1本発明を、1図面を参照しつつ実施例につき説明
する。
第1図は本発明の実施例に係る不用データサプレス機能
付ロジックアナライザのブロック図である。第1図を参
照すれば、本発明のロジックアナライザは、第2図に示
す従来のロジックアナライザに、検出データ前後の保持
時間設定およびデータサプレス起動を行うための第2の
操作部1.各回路の状態制御即ちデータサプレス状態の
管理を行う第2の制御回路2.この第2制御回路2から
の指示によりデータ取り込み時期の設定およびデータ編
集を行うデータ編集回路32編集後データを記憶する第
2の記憶回路4.および情報ルートの切り替えを行う切
替回路5を付加した構成となっている。なお、第1図と
第2図で同じ符号を付した部分は同じ機能部分を示して
いる。
次に本発明のロジックアナライザの動作を説明する。
(a)、まず操作部11より制御回路12に対してサン
プリング周期の設定、使用チャネル設定、トリガ条件設
定等の操作部行う。
(b)1次に第2の操作部1より第2の制御回路2に対
してサプレス機能の有無の設定を行う。そしてサプレス
機能&能有の場合、検出データ前後のデータ保持時間の
設定を行う。第4図に検出前後のデータ保持時間のタイ
ムチャートの例を示しである。
図中T1は検出前データ保持時間、T2は検出後データ
保持時間である。以下、サプレス機能有の場合を説明す
る。
(C)、操作部11よりトレース開始が指示されると、
第2の制御回路2はデータ編集回路3の起動および切替
回路5を、データ収集回路13→データ編集回路3.記
憶回路14→第2の記憶回路4のルートに設定する。ま
たデータ収集回路13に対してデータ検出後の遅延時間
を無限大に設定する。
(d)、データ収集回路13はトレース開始時期よりサ
ンプリングT毎に測定端子1oよりデータを収集し、記
憶回路14ヘデータを格納する。同時にトリガ条件の監
視を行い、トリガ発生時出力する。この時1表示回路に
行くルートは切替回路5により切断されているためトリ
ガ発生情報は表示回路15にはとどかない。しかし本情
報をデータ編集回路3においても取り込んでいるため発
生時期をデータ編集回路3が認知する。データ編集回路
3ではデータ収集回路13よりデータ格納アドレス情報
をもらっているため上記発生時期にアドレス情報を取り
込む。前記アドレス情報と第2の操作部1より設定され
た検出前後のデータ保持時 。
間(第4図Tl、T2)Kより、有効データサイズを計
算し、有効データ部分を記憶回路14がら第2の記憶回
路41/C転送する。上述の処理を前記第2の記憶回路
4が満杯(フル)になるまで繰り返す。この時1.扇集
回路3でけトリガ間隔のチェックも行い、かつデータサ
プレス時間の割り出しも行う。この第2の記憶回路4が
フルになった時点で表示回路15に対して表示要求およ
び該第2の記憶回路4に対してデータサプレス時量情報
全送出する。
(e)1表示回路15は第2の記憶回路41C格納され
ているデータをナイスプレイ16に表示する。
表示回路15けこの表示終了後画面の空スペースに各デ
ータ間のサプレス時間を表示する。
(f)、上記処理終了後、初期設定を行い、連続的に処
理を繰り返す。なお第3図でA部分のデータは収集でき
ない。
(発明の効果) 以上説明したように本発明は、従来のロジックアナライ
ザに不用データのサプレス機能を付加することにより、
論理回路のデータトレースを有効に活用できる効果があ
る。
【図面の簡単な説明】
第1図は本発明の実施例に係る不用データサプレス機能
付ロジックアナライザのブロック図、第2図は従来のロ
ジックアナライザのブロック図、第3図は本発明の実施
例の各部動作のタイムチャー4を示す図、第4図は検出
データ前後のデータ保持時間k 説明するためのタイム
チャートの例を示す図である。 1・・・第2の操作部、   2・・・第2の制御回路
。 3・・・データ編集回路、 4・・・第2の記憶回路、
5・・・切替回路、     10・・・測定端子、1
1・・・操作部、    12・・・制御回路、13・
・・データ収集回路、 14・・・収集データ記憶回路、  15・・・表示回
路、T・・・サンプリング時間、 TI、T2・・・データ保持時間。

Claims (1)

    【特許請求の範囲】
  1. ロジックアナライザにおいて、不用データのサプライ(
    削除)指示を管理する手段と、有効データ部分の判断を
    行う手段と、収集データ記憶回路より有効データを引き
    出す手段と、この引き出された有効データを記憶する手
    段と、サプライ指示により情報ルートの切り替えを行う
    切替手段とを有することを特徴とする不用データサプレ
    ス機能付ロジックアナライザ。
JP60195532A 1985-09-04 1985-09-04 不用デ−タサプレス機能付ロジツクアナライザ Pending JPS6255564A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60195532A JPS6255564A (ja) 1985-09-04 1985-09-04 不用デ−タサプレス機能付ロジツクアナライザ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60195532A JPS6255564A (ja) 1985-09-04 1985-09-04 不用デ−タサプレス機能付ロジツクアナライザ

Publications (1)

Publication Number Publication Date
JPS6255564A true JPS6255564A (ja) 1987-03-11

Family

ID=16342654

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60195532A Pending JPS6255564A (ja) 1985-09-04 1985-09-04 不用デ−タサプレス機能付ロジツクアナライザ

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JP (1) JPS6255564A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB2355308A (en) * 1999-06-21 2001-04-18 Tektronix Inc Data sample suppression in a multi-channel electronic instrument
JP2008155898A (ja) * 2006-12-26 2008-07-10 Hitachi Constr Mach Co Ltd 作業車両のステアリングシステム

Cited By (4)

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Publication number Priority date Publication date Assignee Title
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