JPS6226970A - 電荷検出回路 - Google Patents
電荷検出回路Info
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- JPS6226970A JPS6226970A JP60166477A JP16647785A JPS6226970A JP S6226970 A JPS6226970 A JP S6226970A JP 60166477 A JP60166477 A JP 60166477A JP 16647785 A JP16647785 A JP 16647785A JP S6226970 A JPS6226970 A JP S6226970A
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- switch
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/60—Noise processing, e.g. detecting, correcting, reducing or removing noise
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- Engineering & Computer Science (AREA)
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- Transforming Light Signals Into Electric Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は１次元イメージ・セシサ用検出ｅ駆動回路に関
する。
する。
従来、この種の電荷検出回路としては第２図の構成の回
路がある。
路がある。
第２図（こおいて、ＤＡＩφ〜ＤＡＩ ６４はそれぞれ
フォトダイオードであり、８Ａ１００〜５Ａ１６４はフ
ォトダイオードＤＡ１００〜ＤＡ１６４ のうちのひと
つを選択する為のアナログ・マルチプレクサであり、ア
ｔログ−スイッチ８ＩＡ１１、積分容量ＣＩＡＩＩ、及
び演算増幅器ＯＰ２は蓄積回路を構成している。バイア
ス道ＦＥ源ＶＢ２は演算増幅器ＯＰ２の非反転入力端子
にバイアス電圧を供給している。
フォトダイオードであり、８Ａ１００〜５Ａ１６４はフ
ォトダイオードＤＡ１００〜ＤＡ１６４ のうちのひと
つを選択する為のアナログ・マルチプレクサであり、ア
ｔログ−スイッチ８ＩＡ１１、積分容量ＣＩＡＩＩ、及
び演算増幅器ＯＰ２は蓄積回路を構成している。バイア
ス道ＦＥ源ＶＢ２は演算増幅器ＯＰ２の非反転入力端子
にバイアス電圧を供給している。
その動作を説明すると、まづ、アナログ・スイッチ５Ａ
１００〜８Ａ１６３ がオフ状態であり、８ＩＡ１１が
オフ状態であるとき、積分容１ＣＩＡｌｌは′這荀遣が
１０”となっており、従って出力電圧ｖｏ＝Ｑが現われ
ている。次にアナログ・スイッチａＩＡ１１をオフ状態
にし、アナログ・マルチプレクサ中のアナログ−スイッ
チ８Ａ１００をオン状態にしてフォトダイオードＤＡ１
００を選択すると、光入力によって同フォトダイオード
に発生していた電荷が積分回路へ移動し、積分容量５Ｉ
ＡＩＩの両端に電荷に対応した電圧が発生して出力電圧
ｖｓが得られる。
１００〜８Ａ１６３ がオフ状態であり、８ＩＡ１１が
オフ状態であるとき、積分容１ＣＩＡｌｌは′這荀遣が
１０”となっており、従って出力電圧ｖｏ＝Ｑが現われ
ている。次にアナログ・スイッチａＩＡ１１をオフ状態
にし、アナログ・マルチプレクサ中のアナログ−スイッ
チ８Ａ１００をオン状態にしてフォトダイオードＤＡ１
００を選択すると、光入力によって同フォトダイオード
に発生していた電荷が積分回路へ移動し、積分容量５Ｉ
ＡＩＩの両端に電荷に対応した電圧が発生して出力電圧
ｖｓが得られる。
しかし、上述の従来の電荷検出回路では、アナログ・ス
イッチがオン状態からオフ状態に変化する際に発生する
雑音、いわゆるフィード−スルーが影響が大きく、特に
微少な電荷を検出する場合、８／Ｎ比の低下を招くとい
う欠点があった。
イッチがオン状態からオフ状態に変化する際に発生する
雑音、いわゆるフィード−スルーが影響が大きく、特に
微少な電荷を検出する場合、８／Ｎ比の低下を招くとい
う欠点があった。
更に、第２図における節点ＴＰλ２には６４個のアナロ
グ・スイッチが接続されており、それらアナログ・スイ
ッチの寄生容量、布線容量が、積分回路の動作速度を低
下させ、同節点ＴＰＡ２に残留電圧が生じることが多い
。例えば、第２図番こ８いてフォトダイオードＤＡ１０
０を選択した後、フォトダイオ−１０人１１１を選択し
たとすると、フォトダイオードＤム１１１からの電荷に
０人１００の電荷の一部が混入する。
グ・スイッチが接続されており、それらアナログ・スイ
ッチの寄生容量、布線容量が、積分回路の動作速度を低
下させ、同節点ＴＰＡ２に残留電圧が生じることが多い
。例えば、第２図番こ８いてフォトダイオードＤＡ１０
０を選択した後、フォトダイオ−１０人１１１を選択し
たとすると、フォトダイオードＤム１１１からの電荷に
０人１００の電荷の一部が混入する。
本発明の目的は、アナログ・スイッチより発生するフィ
ード・スルーの影響を低減すると共に、選択していない
フォトダイオードの電荷の影響を低減することにある。
ード・スルーの影響を低減すると共に、選択していない
フォトダイオードの電荷の影響を低減することにある。
その為に、本発明の電荷検出回路は、ダミー−アナログ
−スイッチとダミー−キャパシタを付加された全差動構
成を有し、フォトダイオードを選択する為のアナログ−
マルチプレクサと積分回路の間ζこ茶１及び第２のアナ
ログ・スイッチを有し、それぞれのアナログ−スイッチ
の一端が第３及び第４のアナログｅスイッチを介してバ
イアス電圧源に接続される構成を有する。
−スイッチとダミー−キャパシタを付加された全差動構
成を有し、フォトダイオードを選択する為のアナログ−
マルチプレクサと積分回路の間ζこ茶１及び第２のアナ
ログ・スイッチを有し、それぞれのアナログ−スイッチ
の一端が第３及び第４のアナログｅスイッチを介してバ
イアス電圧源に接続される構成を有する。
以下、本発明の実施例について図面を参照して説明する
。
。
第３図は本発明の一実施例である。ＤＡＯ〜ＤＡｓ ３
はフォトダイオードであり、８ＡＯ〜Ｓ人６３はフォト
ダイオ−１０人０〜Ｄλ６３をそれぞれ選択する為のア
ナログ・スイッチである。
はフォトダイオードであり、８ＡＯ〜Ｓ人６３はフォト
ダイオ−１０人０〜Ｄλ６３をそれぞれ選択する為のア
ナログ・スイッチである。
ＣＤＯ〜Ｃ８６３はフォトダイオードＤム０〜Ｄ人６３
の逆方向接合容量と同じ値を有するダミー・キャパシタ
であり、８ＢＱ〜８Ｂ６３はアナログ−スィッチ８ＡＯ
〜８人６３とほぼ同じ大きさのアナログ−スイッチであ
る。ＯＰＩは全差動演算増幅器、８ＩＡ１，８ＩＢ１は
アナログ−スイッチ、ＣｌＡ１ 、ＣｌＢ１は同じ値を
持つ積分容量である。また、８ＸＡ２．５ＸＢ２は積分
回路とアナログ−マルチプレクサを分離する為のアナロ
グ・スイッチであり、８ＸＡ１．８ＸＢ１は、それぞれ
節点ＴＰ人１．ＴＰＢＩへバイアス電圧源ＶＢＩの゛電
圧を供給する為のアナログｅスイッチである。ＶＢＩは
バイアス電圧源であり、ＶＳＳは負の電源線である。
の逆方向接合容量と同じ値を有するダミー・キャパシタ
であり、８ＢＱ〜８Ｂ６３はアナログ−スィッチ８ＡＯ
〜８人６３とほぼ同じ大きさのアナログ−スイッチであ
る。ＯＰＩは全差動演算増幅器、８ＩＡ１，８ＩＢ１は
アナログ−スイッチ、ＣｌＡ１ 、ＣｌＢ１は同じ値を
持つ積分容量である。また、８ＸＡ２．５ＸＢ２は積分
回路とアナログ−マルチプレクサを分離する為のアナロ
グ・スイッチであり、８ＸＡ１．８ＸＢ１は、それぞれ
節点ＴＰ人１．ＴＰＢＩへバイアス電圧源ＶＢＩの゛電
圧を供給する為のアナログｅスイッチである。ＶＢＩは
バイアス電圧源であり、ＶＳＳは負の電源線である。
次に、各アナログ・スイッチのオンオフ変化の様子を示
す第３図を用いて第１図の回路動作を説明する。
す第３図を用いて第１図の回路動作を説明する。
期間Ｔｌのとき、アナログ−スイッチ８人０〜８Ａ６３
．８ＢＯ〜８Ｂ５３ 、ＳＸ人２ 、５ＸＢ２がオフ状
態であり、一方、アナログ・スイッチ５ＸＡＩ、８ＸＢ
１，５ＩＡｘ、８ＩＢ１にオン状態である。したがって
、この期間では、積分容量ＣｌＡｌ 、ＣＩＢＩは短絡
されており、出力電圧ＶＯ＝Ｑとなる。また、寄生容量
、布線容量の多い節点ＴＰＡＩ 、ＴＰＢＩはＳＸ人１
．８ＸＢ１を介してバイアス電圧源ＶＢＩに接続されて
バイアス電圧源の電圧に光重されている。
．８ＢＯ〜８Ｂ５３ 、ＳＸ人２ 、５ＸＢ２がオフ状
態であり、一方、アナログ・スイッチ５ＸＡＩ、８ＸＢ
１，５ＩＡｘ、８ＩＢ１にオン状態である。したがって
、この期間では、積分容量ＣｌＡｌ 、ＣＩＢＩは短絡
されており、出力電圧ＶＯ＝Ｑとなる。また、寄生容量
、布線容量の多い節点ＴＰＡＩ 、ＴＰＢＩはＳＸ人１
．８ＸＢ１を介してバイアス電圧源ＶＢＩに接続されて
バイアス電圧源の電圧に光重されている。
期間Ｔ２のとき、スイッチ８ＡＯはオン状態、８人１〜
５Ａ６３はオフ状態、８ＸＡ１．５ＸＢＩ参８ＩＡ１，
８ＩＢ１はオフ状態、そしてＳＸλ２゜８ＸＢ２はオン
状態となっている。この期間では、フォトダイオードＤ
ＡＱはスイッチ８人２を介して積分回路へ接続され、ま
たダミー・キャパシタＣＢＯはダミー−スイッチ８ＸＢ
２を介して積分回路へ接続される。フォトダイオードＤ
ＡＯに発生していた電荷は積分回路へ移動し、積分容量
Ｃｌ人１は電圧を発生させる。ダミー−キャパシタＣＢ
Ｑには電荷の発生がないので積分容量ＣＩＢＩに電圧の
発生はない。
５Ａ６３はオフ状態、８ＸＡ１．５ＸＢＩ参８ＩＡ１，
８ＩＢ１はオフ状態、そしてＳＸλ２゜８ＸＢ２はオン
状態となっている。この期間では、フォトダイオードＤ
ＡＱはスイッチ８人２を介して積分回路へ接続され、ま
たダミー・キャパシタＣＢＯはダミー−スイッチ８ＸＢ
２を介して積分回路へ接続される。フォトダイオードＤ
ＡＯに発生していた電荷は積分回路へ移動し、積分容量
Ｃｌ人１は電圧を発生させる。ダミー−キャパシタＣＢ
Ｑには電荷の発生がないので積分容量ＣＩＢＩに電圧の
発生はない。
期間Ｔ３のとき、スイッチ８Ａφ、ＳＢφは依然オン状
態、ＳＡ、１〜８Ａ５３．８Ｂ１〜５ｆ３６３はオフ状
態、そしてＳＸλ２．５ＸＢ２はオフ状態である。この
期間では、５ＩＡＩ、５ＩＢＩがオン状態であり、全差
動演算増幅器の反転入力端子と非反転出力端子が短絡さ
れ、非反転入力端子と反転出力端子が短絡され、積分容
１ｉｃＩＡ１゜ＣｌＢ１は、電荷力げ０”であり、出力
電圧Ｖ。
態、ＳＡ、１〜８Ａ５３．８Ｂ１〜５ｆ３６３はオフ状
態、そしてＳＸλ２．５ＸＢ２はオフ状態である。この
期間では、５ＩＡＩ、５ＩＢＩがオン状態であり、全差
動演算増幅器の反転入力端子と非反転出力端子が短絡さ
れ、非反転入力端子と反転出力端子が短絡され、積分容
１ｉｃＩＡ１゜ＣｌＢ１は、電荷力げ０”であり、出力
電圧Ｖ。
２０となっている。また、フォトダイオードＤＡＯは８
ＸＡ１を介してバイアス電圧源ＶＢＩで充電される。
ＸＡ１を介してバイアス電圧源ＶＢＩで充電される。
期間Ｔ４．Ｔ５のときには、８Ａｏ 、８Ａ２〜Ｓ入６
３．ＳＢＯ，ＳＢ２〜８Ｂ６３はオフ状態であり、８人
１．ＳＢＩがオン状態となり、５ＸＡＩ 、５ＸＩ３１
，８ＩＡｌ 、８Ｉ）３１ 。
３．ＳＢＯ，ＳＢ２〜８Ｂ６３はオフ状態であり、８人
１．ＳＢＩがオン状態となり、５ＸＡＩ 、５ＸＩ３１
，８ＩＡｌ 、８Ｉ）３１ 。
８ＸＡ２ 、８ＸＢ２ハソレソレＪｔＪ］Ｉｆｊ３Ｔ
２ 、 Ｔ ３ト同様にオン、オフとなり、以丁同僅に
繰り返される。
２ 、 Ｔ ３ト同様にオン、オフとなり、以丁同僅に
繰り返される。
本実ｂｔｐ例においてはフォトダイオードＤＡＱ。
ＤＡ６３に対応するダミー・キャパシタＣ’ＢＱ〜ＣＢ
６３を設け、アナログ−スイッチ８ＡＯ〜８Ａ６３に対
もするダミー・アナログ・スイッチ８ＢＯ〜８Ｂ６３を
設け、回路全体を全差動構成とした為、同相成分から成
るアナログ−スイッチのフィード・スルーは相殺され、
出力ＶＱにはフォトダイオードｌ）入０〜Ｉ）＆６３に
発生した電荷に対応した電圧のみが現われる。
６３を設け、アナログ−スイッチ８ＡＯ〜８Ａ６３に対
もするダミー・アナログ・スイッチ８ＢＯ〜８Ｂ６３を
設け、回路全体を全差動構成とした為、同相成分から成
るアナログ−スイッチのフィード・スルーは相殺され、
出力ＶＱにはフォトダイオードｌ）入０〜Ｉ）＆６３に
発生した電荷に対応した電圧のみが現われる。
また、本実袴例では、電荷を積分回路に移し終った後、
例えば、Ｔ３．Ｔ５０期間、フォトダイオードにバイア
ス電圧１ｖＢ１からアナログ、スイッチ５ＸＡＩを介し
て充電される。一般に全差動演算ｊ’Ｊ ’ＰＭ ２Ｓ
の出力インピーダンスより、アナログ・ス／「ツチＳＸ
人１のオン「１♀インピーダンスの方が低いので、フォ
トダイオード及び、１２人１に付く寄生容量、布線容量
は速やかに充電され、動作速度の向上、す曵図れる。
例えば、Ｔ３．Ｔ５０期間、フォトダイオードにバイア
ス電圧１ｖＢ１からアナログ、スイッチ５ＸＡＩを介し
て充電される。一般に全差動演算ｊ’Ｊ ’ＰＭ ２Ｓ
の出力インピーダンスより、アナログ・ス／「ツチＳＸ
人１のオン「１♀インピーダンスの方が低いので、フォ
トダイオード及び、１２人１に付く寄生容量、布線容量
は速やかに充電され、動作速度の向上、す曵図れる。
以上説明したように本発明は第１に′４荷検出米子と等
しいインピーダンスを有する素子、つまり通常のフォト
ダイオードの場合はキャパシタと、それらを選択する為
のアナログ自マルチプレクサを設けて全差動構成を形成
し、第２にアナログ・マルチプレクサと積分回路の間に
アナログ−スイッチを設けた。
しいインピーダンスを有する素子、つまり通常のフォト
ダイオードの場合はキャパシタと、それらを選択する為
のアナログ自マルチプレクサを設けて全差動構成を形成
し、第２にアナログ・マルチプレクサと積分回路の間に
アナログ−スイッチを設けた。
この構成により、アナログ・スイッチのオン。
オフに際して発生するフィルド−スルーを相殺して約０
．１ｐｃ の倣少畦荷の検出をＳＮ比３０ｄＢ以上で行
える。また、アナログ−マルチプレクサ付く寄生容量、
布線容Ｉを分離してｍ分回路を動作させることを可能ｌ
こし、積分回路の動作速度の向上が実現される。さらに
、同寄生容量、布線容量の充電は、バイアス電圧源より
インピーダンスの低いアナログ−スイッチを介して行い
、動作速度の向上と残留電圧の低減が図れる。動作速度
は従来の１素子肖り１０μｓから１素子当り１μｓに向
上した。
．１ｐｃ の倣少畦荷の検出をＳＮ比３０ｄＢ以上で行
える。また、アナログ−マルチプレクサ付く寄生容量、
布線容Ｉを分離してｍ分回路を動作させることを可能ｌ
こし、積分回路の動作速度の向上が実現される。さらに
、同寄生容量、布線容量の充電は、バイアス電圧源より
インピーダンスの低いアナログ−スイッチを介して行い
、動作速度の向上と残留電圧の低減が図れる。動作速度
は従来の１素子肖り１０μｓから１素子当り１μｓに向
上した。
第１図は本発明の一実施例を示す回路図であり、第２図
は従来例の回路図であり、第３図は第１図の回路の動作
を説明する為の信号波形図である。 ＤＡＯ，ＤＡ ６３・・・・・・フォトダイオード。 Ｃ’ＢＯ５ＣＢ６３・・・・・・キャパシタ、８ＡＱ〜
８人６３．８ＢＯ〜８Ｂ５３・・山・アナログ・スイッ
チ、ＯＰＩ・・・・・・全差動演算増幅器、ｓ’ｒＡｔ
。 ８ＩＢ１．５ＸＡ１，８ＸＡ２．８ＸＢ１ 。 ５ｘｎ２・・・中アナログ・スイッチ、ＣｌＡｌ。 ＣＩＢＩ・・・・・・積分容量Ｖ Ｂ Ｉ ・、川・バ
イアスｖｔＩｌｌＥ源、ＤＡＩＩＩ〜Ｄ人１６３・・・
・・・フォトダイオード、５ＡＩＩＩ〜８Ａ１６３・・
・・・・アナログ・スイッチ、ＯＦ２・・・・−・演舅
窄幅器、５ＩＡＩＩ・・・・・・アナログ・スイッチ、
ＣｌＡｌ １・・・・・・積分容量。 ＶＢ２…ψ・・バイアス電圧源。 キ、・ハ゛シｑ 半 ２ 凹
は従来例の回路図であり、第３図は第１図の回路の動作
を説明する為の信号波形図である。 ＤＡＯ，ＤＡ ６３・・・・・・フォトダイオード。 Ｃ’ＢＯ５ＣＢ６３・・・・・・キャパシタ、８ＡＱ〜
８人６３．８ＢＯ〜８Ｂ５３・・山・アナログ・スイッ
チ、ＯＰＩ・・・・・・全差動演算増幅器、ｓ’ｒＡｔ
。 ８ＩＢ１．５ＸＡ１，８ＸＡ２．８ＸＢ１ 。 ５ｘｎ２・・・中アナログ・スイッチ、ＣｌＡｌ。 ＣＩＢＩ・・・・・・積分容量Ｖ Ｂ Ｉ ・、川・バ
イアスｖｔＩｌｌＥ源、ＤＡＩＩＩ〜Ｄ人１６３・・・
・・・フォトダイオード、５ＡＩＩＩ〜８Ａ１６３・・
・・・・アナログ・スイッチ、ＯＦ２・・・・−・演舅
窄幅器、５ＩＡＩＩ・・・・・・アナログ・スイッチ、
ＣｌＡｌ １・・・・・・積分容量。 ＶＢ２…ψ・・バイアス電圧源。 キ、・ハ゛シｑ 半 ２ 凹
Claims (1)
- 【特許請求の範囲】 複数の電荷検出素子と、所定の電荷検出素子を選択する
為の第１のマルチプレクサと、上記電荷検出素子と実質
的に等しいインピーダンスを有するインピーダンス素子
と、所定のインピーダンス素子を選択する第２のマルチ
プレクサと、第１および第２のマルチプレクサの出力を
受ける差動積分回路と、第１および第２のマルチ プルクサと積分回路との間にそれぞれ設けられた第１及
び第２のスイッチと、これら第１及び第２のスイッチの
、前記マルチプレクサ側の端子をバイアス電圧源に結合
する第３および第４のスイッチとを有することを特徴と
する電荷検出回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60166477A JPS6226970A (ja) | 1985-07-26 | 1985-07-26 | 電荷検出回路 |
| US06/891,354 US4763197A (en) | 1985-07-26 | 1986-07-28 | Charge detecting circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60166477A JPS6226970A (ja) | 1985-07-26 | 1985-07-26 | 電荷検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6226970A true JPS6226970A (ja) | 1987-02-04 |
Family
ID=15832122
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60166477A Pending JPS6226970A (ja) | 1985-07-26 | 1985-07-26 | 電荷検出回路 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4763197A (ja) |
| JP (1) | JPS6226970A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05221425A (ja) * | 1992-02-13 | 1993-08-31 | Niigata Eng Co Ltd | 箱の蓋と箱本体の分離方法 |
Families Citing this family (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63100879A (ja) * | 1986-10-17 | 1988-05-02 | Hitachi Ltd | 固体撮像装置 |
| GB8802381D0 (en) * | 1988-02-03 | 1988-03-02 | Crosfield Electronics Ltd | Signal processing circuit & method |
| US4904861A (en) * | 1988-12-27 | 1990-02-27 | Hewlett-Packard Company | Optical encoder using sufficient inactive photodetectors to make leakage current equal throughout |
| US4998013A (en) * | 1988-12-27 | 1991-03-05 | Hewlett-Packard Company | Optical encoder with inactive photodetectors |
| JPH04154166A (ja) * | 1990-10-18 | 1992-05-27 | Fuji Xerox Co Ltd | イメージセンサ |
| JP2513084B2 (ja) * | 1991-01-11 | 1996-07-03 | 富士ゼロックス株式会社 | イメ−ジセンサ及びその駆動方法 |
| FR2774235B1 (fr) * | 1998-01-23 | 2000-06-16 | Proengin | Dispositif d'amplification d'un signal de faible intensite |
| JP4390881B2 (ja) * | 1998-12-02 | 2009-12-24 | 浜松ホトニクス株式会社 | 光検出装置 |
| US6133615A (en) * | 1998-04-13 | 2000-10-17 | Wisconsin Alumni Research Foundation | Photodiode arrays having minimized cross-talk between diodes |
| WO2001065840A1 (fr) * | 2000-02-29 | 2001-09-07 | Hamamatsu Photonics K.K. | Circuit de lecture de signal |
| TWI458266B (zh) * | 2011-11-30 | 2014-10-21 | Sitronix Technology Corp | Analog - to - digital converter |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5257718A (en) * | 1975-11-07 | 1977-05-12 | Victor Co Of Japan Ltd | Self-scanning type image sensor |
| JPS54130828A (en) * | 1978-03-31 | 1979-10-11 | Canon Inc | Photo sensor array device and image scanner using it |
| US4484223A (en) * | 1980-06-12 | 1984-11-20 | Canon Kabushiki Kaisha | Image sensor |
| US4562475A (en) * | 1984-03-15 | 1985-12-31 | Rca Corporation | DC Restoration of synchronously detected CCD imager output signals |
-
1985
- 1985-07-26 JP JP60166477A patent/JPS6226970A/ja active Pending
-
1986
- 1986-07-28 US US06/891,354 patent/US4763197A/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05221425A (ja) * | 1992-02-13 | 1993-08-31 | Niigata Eng Co Ltd | 箱の蓋と箱本体の分離方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| US4763197A (en) | 1988-08-09 |
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