JPS62236055A - Eeprom機密保持回路 - Google Patents
Eeprom機密保持回路Info
- Publication number
- JPS62236055A JPS62236055A JP61079710A JP7971086A JPS62236055A JP S62236055 A JPS62236055 A JP S62236055A JP 61079710 A JP61079710 A JP 61079710A JP 7971086 A JP7971086 A JP 7971086A JP S62236055 A JPS62236055 A JP S62236055A
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- JP
- Japan
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- data
- input
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- eeprom
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- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims description 2
- 230000002401 inhibitory effect Effects 0.000 abstract 2
- 238000013500 data storage Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000014759 maintenance of location Effects 0.000 description 3
- 230000007812 deficiency Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
Landscapes
- Storage Device Security (AREA)
- Read Only Memory (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は電気的に消去可能な本揮発性半導体メモリ(以
下EEPROMと略す)に関するものである。
下EEPROMと略す)に関するものである。
従来の技術
従来、E E F ROMは電気的にデータを容易に書
き替えることが出来、また任意にデータを読み出すこと
が出来る。
き替えることが出来、また任意にデータを読み出すこと
が出来る。
発明が解決しようとする問題点
このため、データの保持および機密保持上大きな欠陥が
ある。
ある。
特にICカード等に応用した場合、重大な問題となる。
本発明はEEPROMの機密保持、データの保持を保証
する手段を提供することを目的としている。
する手段を提供することを目的としている。
問題点を解決するための手段
本発明は上記問題点を解決するため、EEPROMメモ
リセル・トランジスタ・アレイに暗号記憶部を有し、か
つこの暗号データと入出力端子に与えられたデータとを
比較するデータ比較回路部を有し、またこの2つのデー
タが異なる場合データの書き替え、読み出しを禁止する
書き替え読み出し禁止回路を有するものである。
リセル・トランジスタ・アレイに暗号記憶部を有し、か
つこの暗号データと入出力端子に与えられたデータとを
比較するデータ比較回路部を有し、またこの2つのデー
タが異なる場合データの書き替え、読み出しを禁止する
書き替え読み出し禁止回路を有するものである。
作 用
本発明は上記した構成により、暗号データと入出力端子
に与えられたデータとを比較してこの2つのデータが異
なる場合書き替え、読み出しを禁止する。
に与えられたデータとを比較してこの2つのデータが異
なる場合書き替え、読み出しを禁止する。
実施例
図は本発明実施例の機密保持、データ保持機能ヲ有スる
EEPROMの構成ブロック図を示す。
EEPROMの構成ブロック図を示す。
暗号データ記憶部を含んだEEPROMメモリ・セル・
アレイ部1.データ比較部2.書き替え読み出し禁止回
路部3.Xデコーダ部4.Yデコーダ部s、Yゲート部
e、入出力回路部7.制御回路部8.昇圧回路部9から
構成される。
アレイ部1.データ比較部2.書き替え読み出し禁止回
路部3.Xデコーダ部4.Yデコーダ部s、Yゲート部
e、入出力回路部7.制御回路部8.昇圧回路部9から
構成される。
暗号データ記憶部にはあらかじめ特定のデータが書き込
まれている。EEFROMメモリセルアレイ部1の書き
込み/消去および読み出しの各サイクルの前には入出力
端子I10φ〜7に暗号データを入力しなければならな
い。暗号データ記憶部に7. 記憶されているデ
ータと入出力端子に与えられたデータはデータ比較部に
よって比較され異なる場合は書き替え読み出し禁止回路
によって書き替え、読み出しが禁止される。2つのデー
タが等しい場合にのみ書き替え、読み出しが許可される
。
まれている。EEFROMメモリセルアレイ部1の書き
込み/消去および読み出しの各サイクルの前には入出力
端子I10φ〜7に暗号データを入力しなければならな
い。暗号データ記憶部に7. 記憶されているデ
ータと入出力端子に与えられたデータはデータ比較部に
よって比較され異なる場合は書き替え読み出し禁止回路
によって書き替え、読み出しが禁止される。2つのデー
タが等しい場合にのみ書き替え、読み出しが許可される
。
発明の効果
本発明によると、EEPROMメモリ・セル・アレイに
暗号記憶部を設け、入力されたデータと比較することに
より、2つのデータが異なる場合、データの書き替え、
読み出した禁止することによりEEPROMのデータの
保持、機密保持という効果を得ることが出来る。
暗号記憶部を設け、入力されたデータと比較することに
より、2つのデータが異なる場合、データの書き替え、
読み出した禁止することによりEEPROMのデータの
保持、機密保持という効果を得ることが出来る。
図は本発明実施例の構成ブロック図である。
1・・・・・・EEPROMメモリ・セル・アレイ部、
2・・・・・・データ比較部、3・・・・・・書き替え
・読出し禁止回路、4・・・・・・Xデコーダ、5・・
・・・・Yデコーダ、6・・・・・・Yゲート、7・・
・・・・入出力回路、8・・・・・・制御回路、9・・
・・・・昇圧回路。
2・・・・・・データ比較部、3・・・・・・書き替え
・読出し禁止回路、4・・・・・・Xデコーダ、5・・
・・・・Yデコーダ、6・・・・・・Yゲート、7・・
・・・・入出力回路、8・・・・・・制御回路、9・・
・・・・昇圧回路。
Claims (1)
- 電気的に消去可能な半導体不揮発性メモリ・セル・トラ
ンジスタ・アレイに暗号記憶部を有するとともにこの暗
号データと入出力端子に与えられたデータとを比較する
データ比較回路部を有し、この2つのデータが異なる場
合データの書き替え、読み出しを禁止する書き替え、読
み出し禁止回路を有することを特徴とするEEPROM
機密保待回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61079710A JPS62236055A (ja) | 1986-04-07 | 1986-04-07 | Eeprom機密保持回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61079710A JPS62236055A (ja) | 1986-04-07 | 1986-04-07 | Eeprom機密保持回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62236055A true JPS62236055A (ja) | 1987-10-16 |
Family
ID=13697762
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61079710A Pending JPS62236055A (ja) | 1986-04-07 | 1986-04-07 | Eeprom機密保持回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62236055A (ja) |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0498690A (ja) * | 1990-08-16 | 1992-03-31 | Nec Ic Microcomput Syst Ltd | 半導体メモリ |
JPH04344396A (ja) * | 1991-05-21 | 1992-11-30 | Matsushita Electric Ind Co Ltd | 個別選択呼出受信機 |
WO2009064634A3 (en) * | 2007-11-12 | 2009-07-23 | Micron Technology Inc | System and method for updating read-only memory in smart card memory modules |
US8156322B2 (en) | 2007-11-12 | 2012-04-10 | Micron Technology, Inc. | Critical security parameter generation and exchange system and method for smart-card memory modules |
US8162227B2 (en) | 2007-11-12 | 2012-04-24 | Micron Technology, Inc. | Intelligent controller system and method for smart card memory modules |
US8307131B2 (en) | 2007-11-12 | 2012-11-06 | Gemalto Sa | System and method for drive resizing and partition size exchange between a flash memory controller and a smart card |
US8370645B2 (en) | 2009-03-03 | 2013-02-05 | Micron Technology, Inc. | Protection of security parameters in storage devices |
US8898477B2 (en) | 2007-11-12 | 2014-11-25 | Gemalto Inc. | System and method for secure firmware update of a secure token having a flash memory controller and a smart card |
-
1986
- 1986-04-07 JP JP61079710A patent/JPS62236055A/ja active Pending
Cited By (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0498690A (ja) * | 1990-08-16 | 1992-03-31 | Nec Ic Microcomput Syst Ltd | 半導体メモリ |
JPH04344396A (ja) * | 1991-05-21 | 1992-11-30 | Matsushita Electric Ind Co Ltd | 個別選択呼出受信機 |
JP3044494B2 (ja) * | 1991-05-21 | 2000-05-22 | 松下電器産業株式会社 | 個別選択呼出受信機 |
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US9483632B2 (en) | 2007-11-12 | 2016-11-01 | Micron Technology, Inc. | Intelligent controller system and method for smart card memory modules |
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US8286883B2 (en) | 2007-11-12 | 2012-10-16 | Micron Technology, Inc. | System and method for updating read-only memory in smart card memory modules |
US8307131B2 (en) | 2007-11-12 | 2012-11-06 | Gemalto Sa | System and method for drive resizing and partition size exchange between a flash memory controller and a smart card |
WO2009064634A3 (en) * | 2007-11-12 | 2009-07-23 | Micron Technology Inc | System and method for updating read-only memory in smart card memory modules |
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US8898477B2 (en) | 2007-11-12 | 2014-11-25 | Gemalto Inc. | System and method for secure firmware update of a secure token having a flash memory controller and a smart card |
US8930711B2 (en) | 2007-11-12 | 2015-01-06 | Micron Technology, Inc. | Critical security parameter generation and exchange system and method for smart-card memory modules |
US9979540B2 (en) | 2007-11-12 | 2018-05-22 | Micron Technology, Inc. | System and method for updating read-only memory in smart card memory modules |
US9088418B2 (en) | 2007-11-12 | 2015-07-21 | Micron Technology, Inc. | System and method for updating read-only memory in smart card memory modules |
US9111045B2 (en) | 2007-11-12 | 2015-08-18 | Micron Technology, Inc. | Intelligent controller system and method for smart card memory modules |
US9413535B2 (en) | 2007-11-12 | 2016-08-09 | Micron Technology, Inc. | Critical security parameter generation and exchange system and method for smart-card memory modules |
US8370645B2 (en) | 2009-03-03 | 2013-02-05 | Micron Technology, Inc. | Protection of security parameters in storage devices |
US8949626B2 (en) | 2009-03-03 | 2015-02-03 | Micron Technology, Inc. | Protection of security parameters in storage devices |
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