JPS62231445A - 回転ヘツドの回転位相発生装置 - Google Patents

回転ヘツドの回転位相発生装置

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JPS62231445A
JPS62231445A JP61072812A JP7281286A JPS62231445A JP S62231445 A JPS62231445 A JP S62231445A JP 61072812 A JP61072812 A JP 61072812A JP 7281286 A JP7281286 A JP 7281286A JP S62231445 A JPS62231445 A JP S62231445A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、ビデオテープレコーダ(以下、VTRと記
す)等において、回転ヘッドの回転位相を示す信号を発
生する装置に関する。
(従来の技術) 一般に、 VTRにおけるビデオ信号の記録、再生は回
転ヘッドによるヘリカルスキャン方式に従ってなされる
。このヘリカルス中ヤン方式は、回転体上に2つの回転
ヘッドを18cf離して対向配置し、この回転体をビデ
オ信号の1フレームに相当するスピードで回転させ、か
つ磁気テープを回転体に18テの角度だけ斜めに巻き付
けて走行させることによシ、各フィールドのビデオ信号
を各回転ヘッドで順次記録、再生するものである。
このようにヘリカルスキャン方式のVTRにおいては、
ビデオ信号を2つの回転ヘッドで分担記録、分担再生す
るので、例えば、再生時、各回転ヘッドの再生出力をつ
ないで連続した信号を作る場合等に、回転ヘッドの位相
を知る必要がある。
第4図に回転ヘッドの位相を示す信号を発生する従来装
置を示す。
第4図において、llh、llbは18Cfll、II
シて回転ドラム12上に対向配置された回転ヘッドであ
る。回転ドラム12には、さらにPGマグネット13m
、13bが取シ付けられている。各PCマグネット13
m、13bはそれぞれ回転ヘッド11a、llbに対し
て回転方向に01.θbだけ先行するように取り付けら
れている。ま念、PGマグネット13a、13b は互
いに逆極性に着磁されている。14はPCコイルである
。このPGコイル14は、PG?グネット13h、13
bと同心円上で、該マグネット13m、13bと対向す
るように配置されている。
上記構成において、回転ドラム12が回転すると、PG
コイル14に、第5図に示す微分波形信号S1が発生す
る。この信号S1をシェミットアンプ15によシ波形整
形することにより、方形波S2が得られる。しかし、上
記取付角度差θ、、θ5は機械的精度によりばらつく。
そこで、電気的に遅延時間を調整可能な2つの調整回路
16h、16bを設け、その出力信号S3.S4でRS
フリップフロップ回路17をトリガすることによシ、最
終的に回転ヘッドllh、llbの回転位相を示す信号
(rt−sw )を出力するようになっている。
なお、上記2つの調整回路16a、16bのうち、前者
はPGマグネットI Ja用のものでちゃ、徒者はPG
マグネット13b用のものである。
調整要領としては、ヘッド切換位相の規定時間後K、記
録すべきビデオ信号の垂直同期信号Vを記録するように
調整する。例えば、VH8方式では、5〜8H(Hは水
平同期信号)と規定されており、一般に、そのセンター
、つま、i96.5 )1に調整する。
実際には、規定の位置に垂直同期信号Vが記録されたテ
ープ(マスターチーf)を再生し、その再生垂直同期信
号Vと回転位相信号H−8Wとの位相関係を観測しなが
ら、規定値になるようにVTR製造工程で遅延時間を調
整するようになっている。
しかしながら、上記従来の調整方式では、調整用の可変
抵抗及びコンデンサが必要である上に、調整に手間を要
するため、全体の必要経費が高くなる欠点がある。また
、可変抵抗の調整をロピットによって自動化しようとし
ても、調整精度の而で困難である。さらに、経時変化、
温度特性の変化等によフ、調整にはらつきが生じる欠点
がある。
(発明が解決しようとする問題点) 以上述べたように、取付角度差θ8.θ、のばらつきに
よる回転位相信号H−8Wのばらつきを補償するのに、
従来は、調整用外付は部品が必要であったシ、調整の自
動化をしにくかったシ、調整精度が経時変化等の影響を
受けるという問題があっ九。
そこで、この発明は調整用外付は部品が不要で、かつ自
動化に適し、しかも経時変化等の影響を受けることなく
、機械的精度上によるセット間での回転位相信号のばら
つきを除去することができる回転ヘッドの回転位相発生
装置を提供することを目的とする。
[発明の構成コ (問題点を解決するための手段) 上記目的を達成するためにこの発明は、回転ヘッドの回
転位相を検出する手段と、所定のテープから再生された
垂直同期信号と上記回転位相検出手段の検出出力との位
相差に応じたカウント値を出力する手段と、上記カウン
ト値を記憶する手段と、この記憶されたカウント値に従
って上記回転位相検出出力を遅延する遅延手段とを備え
るようKしたものである。
(作用) 上記構成においては、回転ヘッドと回転位相検出手段と
の機械的取付誤差を調整するモードにおいては、所定の
テープから再生された垂直同期信号と回転位相検出出力
との位相差がカウント手段で計測され、その計測値が記
憶手段に記憶される。そして、通常の使用モードでは、
上記記憶内容に従って回転位相検出出力が遅延される。
これにより、上記機械的取付誤差のばらつきに影会され
ない回転位相信号を得ることができる。
(実施例) 以下、図面を参照してこの発明の実施例を詳細に説明す
る。
第1図はこの発明の一実施例の構成を示す回路図である
。第2図は調整モードでの動作を示すりイミングチヤー
ドであフ、第3図は通常モード(記録、再生モード等)
での動作を示すタイミングチャートである。
第1図において、PGコイル21から出力される回転位
相検出信号S、は、シエミットアンデ22によシ波形整
形され、矩形波S2に変換される。この矩形波S2は、
立上が9工ツジ検出回路23及び立下がりエツジ検出回
路24に入力され、各エツジを示す信号S、 、 S4
が得られる。これら立上がシエッジ信号S、及び立下が
シエッジ信号S4はオア回路25にて論理和をとられ、
両エツジ信号S5として出力される。
信号S5はR87リツプフロツグ回路26.27のリセ
ット端子及びコントロール回路28に入力される。RS
Sフリツブフロ1回路26のセット端子には、再生垂直
同期信号Vが印加され、その反転出力56ttl、アン
ドゲート29の一方の入力となる。アンドゲート29の
他方の入力は、クロックCP1であり、その出力はアッ
プカウンタ30のクロックとなる。この接続構成によ)
、アップカウンタ30は、信号S5によりリセットされ
るとともに、クロックCP、を計数し、再生垂直同期信
号Vの到来によシ計数を止めて、回転位相検出信号S、
の両エツジと再生垂直同期信号■との時間差に相当する
。クロックCP、のカウント数Nを保持する。
アップカウンタ30の内容は、メモリ回路31の入力端
子に印加される。メモリ回路31は、2つのメモリ人及
びBで構成され、アドレス選択信号S7によりいずれか
一方が選択される。コントロール回路28は、前記両エ
ツジ検出信号S5及び調整指令信号S8を入力とし、複
数の制御信号を出力する。まず、メモリ回路31の書込
みノ母ルスWR及び読み出し14ルスRDを発生して、
メモリ回路31を制御する。また、書込み、読出しに応
じて極性が反転する信号S8を発生する。この信号S8
は前記信号S2とエクスクル−シブオア回路32で排他
的論理和をとられ、メモリアドレス選択信号S7として
出力される。さらに、コントロール回路28は切換スイ
ッチ32の制御信号S、。を出力する。
メモリ回路31の読み出し出力は、ダウンカウンタ33
にプリセットデータとして与えられ、また、メモリ回路
31の読み出しパルスRDはダウンカウンタ33のプリ
セット端子にも供給されている。ダウンカウンタ33の
出力は、パターン検出回路34に供給され、カウンタ3
3の内容がNになった時に出力S11を得る。パターン
検出回路34の出力S、1は、前記1’LS−フリッグ
70ッグ27のセット入力となり、その反転出力S、2
はアンドゲート36の一方の入力となる。アンドゲート
32の他方の入力は、クロックCP2であり、その出力
は、ダウンカウンタ33のクロック入力となる。この接
続構成によシ、ダウンカウンタ33は、回転位相検出信
号S2の両エツジでプリセットデータNよりダウンカウ
ントを開始し、パターン検出値Nまでカウントして、計
数を止める。よりて、そのクロックカウント′Ij!L
は、N−N  となり、FLSフリップフロップ回路2
7の非反転出力S、Sの立上がシエッジは、回転位相検
出信号S2の両エクジからN−Nだけ遅延した信号とな
る。この出力812は、Tフリップフロン1回路27に
よシ、に分周される。また、この分周位相は、前記立上
がシエッジ信号S、によシリセットされて決定される。
T 717ツグフロツプ回路37の出力814は、切換
スイッチ35の一方の端子に入力される。切換スイッチ
35の他方端子には、前記回転位相検出信号S2が与え
られている。この切換スイッチ35の出力が回転位相信
号)1−8Wとなる。
上記構成において第2図及び第3図を参照しながら動作
を説明する。
まず、第2図に示す調整モードにおいては、調整指令信
号S8によシ、コントロール28は調整モードの動作に
入る。すなわち、まず、切換スイッチ35が回転位相検
出信号S、4を選択するような制御信号S、。を発生す
る。これによシ、回転位相信号H−SWは、シ息ミツト
アンプ22の出力が遅延処理されることなく、直接導び
かれたものとなる。
この状態で、ドラムモータを回転させてマスタチー・グ
を再生し、位相ロック状態になると、コントロール回路
28は、第2図に示すように、信号S5から適当に遅れ
た時間に、メモリ書込み信号WRを発生する。また、こ
のとき、信号S、は@θ″である。ここで、メモリアド
レス選択信号S7が11″でメモリ人が、′″O”でメ
モリBがアクセスされるとすると、第2図に示すように
、メモリ人には、回転位相検出信号S、の矩形波S2の
立上がシエッジから再生垂直同期信号Vまでの時間に相
当する値NAが、メモリBには、立下がりエツジから再
生垂直同期信号Vまでの時間に相当する値N、がそれぞ
れ書き込まれる。この一連の動作によシ、メモリA、B
には、2つの回転ヘッドとPGマグネットとの取付位相
差に相当する値が格納されることになシ、調整過程は終
了する。
次に、調整時以外の通常使用時の動作を第3図を参照し
ながら説明する。このとき、調整指令信号S8は入力さ
れず、コントロール回路28は、これを受けて、切換ス
イッチ35が信号S1.tを選択するような制御信号S
、。を出力する。また、第3図に示すように、信号S5
から適当に遅れた時間にメモリ読み出し信号RDを発生
し、かつ信号S。
”l″にし、アドレス選択の極性な調整時と反対にする
。つまシ、信号S2が1”の区間では、メモリBが読み
出され、0”の区間では、メモリ人が読み出されるよう
にする。まず、立上がシエッソの場合、ダクンカウンタ
33のプリセットデータは、メモリ人の内容NAとなり
、T7リツプフロツグ回路31の出力S、4はN、−N
0後に立上がる。立下がりエツジの場合には、同様KN
、−N0後に立上がる。今、Nを、規格の信号(H−S
W)の位相(つま夛、垂直同期信号の6.5H手前)に
設定しておくと、記録される垂直同期信号Vは、正確に
、マスターチーブの垂直同期信号記録位置と同じ位置に
記録されることになる。
以上のようにこの発明の目的が達成される。
なお、メモリ回路31はデータを長期に保存するために
一般には、不揮発性メモリが使われる。
また、コントロール回路28から調整終了(つまシ、メ
モリ書込み終了)を示す信号を発生し、この信号により
外部自動調整系が調整指令信号S8の出力を停止するよ
りにすれば、完全自動調整を図ることができる。
ダクンカウンタ33のクロックCP2はドラム系の位相
制御系の帰還信号(この実施例では、信号)I−8W)
を作成するクロックであるため、その精度は位相制御系
の精度により決まる。一方、アップカウンタ30のクロ
ックCP1は、単に記録位相6.5Hな決める丸めに用
いられ、この規格は、例えばVH8方式では、±1.5
Hとかなシ精度があらい九め、必要とされる精度のクロ
ックでよい。
以上詳述したこの実施例では、ン為ミットアング22を
除いて全ての回路がデジタル化可能である。・この場合
、可変抵抗やコンデンサを必要としない構成であるため
、外付は部品の数が少なく、高集積化された集積回路化
が可能である。また、デジタル化により、経時変化や温
度変化等の影響も受は難い、さらに、全て回路的に自動
処理されるため、調整の容易化が図られる。
なお、この発明は、ドラム1回転当り複数のt4ルスが
生じるような速度制御用の信号を分周して、信号5(−
8Wの位相180°に決定する方式にも適用可能である
。あるいは、この18ケ位相をデジタル的に作成する場
合にも適用可能である。これらの場合は、メモリは1つ
でよい。
[発明の効果] 以上述べたようにこの発明によれば、可変抵抗やコンデ
ンサ等の外付は部品がなく、容易に調整の自動化が可能
であフ、かつばらつきのない高精度の回転ヘッドの回転
位相発生装置を提供することができる。
【図面の簡単な説明】
第1図はこの発明の一実施例の構成を示す回路図、第2
図、第3図は第1図の動作を説明するためのタイミング
チャート、第4図は従来の回転ヘッドの回転位相発生装
置の構成を示す回路図、第5図は第4図の動作を説明す
るためのタイミングチャートである。 21・・・PGコイル、22・・・シェミットアンプ、
23.24・・・エツジ検出回路、25・・・オアダー
ト、26.27・・・RSSフリップフロラ回路、28
・・・コントロール回路、29.36・・・アンドゲー
ト、30・・・アップカウンタ、31・・・メモリ回路
、32・・・エクスクル−シブオア回路、33・・・ダ
ウンカウンタ、34・・・パターン検出回路、35・・
・切換スイッチ、37・・・Tフリップフロッグ。 出願人代理人  弁理士 鈴 江 武 彦第2図 第3図

Claims (1)

  1. 【特許請求の範囲】 回転ヘッドの回転位相を検出する回転位相検出手段と、 規定の位置に垂直同期信号が記録されたテープから再生
    された垂直同期信号と上記回転位相検出手段の検出出力
    との位相差に応じたカウント値を出力するカウント手段
    と、 このカウント手段のカウント値を記憶する記憶手段と、 この記憶手段に記憶されているカウント値に従って上記
    回転位相検出手段の検出出力を遅延する遅延手段とを具
    備した回転ヘッドの回転位相発生装置。
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