JPH04263578A - 水平同期信号補正回路 - Google Patents
水平同期信号補正回路Info
- Publication number
- JPH04263578A JPH04263578A JP3045874A JP4587491A JPH04263578A JP H04263578 A JPH04263578 A JP H04263578A JP 3045874 A JP3045874 A JP 3045874A JP 4587491 A JP4587491 A JP 4587491A JP H04263578 A JPH04263578 A JP H04263578A
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- JP
- Japan
- Prior art keywords
- signal
- horizontal synchronizing
- synchronizing signal
- circuit
- pulse
- Prior art date
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- Pending
Links
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- 230000003111 delayed effect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 239000013078 crystal Substances 0.000 description 1
- 230000002950 deficient Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
Landscapes
- Synchronizing For Television (AREA)
- Television Signal Processing For Recording (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】この発明は、例えば静止画像信号
再生装置に適用される水平同期信号補正回路に関する。
再生装置に適用される水平同期信号補正回路に関する。
【0002】
【従来の技術】NTSC方式の静止画像信号を小型の磁
気ディスクに記録し、磁気ディスクから静止画像信号を
再生する電子スチルカメラが実用化されている。
気ディスクに記録し、磁気ディスクから静止画像信号を
再生する電子スチルカメラが実用化されている。
【0003】磁気ディスクに記録された静止画像信号に
ディジタル画像処理を行うために、静止画像信号は、A
/D変換器でアナログ信号からディジタル信号に変換さ
れる。そして、ディジタル信号は、ディジタルメモリに
書き込まれる。ディジタルメモリへの書き込みの際には
、再生ビデオ信号中の水平同期信号が基準とされる。 つまり、再生ビデオ信号中の水平同期信号が再生ビデオ
信号から分離される。この水平同期信号を基準として、
1H(Hは1水平走査期間)のデータが910回サンプ
リングされる。また、水平同期信号をカウントすること
により、任意の走査線分のデータがディジタルメモリに
書き込まれる。
ディジタル画像処理を行うために、静止画像信号は、A
/D変換器でアナログ信号からディジタル信号に変換さ
れる。そして、ディジタル信号は、ディジタルメモリに
書き込まれる。ディジタルメモリへの書き込みの際には
、再生ビデオ信号中の水平同期信号が基準とされる。 つまり、再生ビデオ信号中の水平同期信号が再生ビデオ
信号から分離される。この水平同期信号を基準として、
1H(Hは1水平走査期間)のデータが910回サンプ
リングされる。また、水平同期信号をカウントすること
により、任意の走査線分のデータがディジタルメモリに
書き込まれる。
【0004】ディジタルメモリからの読み出しの際には
、安定した発振器、例えば水晶発振器等が用いられる。 ディジタルメモリに書き込まれた水平同期信号をカウン
トすることにより、任意の走査線分のデータがディジタ
ルメモリから読み出される。このようにして、ディジタ
ルメモリの書き込み/読み出しは行われるので、書き込
み時の水平同期信号は、できる限り完全であることが望
ましい。
、安定した発振器、例えば水晶発振器等が用いられる。 ディジタルメモリに書き込まれた水平同期信号をカウン
トすることにより、任意の走査線分のデータがディジタ
ルメモリから読み出される。このようにして、ディジタ
ルメモリの書き込み/読み出しは行われるので、書き込
み時の水平同期信号は、できる限り完全であることが望
ましい。
【0005】
【発明が解決しようとする課題】電子スチルカメラにお
いては、静止画像信号は磁気ディスクにアナログ信号と
して記録される。このため、記録時あるいは再生時に水
平同期信号の不良、欠落等のエラーが生じる可能性があ
る。水平同期信号にエラーが生じると、例えば同期信号
以降の画像データが良好であっても、その1H分のデー
タは全て欠落する恐れがある。また、例えば1H目に水
平同期信号のエラーが生じると、本来2H目であるべき
部分が1H目、3H目であるべき部分が2H目……と1
つずつずれてしまう。このため、例えば、1H目から2
0H目までのデータを書き込む時に、実際には2H目か
ら21H目までのデータを書き込んでしまうことになる
。従って、有効でない部分の走査線のデータをディジタ
ルメモリに書き込んでしまう恐れがある。静止画像信号
においては、1Hのデータが欠落することは、再生画像
の劣化の原因となる。
いては、静止画像信号は磁気ディスクにアナログ信号と
して記録される。このため、記録時あるいは再生時に水
平同期信号の不良、欠落等のエラーが生じる可能性があ
る。水平同期信号にエラーが生じると、例えば同期信号
以降の画像データが良好であっても、その1H分のデー
タは全て欠落する恐れがある。また、例えば1H目に水
平同期信号のエラーが生じると、本来2H目であるべき
部分が1H目、3H目であるべき部分が2H目……と1
つずつずれてしまう。このため、例えば、1H目から2
0H目までのデータを書き込む時に、実際には2H目か
ら21H目までのデータを書き込んでしまうことになる
。従って、有効でない部分の走査線のデータをディジタ
ルメモリに書き込んでしまう恐れがある。静止画像信号
においては、1Hのデータが欠落することは、再生画像
の劣化の原因となる。
【0006】従ってこの発明の目的は、静止画像信号中
の水平同期信号が欠落しても、その欠落の影響を受けず
に水平同期信号を発生し、その水平同期信号を欠落した
水平同期信号に代えて用いることができるような水平同
期信号補正回路を提供することである。
の水平同期信号が欠落しても、その欠落の影響を受けず
に水平同期信号を発生し、その水平同期信号を欠落した
水平同期信号に代えて用いることができるような水平同
期信号補正回路を提供することである。
【0007】
【課題を解決するための手段】記録媒体からの再生ビデ
オ信号より分離された再生水平同期信号が供給され、再
生水平同期信号と同期した2fH(fHは水平走査周波
数)の出力信号を発生するPLL回路と、出力信号を1
/2分周すると共に再生水平同期信号でリセットされる
分周回路とからなり、分周回路から周波数fHのパルス
信号を得るようにした水平同期信号補正回路である。
オ信号より分離された再生水平同期信号が供給され、再
生水平同期信号と同期した2fH(fHは水平走査周波
数)の出力信号を発生するPLL回路と、出力信号を1
/2分周すると共に再生水平同期信号でリセットされる
分周回路とからなり、分周回路から周波数fHのパルス
信号を得るようにした水平同期信号補正回路である。
【0008】
【作用】PLL回路10で再生ビデオ信号中の水平同期
信号と同期するパルスを1/910分周回路8から1/
2分周回路10に供給する。再生ビデオ信号中の水平同
期信号を1/2分周回路10に供給する。再生ビデオ信
号中の水平同期信号が欠落している場合、1/910分
周回路8から供給されたパルスを、1/2分周回路10
から出力端子9に供給する。
信号と同期するパルスを1/910分周回路8から1/
2分周回路10に供給する。再生ビデオ信号中の水平同
期信号を1/2分周回路10に供給する。再生ビデオ信
号中の水平同期信号が欠落している場合、1/910分
周回路8から供給されたパルスを、1/2分周回路10
から出力端子9に供給する。
【0009】
【実施例】以下、この発明の一実施例を図面を参照して
説明する。図1は、この発明の水平同期信号補正回路で
ある。図1において、入力端子1から、ビデオ信号から
分離された水平同期信号P1がモノマルチバイブレータ
2及び3に供給される。この入力ビデオ信号は、磁気デ
ィスクを再生することで得られたものである。モノマル
チバイブレータ3には、そのパルス幅を調整するための
可変抵抗4が接続される。また、入力端子1からの水平
同期信号は、1/2分周回路5にリセット信号として供
給される。モノマルチバイブレータ2の出力パルスEN
が位相比較器6にイネーブル信号として供給される。位
相比較器6の比較出力が電圧制御発振器7に供給される
。電圧制御発振器7の出力信号が分周回路8に供給され
る。分周回路8の分周比は1/910とされている。 位相比較器6、電圧制御発振器7及び分周回路8により
、点線で囲まれたPLL回路10が構成される。分周回
路8の出力信号P3は、位相比較器6に供給される。 また、分周回路8で得られた他の出力信号P4が1/2
分周回路5に供給される。1/2分周回路5が入力端子
1からの水平同期信号P1でリセットされ、1/2分周
回路5の出力パルスの位相が強制的に水平同期信号と同
期したものとされる。1/2分周回路5の出力信号P5
は、出力端子9に取り出され、例えばメモリのアドレス
発生回路(図示せず)に供給される。
説明する。図1は、この発明の水平同期信号補正回路で
ある。図1において、入力端子1から、ビデオ信号から
分離された水平同期信号P1がモノマルチバイブレータ
2及び3に供給される。この入力ビデオ信号は、磁気デ
ィスクを再生することで得られたものである。モノマル
チバイブレータ3には、そのパルス幅を調整するための
可変抵抗4が接続される。また、入力端子1からの水平
同期信号は、1/2分周回路5にリセット信号として供
給される。モノマルチバイブレータ2の出力パルスEN
が位相比較器6にイネーブル信号として供給される。位
相比較器6の比較出力が電圧制御発振器7に供給される
。電圧制御発振器7の出力信号が分周回路8に供給され
る。分周回路8の分周比は1/910とされている。 位相比較器6、電圧制御発振器7及び分周回路8により
、点線で囲まれたPLL回路10が構成される。分周回
路8の出力信号P3は、位相比較器6に供給される。 また、分周回路8で得られた他の出力信号P4が1/2
分周回路5に供給される。1/2分周回路5が入力端子
1からの水平同期信号P1でリセットされ、1/2分周
回路5の出力パルスの位相が強制的に水平同期信号と同
期したものとされる。1/2分周回路5の出力信号P5
は、出力端子9に取り出され、例えばメモリのアドレス
発生回路(図示せず)に供給される。
【0010】図2は、この発明を説明するためのタイミ
ングチャートである。図2Aは、1H周期の水平同期信
号P1である。この水平同期信号P1の立ち下がりで、
モノマルチバイブレータ2、3がトリガーされ、図2B
に示すように、モノマルチバイブレータ2の出力パルス
ENが、再生ビデオ信号の水平同期信号の立ち下がりエ
ッジと同期して立ち上がる。このパルスENが発生して
いる間、位相比較器6は、モノマルチバイブレータ3か
ら入力された信号P2と分周回路8からの信号P3の位
相比較を行う。パルスENのパルス幅が1/3Hとされ
る。一方、モノマルチバイブレータ3の出力パルスP2
は、図2Cに示されるように、再生ビデオ信号の水平同
期信号の立ち下がりエッジと同期して立ち上がり、その
パルス幅は、1/6Hとされる。
ングチャートである。図2Aは、1H周期の水平同期信
号P1である。この水平同期信号P1の立ち下がりで、
モノマルチバイブレータ2、3がトリガーされ、図2B
に示すように、モノマルチバイブレータ2の出力パルス
ENが、再生ビデオ信号の水平同期信号の立ち下がりエ
ッジと同期して立ち上がる。このパルスENが発生して
いる間、位相比較器6は、モノマルチバイブレータ3か
ら入力された信号P2と分周回路8からの信号P3の位
相比較を行う。パルスENのパルス幅が1/3Hとされ
る。一方、モノマルチバイブレータ3の出力パルスP2
は、図2Cに示されるように、再生ビデオ信号の水平同
期信号の立ち下がりエッジと同期して立ち上がり、その
パルス幅は、1/6Hとされる。
【0011】PLL回路10では、中心周波数が182
0fH(fHは水平走査周波数)である約28MHzの
クロック信号が発生される。このクロック信号が、分周
回路8で2fHに分周されて位相比較器6に供給される
。図2Dに示されるように、分周回路8の出力パルスP
3は、水平同期信号P1の立ち下がりエッジから1/6
H遅れた位置から1/6H幅のパルスを発生するように
設定される。このようにパルス幅を設定することで、パ
ルスP2とパルスP3の立ち下がりエッジが一致する。 また、パルスP3の周期は、水平同期信号P1の周期1
Hと比べて、1/2Hになっている。出力パルスP3は
、たとえ入力端子1から入力される水平同期信号P1が
欠落していたとしても、安定して1/2H周期の間隔で
出力される。また、図2Eに示されるように、分周回路
8から1/2分周回路5に出力されるパルスP4は、分
周回路8から位相比較器6に出力されるパルスP3の立
ち下がりエッジから1/3H遅れた位置で発生される。 このパルスP4は、分周回路8の出力パルスP3を基に
しているので、安定して1/2H周期の間隔で出力され
る。
0fH(fHは水平走査周波数)である約28MHzの
クロック信号が発生される。このクロック信号が、分周
回路8で2fHに分周されて位相比較器6に供給される
。図2Dに示されるように、分周回路8の出力パルスP
3は、水平同期信号P1の立ち下がりエッジから1/6
H遅れた位置から1/6H幅のパルスを発生するように
設定される。このようにパルス幅を設定することで、パ
ルスP2とパルスP3の立ち下がりエッジが一致する。 また、パルスP3の周期は、水平同期信号P1の周期1
Hと比べて、1/2Hになっている。出力パルスP3は
、たとえ入力端子1から入力される水平同期信号P1が
欠落していたとしても、安定して1/2H周期の間隔で
出力される。また、図2Eに示されるように、分周回路
8から1/2分周回路5に出力されるパルスP4は、分
周回路8から位相比較器6に出力されるパルスP3の立
ち下がりエッジから1/3H遅れた位置で発生される。 このパルスP4は、分周回路8の出力パルスP3を基に
しているので、安定して1/2H周期の間隔で出力され
る。
【0012】出力端子9から取り出される1/2分周回
路5の出力パルスP5は、図2Fに示されるように、図
2Aの水平同期信号P1の欠落した部分(破線で示す)
が再生された水平同期信号となる。
路5の出力パルスP5は、図2Fに示されるように、図
2Aの水平同期信号P1の欠落した部分(破線で示す)
が再生された水平同期信号となる。
【0013】パルスP4の周期が、出力パルスP5の1
/2H周期にされているのは、奇数フィールド及び偶数
フィールドに切れ目なく対応できるようにさせるためで
ある。奇数フィールド及び偶数フィールドの切れ目以外
は、2回に1回だけパルスP4を取り出し、これを水平
同期信号として、本来の水平同期信号に代えて用いる。
/2H周期にされているのは、奇数フィールド及び偶数
フィールドに切れ目なく対応できるようにさせるためで
ある。奇数フィールド及び偶数フィールドの切れ目以外
は、2回に1回だけパルスP4を取り出し、これを水平
同期信号として、本来の水平同期信号に代えて用いる。
【0014】
【発明の効果】この発明は、再生水平同期信号と同期し
た2fH(fHは水平走査周波数)の出力信号を発生す
るPLL回路10と、出力信号を1/2分周すると共に
再生水平同期信号でリセットされる1/2分周回路5と
からなり、1/2分周回路5から周波数fHのパルス信
号を得るようにした水平同期信号補正回路である。この
ため、再生ビデオ信号中の水平同期信号が欠落しても、
水平同期信号と同等のパルスを発生して、再生ビデオ信
号中の水平同期信号として用いることができる。従って
、データの欠落が生じることがない。つまり、本来書き
込むべきデータを全て書き込むことができる。
た2fH(fHは水平走査周波数)の出力信号を発生す
るPLL回路10と、出力信号を1/2分周すると共に
再生水平同期信号でリセットされる1/2分周回路5と
からなり、1/2分周回路5から周波数fHのパルス信
号を得るようにした水平同期信号補正回路である。この
ため、再生ビデオ信号中の水平同期信号が欠落しても、
水平同期信号と同等のパルスを発生して、再生ビデオ信
号中の水平同期信号として用いることができる。従って
、データの欠落が生じることがない。つまり、本来書き
込むべきデータを全て書き込むことができる。
【図1】この発明の一実施例のブロック図である。
【図2】この発明の一実施例の波形図である。
5 1/2分周回路
10 PLL回路
Claims (1)
- 【請求項1】 記録媒体からの再生ビデオ信号より分
離された再生水平同期信号が供給され、上記再生水平同
期信号と同期した2fH(fHは水平走査周波数)の出
力信号を発生するPLL回路と、上記出力信号を1/2
分周すると共に、上記再生水平同期信号でリセットされ
る分周回路とからなり、上記分周回路から周波数fHの
パルス信号を得るようにした水平同期信号補正回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3045874A JPH04263578A (ja) | 1991-02-18 | 1991-02-18 | 水平同期信号補正回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3045874A JPH04263578A (ja) | 1991-02-18 | 1991-02-18 | 水平同期信号補正回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04263578A true JPH04263578A (ja) | 1992-09-18 |
Family
ID=12731362
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3045874A Pending JPH04263578A (ja) | 1991-02-18 | 1991-02-18 | 水平同期信号補正回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04263578A (ja) |
-
1991
- 1991-02-18 JP JP3045874A patent/JPH04263578A/ja active Pending
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