JPS621239A - 半導体装置 - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(発明の技術分野〕
本発明はリードフレームにマウントされた半導体素子を
樹脂で封止した樹脂封止型の半導体装置に関する。
樹脂で封止した樹脂封止型の半導体装置に関する。
第3図および第4図に従来の樹脂封止型半導体装置を示
す。第3図は樹脂封止の模様を示す透視平面図、第4図
はその断面図である。リードフレームのベッド3上に導
電性接着剤等によって半導体チップ(素子)がマウント
され、リードフレームのベッド3と所定の間隔を有して
放射状に離隔配設されたリードフレームのインナリード
2と半導体チップ4の電極とが金線、アルミニウム線等
のボンディングワイヤ5で接続されている。そして、半
導体チップ4、ボンディングワイヤ5およびインナリー
ド2を含む領域が封止樹脂1によって封止され、インナ
リード2に連設するアウタリード6が封止樹脂1から水
平に突出してフラットパッケージ型の半導体装置が構成
される。
す。第3図は樹脂封止の模様を示す透視平面図、第4図
はその断面図である。リードフレームのベッド3上に導
電性接着剤等によって半導体チップ(素子)がマウント
され、リードフレームのベッド3と所定の間隔を有して
放射状に離隔配設されたリードフレームのインナリード
2と半導体チップ4の電極とが金線、アルミニウム線等
のボンディングワイヤ5で接続されている。そして、半
導体チップ4、ボンディングワイヤ5およびインナリー
ド2を含む領域が封止樹脂1によって封止され、インナ
リード2に連設するアウタリード6が封止樹脂1から水
平に突出してフラットパッケージ型の半導体装置が構成
される。
しかしながら、この従来装置においては、インナリード
先端ピッチは強度上の要求から非常に微小にすることは
困難であり、一般に半導体チップ4の電極の間隔に比べ
て大きくなる。したがって電極の数と同数のインナリー
ドを具備するためには、半導体チップの大きさを大きく
しなければならず、パッケージの外形が大きくなる。又
、すべてのインナリードが同一平面上に位置するため、
インナリードの曲り等による隣接するインナリード先端
どうしの接触不良および隣接するボンディングワイヤど
うしの接触不良が多く、歩留りの低下、信頼性低下の原
因となっているという問題がある。
先端ピッチは強度上の要求から非常に微小にすることは
困難であり、一般に半導体チップ4の電極の間隔に比べ
て大きくなる。したがって電極の数と同数のインナリー
ドを具備するためには、半導体チップの大きさを大きく
しなければならず、パッケージの外形が大きくなる。又
、すべてのインナリードが同一平面上に位置するため、
インナリードの曲り等による隣接するインナリード先端
どうしの接触不良および隣接するボンディングワイヤど
うしの接触不良が多く、歩留りの低下、信頼性低下の原
因となっているという問題がある。
本発明は上記事情を考慮してなされたもので、パッケー
ジ外形の縮小化とボンディングワイヤ等の接触防止を可
能とした半導体装置を提供することを目的とする。
ジ外形の縮小化とボンディングワイヤ等の接触防止を可
能とした半導体装置を提供することを目的とする。
上記目的を達成するため、本発明による半導体装置は、
−のインナリードに対して隣接する他のインナリードの
^さを交互に上下させて、インナリードのピッチを小さ
くし、又、隣接するボンディングワイヤの接触を防止し
たことを特徴としている。このため外形の縮小化と信頼
性の向上を図ることができる。
−のインナリードに対して隣接する他のインナリードの
^さを交互に上下させて、インナリードのピッチを小さ
くし、又、隣接するボンディングワイヤの接触を防止し
たことを特徴としている。このため外形の縮小化と信頼
性の向上を図ることができる。
(発明の実施例〕
以下、本発明の一実施例を添付図面を参照して具体的に
説明する。第1図は本発明の一実施例の透視平面図、第
2図はその断面図である。この実施例の装置は、リード
フレームのベッド13上に導電性接着剤を介してマウン
トされた半導体チップ14と、ベッド13と一定の間隔
で配設されたリードフレームのインナリード12a、1
2bと、このインナリード12a、12bと半導体チッ
プ14の電極とを接続するボンディングワイヤ15とを
具備している。そして、半導体チップ14、ボンディン
グワイヤ15およびインナリード12a、12bを含む
領域が封止樹脂11で封止され、インナリード12a、
12bに連設するアウタリード16が封止樹脂11から
突出して引出し端子となっている。このような半導体装
置において、−のインナリード12aは第2図に図示さ
れるようにその先端部が隣接する他のインナリード12
bよりも高くなっており、この高低が隣接するインナリ
ード間で交互にくり返されている。
説明する。第1図は本発明の一実施例の透視平面図、第
2図はその断面図である。この実施例の装置は、リード
フレームのベッド13上に導電性接着剤を介してマウン
トされた半導体チップ14と、ベッド13と一定の間隔
で配設されたリードフレームのインナリード12a、1
2bと、このインナリード12a、12bと半導体チッ
プ14の電極とを接続するボンディングワイヤ15とを
具備している。そして、半導体チップ14、ボンディン
グワイヤ15およびインナリード12a、12bを含む
領域が封止樹脂11で封止され、インナリード12a、
12bに連設するアウタリード16が封止樹脂11から
突出して引出し端子となっている。このような半導体装
置において、−のインナリード12aは第2図に図示さ
れるようにその先端部が隣接する他のインナリード12
bよりも高くなっており、この高低が隣接するインナリ
ード間で交互にくり返されている。
すなわち、他のインナリード12bはリードフレームの
ベッド13と同一平面上に位置しており、−のインナリ
ード12aの先端部はベッド13よりも高い位置に存在
する。このような段差は例えばリードフレームの打抜き
の際、高い位置のインナリード7aをプレス加工で折曲
させることで形成することができる。このような加工に
より、折曲されたーのインナリード12aの先端部は隣
接する他のインナリード12bよりも半導体チップ14
から離隔された位置となっている。そして、各インナリ
ード12a、12bはボンディングワイヤ15によって
半導体チップ14の電極と接続されるが、インナリード
12a、12bが段差をもって配設されるだめ、隣接す
るインナリードどうしおよびボンディングワイヤとは高
さが異なり、インナリードどうしが接触する危険が少な
くなる他、封止樹脂の際にワイヤ流れを起こしても隣接
するボンディングワイヤが相互に接触することがない。
ベッド13と同一平面上に位置しており、−のインナリ
ード12aの先端部はベッド13よりも高い位置に存在
する。このような段差は例えばリードフレームの打抜き
の際、高い位置のインナリード7aをプレス加工で折曲
させることで形成することができる。このような加工に
より、折曲されたーのインナリード12aの先端部は隣
接する他のインナリード12bよりも半導体チップ14
から離隔された位置となっている。そして、各インナリ
ード12a、12bはボンディングワイヤ15によって
半導体チップ14の電極と接続されるが、インナリード
12a、12bが段差をもって配設されるだめ、隣接す
るインナリードどうしおよびボンディングワイヤとは高
さが異なり、インナリードどうしが接触する危険が少な
くなる他、封止樹脂の際にワイヤ流れを起こしても隣接
するボンディングワイヤが相互に接触することがない。
したがってリード間隔を従来よりも狭めることが可能と
なる。
なる。
このようなワイヤボンディングにおいては、低い位置の
インナリード12bをまず接続し、次いで、高い位置の
インナリード12aを接続するのが作業を安全にかつ効
率的に行う上で好ましい。
インナリード12bをまず接続し、次いで、高い位置の
インナリード12aを接続するのが作業を安全にかつ効
率的に行う上で好ましい。
また高い位置のインナリードのワイヤボンディングを安
定に行うためにインナリードの高低に合致した支持部を
備えた支持冶具を使用することができる。
定に行うためにインナリードの高低に合致した支持部を
備えた支持冶具を使用することができる。
なお、本発明においては、−のインナリード12−aと
屈曲された他のインナリード12bとをそれらの先端が
半導体素子14の外端から等距離になるように配設して
もよく、この場合には折曲される分だけ−のインナリー
ド12を予め、長く形成しておくことによって可能とな
る。又、−のインナリード12aを他のインナリード1
2bよりも低い位置に形成してもよい。
屈曲された他のインナリード12bとをそれらの先端が
半導体素子14の外端から等距離になるように配設して
もよく、この場合には折曲される分だけ−のインナリー
ド12を予め、長く形成しておくことによって可能とな
る。又、−のインナリード12aを他のインナリード1
2bよりも低い位置に形成してもよい。
また、実施例ではフラットパッケージについて本発明を
適用しているが、リードフレームを用いる他のパッケー
ジについても同様に本発明を適用することができる。
適用しているが、リードフレームを用いる他のパッケー
ジについても同様に本発明を適用することができる。
以上説明したように本発明にかかる半導体装置によれば
隣接づるインナリード間のワイヤ接続部を交互に高さを
異ならせて配設しているのでインナリード間のピッチを
小さくすることができると共に、隣接するインナリード
どうし、隣接するボンディングワイVどうしが接触する
ことを有効に防止でき、不良率を低減させることができ
る。
隣接づるインナリード間のワイヤ接続部を交互に高さを
異ならせて配設しているのでインナリード間のピッチを
小さくすることができると共に、隣接するインナリード
どうし、隣接するボンディングワイVどうしが接触する
ことを有効に防止でき、不良率を低減させることができ
る。
第1図は本発明の一実施例の透視平面図、第2図はその
断面図、第3図は従来装置の透視平面図、第4図の断面
図である。 3.13・・・ベッド、4.14・・・半導体素子、5
゜15・・・ボンディングワイヤ、12a、12b・・
・インナリード。 出願人代理人 猪 股 消 馬 1 図 62 図 も 3 図 54 図
断面図、第3図は従来装置の透視平面図、第4図の断面
図である。 3.13・・・ベッド、4.14・・・半導体素子、5
゜15・・・ボンディングワイヤ、12a、12b・・
・インナリード。 出願人代理人 猪 股 消 馬 1 図 62 図 も 3 図 54 図
Claims (1)
- 【特許請求の範囲】 1、リードフレームのベッドにマウントされた半導体素
子と、この半導体素子の電極とボンディングワイヤで接
続され、前記ベッドの周囲に配設されたリードフレーム
の複数のインナリードとを具備してなる半導体装置にお
いて、 前記複数のインナリードのうち互いに隣接するインナリ
ード間でワイヤボンディング接続部の高さが交互に異な
っていることを特徴とする半導体装置。 2、高い位置のインナリード先端部が低い位置のインナ
リード先端部よりも半導体素子外端からの距離が大きく
形成された特許請求の範囲第1項記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60139863A JPS621239A (ja) | 1985-06-26 | 1985-06-26 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60139863A JPS621239A (ja) | 1985-06-26 | 1985-06-26 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS621239A true JPS621239A (ja) | 1987-01-07 |
Family
ID=15255296
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60139863A Pending JPS621239A (ja) | 1985-06-26 | 1985-06-26 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS621239A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0320997A2 (en) * | 1987-12-17 | 1989-06-21 | Kabushiki Kaisha Toshiba | Semiconductor device having a lead frame |
WO1996019828A1 (en) * | 1994-12-21 | 1996-06-27 | Vlsi Technology, Inc. | Wirebond lead system with improved wire separation |
US7102216B1 (en) * | 2001-08-17 | 2006-09-05 | Amkor Technology, Inc. | Semiconductor package and leadframe with horizontal leads spaced in the vertical direction and method of making |
-
1985
- 1985-06-26 JP JP60139863A patent/JPS621239A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0320997A2 (en) * | 1987-12-17 | 1989-06-21 | Kabushiki Kaisha Toshiba | Semiconductor device having a lead frame |
WO1996019828A1 (en) * | 1994-12-21 | 1996-06-27 | Vlsi Technology, Inc. | Wirebond lead system with improved wire separation |
US7102216B1 (en) * | 2001-08-17 | 2006-09-05 | Amkor Technology, Inc. | Semiconductor package and leadframe with horizontal leads spaced in the vertical direction and method of making |
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