JPS617825A - 液晶素子の駆動法 - Google Patents
液晶素子の駆動法Info
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- JPS617825A JPS617825A JP59127415A JP12741584A JPS617825A JP S617825 A JPS617825 A JP S617825A JP 59127415 A JP59127415 A JP 59127415A JP 12741584 A JP12741584 A JP 12741584A JP S617825 A JPS617825 A JP S617825A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は液晶を用いた光シヤツターアレイ、画像表示装
置等の駆動方法に関するものであり、さらに詳しくは双
安定性液晶、特に強誘電性液晶をアクティブマトリック
ス構成により駆動する方法に関するものである。
置等の駆動方法に関するものであり、さらに詳しくは双
安定性液晶、特に強誘電性液晶をアクティブマトリック
ス構成により駆動する方法に関するものである。
［従来の技術］
従来より、走査電極群と信号電極群をマトリクス状に構
成し、その電極間に液晶化合物を充填し、多数の画素を
形成して画像或いは情報の表示を行う液晶表示素子は、
よく知られている。この表示素子の駆動法としては、走
査電極群に、順次、周期的にアドレス信号を選択印加し
、信号電極群には所定の情報信号をアドレス信号と同期
させて並列的に選択印加する時分割駆動が採用されてい
るが、この表示素子及びその駆動法は、以下に述べる如
き致命的とも言える大きな欠点を有していた。
成し、その電極間に液晶化合物を充填し、多数の画素を
形成して画像或いは情報の表示を行う液晶表示素子は、
よく知られている。この表示素子の駆動法としては、走
査電極群に、順次、周期的にアドレス信号を選択印加し
、信号電極群には所定の情報信号をアドレス信号と同期
させて並列的に選択印加する時分割駆動が採用されてい
るが、この表示素子及びその駆動法は、以下に述べる如
き致命的とも言える大きな欠点を有していた。
即ち、画素密度を高く、或いは画面を大きくするのが難
しいことである。従来の液晶の中で応答速度が比較的高
く、しかも消費電力が小さいことから、表示素子として
実用に供されているのは殆どが、例えば、Ｍ、 ５ｃｈ
ａｄｔとＷ、 Ｈｅ１ｆｒｉｃｈ著、”Ａｐｐｌｉｅｄ
Ｐｈｙｓｉｃｓ Ｌｅｔｔｅｒｓ″、 Ｖｏｌ、 １
８． Ｎｏ、４（１１１１７１，２，１５） 、 Ｐ、
１２７〜１２８の”Ｖｏｌｔａｇｅ−Ｄｅｐｅｎｄｅ
ｎｔ ０ｐｔｉｃａｌ Ａｃｔｉｖｉｔｙ ｏｆ ａ
ＴｗｉｓｔｅｄＮｅｓａｔｉｃ Ｌｉｑｕｉｄ Ｃｒｙ
ｓｔａｌ”に示されたＴＮ（ｔｗｉｓｔｅｄ ｎｅｍａ
ｔｉｃ）ｆｉの液晶を用いたも（７）テあり、この型の
液晶は、無電界状態で正の誘電異方性をもつ、ネマチッ
ク液晶の分子が、液晶層厚方向で捩れた構造（ヘリカル
構造）を形成し、両電極面でこの液晶の分子が互いに並
行に配列した構造を形成している。一方、電界印加状態
では、正の誘電異方性をもつネマチック液晶が電界方向
に配列し、この結果光調変調を起すことができる。
しいことである。従来の液晶の中で応答速度が比較的高
く、しかも消費電力が小さいことから、表示素子として
実用に供されているのは殆どが、例えば、Ｍ、 ５ｃｈ
ａｄｔとＷ、 Ｈｅ１ｆｒｉｃｈ著、”Ａｐｐｌｉｅｄ
Ｐｈｙｓｉｃｓ Ｌｅｔｔｅｒｓ″、 Ｖｏｌ、 １
８． Ｎｏ、４（１１１１７１，２，１５） 、 Ｐ、
１２７〜１２８の”Ｖｏｌｔａｇｅ−Ｄｅｐｅｎｄｅ
ｎｔ ０ｐｔｉｃａｌ Ａｃｔｉｖｉｔｙ ｏｆ ａ
ＴｗｉｓｔｅｄＮｅｓａｔｉｃ Ｌｉｑｕｉｄ Ｃｒｙ
ｓｔａｌ”に示されたＴＮ（ｔｗｉｓｔｅｄ ｎｅｍａ
ｔｉｃ）ｆｉの液晶を用いたも（７）テあり、この型の
液晶は、無電界状態で正の誘電異方性をもつ、ネマチッ
ク液晶の分子が、液晶層厚方向で捩れた構造（ヘリカル
構造）を形成し、両電極面でこの液晶の分子が互いに並
行に配列した構造を形成している。一方、電界印加状態
では、正の誘電異方性をもつネマチック液晶が電界方向
に配列し、この結果光調変調を起すことができる。
この型の液晶を用いてマトリクス電極構造によって表示
素子を構成した場合、走査電極と゛信号電極が共に選択
される領域（選択点）には、液晶分子を電極面に垂直に
配列させるに要する閾値以上の電圧が印加され、走査電
極と信号電極が共に選択されない領域（非選択点）には
電圧は印加されず、したがって液晶分子は電極面に対し
て並行な安定配列を保っている。このような液晶セルの
上下に、互いにクロスニコル関係にある直線偏光子を配
置することにより、選択点では光が透過せず、非選択点
では光が透過するため、画像素子とすることが可能とな
る。然し乍ら、マトリクス電極構造を構成した場合には
、走査電極が選択さ庇、信号電極が選択されない領域或
いは、走査電極が選択されず、信号電極が選択される領
Ｍ（所謂゛′半選択点゛′）にも有限の電界がかかって
しまう６選択点にかかる電圧と、半選択点にかかる電圧
の差が充分に大きく、液晶分子を電界に垂直に配列させ
るに要する電圧闇値がこの中間の電圧値に設定されるな
らば、表示素子は正常に動作するわけである。しかし、
この方式において、走査線数（Ｎ）を増やして行った場
合、画面全体（１フレーム）を走査する間に一つの選択
点に有効な電界がかかっている時Ｍ（ｄｕｔｙ比）は、
Ｉ／Ｈの割合で減少してしまう。このために、〈り返し
走査を行った場合の選択点と非選択点にかかる実効値と
しての電圧差は、走査線数が増えれば増える程小さくな
り、結果的には画像コントラストの低下やクロストーク
が避は難い欠点となっている。このような現象は、双安
定状態を右さない液晶（電極面に対し、液晶分子が水平
に配向しているのが安定状態であり、電界が有効に印加
されている間のみ垂直に配向する）を、時間的蓄積効果
を利用して駆動する（即ち、繰り返し走査する）ときに
生じる木質的には避は難い問題点である。この点を改良
するために、電圧平均化法、２周波駆動法や多重マトリ
クス法等が既に提案されているが、いずれの方法でも不
充分であり、表示素子の大画面化や高密度化は、走査線
数が充分に増やせないことによって頭打ちになっている
のが現状である。
素子を構成した場合、走査電極と゛信号電極が共に選択
される領域（選択点）には、液晶分子を電極面に垂直に
配列させるに要する閾値以上の電圧が印加され、走査電
極と信号電極が共に選択されない領域（非選択点）には
電圧は印加されず、したがって液晶分子は電極面に対し
て並行な安定配列を保っている。このような液晶セルの
上下に、互いにクロスニコル関係にある直線偏光子を配
置することにより、選択点では光が透過せず、非選択点
では光が透過するため、画像素子とすることが可能とな
る。然し乍ら、マトリクス電極構造を構成した場合には
、走査電極が選択さ庇、信号電極が選択されない領域或
いは、走査電極が選択されず、信号電極が選択される領
Ｍ（所謂゛′半選択点゛′）にも有限の電界がかかって
しまう６選択点にかかる電圧と、半選択点にかかる電圧
の差が充分に大きく、液晶分子を電界に垂直に配列させ
るに要する電圧闇値がこの中間の電圧値に設定されるな
らば、表示素子は正常に動作するわけである。しかし、
この方式において、走査線数（Ｎ）を増やして行った場
合、画面全体（１フレーム）を走査する間に一つの選択
点に有効な電界がかかっている時Ｍ（ｄｕｔｙ比）は、
Ｉ／Ｈの割合で減少してしまう。このために、〈り返し
走査を行った場合の選択点と非選択点にかかる実効値と
しての電圧差は、走査線数が増えれば増える程小さくな
り、結果的には画像コントラストの低下やクロストーク
が避は難い欠点となっている。このような現象は、双安
定状態を右さない液晶（電極面に対し、液晶分子が水平
に配向しているのが安定状態であり、電界が有効に印加
されている間のみ垂直に配向する）を、時間的蓄積効果
を利用して駆動する（即ち、繰り返し走査する）ときに
生じる木質的には避は難い問題点である。この点を改良
するために、電圧平均化法、２周波駆動法や多重マトリ
クス法等が既に提案されているが、いずれの方法でも不
充分であり、表示素子の大画面化や高密度化は、走査線
数が充分に増やせないことによって頭打ちになっている
のが現状である。
［発明が解決しようとする問題点］
本発明の目的は、前述したような従来の液晶表示素子に
おける問題点を悉く解決した新規な双安定性液晶、特に
強誘電性液晶素子の駆動法を提供することにある。
おける問題点を悉く解決した新規な双安定性液晶、特に
強誘電性液晶素子の駆動法を提供することにある。
即ち、本発明は電圧応答速度が早く、状態記憶性を有す
る強誘電性液晶をアクティブマトリックスにより２方向
の電界を印加して明、暗の２つの状態に駆動することに
より１画素数の多い大画面の表示及び高速度で画像を表
示する強誘電性液晶の駆動方法を提供することを目的と
するものである。
る強誘電性液晶をアクティブマトリックスにより２方向
の電界を印加して明、暗の２つの状態に駆動することに
より１画素数の多い大画面の表示及び高速度で画像を表
示する強誘電性液晶の駆動方法を提供することを目的と
するものである。
［問題点を解決するための手段］及び［作用］本発明の
液晶素子の駆動方法は、ＦＥＴ （電界効果トランジス
タ）のゲート以外の端子である第一端子と接続した画素
電極を該ＦＥＴに対応して複数設けた第一基板と該画素
電極に対向する対向電極を設けた第二基板を有し、前記
画素電極と対向電極の間に電界に対して双安定状態を有
する強誘電性液晶を挟持した構造の液晶素子の駆動法で
あって、前記ＦＥＴのゲートがゲートオン状態となる信
号印加と同期させてＦＥＴのゲート以外の端子である第
一端子と第二端子の間で電界を形成することによって、
第一の配向状態に強誘電性液晶の配列を制御する第一位
相と、前記第一端子と第二端子の間で形成した電界と逆
極性の電界を第一端子と第二端子の間で形成することに
よって、第二の配向状態に強誘電性液晶の配列を制御す
る第二位相を有し、前記対向電極群に表示信号を印加す
るとともに各画素に対応しているＦＥＴ端子のうち、ソ
ースもしくはドレインを共通端子に接続してゲートに走
査信号を印加する時分割駆動であり、かかる考査信号線
（ゲート）に所定の走査信号を印加するとともに、表示
信号線（複数のストライプ状対向電極群）に信号電圧を
印加することによって全画面の表示状態を第一の配向状
態に基づく表示状態に一様にそろえ、次に前記走査信号
線に順次所定の電圧信号を印加するとともに、選択され
た表示信号線に第二の配向状態を形成する画像信号を印
加することを特徴とするものである。
液晶素子の駆動方法は、ＦＥＴ （電界効果トランジス
タ）のゲート以外の端子である第一端子と接続した画素
電極を該ＦＥＴに対応して複数設けた第一基板と該画素
電極に対向する対向電極を設けた第二基板を有し、前記
画素電極と対向電極の間に電界に対して双安定状態を有
する強誘電性液晶を挟持した構造の液晶素子の駆動法で
あって、前記ＦＥＴのゲートがゲートオン状態となる信
号印加と同期させてＦＥＴのゲート以外の端子である第
一端子と第二端子の間で電界を形成することによって、
第一の配向状態に強誘電性液晶の配列を制御する第一位
相と、前記第一端子と第二端子の間で形成した電界と逆
極性の電界を第一端子と第二端子の間で形成することに
よって、第二の配向状態に強誘電性液晶の配列を制御す
る第二位相を有し、前記対向電極群に表示信号を印加す
るとともに各画素に対応しているＦＥＴ端子のうち、ソ
ースもしくはドレインを共通端子に接続してゲートに走
査信号を印加する時分割駆動であり、かかる考査信号線
（ゲート）に所定の走査信号を印加するとともに、表示
信号線（複数のストライプ状対向電極群）に信号電圧を
印加することによって全画面の表示状態を第一の配向状
態に基づく表示状態に一様にそろえ、次に前記走査信号
線に順次所定の電圧信号を印加するとともに、選択され
た表示信号線に第二の配向状態を形成する画像信号を印
加することを特徴とするものである。
本発明の駆動法で用いる強誘電性液晶としては、加えら
れる電界に応じて第一の光学的安定状態と第二の光学的
安定状態とのいずれかを取る。
れる電界に応じて第一の光学的安定状態と第二の光学的
安定状態とのいずれかを取る。
すなわち電界に対する双安定状態を有する物質、特にこ
のような性質を有する液晶が用いられ“る。
のような性質を有する液晶が用いられ“る。
本発明の駆動法で用いることができる双安定性を有する
強誘電性液晶としては、強誘電性を有するカイラルスメ
クティック液晶が最も好ましく、そのうち力イラルスメ
クティックＣ相（Ｓ履Ｃり又Ｈ相（ＳｍＨりの液晶が適
している。この強誘電性液晶ニツイテハ、”ＬＥ ＪＯ
ＵＲＮＡＬ ［ｌＥ ＰＨＹＳＩＯＵＥＬＥＴＴＥＲ３
” ３Ｂ （Ｌ−８８） １９７５． ｒ Ｆｅｒｒ
ｏｅｌｅｃｔｒｉｃＬｉｑｕｉｄ Ｃｒｙｓｔａｌｓ
Ｊ ； Ａｐｐｌｉｅｄ ｐｈｙＳｉｃｓ
Ｌｅｔ−ｔｅｒｓ″ ３Ｂ （１１） １ｉ３８
０ 、 ｒ Ｓｕｂｍｉｃｒｏ ５ｅｃｏｎｄ Ｂ
１−５ｔａｂｌｅ Ｅｌｅｃｔｒｏｏｐｔｉｃ Ｓ
ｗｉｔｃｈｉｎｇ ｉｎ ＬｉｑｕｉｄＣｒｙｓｔ
ａｌｓ Ｊ ； ”固体物理″１６ （１４１） ＩＨ
Ｉ ｒ液晶」等に記載されており、本発明ではこれら
に開示された強誘電性液晶を用いることができる。
強誘電性液晶としては、強誘電性を有するカイラルスメ
クティック液晶が最も好ましく、そのうち力イラルスメ
クティックＣ相（Ｓ履Ｃり又Ｈ相（ＳｍＨりの液晶が適
している。この強誘電性液晶ニツイテハ、”ＬＥ ＪＯ
ＵＲＮＡＬ ［ｌＥ ＰＨＹＳＩＯＵＥＬＥＴＴＥＲ３
” ３Ｂ （Ｌ−８８） １９７５． ｒ Ｆｅｒｒ
ｏｅｌｅｃｔｒｉｃＬｉｑｕｉｄ Ｃｒｙｓｔａｌｓ
Ｊ ； Ａｐｐｌｉｅｄ ｐｈｙＳｉｃｓ
Ｌｅｔ−ｔｅｒｓ″ ３Ｂ （１１） １ｉ３８
０ 、 ｒ Ｓｕｂｍｉｃｒｏ ５ｅｃｏｎｄ Ｂ
１−５ｔａｂｌｅ Ｅｌｅｃｔｒｏｏｐｔｉｃ Ｓ
ｗｉｔｃｈｉｎｇ ｉｎ ＬｉｑｕｉｄＣｒｙｓｔ
ａｌｓ Ｊ ； ”固体物理″１６ （１４１） ＩＨ
Ｉ ｒ液晶」等に記載されており、本発明ではこれら
に開示された強誘電性液晶を用いることができる。
より具体的には、本発明法に用いられる強誘電性液晶化
合物の例としては、デシロキシベンジリデン−Ｐ′−ア
ミノ−２−メチルプチルシンナメー） （ＤＱＢＡＭＢ
Ｇ） 、ヘキシルオキシベンジリデン−Ｐ′−アミノ−
２−クロロプロピルシンナメート（ＨＯＢＡＣＰＣ）お
よび４−ｏ−（２−メチル）−ブチルレゾルシリテン−
４′−オクチルアニリン（ＭＢＲＡ８）等が挙げられる
。
合物の例としては、デシロキシベンジリデン−Ｐ′−ア
ミノ−２−メチルプチルシンナメー） （ＤＱＢＡＭＢ
Ｇ） 、ヘキシルオキシベンジリデン−Ｐ′−アミノ−
２−クロロプロピルシンナメート（ＨＯＢＡＣＰＣ）お
よび４−ｏ−（２−メチル）−ブチルレゾルシリテン−
４′−オクチルアニリン（ＭＢＲＡ８）等が挙げられる
。
これらの材料を用いて、素子を構成する場合、液晶化合
物がＳ腸Ｃ零相又はＳｍＨ准相となるような温度状態に
保持する為、必要に応じて素子をヒーターが埋め込まれ
た銅ブロック等により支持することができる。
物がＳ腸Ｃ零相又はＳｍＨ准相となるような温度状態に
保持する為、必要に応じて素子をヒーターが埋め込まれ
た銅ブロック等により支持することができる。
第１図は、強誘電性液晶セルの例を模式的に描いたもの
である。１と１′は、Ｉｎｅ ０３ 、 ＳｎｕｇやＩ
ＴＯ（Ｉｎｄｉｕ＋ｗ−Ｔｉｎ ０ｘｉｄｅ）等の透明
電極がコートされた基板（ガラス板）であり、その間に
液晶分子層２がガラス面に垂直になるよう配向したＳａ
ｃ京相の液晶が封入されている。太線で示した線３が液
晶分子を表わしており、この液晶分子３は、その分子に
直交した方向に双極子モーメント（Ｐよ）４を有してい
る。基板ｌと１′上の電極間に一定の閾値以上の電圧を
印加すると、液晶分子３のらせん構造がほどけ、双極子
モーメント（Ｐ、）４はすべて電界方向に向くよう、液
晶分子３の配向方向を変えることができる。液晶分子３
は細長い形状を有しており、その長袖方向と短軸方向で
屈折率異方性を示し、従って例えばガラス面の上下に互
いにクロスニコルの位置関係に配置した偏光子を置けば
、電圧印加極性によって光学特性が変わる液晶光学変調
素子となることは、容易に理解される。さらに液晶セル
の厚さを充分に薄くした場合（例えばＩＪＬ）には、第
２図に示すように電界を印加していない状態でも液晶分
子のらせん構造は、はどけ（非らせん構造）、その双極
子モーメン）Ｐ又はＰ′は上向き（４ａ）又は下向（４
ｂ）のどちらかの状態をとる。このようなセルに第２図
に示す如く一定の闇値以上の極性の異なる電界Ｅ又はＥ
′を所定時間付与すると、双極子モーメントは電界Ｅ又
はＥ′の電界ベクトルに対応して上向き４ａ又は、下向
き４ｂと向きを変え、それに応じて液晶分子は第一の配
向状態５かあるいは第二の配向状態５′の何れか一方に
配向する。
である。１と１′は、Ｉｎｅ ０３ 、 ＳｎｕｇやＩ
ＴＯ（Ｉｎｄｉｕ＋ｗ−Ｔｉｎ ０ｘｉｄｅ）等の透明
電極がコートされた基板（ガラス板）であり、その間に
液晶分子層２がガラス面に垂直になるよう配向したＳａ
ｃ京相の液晶が封入されている。太線で示した線３が液
晶分子を表わしており、この液晶分子３は、その分子に
直交した方向に双極子モーメント（Ｐよ）４を有してい
る。基板ｌと１′上の電極間に一定の閾値以上の電圧を
印加すると、液晶分子３のらせん構造がほどけ、双極子
モーメント（Ｐ、）４はすべて電界方向に向くよう、液
晶分子３の配向方向を変えることができる。液晶分子３
は細長い形状を有しており、その長袖方向と短軸方向で
屈折率異方性を示し、従って例えばガラス面の上下に互
いにクロスニコルの位置関係に配置した偏光子を置けば
、電圧印加極性によって光学特性が変わる液晶光学変調
素子となることは、容易に理解される。さらに液晶セル
の厚さを充分に薄くした場合（例えばＩＪＬ）には、第
２図に示すように電界を印加していない状態でも液晶分
子のらせん構造は、はどけ（非らせん構造）、その双極
子モーメン）Ｐ又はＰ′は上向き（４ａ）又は下向（４
ｂ）のどちらかの状態をとる。このようなセルに第２図
に示す如く一定の闇値以上の極性の異なる電界Ｅ又はＥ
′を所定時間付与すると、双極子モーメントは電界Ｅ又
はＥ′の電界ベクトルに対応して上向き４ａ又は、下向
き４ｂと向きを変え、それに応じて液晶分子は第一の配
向状態５かあるいは第二の配向状態５′の何れか一方に
配向する。
このような強誘電性液晶を光学変調素子として用いるこ
との利点は２つある。第１に、応答速度が極めて速いこ
と、第２に液晶分子の配向が双安定状態を有することで
ある。第２の点を例えば第２図によって説明すると、電
界Ｅを印加すると液晶分子は第一の配向状態５に配向す
るが、この状態は電界を切っても安定である。又、逆向
きの電界Ｅ′を印加すると、液晶分子は第二の配向状態
５′に配向して、その分子の向きを変えるが、やはり電
界を切ってもこの状態に留っている。又、与える電界Ｅ
が一定の閾値を越えない限り、それぞれの配向状態にや
はり維持されている。このような応答速度の速さと、双
安定性が有効に実現されるには、セルとしては出来るだ
け薄い方が好ま 。
との利点は２つある。第１に、応答速度が極めて速いこ
と、第２に液晶分子の配向が双安定状態を有することで
ある。第２の点を例えば第２図によって説明すると、電
界Ｅを印加すると液晶分子は第一の配向状態５に配向す
るが、この状態は電界を切っても安定である。又、逆向
きの電界Ｅ′を印加すると、液晶分子は第二の配向状態
５′に配向して、その分子の向きを変えるが、やはり電
界を切ってもこの状態に留っている。又、与える電界Ｅ
が一定の閾値を越えない限り、それぞれの配向状態にや
はり維持されている。このような応答速度の速さと、双
安定性が有効に実現されるには、セルとしては出来るだ
け薄い方が好ま 。
しく、一般的には、０．５ ｐＬ〜２０ＩＬ、特にｌｐ
〜５ルが適している。この種の強誘電性液晶を用いたマ
トリクス電極構造を有する液晶−電気光学装置は、例え
ばクラークとラガバルにより、米国特許第４３８７９２
４号明細書で提案されている。
〜５ルが適している。この種の強誘電性液晶を用いたマ
トリクス電極構造を有する液晶−電気光学装置は、例え
ばクラークとラガバルにより、米国特許第４３８７９２
４号明細書で提案されている。
本発明は、アクティブマトリックスを構成するＴＰＴ
（薄膜トランジスタ）等のＦＥＴ （電界効果トラ
ンジスタ）構造の素子が、ドレインとソースの印加電圧
を逆にする事により、いずれをドレインとしていずれを
ソースとしても使用しうるという事にもとづいている。
（薄膜トランジスタ）等のＦＥＴ （電界効果トラ
ンジスタ）構造の素子が、ドレインとソースの印加電圧
を逆にする事により、いずれをドレインとしていずれを
ソースとしても使用しうるという事にもとづいている。
アクティブマトリックスを構成する素子としてはＦＥＴ
構造の素子であればアモルファスシリコンＴＰＴ 、多
結晶シリコンＴＰＴ等のいずれであっても使用しうる。
構造の素子であればアモルファスシリコンＴＰＴ 、多
結晶シリコンＴＰＴ等のいずれであっても使用しうる。
又ＦＥＴ構造以外のバイポーラトランジスタであっても
同様に行う事も可能である。
同様に行う事も可能である。
Ｎ型ＦＥＴは、■ をドレイン電圧、Ｖ をＤ
Ｇゲート電圧、Ｖ
Ｓをソース電圧、■、をゲートソース間の閾値電圧とす
るとＶｎ ＞ Ｖｓ であり、ＶＧ＞■、＋ｖ、の
時導通状態となり、Ｖ ｃ ＜ Ｖ ｓ ＋ Ｖ−ｐの
時非導通状態となる。
Ｇゲート電圧、Ｖ
Ｓをソース電圧、■、をゲートソース間の閾値電圧とす
るとＶｎ ＞ Ｖｓ であり、ＶＧ＞■、＋ｖ、の
時導通状態となり、Ｖ ｃ ＜ Ｖ ｓ ＋ Ｖ−ｐの
時非導通状態となる。
Ｐ型ＦＥＴ ニオイテはｖＤくｖｓとし、ｖＧ くＶＳ
＋Ｖ、−ｃ導通状態トナリ、ｖｏ＞ＶＳ＋ｖ。
＋Ｖ、−ｃ導通状態トナリ、ｖｏ＞ＶＳ＋ｖ。
で非導通状態となる。
ｐｙＪ！！であってもＮｆｆ１であってもＦＥＴの端子
のいずれがドレインとして作用し、いずれがソースとし
て作用するかは、電圧の印加の方向によって定まる。す
なわちＮ型では電圧の低い方がソースであり、Ｐ型では
電圧の高い方がソースとして作用する。
のいずれがドレインとして作用し、いずれがソースとし
て作用するかは、電圧の印加の方向によって定まる。す
なわちＮ型では電圧の低い方がソースであり、Ｐ型では
電圧の高い方がソースとして作用する。
強誘電性液晶においては、液晶セルに印加する、正、負
の電圧に対していずれを「明」状態とし、いずれを「暗
」状態とするかはセルの上下に配置するクロスニコル状
態にした一対の偏光子の偏光軸と、液晶分子長軸との向
きにより自由に設定できる。
の電圧に対していずれを「明」状態とし、いずれを「暗
」状態とするかはセルの上下に配置するクロスニコル状
態にした一対の偏光子の偏光軸と、液晶分子長軸との向
きにより自由に設定できる。
本発明は液晶セルに印加される電界をアクティブマトリ
ックスの各素子の端子間電圧を制御する事によって制御
し、表示を行なうものであるから、各信号の電圧レベル
は以下の実施例にとられれる事なく、各信号の電位差を
相対的に維持すれば、実施する事が可能である。
ックスの各素子の端子間電圧を制御する事によって制御
し、表示を行なうものであるから、各信号の電圧レベル
は以下の実施例にとられれる事なく、各信号の電位差を
相対的に維持すれば、実施する事が可能である。
［実施例］
次に、本発明のアクティブマトリックスによる強誘電性
液晶の駆動方法の具体例を第３図〜第７図に基づいて説
明する。
液晶の駆動方法の具体例を第３図〜第７図に基づいて説
明する。
第３図はアクティブマトリックスの回路図、第４図は対
応画素の番地を示す説明図及び第５図は対応画素の表示
例を示す説明図である。
応画素の番地を示す説明図及び第５図は対応画素の表示
例を示す説明図である。
６は走査電極群であり、７は表示電極群である。
第６図（ａ）は走査信号を示す図であって、位相ｊｌ
＋ｔ２ ＋・・・においてそれぞれ選択された走査電
極に印加される電気信号とそれ以外の走査電極（選択さ
れない走査電極）に印加される電気信号を示している。
＋ｔ２ ＋・・・においてそれぞれ選択された走査電
極に印加される電気信号とそれ以外の走査電極（選択さ
れない走査電極）に印加される電気信号を示している。
第６図（ｂ）は、表示信号を示す図であって位相ｔｌ＋
ｔ２＋・・・においてそれぞれ選択された表示電極と選
択されない表示電極に与えられる電気信号を示している
。
ｔ２＋・・・においてそれぞれ選択された表示電極と選
択されない表示電極に与えられる電気信号を示している
。
第６図においては、それぞれ横軸が時間を、縦軸が電圧
を表す。例えば、動画を表示するような場合には、走査
電極群６は逐次、周期的に選択される。選択された走査
電極ＧＮに与えられる電気信号は、第６図（ａ）に示さ
れる如く位相（時間）ｔｌでは、０であり、位相（時間
）ｔｚでは、＋ｖ６である。
を表す。例えば、動画を表示するような場合には、走査
電極群６は逐次、周期的に選択される。選択された走査
電極ＧＮに与えられる電気信号は、第６図（ａ）に示さ
れる如く位相（時間）ｔｌでは、０であり、位相（時間
）ｔｚでは、＋ｖ６である。
一方、それ以外の選択されない走査電極ＧＮ＋□。
Ｇ は第６図（ａ）に示す如く位相ｔ、、ｔ２でＮ＋
２ は０である。また、位相１．において選択された表示電
極ＣＮ ” Ｎ＋１ ” Ｎや、に与えられる電気
信号は、第６図（ｂ）に示される如＜ Ｖｃで あり
、位相ｔ２において選択された表示電極ＣＮ 。
２ は０である。また、位相１．において選択された表示電
極ＣＮ ” Ｎ＋１ ” Ｎや、に与えられる電気
信号は、第６図（ｂ）に示される如＜ Ｖｃで あり
、位相ｔ２において選択された表示電極ＣＮ 。
ＣＮ＋２に与えられる電気信号は＋ｖｏである。また位
相ｔ２において選択されない表示電極ＣＮ＋１に与えら
れる電気信号はＯである。以上に於て各々の電圧値は、
以下の関係を満足する所望の値に設定される。
相ｔ２において選択されない表示電極ＣＮ＋１に与えら
れる電気信号はＯである。以上に於て各々の電圧値は、
以下の関係を満足する所望の値に設定される。
走査電極ｍ＝Ｉ〜Ｎ （Ｎは走査線数）ラインに表示
電極ｎ＝１−Ｍ（Ｍは表示線数）の信号線で、全面に「
明」をリフレッシュ、次いで走査電極ｍ＝ｑのラインに
表示電極ｎ＝ｎで「暗」の書込みをする場合、 Ｖ −Ｖ ＞ＶＬｃ＋ＶｓＣｍ＝ｑ、ｎ＝ｆＬ）Ｃ
ｒｔｒ＝ｑ、ｎ＃ｎ）ｍ Ｐ ｖｓ−ｖＬｃ＞ｖｃｎ （ｍ＝１〜Ｎ 、ｎ−１
〜Ｍ）Ｖ ｓ ＋ Ｖ Ｌ ｃ、 ＜ Ｖ ｃｎ
（ｍ−ｑ 、ｎ −ＣＬ） （ｍ ＃ｑ 、ｎ −１）
ｖＧ、−ｖＰ＜ｖｃｎＣｍ＃ｑ 、 ｒ＋＃ｊＬ）但
し、各記号は下記の事項を表わす。
電極ｎ＝１−Ｍ（Ｍは表示線数）の信号線で、全面に「
明」をリフレッシュ、次いで走査電極ｍ＝ｑのラインに
表示電極ｎ＝ｎで「暗」の書込みをする場合、 Ｖ −Ｖ ＞ＶＬｃ＋ＶｓＣｍ＝ｑ、ｎ＝ｆＬ）Ｃ
ｒｔｒ＝ｑ、ｎ＃ｎ）ｍ Ｐ ｖｓ−ｖＬｃ＞ｖｃｎ （ｍ＝１〜Ｎ 、ｎ−１
〜Ｍ）Ｖ ｓ ＋ Ｖ Ｌ ｃ、 ＜ Ｖ ｃｎ
（ｍ−ｑ 、ｎ −ＣＬ） （ｍ ＃ｑ 、ｎ −１）
ｖＧ、−ｖＰ＜ｖｃｎＣｍ＃ｑ 、 ｒ＋＃ｊＬ）但
し、各記号は下記の事項を表わす。
ｖＧｍ’ゲー上ゲート走査信号）電圧
ｖＣｎ’対向電極（表示信号）電圧
■、：ゲート、ソース間の閾値
以上の動作をｑ＝ｌ−Ｎまで繰返し書込みを行う。
この様な電気信号が与えられたときの各画素のうち１例
えば第４図中の画素の書込み動作を第７図に示す、第７
図においてはそれぞれ横軸が時間を縦軸がＯＮ（暗）上
側、ＯＦＦ （明）下側の各表示゛ 状態を表わす
。すなわち、第６図及び第７図より明らかな如く、位相
ｔ１において選択された走査線及び表示線の交点にある
すべての画素ＰＮ、Ｎ〜Ｐ には、閾値−ｖＬＣ
を越える一Ｖｔ、ｃ＞−Ｎ＋２ 、 Ｎ＋２ Ｖｓ−Ｖ、が印加される。したがって、第４図において
全画素Ｐ −Ｐ は配向状態を変Ｎ、Ｎ
Ｎ＋２．Ｎ＋２ え、「明Ｊにリフレッシュされる。次に１位相ｔ２にお
いて、選択された走査線及び表示線の交点にある画素Ｐ
、Ｐ には閾値ｖＬ６をＮ、Ｎ Ｎ＋
２．Ｎ 越える電圧ＶＬｏ＜Ｖ８−Ｖ、が印加される。したＮ、
Ｎ Ｎ＋２．Ｎは「暗」に転移（スがって画素Ｐ
、Ｐ イッチ）する。位相ｔ３以降の動作は、位相ｔ２の場合
と同じように、選択された走査線及び表示線に対応する
画素に順次「暗」が書込まれていく。以上の各動作でわ
かる通り、選択された走査電極線上に表示電極が選択さ
れたか否かに応じて、選択された場合には液晶分子は第
一の配向状態あるいは第二の配向状態に配向を揃え、画
素はＯＮ（暗）あるいはＯＦＦ （明）となり、選択
されない場合にはすべての画素に印加される電圧は、い
ずれも閾値電圧を越えない。従って、第７図に示される
如く、選択された走査線上以外の各画素における液晶分
子は配向状態を変えることなく前回走査されたときの信
号状態に対応した配向を、そのまま保持している。即ち
、走査電極が選択されたときにその１ライン分の信号の
書き込みが行われ、１フレームが終了して次回選択され
るまでの間は、その信号状態を保持し得るわけである。
えば第４図中の画素の書込み動作を第７図に示す、第７
図においてはそれぞれ横軸が時間を縦軸がＯＮ（暗）上
側、ＯＦＦ （明）下側の各表示゛ 状態を表わす
。すなわち、第６図及び第７図より明らかな如く、位相
ｔ１において選択された走査線及び表示線の交点にある
すべての画素ＰＮ、Ｎ〜Ｐ には、閾値−ｖＬＣ
を越える一Ｖｔ、ｃ＞−Ｎ＋２ 、 Ｎ＋２ Ｖｓ−Ｖ、が印加される。したがって、第４図において
全画素Ｐ −Ｐ は配向状態を変Ｎ、Ｎ
Ｎ＋２．Ｎ＋２ え、「明Ｊにリフレッシュされる。次に１位相ｔ２にお
いて、選択された走査線及び表示線の交点にある画素Ｐ
、Ｐ には閾値ｖＬ６をＮ、Ｎ Ｎ＋
２．Ｎ 越える電圧ＶＬｏ＜Ｖ８−Ｖ、が印加される。したＮ、
Ｎ Ｎ＋２．Ｎは「暗」に転移（スがって画素Ｐ
、Ｐ イッチ）する。位相ｔ３以降の動作は、位相ｔ２の場合
と同じように、選択された走査線及び表示線に対応する
画素に順次「暗」が書込まれていく。以上の各動作でわ
かる通り、選択された走査電極線上に表示電極が選択さ
れたか否かに応じて、選択された場合には液晶分子は第
一の配向状態あるいは第二の配向状態に配向を揃え、画
素はＯＮ（暗）あるいはＯＦＦ （明）となり、選択
されない場合にはすべての画素に印加される電圧は、い
ずれも閾値電圧を越えない。従って、第７図に示される
如く、選択された走査線上以外の各画素における液晶分
子は配向状態を変えることなく前回走査されたときの信
号状態に対応した配向を、そのまま保持している。即ち
、走査電極が選択されたときにその１ライン分の信号の
書き込みが行われ、１フレームが終了して次回選択され
るまでの間は、その信号状態を保持し得るわけである。
従って、走査電極数が増えても、実質的なデユーティ比
はかわらず、コントラストの低下は全く生じない。
はかわらず、コントラストの低下は全く生じない。
第５図に於て、走査電極ＧＧ、Ｇ ・・・Ｎ’Ｎ＋
Ｉ Ｎ＋２’ と表示電極ＣＣＣ・・・の交点で形成するＮ’ Ｎ
＋１’ Ｎ＋２’ 画素のうち、斜線部の画素は「暗Ｊ状態に、白地で示し
た画素は「明」状態に対応するものとする。今、第５図
中の表示電極ＣＮ上の表示に注目すると、走査電極ＧＮ
、ＧＮ＋２に対応する画素では「暗」状態であり、それ
以外の画素は「明」状態である。前記、位相ｔ 、 ｘ
ｔ ４の各動作によって、第５図の表示パターンが完成
する。
Ｉ Ｎ＋２’ と表示電極ＣＣＣ・・・の交点で形成するＮ’ Ｎ
＋１’ Ｎ＋２’ 画素のうち、斜線部の画素は「暗Ｊ状態に、白地で示し
た画素は「明」状態に対応するものとする。今、第５図
中の表示電極ＣＮ上の表示に注目すると、走査電極ＧＮ
、ＧＮ＋２に対応する画素では「暗」状態であり、それ
以外の画素は「明」状態である。前記、位相ｔ 、 ｘ
ｔ ４の各動作によって、第５図の表示パターンが完成
する。
本発明の強誘電性液晶の駆動方法において、走査電極と
信号電極の配置は任意であり、例えば第９図（ａ）
、 （ｂ）に示すように一列に画素を配置することも可
能であり、この様に配置するとシャッターアレイ等とし
て利用することができる。
信号電極の配置は任意であり、例えば第９図（ａ）
、 （ｂ）に示すように一列に画素を配置することも可
能であり、この様に配置するとシャッターアレイ等とし
て利用することができる。
次に、以上に説明した実施例において、強誘電性液晶と
してＤＯＢＡＭＢＧを駆動するのに好ましい具体的数値
を示すと、例えば 入力周波数ｆｏ＝ Ｉ ＸＩＯ’ 〜ｌＸｌ０” ）１
２１０＜ ｌ Ｖ、 Ｉ ＜８０Ｖ （波高値）０．
３ ＜ ｌ ｖ８１ ＜ＩＯＶ Ｃ波高値）が挙げられ
る。
してＤＯＢＡＭＢＧを駆動するのに好ましい具体的数値
を示すと、例えば 入力周波数ｆｏ＝ Ｉ ＸＩＯ’ 〜ｌＸｌ０” ）１
２１０＜ ｌ Ｖ、 Ｉ ＜８０Ｖ （波高値）０．
３ ＜ ｌ ｖ８１ ＜ＩＯＶ Ｃ波高値）が挙げられ
る。
第９図は本発明において使用されるＴＦＴにおけるＦＥ
Ｔの構成を示す断面図、第１０図はＴＰＴを用いた強誘
電性液晶セルの断面図、第１１図はＴＦＴ基板の斜視図
、第１２図はＴＰＴ基板の平面図、第１３図は第１２図
のＡ−Ａ ’線で切断した部分断面図、第１４図は第１
２図のＢ−Ｂ’線で切断した部分断面図であり、以上に
示す各図はいずれも本発明の一実施態様を示すものであ
る。
Ｔの構成を示す断面図、第１０図はＴＰＴを用いた強誘
電性液晶セルの断面図、第１１図はＴＦＴ基板の斜視図
、第１２図はＴＰＴ基板の平面図、第１３図は第１２図
のＡ−Ａ ’線で切断した部分断面図、第１４図は第１
２図のＢ−Ｂ’線で切断した部分断面図であり、以上に
示す各図はいずれも本発明の一実施態様を示すものであ
る。
第１０図は、本発明の方法で用いうる液晶素子の１つの
具体例を表わしている。ガラス、プラスチック等の基板
２０の上にゲート電極２４、絶縁膜２２（水素原子をド
ーピングした窒化シリコン膜など）を介し゛て形成した
半導体膜１６（水素原子をドーピング、したアモルファ
スシリコン）と、この半導体膜１６に接する２つ端子８
と１１で構成したＴＰＴと、ＴＰＴの端子１１と接続し
た画素電極１２（ＩＴＯ； Ｉｎｄｎｉｕｍ Ｔｉｎ
０ｗ１ｄｅ）が形成されている。
具体例を表わしている。ガラス、プラスチック等の基板
２０の上にゲート電極２４、絶縁膜２２（水素原子をド
ーピングした窒化シリコン膜など）を介し゛て形成した
半導体膜１６（水素原子をドーピング、したアモルファ
スシリコン）と、この半導体膜１６に接する２つ端子８
と１１で構成したＴＰＴと、ＴＰＴの端子１１と接続し
た画素電極１２（ＩＴＯ； Ｉｎｄｎｉｕｍ Ｔｉｎ
０ｗ１ｄｅ）が形成されている。
さらに、この上に絶縁層＋３（ポリイミド、ポリアミド
、ポリビニルアルコール、ポリバラキシリレン、ＳｉＯ
、’ ＳｉＯｇ）とアルミニウムやクロムなどからなる
光遮蔽膜９が設けられている。対向基板となる基板２０
′ノ上には対向電極２１ （ＩＴＯＢ Ｉｎｄｎｉｕｍ
Ｔｉｎ ０ｗ１ｄｅ）と絶縁膜２２が形成されている。
、ポリビニルアルコール、ポリバラキシリレン、ＳｉＯ
、’ ＳｉＯｇ）とアルミニウムやクロムなどからなる
光遮蔽膜９が設けられている。対向基板となる基板２０
′ノ上には対向電極２１ （ＩＴＯＢ Ｉｎｄｎｉｕｍ
Ｔｉｎ ０ｗ１ｄｅ）と絶縁膜２２が形成されている。
この基板２０と２０′の間には、前述の強誘電性液晶２
３が挟持されている。又、この基板２０と２０′の周囲
部には強誘電性液晶２３を封止するためのシール材２５
が設けられている。
３が挟持されている。又、この基板２０と２０′の周囲
部には強誘電性液晶２３を封止するためのシール材２５
が設けられている。
この様なセル構造の液晶素子の両側にはクロスニコル状
態の偏光子１８と１８′が配置され、観察者Ａが入射光
重。よりの反射光重１によって表示状態を見ることがで
きる様に偏光子１８′の背後に反射板１８（乱反射性ア
ルミニウムシート又は板）が設けられている。
態の偏光子１８と１８′が配置され、観察者Ａが入射光
重。よりの反射光重１によって表示状態を見ることがで
きる様に偏光子１８′の背後に反射板１８（乱反射性ア
ルミニウムシート又は板）が設けられている。
又、上記の各図においてソース電極、ドレイン電極とは
、ドレインからソースへ電流が流れる場合に限定した命
名である。 ＦＥＴの働きではソースがドレインとして
働く場合も可能である。
、ドレインからソースへ電流が流れる場合に限定した命
名である。 ＦＥＴの働きではソースがドレインとして
働く場合も可能である。
［発明の効果］
上記の構造よりなる本発明の強誘電性液晶の駆動方法を
用いることにより、アクティブマトリックスに画素数の
多い大画面の表示及び高速度で鮮明な画像を表示するこ
とができる。
用いることにより、アクティブマトリックスに画素数の
多い大画面の表示及び高速度で鮮明な画像を表示するこ
とができる。
第１図及び第２図は、本発明の方法に用いる強誘電性液
晶を模式的に表わす斜視図、第３図は本発明の方法に用
いるマトリックス電極の回路図、第４図は対応画素の番
地を示す説明図、第５図は対応画素の表示例を示す説明
図、第６図（ａ）及び（ｂ）は走査電極及び表示電極に
印加する電気信号を表わす説明図、第７図は各画素への
書込み動作を表わす説明図、第８図（ａ）及び（ｂ）は
アクティブマトリックス回路と画素配置の例を示す配線
図、第９図はＴＦＴにおけるＦＥＴの構成を示す断面図
、第１０図はＴＦＴを用いた強誘電性液晶セルの断面図
、第１１図はＴＦ丁基板の斜視図、第１２図はＴＦＴ基
板の平面図、第１３図はＡ−Ａ ’線部分断面図及び第
１４図はＢ−Ｂ ′部分断面図である。 １．１’；透明電極がコートされた基板２；液晶分子層 ３；液晶分子 ４；双極子モーメント（Ｐ、） ４ａ；上向き双極子モーメント ４ｂ；下向き双極子モーメント ５；第一の配向状態 ５′；第二の配向状態 ９；光遮蔽膜 １０；ｎ″″層 １１； ドレイン電極（ソース電極）１２；画素電極
１３；絶縁層 １４；基板 １５；半導体直下の光遮蔽膜１６；半
導体 １７；ゲート配線部の透明電極１８；反射板
１９．１！３”；偏光板２０．２０’；ガラス、プラ
スチック等の透明基板２１；対向電極 ２２；絶縁膜 ２３；強誘電性液晶層 ２４；ゲート電極 ２５；シール材 ２θ：薄膜半導体 ２７；ゲート配線 ２８；パネル基板 ２８；光遮断効果を有するゲート部 １′〜Ｍ′；走査電極 １−Ｎ、表示電極 Ｌ；共通電極 ＬＣｉ液晶 ＦＥＴ、電界効果トランジスタ
晶を模式的に表わす斜視図、第３図は本発明の方法に用
いるマトリックス電極の回路図、第４図は対応画素の番
地を示す説明図、第５図は対応画素の表示例を示す説明
図、第６図（ａ）及び（ｂ）は走査電極及び表示電極に
印加する電気信号を表わす説明図、第７図は各画素への
書込み動作を表わす説明図、第８図（ａ）及び（ｂ）は
アクティブマトリックス回路と画素配置の例を示す配線
図、第９図はＴＦＴにおけるＦＥＴの構成を示す断面図
、第１０図はＴＦＴを用いた強誘電性液晶セルの断面図
、第１１図はＴＦ丁基板の斜視図、第１２図はＴＦＴ基
板の平面図、第１３図はＡ−Ａ ’線部分断面図及び第
１４図はＢ−Ｂ ′部分断面図である。 １．１’；透明電極がコートされた基板２；液晶分子層 ３；液晶分子 ４；双極子モーメント（Ｐ、） ４ａ；上向き双極子モーメント ４ｂ；下向き双極子モーメント ５；第一の配向状態 ５′；第二の配向状態 ９；光遮蔽膜 １０；ｎ″″層 １１； ドレイン電極（ソース電極）１２；画素電極
１３；絶縁層 １４；基板 １５；半導体直下の光遮蔽膜１６；半
導体 １７；ゲート配線部の透明電極１８；反射板
１９．１！３”；偏光板２０．２０’；ガラス、プラ
スチック等の透明基板２１；対向電極 ２２；絶縁膜 ２３；強誘電性液晶層 ２４；ゲート電極 ２５；シール材 ２θ：薄膜半導体 ２７；ゲート配線 ２８；パネル基板 ２８；光遮断効果を有するゲート部 １′〜Ｍ′；走査電極 １−Ｎ、表示電極 Ｌ；共通電極 ＬＣｉ液晶 ＦＥＴ、電界効果トランジスタ
Claims (1)
- （１）ＦＥＴのゲート以外の端子である第一端子と接続
した画素電極を該ＦＥＴに対応して複数設けた第一基板
と該画素電極に対向する対向電極を設けた第二基板を有
し、前記画素電極と対向電極の間に電界に対して双安定
状態を有する強誘電性液晶を挟持した構造の液晶素子の
駆動法であって、前記ＦＥＴのゲートがゲートオン状態
となる信号印加と同期させてＦＥＴのゲート以外の端子
である第一端子と第二端子の間で電界を形成することに
よって、第一の配向状態に強誘電性液晶の配列を制御す
る第一位相と、前記第一端子と第二端子の間で形成した
電界と逆極性の電界を第一端子と第二端子の間で形成す
ることによって、第二の配向状態に強誘電性液晶の配列
を制御する第二位相を有し、前記対向電極群に表示信号
を印加するとともに各画素に対応している、ＦＦＴ端子
のうち、ソースもしくはドレインを共通端子に接続して
ゲートに走査信号を印加する時分割駆動であり、かかる
走査信号線に所定の走査信号を印加するとともに、表示
信号線に信号電圧を印加することによって全画面の表示
状態を第一の配向状態に基づく表示状態に一様にそろえ
、次に前記走査信号線に順次、所定の電圧信号を印加す
るとともに、選択された表示信号線に第二の配向状態を
形成する画像信号を印加することを特徴とする液晶素子
の駆動法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59127415A JPS617825A (ja) | 1984-06-22 | 1984-06-22 | 液晶素子の駆動法 |
| US06/724,828 US4697887A (en) | 1984-04-28 | 1985-04-18 | Liquid crystal device and method for driving the same using ferroelectric liquid crystal and FET's |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59127415A JPS617825A (ja) | 1984-06-22 | 1984-06-22 | 液晶素子の駆動法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS617825A true JPS617825A (ja) | 1986-01-14 |
| JPH0453292B2 JPH0453292B2 (ja) | 1992-08-26 |
Family
ID=14959395
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59127415A Granted JPS617825A (ja) | 1984-04-28 | 1984-06-22 | 液晶素子の駆動法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS617825A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4770501A (en) * | 1985-03-07 | 1988-09-13 | Canon Kabushiki Kaisha | Optical modulation device and method of driving the same |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS614029A (ja) * | 1984-06-19 | 1986-01-09 | Canon Inc | 液晶素子の駆動法 |
-
1984
- 1984-06-22 JP JP59127415A patent/JPS617825A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS614029A (ja) * | 1984-06-19 | 1986-01-09 | Canon Inc | 液晶素子の駆動法 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4770501A (en) * | 1985-03-07 | 1988-09-13 | Canon Kabushiki Kaisha | Optical modulation device and method of driving the same |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0453292B2 (ja) | 1992-08-26 |
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