JPS617653A - 半導体用リ−ドフレ−ム - Google Patents

半導体用リ−ドフレ−ム

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Publication number
JPS617653A
JPS617653A JP12870784A JP12870784A JPS617653A JP S617653 A JPS617653 A JP S617653A JP 12870784 A JP12870784 A JP 12870784A JP 12870784 A JP12870784 A JP 12870784A JP S617653 A JPS617653 A JP S617653A
Authority
JP
Japan
Prior art keywords
lead frame
push
resin
backs
lead
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP12870784A
Other languages
English (en)
Inventor
Masahito Sei
雅人 清
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP12870784A priority Critical patent/JPS617653A/ja
Publication of JPS617653A publication Critical patent/JPS617653A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/48Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
    • H01L23/488Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
    • H01L23/495Lead-frames or other flat leads
    • H01L23/49541Geometry of the lead-frame
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

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  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体装置製造に使用される半導体従来使用
されてきたリードフレームの一例を第3図に示す。従来
のリードフレームではアイランド部1に半導体素子を取
り付け、金属線で半導体素子の電極とイン九−リード2
とを接続し、樹脂で封入した後、樹脂が固化した本来の
パッケージ部とアウターリード3とタイバー4とでかこ
まれた空間に樹脂の厚パリが形成され、樹脂破断等の処
理をしても取り切れない樹ハバリが残ってしまうという
欠点があった。
〔発明が解決しようとする問題点〕
本発明の目的は、半導体パッケージ側面に樹脂パリので
きない様な半導体用リードフレームを提供することであ
る。
〔問題点を解決するための手段〕
本発明によれば、アウターリード間にプッシュバックを
有する半尋体用リードフレームを得る。
〔実施例〕
次に、図面を参照して本発明をより詳細に説明する。
本発明によるリードフレームを第1図に示す。
半導体素子を取り付けるアイランド部1.ワイヤーボン
ディング部を有するインナーリード2.外部端子を有す
るアウターリード3.がリードフレーム枠7で連結して
成るリードフレームにおいて2本のアウターリード30
間に一端をリードフレーム枠7Vc固冗され十分なバネ
剛性を有し、かつ樹脂をせん断するのに十分な強さを有
するプッシュバック5を有している。
2本のアウターリード3とそめ間に位置するプッシュバ
ック5を第2図に示す。プッシュバック先端部5aとア
ウターリード3との間隔は最大で0.04mm程度でそ
のすき間から樹脂もれ奮起こさない程、短かいものであ
る。また、プッシュバック先端部5aと本来の樹脂パッ
ケージ6との間隔は0.15 mm程度である。樹脂封
入後、プッシュバック先端部5aを下方へ押し込めば、
半導体パッケージbとプッシュバック5の先端部5aと
の間に形成された樹脂パリはプッシュバック5が下がる
ことによって破断される。充いで押込み力を解除すれば
、十分なバネ剛性をもつプッシュバック5は押し込む前
の状態に復帰し、後の工程にも支障がない。
〔発明の効果〕
本発明によるプッシュバックをもつリードフレームでは
樹脂封入後に形成される樹脂パリの景が少なく、破断が
楽であシ、かつアウターリードに薄パリがつかないとい
う利点がある。
また、従来樹脂破断とタイバー切断という2つの工数を
かけて行なっていたことを1つの工数で行なってしまう
という効果もある。
【図面の簡単な説明】
第1図は本発明の一実施例によるリードフレームの平面
図である。 1・・−・・・アイランド部、2・・・・・・インナー
リード。 3・・・・・・アウターリード、5・・・・・・プッシ
ュバック。 7・・・・・・リードフレーム枠。 第2図はプッシュバック部の拡大間である。 3・・・・・・アウターリード、5・・・・・・プッシ
ュバック。 5a・・・・・・ブックユバツク先端、6・・・・・・
樹脂パッケージ。 −ジ。 第3図は従来のリードフレームの一例を示す平面図であ
る。 ■・・・・・・アイランド部、2・・・・・・インナー
リード。 3・・・・・・アウターリード、4・・・・・・タイバ
ー。 竿 ! 図 $2rgJ 算3 回

Claims (1)

    【特許請求の範囲】
  1. 半導体素子を取り付けるアイランド部とワイヤーボンデ
    ィング部とを有するインナーリード、外部端子を有する
    アウターリードがリードフレーム枠で連続して成るリー
    ドフレームおいて、前記アウターリード間に一端をリー
    ドフレーム枠に固定されたプッシュバックを有すること
    を特徴とする半導体用リードフレーム。
JP12870784A 1984-06-22 1984-06-22 半導体用リ−ドフレ−ム Pending JPS617653A (ja)

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JP12870784A JPS617653A (ja) 1984-06-22 1984-06-22 半導体用リ−ドフレ−ム

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JPS617653A true JPS617653A (ja) 1986-01-14

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JP12870784A Pending JPS617653A (ja) 1984-06-22 1984-06-22 半導体用リ−ドフレ−ム

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5343615A (en) * 1991-03-22 1994-09-06 Fujitsu Limited Semiconductor device and a process for making same having improved leads

Cited By (1)

* Cited by examiner, † Cited by third party
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