JPS6162956A - 処理装置のｉｐｌ制御方式 - Google Patents
処理装置のｉｐｌ制御方式Info
- Publication number
- JPS6162956A JPS6162956A JP59184589A JP18458984A JPS6162956A JP S6162956 A JPS6162956 A JP S6162956A JP 59184589 A JP59184589 A JP 59184589A JP 18458984 A JP18458984 A JP 18458984A JP S6162956 A JPS6162956 A JP S6162956A
- Authority
- JP
- Japan
- Prior art keywords
- ipl
- processor
- power
- execution
- power outage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、処理装置のＩＰＬ制御方式に関する。
〔発明の背景］
処理装置の運転操作を軽減するため、処理装置の電源を
投入することで、ＩＭｐ Ｌ （イニシャルマイクロプ
ログラムロード）からプログラムのＩＰＬまでを自動的
に処理することが行なわれている。一般的に、この方式
の実現のために、論理回路の電源の立上りを回路で検出
しスタートする回路が使用されている。この回路は停電
などで電圧が変動しても同様に動作する。
投入することで、ＩＭｐ Ｌ （イニシャルマイクロプ
ログラムロード）からプログラムのＩＰＬまでを自動的
に処理することが行なわれている。一般的に、この方式
の実現のために、論理回路の電源の立上りを回路で検出
しスタートする回路が使用されている。この回路は停電
などで電圧が変動しても同様に動作する。
処理装置がＪＯＢを実行中に瞬間停電が発生すると、こ
の回路によりＩＭｐＬ 、ＩＰＬが自動的に実行される
。このことは停電前実行中のＪＯＢが中途で打切られ、
具合が悪い。
の回路によりＩＭｐＬ 、ＩＰＬが自動的に実行される
。このことは停電前実行中のＪＯＢが中途で打切られ、
具合が悪い。
本発明は、上記問題を解決することが目的である。
本発明では、瞬間停電による電源立上り時には自動的な
ｌｐＬを抑止し、以前圧実行していりＪ ＯＢの後処理
を実行するための人手介入の余地をあたえることを特徴
とするものである。
ｌｐＬを抑止し、以前圧実行していりＪ ＯＢの後処理
を実行するための人手介入の余地をあたえることを特徴
とするものである。
以下、本発明の一実施例を第１図から第５図により説明
する。第１図Ａ、Ｂは本発明を使用しない場合と使用し
た場合のＩＭｐＬからＩＰＬおよびプログラムの実行ま
での順序を示している。処理装置は電源をＯＮにすると
、自動的にＩＭｐＬを実行し、終了後あらかじめプリセ
ットされているＩＰＬ用装置番号に対しＩ ｆ） Ｌコ
マンドを発行し、プログラムをロードし実行を開始する
。これらすべては人手の介入なしに実行される。
する。第１図Ａ、Ｂは本発明を使用しない場合と使用し
た場合のＩＭｐＬからＩＰＬおよびプログラムの実行ま
での順序を示している。処理装置は電源をＯＮにすると
、自動的にＩＭｐＬを実行し、終了後あらかじめプリセ
ットされているＩＰＬ用装置番号に対しＩ ｆ） Ｌコ
マンドを発行し、プログラムをロードし実行を開始する
。これらすべては人手の介入なしに実行される。
本発明は、この人手介入の不用なシステムにおいて、異
常なＩＭｐＬによる期待しないＩＰＬの実行を防ぐため
にある。第１図Ｂは、Ａに対し、停電後のＩＭｐＬの判
寓を追加している。
常なＩＭｐＬによる期待しないＩＰＬの実行を防ぐため
にある。第１図Ｂは、Ａに対し、停電後のＩＭｐＬの判
寓を追加している。
瞬間停電による停電後の予期せぬＩＭｐＬの実。
行を判別１．、通常のパワーオンでないことを検出した
場合には、自動的なＩＰＬを実行せずに異常警告を出す
ことで、すみゃかに停電に対する処置の実行を可能とす
る。
場合には、自動的なＩＰＬを実行せずに異常警告を出す
ことで、すみゃかに停電に対する処置の実行を可能とす
る。
第２図は、本発明を使用している処理装置で、処理を実
行中に停電が発生した場合の動作をタイムチャートで示
している。処理装置の電源が停電となると、当然処理装
置内部の各素子で使用している電圧は低下１−１ついに
は動作不能とｔ「る。この時これらの電圧を停電検出回
路でチェックし停電を検出する。停電検出ができても、
その電源自体が停電により無くなってしまっては意味が
ない。停電、検出回路の電源は電池など停電の発生する
電源とは別にする。またこの停電検出回路は、停電が検
出されると、停電を検出したことを保持しておく。
行中に停電が発生した場合の動作をタイムチャートで示
している。処理装置の電源が停電となると、当然処理装
置内部の各素子で使用している電圧は低下１−１ついに
は動作不能とｔ「る。この時これらの電圧を停電検出回
路でチェックし停電を検出する。停電検出ができても、
その電源自体が停電により無くなってしまっては意味が
ない。停電、検出回路の電源は電池など停電の発生する
電源とは別にする。またこの停電検出回路は、停電が検
出されると、停電を検出したことを保持しておく。
停電時間の短い瞬間停電のとき、素子に供給されている
電源は一度電圧は下がり再度回復する。
電源は一度電圧は下がり再度回復する。
この回復状態が通常の電源オンと同様であると、処理装
置のＩＭｐＬ開始回路が働きＩ ｋｌ ｐＬが開始され
、コントロールのプログラムＶＣ（ｊＬいＩＭｐ Ｌが
実行される。Ｉ Ｍ ｐ Ｌ終了後、ＩＰＬの実行前、
停電検出回路の状態がチェックされる。
置のＩＭｐＬ開始回路が働きＩ ｋｌ ｐＬが開始され
、コントロールのプログラムＶＣ（ｊＬいＩＭｐ Ｌが
実行される。Ｉ Ｍ ｐ Ｌ終了後、ＩＰＬの実行前、
停電検出回路の状態がチェックされる。
もし停電を検出したことを保持していた場合には異常を
警告し、ＩＰＬを抑止する。
警告し、ＩＰＬを抑止する。
第５図は停電検出回路を示す。この回路は停電検出部５
、停電検出保持部２で構成される。
、停電検出保持部２で構成される。
停電検出保持部２はフリップフロタブから成り、これは
停電検出部５の出力でセットされ、処理装置の電源オン
キー信号５および電源オフキー信号乙のオアゲート４を
介した信号でリセットされる。
停電検出部５の出力でセットされ、処理装置の電源オン
キー信号５および電源オフキー信号乙のオアゲート４を
介した信号でリセットされる。
本発明によれば、処理装置の電源を投入することにより
、自動的にＩＭｐＬ、ＩＰＬを実行１する処理装置にお
いて、瞬間停電発生時のあやまったＩＰＬを抑止するこ
とができ、停電時におけるプログラムの回復処理をスム
ーズに実行可能となる。
、自動的にＩＭｐＬ、ＩＰＬを実行１する処理装置にお
いて、瞬間停電発生時のあやまったＩＰＬを抑止するこ
とができ、停電時におけるプログラムの回復処理をスム
ーズに実行可能となる。
第１図のイ、Ｂはそれぞれ本発明を使用しない場合のＩ
ＭｐＬ、ＩＰＬの実行順序、本発明によるＩＭｐＬ、Ｉ
ＰＬの実行順序のフローチャート。第２図は処理の実行
中に停電が発生してからＩＭｐＬが開始するまでのタイ
ムチャート。第３図は停電検出回路を示す図である。 ５・・・停電検出部、 ２・・・停電状態保持部。
ＭｐＬ、ＩＰＬの実行順序、本発明によるＩＭｐＬ、Ｉ
ＰＬの実行順序のフローチャート。第２図は処理の実行
中に停電が発生してからＩＭｐＬが開始するまでのタイ
ムチャート。第３図は停電検出回路を示す図である。 ５・・・停電検出部、 ２・・・停電状態保持部。
Claims (1)
- 電源を投入することによりＩＭＰＬ（イニシャル マイ
クロプログラム ロード）を開始し、引き続きＩＰＬ（
イニシャル プログラム ロード）を実行する機能を有
する処理装置において、処理装置に給電する電源系の停
電を検出し、停電が発生したことを記憶する手段を設け
、停電後の電源立上り時にはＩＭＰＬ後のＩＰＬを上記
記憶内容により抑止することを特徴とするＩＰＬ制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59184589A JPS6162956A (ja) | 1984-09-05 | 1984-09-05 | 処理装置のｉｐｌ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59184589A JPS6162956A (ja) | 1984-09-05 | 1984-09-05 | 処理装置のｉｐｌ制御方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6162956A true JPS6162956A (ja) | 1986-03-31 |
| JPH0316656B2 JPH0316656B2 (ja) | 1991-03-06 |
Family
ID=16155847
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59184589A Granted JPS6162956A (ja) | 1984-09-05 | 1984-09-05 | 処理装置のｉｐｌ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6162956A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01158597A (ja) * | 1987-12-15 | 1989-06-21 | Tokyo Electric Co Ltd | 電子式キャッシュレジスタ |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5725044A (en) * | 1980-07-21 | 1982-02-09 | Hitachi Ltd | Initial microprogram load execution control system |
| JPS5887636A (ja) * | 1981-11-20 | 1983-05-25 | Fujitsu Ltd | プログラム・ロ−ド方式 |
-
1984
- 1984-09-05 JP JP59184589A patent/JPS6162956A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5725044A (en) * | 1980-07-21 | 1982-02-09 | Hitachi Ltd | Initial microprogram load execution control system |
| JPS5887636A (ja) * | 1981-11-20 | 1983-05-25 | Fujitsu Ltd | プログラム・ロ−ド方式 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01158597A (ja) * | 1987-12-15 | 1989-06-21 | Tokyo Electric Co Ltd | 電子式キャッシュレジスタ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0316656B2 (ja) | 1991-03-06 |
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