JPS6140649A - レジスタトレ−サ装置 - Google Patents
レジスタトレ−サ装置Info
- Publication number
- JPS6140649A JPS6140649A JP16213184A JP16213184A JPS6140649A JP S6140649 A JPS6140649 A JP S6140649A JP 16213184 A JP16213184 A JP 16213184A JP 16213184 A JP16213184 A JP 16213184A JP S6140649 A JPS6140649 A JP S6140649A
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- JP
- Japan
- Prior art keywords
- register
- contents
- registers
- microinstruction
- written
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- Pending
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/36—Preventing errors by testing or debugging software
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、情報処理装置に使用されるレジスタトレーサ
装置に関する。
装置に関する。
（従来の技術）
情報処理装置において成るレジスタ、またはレジスタ群
に着目して状態変化の履歴をトレースすれば、°情報処
理装置のデバッグや障害の解析を行う際に重要な情報が
得られる。
に着目して状態変化の履歴をトレースすれば、°情報処
理装置のデバッグや障害の解析を行う際に重要な情報が
得られる。
第２図はマイクロ命令の実行ルーチンの一例番示す説明
図である。第２図において、ｗ ＲＥＧ１←０１（薊”
は「レジスタ１に１６進で１を書込む」ことを意味する
。第２図に示すよう々ルーチンの場合、レジスタ１の内
容が割込みの種類を示すフラグとなっている。従って、
レジスタｌの内容の状態変化の履歴を取れば、どのよう
な割込みが、どのような順序で処理されたかを知ること
ができる。。
図である。第２図において、ｗ ＲＥＧ１←０１（薊”
は「レジスタ１に１６進で１を書込む」ことを意味する
。第２図に示すよう々ルーチンの場合、レジスタ１の内
容が割込みの種類を示すフラグとなっている。従って、
レジスタｌの内容の状態変化の履歴を取れば、どのよう
な割込みが、どのような順序で処理されたかを知ること
ができる。。
従来、斯かるレジスタの履歴を採取する場合には、あら
かじめ決められた条件でレジスタの内容を採取するため
のマイクロ命令ルーチンが起動され、このマイクロ命令
によりレジスタの内容を読出し、さらに読出された内容
を記憶回路に記憶させて実現していた。
かじめ決められた条件でレジスタの内容を採取するため
のマイクロ命令ルーチンが起動され、このマイクロ命令
によりレジスタの内容を読出し、さらに読出された内容
を記憶回路に記憶させて実現していた。
（発明が解決しようとする問題点）
しかし、上記の方式にｂｔ、−ｔてはレジスタの内容を
採取するのに多くの時間が必要であり、採取の期間、通
常の処理が止ってしまうという欠点があった。さらに、
レジスタの状態が変化した時点で情報を採取するわけで
はないので、履歴のすべてを採取できない可能性があり
、また必要と思われるレジスタの内容をすべて採取する
ことになるので、不必要なレジスタの履歴も採取しなけ
ればなら々〈々す、多くの記憶容量が必要になるという
欠点もあった。
採取するのに多くの時間が必要であり、採取の期間、通
常の処理が止ってしまうという欠点があった。さらに、
レジスタの状態が変化した時点で情報を採取するわけで
はないので、履歴のすべてを採取できない可能性があり
、また必要と思われるレジスタの内容をすべて採取する
ことになるので、不必要なレジスタの履歴も採取しなけ
ればなら々〈々す、多くの記憶容量が必要になるという
欠点もあった。
本発明の目的は、内部レジスタの内容が変化した時のマ
イクロ命令アドレスと、上記レジスタを識別するための
、あらかじめ定められたコード、および上記変化の後の
レジスタの内容をノ・−ドウエアによって記憶回路に記
憶させ、外部からスイッチにより履歴を採取したいレジ
スタを選択できるように構成することにより上記欠点を
解決し、必要外レジスタの履歴を確実に採取できるよう
に構成したレジスタトレーサ装置を提供することにある
。
イクロ命令アドレスと、上記レジスタを識別するための
、あらかじめ定められたコード、および上記変化の後の
レジスタの内容をノ・−ドウエアによって記憶回路に記
憶させ、外部からスイッチにより履歴を採取したいレジ
スタを選択できるように構成することにより上記欠点を
解決し、必要外レジスタの履歴を確実に採取できるよう
に構成したレジスタトレーサ装置を提供することにある
。
（問題点を解決するための手段）
本発明によるレジスタトレーサ装量は１個以上のレジス
タと、トレース情報格納手段と、トレース情報読出し手
段と、選択手段とを具備して構成したものである。
タと、トレース情報格納手段と、トレース情報読出し手
段と、選択手段とを具備して構成したものである。
１個以上のレジスタは、マイクロ命令により制御された
ものである。
ものである。
トレース情報格納手段は、１個以上のレジスタの内容が
変化した時には変化時のマイクロ命令アドレス、および
上記内容の変化したレジスタ′ｔ−識別するためのあら
かじめ定められたコード、ならびに上記変化の後に上記
内容の変化したレジスタに格納された内容を、共に装置
の動作に影響を与えずに格納するためのものである。
変化した時には変化時のマイクロ命令アドレス、および
上記内容の変化したレジスタ′ｔ−識別するためのあら
かじめ定められたコード、ならびに上記変化の後に上記
内容の変化したレジスタに格納された内容を、共に装置
の動作に影響を与えずに格納するためのものである。
トレース情報読出し手段は、上記格納した内容を読出＋
念めのものである。
念めのものである。
選択手段は、１個以上のレジスタのうちで外３一
部よりトレースすべきレジスタを選択するためのもので
ある。
ある。
（実 施例）
次に、本発明について図面を参照して詳細に説明する。
第１図は本発明によるレジメタトレーサ装置の一実施ｆ
１１′？示すブロック図である。第１図は、Ｎ個のレジ
スタの内容の変化の履歴をトレースする場合を示したも
のである。ｉ１図において、１はマイクロ命令アドレス
格納レジスタ、２はマイクロ命令格納メモリ、３は実行
中マイクロ命令格納レジスタ、４は実行７中のマイクロ
命令をデコードするためのデコーダ、５はトレーサメモ
リのアドレスを示すためのアドレスカウンタ、６はマイ
クロ命令アドレスをトレースするための第１のトレーサ
メモリ、７はレジスタを識別するコード、ならびに変化
後のレジスタの内容をトレースするための第２のトレー
サメモリ、８はデータバス信号線、９はＮＯＲゲート、
１０−１〜１０−ＮはＮ個のデータスイッチ、１１−１
〜１１−ＮはＮ個のフィルタ、１３−１〜１３−ＮはＮ
個のＮｏｎ、ゲート、１４−１〜１４−ＮはＮ個のＮＡ
ＮＤゲート、１５−１〜１５−ＮはＮ個のトレースすべ
きレジスタ１００ハマイクロ命令実行うロック信号線、
１０１はレジスタ１５−１〜１５−Ｎの書込みクロック
信号線である。
１１′？示すブロック図である。第１図は、Ｎ個のレジ
スタの内容の変化の履歴をトレースする場合を示したも
のである。ｉ１図において、１はマイクロ命令アドレス
格納レジスタ、２はマイクロ命令格納メモリ、３は実行
中マイクロ命令格納レジスタ、４は実行７中のマイクロ
命令をデコードするためのデコーダ、５はトレーサメモ
リのアドレスを示すためのアドレスカウンタ、６はマイ
クロ命令アドレスをトレースするための第１のトレーサ
メモリ、７はレジスタを識別するコード、ならびに変化
後のレジスタの内容をトレースするための第２のトレー
サメモリ、８はデータバス信号線、９はＮＯＲゲート、
１０−１〜１０−ＮはＮ個のデータスイッチ、１１−１
〜１１−ＮはＮ個のフィルタ、１３−１〜１３−ＮはＮ
個のＮｏｎ、ゲート、１４−１〜１４−ＮはＮ個のＮＡ
ＮＤゲート、１５−１〜１５−ＮはＮ個のトレースすべ
きレジスタ１００ハマイクロ命令実行うロック信号線、
１０１はレジスタ１５−１〜１５−Ｎの書込みクロック
信号線である。
Ｎ個のデータスイッチ１０−１〜１０−Ｎ、ならびにＮ
個のフィルタ１１−１〜１１−Ｎは、それぞれＮ個のト
レースすべきレジスタ１５−１〜１５−Ｎに対応してい
る。
個のフィルタ１１−１〜１１−Ｎは、それぞれＮ個のト
レースすべきレジスタ１５−１〜１５−Ｎに対応してい
る。
第１図によるトレーサメモリ装置の動作は、次のように
して行われる。すなわち、マイクロ命令アルレス格納レ
ジスタ１の内容に対応してマイクロ命令格納メモリ２の
内容が出力され、出力データの値ｉ信号線１００上のマ
イクロ命令実行りロックの前縁で実行中ヤイクロ命令格
納レジスタ３に取込まれる。゛ 実行中マイクロ格命苓格納レジスタ３の内容はデコーダ
４によりデコードされ、該当する命令が実行される。さ
らに、実行内容に従ってマイクロ命令アドレス格納レジ
スタｌの内容が更新され、それに伴ってマイクロ命令格
納メモリ２の出力の値も更新される。更新されたマイク
ロ命令格納メモリ２の内容は次のマイクロ命令実行うロ
ック信号線１００の前縁で実行中マイクロ命令格納レジ
スタ３に取込まれ、次のマイクロ命令が実行される。以
下、上記の動作を繰り返すことにより次々とマイクロ命
令が実行されてゆく。
して行われる。すなわち、マイクロ命令アルレス格納レ
ジスタ１の内容に対応してマイクロ命令格納メモリ２の
内容が出力され、出力データの値ｉ信号線１００上のマ
イクロ命令実行りロックの前縁で実行中ヤイクロ命令格
納レジスタ３に取込まれる。゛ 実行中マイクロ格命苓格納レジスタ３の内容はデコーダ
４によりデコードされ、該当する命令が実行される。さ
らに、実行内容に従ってマイクロ命令アドレス格納レジ
スタｌの内容が更新され、それに伴ってマイクロ命令格
納メモリ２の出力の値も更新される。更新されたマイク
ロ命令格納メモリ２の内容は次のマイクロ命令実行うロ
ック信号線１００の前縁で実行中マイクロ命令格納レジ
スタ３に取込まれ、次のマイクロ命令が実行される。以
下、上記の動作を繰り返すことにより次々とマイクロ命
令が実行されてゆく。
次に、レジスタ１５−１に情報を書込む場合を例に挙げ
て説明する。実行中マイクロ命令格納レジスタ３に格納
されたマイクロ命令はデコーダ４によりデコードされ、
デコーダ４とＮＡＮＤゲー）１４−１とを結ぶ信号線の
状態は′″ｌ＃となる。レジスタ１５−１へ書込むべき
データはデータバス８に乗せられ、信号線１０１上の書
込みクロックによりレジスタ１５−１へ書込まれる。
て説明する。実行中マイクロ命令格納レジスタ３に格納
されたマイクロ命令はデコーダ４によりデコードされ、
デコーダ４とＮＡＮＤゲー）１４−１とを結ぶ信号線の
状態は′″ｌ＃となる。レジスタ１５−１へ書込むべき
データはデータバス８に乗せられ、信号線１０１上の書
込みクロックによりレジスタ１５−１へ書込まれる。
この時、データスイッチ１０−１ がオン状態（フィル
タ１１−１の入力が接地されて込る状態）であるならば
、フィルタ１１−１とＮＯＲゲー） １３−１ とを結
ぶ信号線の状態は＠Ｏ＃となってレジスタ１５−１の書
込みパルスと同一（７）パルスがＮＯＲゲート９の出力
に現われる。
タ１１−１の入力が接地されて込る状態）であるならば
、フィルタ１１−１とＮＯＲゲー） １３−１ とを結
ぶ信号線の状態は＠Ｏ＃となってレジスタ１５−１の書
込みパルスと同一（７）パルスがＮＯＲゲート９の出力
に現われる。
そこで第２のトレーサメモリ７にはレジスタを識別する
ためのコード、およびレジスタ１５−１の内容が変化し
た後のデータ値が書込まれ、同時にアドレスカウンタ５
の内容も更、新される。
ためのコード、およびレジスタ１５−１の内容が変化し
た後のデータ値が書込まれ、同時にアドレスカウンタ５
の内容も更、新される。
マイクロ命令アドレスは信号線１００上のマイクロ命令
実行うロックの前縁で第１のトレーサメモリ６に常に書
込まれている。従って、上記のレジスタ１５−１ に情
報を書込む旨を指示したマイクロ命令が実行中マイクロ
命令格納レジスタ３に格納された時にはセットされてい
るマイクロ命令アドレス格納レジスタｌの内容が、レジ
スタを識別するコードおよび状態変化後のレジスタ１５
−１の内容を書込んである第２のトレーサメモリ７と、
同一の第１のトレーサメモリ６のアドレスにも書込まれ
ている。このようにして、レジスタ１５−１の内容が変
化した時にマイクロ命令アドレスカウンタヲ識別するコ
ード、および状態変化後のレジスＪ１１５−１７７）内
容をトレーサメモリ６．７に格納することができる。な
お、データスイッチ１０−１がオフの場合には、フィル
タ１１−１とＮＯＲゲー）１３−１とを結ぶ信号線の状
態が′１＃となるので、ＮＯＲゲーｈｔａｆｘの出力の
論理値は＠１＃になったままになる。従って、情報はト
レーサメモＩＪ ６ 、７に書込まれない。
実行うロックの前縁で第１のトレーサメモリ６に常に書
込まれている。従って、上記のレジスタ１５−１ に情
報を書込む旨を指示したマイクロ命令が実行中マイクロ
命令格納レジスタ３に格納された時にはセットされてい
るマイクロ命令アドレス格納レジスタｌの内容が、レジ
スタを識別するコードおよび状態変化後のレジスタ１５
−１の内容を書込んである第２のトレーサメモリ７と、
同一の第１のトレーサメモリ６のアドレスにも書込まれ
ている。このようにして、レジスタ１５−１の内容が変
化した時にマイクロ命令アドレスカウンタヲ識別するコ
ード、および状態変化後のレジスＪ１１５−１７７）内
容をトレーサメモリ６．７に格納することができる。な
お、データスイッチ１０−１がオフの場合には、フィル
タ１１−１とＮＯＲゲー）１３−１とを結ぶ信号線の状
態が′１＃となるので、ＮＯＲゲーｈｔａｆｘの出力の
論理値は＠１＃になったままになる。従って、情報はト
レーサメモＩＪ ６ 、７に書込まれない。
以上、説明したように、まったく同様な方法によりレジ
スタ１５−２〜１５−Ｎについても状態変化の履歴をト
レースするととが可能であり、データスイッチ１０−２
〜１０−Ｎのオン／オフ制御によりトレースの有無主選
択することもできる。格納されたデータは、データをデ
ータバス信号線８にデータを送出することによりマイク
ロ命令によね門出すことが可能である。 ・（発明の
効果） 本発明には以上説明したように、内部のレジスタの状態
変化をマイクロ命令アドレスとレジスタ識別コードと共
にノ為−ドウェアにより記憶しておき、外部のスイッチ
により記憶したり、ある込はレジスタを選別することが
可能力ように構成することにより、確実で効率のよいト
、レースができるという効果がある。
スタ１５−２〜１５−Ｎについても状態変化の履歴をト
レースするととが可能であり、データスイッチ１０−２
〜１０−Ｎのオン／オフ制御によりトレースの有無主選
択することもできる。格納されたデータは、データをデ
ータバス信号線８にデータを送出することによりマイク
ロ命令によね門出すことが可能である。 ・（発明の
効果） 本発明には以上説明したように、内部のレジスタの状態
変化をマイクロ命令アドレスとレジスタ識別コードと共
にノ為−ドウェアにより記憶しておき、外部のスイッチ
により記憶したり、ある込はレジスタを選別することが
可能力ように構成することにより、確実で効率のよいト
、レースができるという効果がある。
第１図は本発明によるレジスタトレーサ装置の一実施一
を示すブロック図である。 第２図は、マイクロ命令の実行動作の一例を示すフロー
チ＝−トであり、３種類の割込み処理を示すフローチャ
ー□トである。 １・・・マイクロ命゛令アドレス格納レジスタ２・・・
マイクロ命令格納メモリ ３・・・実行中マイクロ命令格納レジスタ４・・・デコ
ーダ ５・・・アドレスカウンタ６７・・・トレーサ
メモリ ８・・・バス９ １３−４〜１３−Ｎ・・・
ＮＯＲゲート１０−１〜１０−Ｎ・・・データスイッチ
１１−】〜１ｌ−Ｎ−・・フィルタ １４−１〜１４−Ｎ・・・ＮＡＮＤゲート１５−１〜ｚ
ｓ−Ｎ・・・レジスタ １００ 、１０１・・・信号線
を示すブロック図である。 第２図は、マイクロ命令の実行動作の一例を示すフロー
チ＝−トであり、３種類の割込み処理を示すフローチャ
ー□トである。 １・・・マイクロ命゛令アドレス格納レジスタ２・・・
マイクロ命令格納メモリ ３・・・実行中マイクロ命令格納レジスタ４・・・デコ
ーダ ５・・・アドレスカウンタ６７・・・トレーサ
メモリ ８・・・バス９ １３−４〜１３−Ｎ・・・
ＮＯＲゲート１０−１〜１０−Ｎ・・・データスイッチ
１１−】〜１ｌ−Ｎ−・・フィルタ １４−１〜１４−Ｎ・・・ＮＡＮＤゲート１５−１〜ｚ
ｓ−Ｎ・・・レジスタ １００ 、１０１・・・信号線
Claims (1)
- マイクロ命令により制御された１個以上のレジスタと、
前記１個以上のレジスタの内容が変化した時には変化時
のマイクロ命令アドレス、および前記内容の変化したレ
ジスタを識別するためのあらかじめ定められたコード、
ならびに変化後に前記内容の変化したレジスタに格納さ
れた内容を共に装置の動作に影響を与えずに格納するた
めのトレース情報格納手段と、前記格納した内容を読出
すためのトレース情報読出し手段と、前記１個以上のレ
ジスタのうちで外部よりトレースすべきレジスタを選択
するための選択手段とを具備して構成したことを特徴と
するレジスタトレーサ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16213184A JPS6140649A (ja) | 1984-07-31 | 1984-07-31 | レジスタトレ−サ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16213184A JPS6140649A (ja) | 1984-07-31 | 1984-07-31 | レジスタトレ−サ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6140649A true JPS6140649A (ja) | 1986-02-26 |
Family
ID=15748624
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16213184A Pending JPS6140649A (ja) | 1984-07-31 | 1984-07-31 | レジスタトレ−サ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6140649A (ja) |
-
1984
- 1984-07-31 JP JP16213184A patent/JPS6140649A/ja active Pending
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