JPS61273124A - 電源瞬断アラ−ム表示方式 - Google Patents
電源瞬断アラ−ム表示方式Info
- Publication number
- JPS61273124A JPS61273124A JP60112088A JP11208885A JPS61273124A JP S61273124 A JPS61273124 A JP S61273124A JP 60112088 A JP60112088 A JP 60112088A JP 11208885 A JP11208885 A JP 11208885A JP S61273124 A JPS61273124 A JP S61273124A
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- Japan
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- power
- alarm display
- signal
- power interruption
- interruption
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- Emergency Protection Circuit Devices (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はメモリ保護機能を持っている装置における電源
瞬断検出方式に関するものである。
瞬断検出方式に関するものである。
（従来の技術）
第２図（イ）は従来の電源瞬断検出方式の一構成例を示
すブロック図で（例えば実公昭６〇−３８３９）、ｌは
ＡＣ入力電源を断接するための半導体またはリレーで構
成されたスイッチ回路、２はＡＣ入力電源の一定時間以
上の断状態を検出し第１瞬断信号（ｐｏｗ ｔ、ｏｗ倍
信号を制御回路部（図示なし）へ送出すると共に第２瞬
断信号（ｐｏｗ断信号）を送出する瞬断検出回路、３は
入力電圧を所定の出力電圧に変換するためのトランス、
４は図示せぬ制御回路部へ必要なりＣ出力を供給するた
めの定電圧回路である。
すブロック図で（例えば実公昭６〇−３８３９）、ｌは
ＡＣ入力電源を断接するための半導体またはリレーで構
成されたスイッチ回路、２はＡＣ入力電源の一定時間以
上の断状態を検出し第１瞬断信号（ｐｏｗ ｔ、ｏｗ倍
信号を制御回路部（図示なし）へ送出すると共に第２瞬
断信号（ｐｏｗ断信号）を送出する瞬断検出回路、３は
入力電圧を所定の出力電圧に変換するためのトランス、
４は図示せぬ制御回路部へ必要なりＣ出力を供給するた
めの定電圧回路である。
第２図（ロ）は電源瞬断検出回路２の詳細図を示し、電
圧変換するためのトランス５．整流回路６、およびＡＣ
入力が許容時間以上基準電圧以下に低下したか（つまり
ＰＯ％！ｌ ＬＯＷ）を検出する検出回路７から構成さ
れる。
圧変換するためのトランス５．整流回路６、およびＡＣ
入力が許容時間以上基準電圧以下に低下したか（つまり
ＰＯ％！ｌ ＬＯＷ）を検出する検出回路７から構成さ
れる。
次に動作について説明する。
第２図（ハ）は整流回路６を経た整流波形である。ＡＣ
入力に瞬断が発生すると検出回路７は基準電圧（賄−以
下の状態が許容時間（Ｔ）例えば半サイクル以上継続し
たかを検出する。瞬断と判断するとｐｏｗ ｔ、ｏｗ倍
信号出力すると同時にｐａｗ断信号をスイッチ回路１に
出力する。スイッチ回路ｌはオフとなりＤＣ出力は所定
のシーケンスを守ってオフとなる。
入力に瞬断が発生すると検出回路７は基準電圧（賄−以
下の状態が許容時間（Ｔ）例えば半サイクル以上継続し
たかを検出する。瞬断と判断するとｐｏｗ ｔ、ｏｗ倍
信号出力すると同時にｐａｗ断信号をスイッチ回路１に
出力する。スイッチ回路ｌはオフとなりＤＣ出力は所定
のシーケンスを守ってオフとなる。
次に瞬断が復旧すると検出回路７は基準電圧以上の電圧
が許容時間以上継続したかを判断しＰＯｗＬＯＷ信号を
オフとし同時にＰＯ％ｌｌ断信号もオフとするのでスイ
ッチ回路はオンとなりＤＣ出力は所定のシーケンスを守
ってオンとなる。
が許容時間以上継続したかを判断しＰＯｗＬＯＷ信号を
オフとし同時にＰＯ％ｌｌ断信号もオフとするのでスイ
ッチ回路はオンとなりＤＣ出力は所定のシーケンスを守
ってオンとなる。
（発明が解決しようとする問題点）
しかしながら上記構成の方式ではＡＣ入力の１次側で電
源瞬断検出を行なうため検出回路にＡＣｔ−ＤＣへ変換
するトランスや整流回路が必要であり寸法的にも経済的
にも小型機器実現に大きな障害となっていた。
源瞬断検出を行なうため検出回路にＡＣｔ−ＤＣへ変換
するトランスや整流回路が必要であり寸法的にも経済的
にも小型機器実現に大きな障害となっていた。
この発明は以上のべた電源瞬断検出専用のＡＣをＤＣニ
変換スるトランスおよび整流回路をなくし小型でかつ経
済性の優れた装置の提供を目的とする。また、この発明
は装置が電源瞬断により作動しなくなったことを報知す
ることにより、オペレータの操作性向上を図ることを目
的とする。
変換スるトランスおよび整流回路をなくし小型でかつ経
済性の優れた装置の提供を目的とする。また、この発明
は装置が電源瞬断により作動しなくなったことを報知す
ることにより、オペレータの操作性向上を図ることを目
的とする。
（問題点を解決するための手段）
前記目的を達成するための本発明の特徴は、ＡＣ電源を
ＤＣ電源に変換してコンピュータに供給すると共に電源
瞬断検出回路により電源瞬断を表示する電源瞬断アラー
ム表示方式において、前記電源瞬断検出回路はＤＣ電源
出力電圧が基準電圧より低いときにその旨の信号をコン
ピュータに送受し、コンピュータは当該信号に従ってメ
モリ保護処理及びオペレータへの警告処理を行なう電源
瞬断アラーム表示方式にある。
ＤＣ電源に変換してコンピュータに供給すると共に電源
瞬断検出回路により電源瞬断を表示する電源瞬断アラー
ム表示方式において、前記電源瞬断検出回路はＤＣ電源
出力電圧が基準電圧より低いときにその旨の信号をコン
ピュータに送受し、コンピュータは当該信号に従ってメ
モリ保護処理及びオペレータへの警告処理を行なう電源
瞬断アラーム表示方式にある。
（作用）
上記構成においてＤＣ電源出力電圧の低下又は瞬断は検
出回路により検出され、該検出回路はコンピュータにそ
の旨の信号を送出する。コンピュータはソフトウェアの
処理によりメモリ保護処理及びオペレータへの警告処理
を行なう、電圧検出を直流側で行なうので検出回路が小
型軽量化されると共にソフトウェアによるオペレータへ
の警告処理によりオペレータの操作性が向上する。
出回路により検出され、該検出回路はコンピュータにそ
の旨の信号を送出する。コンピュータはソフトウェアの
処理によりメモリ保護処理及びオペレータへの警告処理
を行なう、電圧検出を直流側で行なうので検出回路が小
型軽量化されると共にソフトウェアによるオペレータへ
の警告処理によりオペレータの操作性が向上する。
（実施例）
第１図は本発明の実施例を示すブロック図であって、１
３は装置の制御１１１回路部へ必要なりＣ出力を供給す
るための低電圧回路、 １４はＰＯＷ ＬＯＷ信号を送
出するための瞬断検出回路である。なお、各図面に共通
の要素には同一の符号を付す。
３は装置の制御１１１回路部へ必要なりＣ出力を供給す
るための低電圧回路、 １４はＰＯＷ ＬＯＷ信号を送
出するための瞬断検出回路である。なお、各図面に共通
の要素には同一の符号を付す。
通常、装置が運用状態にあるときはスイッチ回路ｌがオ
ン状態でトランス２の１次側にＡＣ入力電圧が供給され
ている。
ン状態でトランス２の１次側にＡＣ入力電圧が供給され
ている。
トランス２の２次側には所定の電圧に変換されたＡＣ出
力電圧が低電圧回路１３に供給され、装置制御回路に必
要なりＣ出力を送出している。今、ＡＣの入力電圧に瞬
断が発生した時のタイムチャートを第４図に、フローチ
ャートを第３図に示す、 ＡＣ入力が断になるとＩ］Ｃ
出力は一般に徐々に低下していく、電源瞬断検出回路１
４はこのＤＣ出力電圧を監視し所定の電圧：Ｖ２ 、す
なわち装置が正常に動作可能な電圧以下になったときＰ
ＯＷ ｔ、ｏ―倍信号送出し図示せぬ制御回路部のＣＰ
ｕへ通知する。 ｃｐｕはｐｏｗ ｔ、ｏｗ倍信号受は
取るとブザー鳴動オン、アラームランプ オンにし現在
処理中のプログラムを中止し再び電源が正常に戻ったと
きに引き続き正常に運用が可能なようにメモリ保護処理
を実行し以降のＣＰＵ処理を停止する。第４図のタイム
チャートにおいて瞬断時間ｔ１は一般に様々で瞬断から
ｐｏｗ Ｌｏｗ検出までの時間ｔ２より短い場合もある
。この場合はＰＯＷ ＬＯ％１信号が送出される以前に
電源が復旧されるもので運用上特に問題はない、またｔ
ｌが１２＋１３以上すなわちＤＣ出力がｖ３以下となっ
た場合は次に電源が立上った時にリセット信号が送出さ
れＣＰＵはイニシアルからプログラムがスタートしブザ
ーの鳴動及びアラームランプはリセットされて通常の運
用が再開される。
力電圧が低電圧回路１３に供給され、装置制御回路に必
要なりＣ出力を送出している。今、ＡＣの入力電圧に瞬
断が発生した時のタイムチャートを第４図に、フローチ
ャートを第３図に示す、 ＡＣ入力が断になるとＩ］Ｃ
出力は一般に徐々に低下していく、電源瞬断検出回路１
４はこのＤＣ出力電圧を監視し所定の電圧：Ｖ２ 、す
なわち装置が正常に動作可能な電圧以下になったときＰ
ＯＷ ｔ、ｏ―倍信号送出し図示せぬ制御回路部のＣＰ
ｕへ通知する。 ｃｐｕはｐｏｗ ｔ、ｏｗ倍信号受は
取るとブザー鳴動オン、アラームランプ オンにし現在
処理中のプログラムを中止し再び電源が正常に戻ったと
きに引き続き正常に運用が可能なようにメモリ保護処理
を実行し以降のＣＰＵ処理を停止する。第４図のタイム
チャートにおいて瞬断時間ｔ１は一般に様々で瞬断から
ｐｏｗ Ｌｏｗ検出までの時間ｔ２より短い場合もある
。この場合はＰＯＷ ＬＯ％１信号が送出される以前に
電源が復旧されるもので運用上特に問題はない、またｔ
ｌが１２＋１３以上すなわちＤＣ出力がｖ３以下となっ
た場合は次に電源が立上った時にリセット信号が送出さ
れＣＰＵはイニシアルからプログラムがスタートしブザ
ーの鳴動及びアラームランプはリセットされて通常の運
用が再開される。
なお、ｔ２〜ｔ ２’＋ ｔ ３内に電源復旧した場合
はＰＯＷ ＬＯ％１信号が送出されたあとリセット信号
が送出されないままで装置の電源がオンの状態となるた
めＣｐＵ動作が停止したままとなってオペレータには何
の理由で停止しているか不明であり不親切となる。
はＰＯＷ ＬＯ％１信号が送出されたあとリセット信号
が送出されないままで装置の電源がオンの状態となるた
めＣｐＵ動作が停止したままとなってオペレータには何
の理由で停止しているか不明であり不親切となる。
従って本発明では第３図のフローチャートに示すように
ｐｏｗ ｔ、ｏｗを検出するとブザー鳴動、アラームラ
ンプ オンをしてメモリ保護処理を行なうためｔ２〜ｔ
２＋ｔ３で電源が復旧した場合でもオペレータに知らせ
ることができ上記の不具合を除去できるものである。
ｐｏｗ ｔ、ｏｗを検出するとブザー鳴動、アラームラ
ンプ オンをしてメモリ保護処理を行なうためｔ２〜ｔ
２＋ｔ３で電源が復旧した場合でもオペレータに知らせ
ることができ上記の不具合を除去できるものである。
（発明の効果）
以上、詳細に説明したように本発明によれば電源瞬断検
出、を２次側のＤＣ出力部で行なうようにし、またその
場合発生しうる不定の時間領域でＣＰＵが停止しオペレ
ータに不親切となることに対し、瞬断検出時にＣＰＵは
最初にソフトウェアによりオペレータへの警告表示を行
なうこととしたので改善され電源瞬断専用のＡＣからＤ
Ｃへ変換する回路を持つことなく制御部回路用のＤＣ出
力を兼用することができ経済的効果が期待できる。
出、を２次側のＤＣ出力部で行なうようにし、またその
場合発生しうる不定の時間領域でＣＰＵが停止しオペレ
ータに不親切となることに対し、瞬断検出時にＣＰＵは
最初にソフトウェアによりオペレータへの警告表示を行
なうこととしたので改善され電源瞬断専用のＡＣからＤ
Ｃへ変換する回路を持つことなく制御部回路用のＤＣ出
力を兼用することができ経済的効果が期待できる。
更にＤＣ出力部に電源瞬断検出回路をもつことは他の装
置でも実現可能であり、メモリ保護機能をもつ他の装置
にも適用可能である。
置でも実現可能であり、メモリ保護機能をもつ他の装置
にも適用可能である。
第１図は本発明による電源瞬断アラーム表示方式を示す
図、第２図は従来の電源瞬断アラーム表示方式を示す図
、第３図は本発明の動作フローを示す図、第４図は本発
明の動作タイムチャートを示す図である。 １；スイッチ回路、３；トランス、 １３；低電圧回路、 １４；電源瞬断検出回路。
図、第２図は従来の電源瞬断アラーム表示方式を示す図
、第３図は本発明の動作フローを示す図、第４図は本発
明の動作タイムチャートを示す図である。 １；スイッチ回路、３；トランス、 １３；低電圧回路、 １４；電源瞬断検出回路。
Claims (2)
- （１）ＡＣ電源をＤＣ電源に変換してコンピュータに供
給すると共に電源瞬断検出回路（１４）により電源瞬断
を表示する電源瞬断アラーム表示方式において、 （ａ）前記電源瞬断検出回路（１４）はＤＣ電源出力電
圧が基準電圧より低いときにその旨の信号をコンピュー
タに送出し、 （ｂ）コンピュータは当該信号に従ってメモリ保護処理
及びオペレータへの警告処理を行なうことを特徴とする
電源瞬断アラーム表示方式。 - （２）前記警告処理がブザー鳴動及びアラームランプ
オンの少なくとも一方をふくむことを特徴とする特許請
求の範囲第１項記載の電源瞬断アラーム表示方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60112088A JPS61273124A (ja) | 1985-05-27 | 1985-05-27 | 電源瞬断アラ−ム表示方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60112088A JPS61273124A (ja) | 1985-05-27 | 1985-05-27 | 電源瞬断アラ−ム表示方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61273124A true JPS61273124A (ja) | 1986-12-03 |
Family
ID=14577796
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60112088A Pending JPS61273124A (ja) | 1985-05-27 | 1985-05-27 | 電源瞬断アラ−ム表示方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61273124A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2021026342A (ja) * | 2019-07-31 | 2021-02-22 | キヤノン株式会社 | 電子機器 |
-
1985
- 1985-05-27 JP JP60112088A patent/JPS61273124A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2021026342A (ja) * | 2019-07-31 | 2021-02-22 | キヤノン株式会社 | 電子機器 |
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