JPS61220344A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- H01L2924/01079—Gold [Au]
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- H01L2924/06—Polymers
- H01L2924/078—Adhesive characteristics other than chemical
- H01L2924/07802—Adhesive characteristics other than chemical not being an ohmic electrical conductor
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置の製造方法、特にオーミック接続工
程に関するものである。
程に関するものである。
従来の半導体装置のオーミック接続に関しては、半導体
素子形成基板の裏面はアルミニウム(人t)との接触に
よシ行い、反対面は半田付にて容器にオーミック接続す
る方法が一般的であった。半田付される裏面は半田との
なじみの良い金属及びシリコンとの密着性の良い金属と
の組み合せでおおわれており、シリコン基板裏面側には
リン等の不純物を用いてN+層を設けていた。
素子形成基板の裏面はアルミニウム(人t)との接触に
よシ行い、反対面は半田付にて容器にオーミック接続す
る方法が一般的であった。半田付される裏面は半田との
なじみの良い金属及びシリコンとの密着性の良い金属と
の組み合せでおおわれており、シリコン基板裏面側には
リン等の不純物を用いてN+層を設けていた。
すなわち、第2図に示すように、裏面にエピタキシャル
層を有するシリコン基板1の裏面を研磨して薄くした後
、表面エピタキシャル層にベース領域3およびエミッタ
領域2を設け、裏面に請、u8i共晶層9.Ti層6.
Ni層5および銀層4を積層し、その後熱処理をして、
裏面に半田付の可能なオーミック接続を設けていた。
層を有するシリコン基板1の裏面を研磨して薄くした後
、表面エピタキシャル層にベース領域3およびエミッタ
領域2を設け、裏面に請、u8i共晶層9.Ti層6.
Ni層5および銀層4を積層し、その後熱処理をして、
裏面に半田付の可能なオーミック接続を設けていた。
しかしながら、これらの複数金属層からなる電極系にお
いては、シリコンと直接接続される金属をどの様に選ん
でもシリコン基板の不純物濃度が8 X 10” at
o鴨/ cc以上でないと良好なオーミック性接触が得
られない事が経験的に知られている。それ以下の不純物
濃度でオーミック性接触を得る場合には高温(500℃
以上)での熱処理が必要である。シリコン単結晶引き上
げ法で作られる基板そのものの不純物濃度を8 X 1
0”atos/cc以上の不純物濃度とすることは製法
技前上は非常に困難であり、エピタキシャル基板として
の不純物濃度には限界があった0高温熱処理を行なうと
、トランジスタの電流増巾率(hFIe)のリニアリテ
ィーが劣化する賭点がある、又シリコン基板の熱抵抗を
低く押える為に拡散投入前に@磨にニジ薄くしているが
、このためその後の不純物拡散工程においてウェハー割
れ不良の増加等の問題が生じていた。
いては、シリコンと直接接続される金属をどの様に選ん
でもシリコン基板の不純物濃度が8 X 10” at
o鴨/ cc以上でないと良好なオーミック性接触が得
られない事が経験的に知られている。それ以下の不純物
濃度でオーミック性接触を得る場合には高温(500℃
以上)での熱処理が必要である。シリコン単結晶引き上
げ法で作られる基板そのものの不純物濃度を8 X 1
0”atos/cc以上の不純物濃度とすることは製法
技前上は非常に困難であり、エピタキシャル基板として
の不純物濃度には限界があった0高温熱処理を行なうと
、トランジスタの電流増巾率(hFIe)のリニアリテ
ィーが劣化する賭点がある、又シリコン基板の熱抵抗を
低く押える為に拡散投入前に@磨にニジ薄くしているが
、このためその後の不純物拡散工程においてウェハー割
れ不良の増加等の問題が生じていた。
そこで、本発明に2いては前記欠点をなくす九めに、ウ
ェハーを研磨することなく厚い基板のまま拡散工程を施
し、拡散の最終工程においてウェハーを所定の厚さに研
磨を行い、しかる後sbの入ったAuを蒸着又はスパッ
ターで付着させ、次にsbのストッパーとしてのTi又
はMo、 W、 TaO内の1つ又は2つ以上の組み合
わされ九金属膜を設け、さらにこの上にN i、 Cu
、 Ag、 Auの内の1つ又は2つ以上の組み合わさ
れた金属膜を設け、この系を350℃以上500℃以下
で熱処理を行って、オーミック接続をとっている。
ェハーを研磨することなく厚い基板のまま拡散工程を施
し、拡散の最終工程においてウェハーを所定の厚さに研
磨を行い、しかる後sbの入ったAuを蒸着又はスパッ
ターで付着させ、次にsbのストッパーとしてのTi又
はMo、 W、 TaO内の1つ又は2つ以上の組み合
わされ九金属膜を設け、さらにこの上にN i、 Cu
、 Ag、 Auの内の1つ又は2つ以上の組み合わさ
れた金属膜を設け、この系を350℃以上500℃以下
で熱処理を行って、オーミック接続をとっている。
次に、本発明を図面を参照してより詳細に説明する。
本発明の一実施例によれば、第1図に示すように、直径
4“φ、厚さ450μm、不純物濃度1×10” at
om/ccのエピタキシャル基板1を用い、所定の拡散
工程を施し、ベース層3及びエミツタ層2を形成する。
4“φ、厚さ450μm、不純物濃度1×10” at
om/ccのエピタキシャル基板1を用い、所定の拡散
工程を施し、ベース層3及びエミツタ層2を形成する。
さらに基板1を厚さ230μmmとなる様に研磨し、蒸
着を行う面に対しサンドブラストを行う。又多層蒸着の
可能な蒸着材を用いてTiN 8 、 AuSb層7.
Ti層5.Ni層5.Ag層4をそれぞれ、200人、
xoooX、zoooX。
着を行う面に対しサンドブラストを行う。又多層蒸着の
可能な蒸着材を用いてTiN 8 、 AuSb層7.
Ti層5.Ni層5.Ag層4をそれぞれ、200人、
xoooX、zoooX。
40oo1,4000XoJlさ−t’inL、alt
−400”Q30分間熱処理を行った。以上の製法では
拡散工程ではウェハー厚が450μmと厚い為にウェハ
ー割れ不良はほとんどなく、2番目のTi層6がAuS
b層7のストッパ一層として働き、第1層のTi8をつ
きやぶってsbを含む人u8i層90合金が良好なオー
ミック接触をも友らすので、フリーズ抵抗は拡散でN+
を形成した場合と同様に良好!。
−400”Q30分間熱処理を行った。以上の製法では
拡散工程ではウェハー厚が450μmと厚い為にウェハ
ー割れ不良はほとんどなく、2番目のTi層6がAuS
b層7のストッパ一層として働き、第1層のTi8をつ
きやぶってsbを含む人u8i層90合金が良好なオー
ミック接触をも友らすので、フリーズ抵抗は拡散でN+
を形成した場合と同様に良好!。
値とすることが可能である。
以上の様な構成で拡散工程でのワレ不良を低威し、通常
得られるエビタヤシャルクエハーの不M物1lli度に
於ても400℃とhFIのリニアリティーを悪化させる
事なく良好なオーミック接続を得ることができる。
得られるエビタヤシャルクエハーの不M物1lli度に
於ても400℃とhFIのリニアリティーを悪化させる
事なく良好なオーミック接続を得ることができる。
第1図は本発明一実施例による熱処理前の半導体装置の
断面図、第2図は従来例による熱処理前の半導体装置の
断面図である。 l・・・・・・シリコン基板、2・・団・エミッタ、3
・・・・・・ベース層、4・・・・・・Ag層、5・・
・・・・NiMJ、5・・・・・・第2Ti層、7・・
・・・・AuSb層、8・・・・・・第1’riM、9
・・・・・・Au8i共晶層。
断面図、第2図は従来例による熱処理前の半導体装置の
断面図である。 l・・・・・・シリコン基板、2・・団・エミッタ、3
・・・・・・ベース層、4・・・・・・Ag層、5・・
・・・・NiMJ、5・・・・・・第2Ti層、7・・
・・・・AuSb層、8・・・・・・第1’riM、9
・・・・・・Au8i共晶層。
Claims (1)
- シリコンN型半導体装置の電極形成に於て、シリコン基
板上にアンチモン(Sb)を含有した金(Au)層を設
け、その上にチタン(Ti)、モリブデン(Mo)タン
グステン(W)、タンタル(Ta)の内の1つ又は2つ
以上の組み合わされた金属層を設け、さらにこの上にニ
ッケル(Ni)、銅(Cu)、銀(Ag)、金(Au)
の内の1つ又は2つ以上の組み合わされた金属層を設け
た後、この系を350℃〜500℃の範囲で熱処理する
ことを特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60061308A JPH084095B2 (ja) | 1985-03-26 | 1985-03-26 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60061308A JPH084095B2 (ja) | 1985-03-26 | 1985-03-26 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS61220344A true JPS61220344A (ja) | 1986-09-30 |
JPH084095B2 JPH084095B2 (ja) | 1996-01-17 |
Family
ID=13167412
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60061308A Expired - Lifetime JPH084095B2 (ja) | 1985-03-26 | 1985-03-26 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH084095B2 (ja) |
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0523701A2 (en) * | 1991-07-17 | 1993-01-20 | Nippondenso Co., Ltd. | Method of forming electrodes of semiconductor device |
US6211550B1 (en) * | 1999-06-24 | 2001-04-03 | Intersil Corporation | Backmetal drain terminal with low stress and thermal resistance |
WO2005008793A1 (ja) * | 2003-07-23 | 2005-01-27 | Shin-Etsu Handotai Co.,Ltd. | 発光素子及び発光素子の製造方法 |
JP2005353809A (ja) * | 2004-06-10 | 2005-12-22 | Shin Etsu Handotai Co Ltd | 発光素子の製造方法及び発光素子 |
JP5355586B2 (ja) * | 2009-04-30 | 2013-11-27 | パナソニック株式会社 | 接合構造体の接合方法 |
CN111354784A (zh) * | 2018-12-21 | 2020-06-30 | 瑞萨电子株式会社 | 半导体器件及其制造方法 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5690450A (en) * | 1979-12-24 | 1981-07-22 | Matsushita Electric Ind Co Ltd | Recording and reproducing device |
JPS56119650U (ja) * | 1980-02-15 | 1981-09-11 | ||
JPS57154844A (en) * | 1981-03-20 | 1982-09-24 | Hitachi Ltd | Semiconductor element |
-
1985
- 1985-03-26 JP JP60061308A patent/JPH084095B2/ja not_active Expired - Lifetime
Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US6211550B1 (en) * | 1999-06-24 | 2001-04-03 | Intersil Corporation | Backmetal drain terminal with low stress and thermal resistance |
WO2005008793A1 (ja) * | 2003-07-23 | 2005-01-27 | Shin-Etsu Handotai Co.,Ltd. | 発光素子及び発光素子の製造方法 |
JP2005353809A (ja) * | 2004-06-10 | 2005-12-22 | Shin Etsu Handotai Co Ltd | 発光素子の製造方法及び発光素子 |
JP5355586B2 (ja) * | 2009-04-30 | 2013-11-27 | パナソニック株式会社 | 接合構造体の接合方法 |
CN111354784A (zh) * | 2018-12-21 | 2020-06-30 | 瑞萨电子株式会社 | 半导体器件及其制造方法 |
JP2020102547A (ja) * | 2018-12-21 | 2020-07-02 | ルネサスエレクトロニクス株式会社 | 半導体装置およびその製造方法 |
US11217670B2 (en) | 2018-12-21 | 2022-01-04 | Renesas Electronics Corporation | Semiconductor device having a back electrode including Au-Sb alloy layer and method of manufacturing the same |
Also Published As
Publication number | Publication date |
---|---|
JPH084095B2 (ja) | 1996-01-17 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
EXPY | Cancellation because of completion of term |