JPS61170909A - 半導体集積回路 - Google Patents
半導体集積回路Info
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- JPS61170909A JPS61170909A JP1082785A JP1082785A JPS61170909A JP S61170909 A JPS61170909 A JP S61170909A JP 1082785 A JP1082785 A JP 1082785A JP 1082785 A JP1082785 A JP 1082785A JP S61170909 A JPS61170909 A JP S61170909A
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
- G11B19/02—Control of operating function, e.g. switching from recording to reproducing
- G11B19/04—Arrangements for preventing, inhibiting, or warning against double recording on the same blank or against other recording or reproducing malfunctions
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/02—Recording, reproducing, or erasing methods; Read, write or erase circuits therefor
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B2005/0002—Special dispositions or recording techniques
- G11B2005/0005—Arrangements, methods or circuits
- G11B2005/001—Controlling recording characteristics of record carriers or transducing characteristics of transducers by means not being part of their structure
- G11B2005/0013—Controlling recording characteristics of record carriers or transducing characteristics of transducers by means not being part of their structure of transducers, e.g. linearisation, equalisation
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/455—Arrangements for functional testing of heads; Measuring arrangements for heads
Landscapes
- Digital Magnetic Recording (AREA)
- Bipolar Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［技術分野］
この発明は、半導体集積回路技術に関し、例えば磁気デ
ィスク装置における記録再生用の半導体集積回路装置に
利用して有効な技術に関する。
ィスク装置における記録再生用の半導体集積回路装置に
利用して有効な技術に関する。
［背景技術］
第３図に、ハードディスクドライバやフロッピ−ディス
クドライバのような磁気ディスク装置における記録再生
用ＩＣ（半導体集積回路）のヘッド駆動部の構成が示さ
れている。すなわち、電源電圧Ｖｃｃと端子Ａ、Ｂ間に
は、バイポーラトランジスタＱｌ、Ｑ２が、また端子Ａ
、Ｂと定電流源ＣＣｏ間にはトランジスタＱ３．Ｑ４が
互いに対をなすように接続されている。そして、上記端
子Ａ、Ｂ間に磁気ヘッドを構成するコイルＬが外付けさ
れるとともに、トランジスタＱ１．Ｑ２およびＱ３．Ｑ
４のベース端子には、相補的な書込みデータ信号り、Ｄ
がそれぞれ印加される。これによって、書込みデータ信
号り、Ｄが変化するとコイルに流される電流の向きが変
わり、そのときの磁界の反転によって磁気ディスクに対
し、データの書込みが行なわれる。
クドライバのような磁気ディスク装置における記録再生
用ＩＣ（半導体集積回路）のヘッド駆動部の構成が示さ
れている。すなわち、電源電圧Ｖｃｃと端子Ａ、Ｂ間に
は、バイポーラトランジスタＱｌ、Ｑ２が、また端子Ａ
、Ｂと定電流源ＣＣｏ間にはトランジスタＱ３．Ｑ４が
互いに対をなすように接続されている。そして、上記端
子Ａ、Ｂ間に磁気ヘッドを構成するコイルＬが外付けさ
れるとともに、トランジスタＱ１．Ｑ２およびＱ３．Ｑ
４のベース端子には、相補的な書込みデータ信号り、Ｄ
がそれぞれ印加される。これによって、書込みデータ信
号り、Ｄが変化するとコイルに流される電流の向きが変
わり、そのときの磁界の反転によって磁気ディスクに対
し、データの書込みが行なわれる。
しかしながら、磁気ヘッド内のコイルＬが断線していた
ような場合には、正常な書込みが行なえない。そこで、
そのような異常を検出する回路を記録再生用ＩＣ内に設
けてやる必要がある。
ような場合には、正常な書込みが行なえない。そこで、
そのような異常を検出する回路を記録再生用ＩＣ内に設
けてやる必要がある。
ところで、第３図に示すヘッド駆動部の端子Ａ。
Ｂの電位Ｖａ、Ｖｂは、それぞれ正常時には第４図（Ｂ
）に示すように変化するものが、上記のごとく磁気ヘッ
ド内のコイルＬが断線したような場合には、同図（Ｃ）
に示すようにＶｃｃレベルに非常に近いレベルまで上昇
して行くようになる。
）に示すように変化するものが、上記のごとく磁気ヘッ
ド内のコイルＬが断線したような場合には、同図（Ｃ）
に示すようにＶｃｃレベルに非常に近いレベルまで上昇
して行くようになる。
そこで１例えば［株］日立製作所製ＨＤ１０２１２８の
ような従来の記録再生用ＩＣでは、第４図（Ｃ）に示す
ように端子ＡまたはＢのハイレベルの電位Ｖａｎよりも
高い基準電圧Ｖｒｅｆを設定して、この基準電圧Ｖｒｅ
ｆと端子ＡまたはＢの電位Ｖａ（Ｖｂ）とをコンパレー
タで常時比較して、ＶａがＶ ｒ ｅ ｆを越えた時点
で異常信号を出力するようにされていた６ 一方、記録再生用ＩＣにおいては、端子Ａ、 Ｂに接続
される磁気ヘッド特にコイルＬの特性に応じて定電流源
ＣＣ０によってヘッド駆動部に流す書込み電流Ｉｗを調
整して、最適な書込み条件を、オｔう、２９．６ケゎゎ
う。、７１．ア、３つよ、 −に書込み電流Ｉｗを
調整すると、第５図に示すように端子Ａ、Ｂの電圧Ｖ
ａ Ｈも変動してしまう。
ような従来の記録再生用ＩＣでは、第４図（Ｃ）に示す
ように端子ＡまたはＢのハイレベルの電位Ｖａｎよりも
高い基準電圧Ｖｒｅｆを設定して、この基準電圧Ｖｒｅ
ｆと端子ＡまたはＢの電位Ｖａ（Ｖｂ）とをコンパレー
タで常時比較して、ＶａがＶ ｒ ｅ ｆを越えた時点
で異常信号を出力するようにされていた６ 一方、記録再生用ＩＣにおいては、端子Ａ、 Ｂに接続
される磁気ヘッド特にコイルＬの特性に応じて定電流源
ＣＣ０によってヘッド駆動部に流す書込み電流Ｉｗを調
整して、最適な書込み条件を、オｔう、２９．６ケゎゎ
う。、７１．ア、３つよ、 −に書込み電流Ｉｗを
調整すると、第５図に示すように端子Ａ、Ｂの電圧Ｖ
ａ Ｈも変動してしまう。
ところが、従来の記録再生用ＩＣにおいては、同図に実
線イで示すように基準電圧Ｖ ｒ ｅ ｆが固定されて
いた。
線イで示すように基準電圧Ｖ ｒ ｅ ｆが固定されて
いた。
そのため、書込み電流Ｉｆの大きさによって、検出マー
ジンが変化してしまい、これによって予め基準電圧Ｖ
ｒ ｅ ｆを高めに設定しておくと検出精度が低下し、
また、Ｖｒｅｆを低めに設定しておくと正常な書込み動
作時にも誤まって異常信号が形成されてしまうおそれが
ある。上記のような問題点があることが、本発明者によ
って明らかにされた。
ジンが変化してしまい、これによって予め基準電圧Ｖ
ｒ ｅ ｆを高めに設定しておくと検出精度が低下し、
また、Ｖｒｅｆを低めに設定しておくと正常な書込み動
作時にも誤まって異常信号が形成されてしまうおそれが
ある。上記のような問題点があることが、本発明者によ
って明らかにされた。
［発明の目的］
この発明の目的は、例えば磁気ディスク装置の記録再生
用ＩＣにおける異常検出回路に適用した場合に、ヘッド
の特性に応じて書込み電流値を変化させてもヘッドの断
線等の異常の検出マージンが低下されないような半導体
集積回路技術を提供することにある。
用ＩＣにおける異常検出回路に適用した場合に、ヘッド
の特性に応じて書込み電流値を変化させてもヘッドの断
線等の異常の検出マージンが低下されないような半導体
集積回路技術を提供することにある。
この発明の前記ならびにそのほかの目的と新規な特徴に
ついては１本明細書の記述および添附図面から明かにな
るであろう。
ついては１本明細書の記述および添附図面から明かにな
るであろう。
［発明の概要］
本願において開示される発明のうち代表的なものの概要
を説明すれば、下記のとおりである。
を説明すれば、下記のとおりである。
すなわち、ヘッド駆動部に書込み電流を流す定電流源に
、ヘッド駆動部およびその前段の回路から定電流源まで
の電流経路と同じ構成の電流経路を別個に設け、この新
たな電流経路には、上記定電流源によってヘッド駆動部
の書込み電流に比例した電流を流してやることにより、
ヘッド駆動部の出力端子の電位と同じもしくはそれと一
定の電位差を有する電位を発生させ、その電位に基づい
て異常検出用の基準電圧を形成させることによって、定
電流源によって流される電流がヘッドの特性に応じて調
整されたときに変化されるヘッド駆動部の出力端子の電
位と同じ傾向で基準電圧が変化されるようにし、これに
よってヘッドの断線のような異常を検出する際のマージ
ンが低下されないようにするという上記目的を達成する
ものである。
、ヘッド駆動部およびその前段の回路から定電流源まで
の電流経路と同じ構成の電流経路を別個に設け、この新
たな電流経路には、上記定電流源によってヘッド駆動部
の書込み電流に比例した電流を流してやることにより、
ヘッド駆動部の出力端子の電位と同じもしくはそれと一
定の電位差を有する電位を発生させ、その電位に基づい
て異常検出用の基準電圧を形成させることによって、定
電流源によって流される電流がヘッドの特性に応じて調
整されたときに変化されるヘッド駆動部の出力端子の電
位と同じ傾向で基準電圧が変化されるようにし、これに
よってヘッドの断線のような異常を検出する際のマージ
ンが低下されないようにするという上記目的を達成する
ものである。
［実施例１コ
第１図には、本発明を磁気ディスク装置の記録再生用Ｉ
Ｃにおける異常検出回路に適用した場合の第１の実施例
が示されている。
Ｃにおける異常検出回路に適用した場合の第１の実施例
が示されている。
トランジスタＱ１〜Ｑ４からなるヘッド駆動部の前段に
は、書込みデータ信号り、Ｄに基づいて、トランジスタ
Ｑ、〜Ｑ４の駆動信号を形成する回路が設けられている
。この回路は、エミッタが共通接続された一対の差動ト
ランジスタＱＯＩ−Ｑｏ２とそのコレクタ抵抗Ｒ１，Ｒ
２および定電流源ＣＣ１とからなる差動アンプによって
構成されている。なお１図面には、トランジスタＱ１〜
Ｑ４のうち、ＱｚとＱｌのベースに印加される信号を形
成する差動アンプのみ示されているが、トランジスタＱ
３とＱ４のベースに印加される信号も同様な構成の差動
アンプによって形成される。
は、書込みデータ信号り、Ｄに基づいて、トランジスタ
Ｑ、〜Ｑ４の駆動信号を形成する回路が設けられている
。この回路は、エミッタが共通接続された一対の差動ト
ランジスタＱＯＩ−Ｑｏ２とそのコレクタ抵抗Ｒ１，Ｒ
２および定電流源ＣＣ１とからなる差動アンプによって
構成されている。なお１図面には、トランジスタＱ１〜
Ｑ４のうち、ＱｚとＱｌのベースに印加される信号を形
成する差動アンプのみ示されているが、トランジスタＱ
３とＱ４のベースに印加される信号も同様な構成の差動
アンプによって形成される。
また、この実施例では、上記ヘッド駆動部を構成するト
ランジスタＱ３とＱ４のエミッタ端子に。
ランジスタＱ３とＱ４のエミッタ端子に。
定電流源ＣＣＯが選択用スイッチトランジスタＱ５を介
して接続されている。なお、定電流源ＣＣ０は、特に制
限されないが、外付は回路によって構成されている。ト
ランジスタＱ５のベース端子には選択信号Ｓが印加され
おり１選択信号Ｓがハイレベルにされると、トランジス
タＱｓがオンされて定電流源ＣＣｏによってヘッド駆動
部に書込み電流Ｉｗ’ が流されて選択的に駆動状態に
される。しかして、選択信号Ｓがロウレベルにされると
、トランジスタＱＳがカットオフ状態にされるため、ヘ
ッド駆動部は非駆動状態にされる。
して接続されている。なお、定電流源ＣＣ０は、特に制
限されないが、外付は回路によって構成されている。ト
ランジスタＱ５のベース端子には選択信号Ｓが印加され
おり１選択信号Ｓがハイレベルにされると、トランジス
タＱｓがオンされて定電流源ＣＣｏによってヘッド駆動
部に書込み電流Ｉｗ’ が流されて選択的に駆動状態に
される。しかして、選択信号Ｓがロウレベルにされると
、トランジスタＱＳがカットオフ状態にされるため、ヘ
ッド駆動部は非駆動状態にされる。
そして、上記選択用トランジスタＱ５と並列にトランジ
スタＱ６がエミッタを共通に接続されている。このトラ
ンジスタＱ６は、そのエミッタサイズが上記選択用トラ
ンジスタＱ５のエミッタサイズのおよそ１０分の１以下
になるように形成され、かつベース端子にはトランジス
タＱＢのベース端子に印加される信号と同じ選択信号Ｓ
が印加される。これによって、トランジスタＱｓがオン
よ□。あ、、ゎ、１８うッ、ユ、。６□よ、うッ
Ｊジスタロ５とのエミッタサイズの比に比例した電流
が流される。つまり、トランジスタＱ５とＱ６のエミッ
タサイズＥｓ６．Ｅｓ６の比を１０：Ｉとすると、トラ
ンジスタＱ６にはトランジスタＱものコレクタ電流Ｉｗ
’ の１０分の１のコレクタ電流ｉｗＩＩが流されるこ
とになる。
スタＱ６がエミッタを共通に接続されている。このトラ
ンジスタＱ６は、そのエミッタサイズが上記選択用トラ
ンジスタＱ５のエミッタサイズのおよそ１０分の１以下
になるように形成され、かつベース端子にはトランジス
タＱＢのベース端子に印加される信号と同じ選択信号Ｓ
が印加される。これによって、トランジスタＱｓがオン
よ□。あ、、ゎ、１８うッ、ユ、。６□よ、うッ
Ｊジスタロ５とのエミッタサイズの比に比例した電流
が流される。つまり、トランジスタＱ５とＱ６のエミッ
タサイズＥｓ６．Ｅｓ６の比を１０：Ｉとすると、トラ
ンジスタＱ６にはトランジスタＱものコレクタ電流Ｉｗ
’ の１０分の１のコレクタ電流ｉｗＩＩが流されるこ
とになる。
さらに、上記トランジスタＱ６のコレクタ端子と電源電
圧Ｖｃｃとの間には、ベース・コレクタ間が短絡されて
ダイオードとして作用するようにされたＰＮＰ型のトラ
ンジスタＱ８と、ＮＰＮ型のトランジスタＱ７が直列に
接続されている。また、このトランジスタＱ７のベース
端子と電源電圧Ｖｃｃとの間には抵抗Ｒ３が接続されて
いる。そして、上記トランジスタＱ７のエミッタサイズ
Ｅｓフは、ヘッド駆動部内のトランジスタＱ１のエミッ
タサイズ比Ｅ ｓ １との比が、前記トランジスタＱｓ
ｔＱ３のエミッタサイズ比Ｅｓ６ ：Ｅｓ６と同じにな
るように形成されている。また、抵抗Ｒ３は。
圧Ｖｃｃとの間には、ベース・コレクタ間が短絡されて
ダイオードとして作用するようにされたＰＮＰ型のトラ
ンジスタＱ８と、ＮＰＮ型のトランジスタＱ７が直列に
接続されている。また、このトランジスタＱ７のベース
端子と電源電圧Ｖｃｃとの間には抵抗Ｒ３が接続されて
いる。そして、上記トランジスタＱ７のエミッタサイズ
Ｅｓフは、ヘッド駆動部内のトランジスタＱ１のエミッ
タサイズ比Ｅ ｓ １との比が、前記トランジスタＱｓ
ｔＱ３のエミッタサイズ比Ｅｓ６ ：Ｅｓ６と同じにな
るように形成されている。また、抵抗Ｒ３は。
ヘッド駆動部前段の差動アンプ内のコレクタ抵抗Ｒ１と
の抵抗比が１ ／ Ｒ１： ｌ ／ Ｒ３＝Ｅ ｓ ｓ
：Ｅｓ６ （この実施例では１０：ｌ）となるよう
に抵抗値が設定されている。
の抵抗比が１ ／ Ｒ１： ｌ ／ Ｒ３＝Ｅ ｓ ｓ
：Ｅｓ６ （この実施例では１０：ｌ）となるよう
に抵抗値が設定されている。
さらに、この実施例では、上記トランジスタＱ８とカレ
ントミラー接続さ九たトランジスタＱ９が設けられ、こ
のトランジスタＱ９のエミッタ端子と電源電圧Ｖｃｃと
の間には、抵抗Ｒ４とＲ５とが直列に接続され、この抵
抗Ｒ４とＲ５の接続ノードｎ１の電位が基準電圧Ｖ ｒ
ｅ ｆとして取り出されてコンパレータＣＭＰ、とＣ
ＭＰ２の反転入力端子に印加されている。コンパレータ
ＣＭＰ１とＣＭＰ２の非反転入力端子には、ヘッド駆動
部の端子ＡおよびＢの電位Ｖａとｖｂがそれぞれ印加さ
れている。
ントミラー接続さ九たトランジスタＱ９が設けられ、こ
のトランジスタＱ９のエミッタ端子と電源電圧Ｖｃｃと
の間には、抵抗Ｒ４とＲ５とが直列に接続され、この抵
抗Ｒ４とＲ５の接続ノードｎ１の電位が基準電圧Ｖ ｒ
ｅ ｆとして取り出されてコンパレータＣＭＰ、とＣ
ＭＰ２の反転入力端子に印加されている。コンパレータ
ＣＭＰ１とＣＭＰ２の非反転入力端子には、ヘッド駆動
部の端子ＡおよびＢの電位Ｖａとｖｂがそれぞれ印加さ
れている。
従って、この実施例においては、ヘッド駆動部のコイル
Ｌが正常であれば１選択信号ＳによってトランジスタＱ
５とＱ６がオン状態にされると、定電流源ＣＣｏによっ
てヘッド駆動部には書込み電流Ｉｗ’ が流され、また
トランジスタＱ７．Ｑ８、Ｑ６の経路には上記書込み電
流Ｉｗ’ の１０分の１の電流■ｗ″がそれぞれ流され
る。
Ｌが正常であれば１選択信号ＳによってトランジスタＱ
５とＱ６がオン状態にされると、定電流源ＣＣｏによっ
てヘッド駆動部には書込み電流Ｉｗ’ が流され、また
トランジスタＱ７．Ｑ８、Ｑ６の経路には上記書込み電
流Ｉｗ’ の１０分の１の電流■ｗ″がそれぞれ流され
る。
ところが、トランジスタＱ７とＱｌのベース端子と電源
電圧Ｖｃｃとの間に接続された抵抗Ｒ３とＲ１の比は１
０：１にされている。そのため、抵抗Ｒ３を流れる電流
が、Ｒ１を流れる電流の１゜分の１であっても、抵抗Ｒ
３とＲ１による電圧降下量は等しくなる。その結果、ト
ランジスタＱ１とＱ７のベース端子に印加される電圧は
等しくなる。しかも、トランジスタＱ１とＱ７のエミッ
タサイズの比は１０：１にされているため、上記のごと
くトランジスタＱ７に流される電流がＱ、の１０分の１
になっていると、トランジスタＱ１とＱ７におけるベー
ス・エミッタ間の電圧差Ｖ ｅ Ｅも等しくなる。
電圧Ｖｃｃとの間に接続された抵抗Ｒ３とＲ１の比は１
０：１にされている。そのため、抵抗Ｒ３を流れる電流
が、Ｒ１を流れる電流の１゜分の１であっても、抵抗Ｒ
３とＲ１による電圧降下量は等しくなる。その結果、ト
ランジスタＱ１とＱ７のベース端子に印加される電圧は
等しくなる。しかも、トランジスタＱ１とＱ７のエミッ
タサイズの比は１０：１にされているため、上記のごと
くトランジスタＱ７に流される電流がＱ、の１０分の１
になっていると、トランジスタＱ１とＱ７におけるベー
ス・エミッタ間の電圧差Ｖ ｅ Ｅも等しくなる。
これによって、トランジスタＱ７のエミッタ端子すなわ
ちノードｎ３には、トランジスタＱ１がオンされている
ときの端子Ａの電位ＶａＨと同一レベルの電位が表われ
る。しかも、ヘッド駆動部内の書込み電流の向きが変わ
ってもトランジスタＱ５に流される電流Ｉｗ″は変わら
ないので、ノードｎ３の電位は一定である。そして、こ
のノードｎ３の電位は、トランジスタＱ８とカレントミ
ラー接続されたトランジスタＱ９によって、ノードｎ２
に再現される。
ちノードｎ３には、トランジスタＱ１がオンされている
ときの端子Ａの電位ＶａＨと同一レベルの電位が表われ
る。しかも、ヘッド駆動部内の書込み電流の向きが変わ
ってもトランジスタＱ５に流される電流Ｉｗ″は変わら
ないので、ノードｎ３の電位は一定である。そして、こ
のノードｎ３の電位は、トランジスタＱ８とカレントミ
ラー接続されたトランジスタＱ９によって、ノードｎ２
に再現される。
その結果、ノードｎ１には、正常時の端子Ａのハイレベ
ル状態での電位Ｖ ａ Ｈと電源電圧Ｖｃｃとの電位差
を抵抗比Ｒ４：Ｒｓで分割したような基準電圧Ｖ ｒ
ｅ ｆが発生される。しかも、ヘッド駆動部および基準
電圧発生部は、同一の定電流源Ｃｃｏによって引かれて
いるので、定電流Ｉｗが変化すると書込み電流１ｗ’
も電流■ｗＰＩも同じ割合で変化する。そのため、ノー
ドｎ、の電位すなわち発生される基準電圧Ｖ ｒ ｅ
ｆは、第５図に破線口で示すごとく、コイルＬの特性に
応じて定電流源ＣＣＯによって流す書込み電流を変えて
やったときに変化する端子Ａのハイレベルの電位ＶａＨ
と同じ傾向で変化するようになる。
ル状態での電位Ｖ ａ Ｈと電源電圧Ｖｃｃとの電位差
を抵抗比Ｒ４：Ｒｓで分割したような基準電圧Ｖ ｒ
ｅ ｆが発生される。しかも、ヘッド駆動部および基準
電圧発生部は、同一の定電流源Ｃｃｏによって引かれて
いるので、定電流Ｉｗが変化すると書込み電流１ｗ’
も電流■ｗＰＩも同じ割合で変化する。そのため、ノー
ドｎ、の電位すなわち発生される基準電圧Ｖ ｒ ｅ
ｆは、第５図に破線口で示すごとく、コイルＬの特性に
応じて定電流源ＣＣＯによって流す書込み電流を変えて
やったときに変化する端子Ａのハイレベルの電位ＶａＨ
と同じ傾向で変化するようになる。
これによって、書込み電流Ｉｗが変化されても、コンパ
レータＣＭＰによるヘッドの断線のような異れ検１！ｆ
５ｔ６際（７） ？ −Ｕ″／ Ｌ＊ ＠ １” Ｌ
ｔｔ ＜ ｆａ−６・ Ｊその結果、異常検
出精度の低下や正常な状態での誤まった異常検出が防止
されるようになる。
レータＣＭＰによるヘッドの断線のような異れ検１！ｆ
５ｔ６際（７） ？ −Ｕ″／ Ｌ＊ ＠ １” Ｌ
ｔｔ ＜ ｆａ−６・ Ｊその結果、異常検
出精度の低下や正常な状態での誤まった異常検出が防止
されるようになる。
［実施例２］
第２図には、本発明の第２の実施例が示されている。
この実施例では、基準電圧発生部内にヘッド駆動部の端
子ＡまたはＢと同じ電位を発生させて、それを抵抗分割
して基準電圧Ｖ ｒ ｅ ’ｆを作ってやる代わりに、
予めトランジスタＱフのベースに、トランジスタＱ１の
ベース電位よりも検出マージンΔＶ（約０．２Ｖ）分だ
け高い電圧を印加させるようにされている。トランジス
タＱ１とＱ７のエミッタサイズ比および抵抗Ｒ１とＲ３
の抵抗比の設定の仕方は、第１の実施例と同じである。
子ＡまたはＢと同じ電位を発生させて、それを抵抗分割
して基準電圧Ｖ ｒ ｅ ’ｆを作ってやる代わりに、
予めトランジスタＱフのベースに、トランジスタＱ１の
ベース電位よりも検出マージンΔＶ（約０．２Ｖ）分だ
け高い電圧を印加させるようにされている。トランジス
タＱ１とＱ７のエミッタサイズ比および抵抗Ｒ１とＲ３
の抵抗比の設定の仕方は、第１の実施例と同じである。
従って、この実施例においては、トランジスタＱ７のエ
ミッタ端子に〈常にヘッド駆動部内の端子Ａのハイレベ
ル状態での電位ＶａＨよりもΔＶ（約０．２Ｖ）だけ高
い電圧が発生される。そのため、この電位を基準電圧Ｖ
ｒ ｅ ｆとして取り出してやれば、定電流源ｃｃｏ
によって流される書込み電流Ｉｗが変化しても、検出マ
ージンが低下するおそれはない。
ミッタ端子に〈常にヘッド駆動部内の端子Ａのハイレベ
ル状態での電位ＶａＨよりもΔＶ（約０．２Ｖ）だけ高
い電圧が発生される。そのため、この電位を基準電圧Ｖ
ｒ ｅ ｆとして取り出してやれば、定電流源ｃｃｏ
によって流される書込み電流Ｉｗが変化しても、検出マ
ージンが低下するおそれはない。
しかも、この実施例では、第１の実施例のようにカレン
トミラー接続されたＰＮＰ型トランジスタＱ８．Ｑ９を
設ける必要がないので、トランジスタＱ８としてＮＰＮ
型を用いることができる。
トミラー接続されたＰＮＰ型トランジスタＱ８．Ｑ９を
設ける必要がないので、トランジスタＱ８としてＮＰＮ
型を用いることができる。
そのため、ヘッド駆動部側と基準電圧発生部側とが完全
に対称的な回路構成になるので、よりマージンの正確な
基準電圧Ｖ ｒ ｅ ｆが得られる。また、ＰＮＰ型ト
ランジスタが不要になるので、プロセスやレイアウトの
面でも有利である。
に対称的な回路構成になるので、よりマージンの正確な
基準電圧Ｖ ｒ ｅ ｆが得られる。また、ＰＮＰ型ト
ランジスタが不要になるので、プロセスやレイアウトの
面でも有利である。
なお、上記実施例では、定電流源ｃｃｏは外付は回路で
構成されていると説明したが、ヘッド駆動部等と同一の
半導体基板上に一体に形成するようにしてもよいことは
いうまでもない。
構成されていると説明したが、ヘッド駆動部等と同一の
半導体基板上に一体に形成するようにしてもよいことは
いうまでもない。
［効果］
磁気ディスク装置の記録再生用ＩＣにおいて。
ヘッド駆動部に書込み電流を流す定電流源に、ヘッド駆
動部およびその前段の回路から定電流源までの電流経路
と同じ構成の電流経路を接続し、この第２の電流経路に
は上記定電流源によってヘッド駆動部の書込み電流に比
例した電流を流してやることにより、ヘッド駆動部の出
力端子の電位と同じもしくはそれと一定の電位差を有す
る電圧を発生させ、その電圧に基づいて異常検出用の基
準電圧を形成するようにしたので、定電流源によってヘ
ッド駆動部に流される電流がヘッドの特性に応じて調整
されたときに変化するヘッド駆動部の出力端子の電位と
同じ傾向で基準電圧が変化するようになるという作用に
より、ヘッドの断線のような異常を検出する際のマージ
ンが低下されないようになる。また、これによって、異
常検出精度が向上されるとともに、正常な書込み動作時
に誤まって異常信号が形成されるのが防止されるという
効果がある。
動部およびその前段の回路から定電流源までの電流経路
と同じ構成の電流経路を接続し、この第２の電流経路に
は上記定電流源によってヘッド駆動部の書込み電流に比
例した電流を流してやることにより、ヘッド駆動部の出
力端子の電位と同じもしくはそれと一定の電位差を有す
る電圧を発生させ、その電圧に基づいて異常検出用の基
準電圧を形成するようにしたので、定電流源によってヘ
ッド駆動部に流される電流がヘッドの特性に応じて調整
されたときに変化するヘッド駆動部の出力端子の電位と
同じ傾向で基準電圧が変化するようになるという作用に
より、ヘッドの断線のような異常を検出する際のマージ
ンが低下されないようになる。また、これによって、異
常検出精度が向上されるとともに、正常な書込み動作時
に誤まって異常信号が形成されるのが防止されるという
効果がある。
以上本発明者によってなされた発明を実施例に基づき具
体的に説明したが１本発明は上記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。例えば、上記実施例では
、基準電圧を発生する回路の側の素子寸法を調整してヘ
ッド駆動部の書込み電流の１０分の１の電流を流すよう
にしているが、ヘッド駆動部側の素子と同一寸法にして
同一の大きさの電流を流して基準電圧を発生させること
も可能である。
体的に説明したが１本発明は上記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。例えば、上記実施例では
、基準電圧を発生する回路の側の素子寸法を調整してヘ
ッド駆動部の書込み電流の１０分の１の電流を流すよう
にしているが、ヘッド駆動部側の素子と同一寸法にして
同一の大きさの電流を流して基準電圧を発生させること
も可能である。
［利用分野］
以」二の説明では主として本発明者によってなされた発
明をその背景となった利用分野である磁気ディスク装置
の記録再生用ＩＣにおける異常検出回路に適用した場合
について説明したが、それに限定されるものでなく、定
電流源を有する回路内のある点の電位と同一電位を他の
回路内に再現したいような場合に広く利用することがで
きる。
明をその背景となった利用分野である磁気ディスク装置
の記録再生用ＩＣにおける異常検出回路に適用した場合
について説明したが、それに限定されるものでなく、定
電流源を有する回路内のある点の電位と同一電位を他の
回路内に再現したいような場合に広く利用することがで
きる。
第１図は、本発明を磁気ディスク装置の記録再生用ＩＣ
における異常検出回路に適用した場合の一実施例を示す
回路図。 第２図は１本発明の他の実施例を示す回路図、第３図は
、ヘッド駆動部の構成の一例を示す目方端子の電位の変
化を示す波形図、 第５図は、ヘッド駆動部の書込み電流の大きさと出力端
子の電位との関係を示す説明図である。 Ｌ・・・・コイル、ｃｃ、、ＣＧ、・・・・定電流源、
ＣＭＰ、、ＣＭＰ２・・・・コンパレータ第 １
図 第 ２ 図
における異常検出回路に適用した場合の一実施例を示す
回路図。 第２図は１本発明の他の実施例を示す回路図、第３図は
、ヘッド駆動部の構成の一例を示す目方端子の電位の変
化を示す波形図、 第５図は、ヘッド駆動部の書込み電流の大きさと出力端
子の電位との関係を示す説明図である。 Ｌ・・・・コイル、ｃｃ、、ＣＧ、・・・・定電流源、
ＣＭＰ、、ＣＭＰ２・・・・コンパレータ第 １
図 第 ２ 図
Claims (1)
- 【特許請求の範囲】 １、定電流源によって流される電流によって動作される
回路を備えた半導体集積回路において、上記定電流源に
よって流される電流の経路と対称的な電流経路が別個に
設けられ、その２つの電流経路は同一の定電流源によっ
て電流が流されるようにされているとともに、第１の電
流経路内の所定の点の電位が第２の電流経路内に再現さ
れ、その再現された電位に基づいて、第１の電流経路内
のある点の電位が所定のレベルに達しているか否か検出
するための基準電圧が形成されるようにされてなること
を特徴とする半導体集積回路。 ２、書込みデータ信号に対応した駆動信号によって駆動
される差動形のトランジスタを有するヘッド駆動部を備
え、該ヘッド駆動部の出力端子に磁気ヘッドが接続され
るようにされた磁気ディスク装置の記録再生用の半導体
集積回路であって、上記ヘッド駆動部およびその前段の
アンプからの電流経路に対応して設けられた対称的な電
流経路が上記ヘッド駆動部と同一の定電流源に接続され
、ヘッド駆動部の出力端子の電位が他方の電流経路内の
対応する点に再現され、その再現された電位に基づいて
、上記ヘッド駆動部の異常検出用の基準電圧が形成され
るようにされてなることを特徴とする特許請求の範囲第
１項記載の半導体集積回路。 ３、上記第２の電流経路内に再現された電位を抵抗分割
することによって、上記基準電圧が形成されるようにさ
れてなることを特徴とする特許請求の範囲第２項記載の
半導体集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1082785A JPH0640364B2 (ja) | 1985-01-25 | 1985-01-25 | 半導体集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1082785A JPH0640364B2 (ja) | 1985-01-25 | 1985-01-25 | 半導体集積回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61170909A true JPS61170909A (ja) | 1986-08-01 |
| JPH0640364B2 JPH0640364B2 (ja) | 1994-05-25 |
Family
ID=11761191
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1082785A Expired - Lifetime JPH0640364B2 (ja) | 1985-01-25 | 1985-01-25 | 半導体集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0640364B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5392172A (en) * | 1992-01-30 | 1995-02-21 | Hitachi, Ltd. | Magnetic head circuit having a write current changeover circuit with a clamp voltage depending on write current for high-speed data transfer |
| US5434717A (en) * | 1993-03-19 | 1995-07-18 | Hitachi, Ltd. | Read and/or write integrated circuit having an operation timing adjusting circuit and constant current elements |
-
1985
- 1985-01-25 JP JP1082785A patent/JPH0640364B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5392172A (en) * | 1992-01-30 | 1995-02-21 | Hitachi, Ltd. | Magnetic head circuit having a write current changeover circuit with a clamp voltage depending on write current for high-speed data transfer |
| US5434717A (en) * | 1993-03-19 | 1995-07-18 | Hitachi, Ltd. | Read and/or write integrated circuit having an operation timing adjusting circuit and constant current elements |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0640364B2 (ja) | 1994-05-25 |
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