JPS6079852A - ル−プテスト方式 - Google Patents
ル−プテスト方式Info
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- JPS6079852A JPS6079852A JP58186699A JP18669983A JPS6079852A JP S6079852 A JPS6079852 A JP S6079852A JP 58186699 A JP58186699 A JP 58186699A JP 18669983 A JP18669983 A JP 18669983A JP S6079852 A JPS6079852 A JP S6079852A
- Authority
- JP
- Japan
- Prior art keywords
- loop
- address
- test
- control block
- block
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L43/00—Arrangements for monitoring or testing data switching networks
- H04L43/50—Testing arrangements
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Computer And Data Communications (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は通信制御装置におけるループナス１一方式に関
し、特に国際標準規格（ＩＳＯ）準拠のハイレベルデー
タリンク制御手順（以下、ｒＨＤＬＣ手順」という）を
含んだ通信制御装置のループテスト方式に関するもので
ある。
し、特に国際標準規格（ＩＳＯ）準拠のハイレベルデー
タリンク制御手順（以下、ｒＨＤＬＣ手順」という）を
含んだ通信制御装置のループテスト方式に関するもので
ある。
通信制御装置の自己診断、障害調査あるいは接続試験に
用いられるループテストは、従来、送信したデータをそ
のまま折り返し受信し、両データの比較検査を行うこと
によって行われていた。しかしながら、この方式ではＨ
ＤＬＣ手順を含む通信制御装置の内部ループテスト、あ
るいは外部ループテストを行うことはできなかった。
用いられるループテストは、従来、送信したデータをそ
のまま折り返し受信し、両データの比較検査を行うこと
によって行われていた。しかしながら、この方式ではＨ
ＤＬＣ手順を含む通信制御装置の内部ループテスト、あ
るいは外部ループテストを行うことはできなかった。
ＨＤ Ｌ Ｃ手順を含む通信制御装置の外部ループテス
トは、例えば、第１図に示す如く、同じ通信制御装置を
２セツト対向させることによって行うことができる。図
において、１は中央処理装置、２Ａは第１の通信制御装
置、２Ｂは第２の通信制御装置を示している。上記両通
信制御装置２Ａ。
トは、例えば、第１図に示す如く、同じ通信制御装置を
２セツト対向させることによって行うことができる。図
において、１は中央処理装置、２Ａは第１の通信制御装
置、２Ｂは第２の通信制御装置を示している。上記両通
信制御装置２Ａ。
２Ｂは、それぞれ、ＨＤＬＣ手順制御ブロック４Ａ、４
Ｂ、送信制御ブロック５Ａ、５Ｂおよび受信制御ブロッ
ク６Ａ、６Ｂから構成される装置この例では、中央処理
装置１からテスト用の送信データが通信制御装置２Ａ内
のＨＤ Ｌ Ｃ手順制御ブロック４Ａに出力されると、
該ＨＤＬＣ手順制御ブロック４Ａは上記データを、送信
制御ブロック５Ａに送出するよう要求する。送信制御ブ
ロック５Ａが上記データを送出すると、該データは外部
に接続されたケーブルを通して通信制御装置２Ｂ内の受
（ｉ制御ブロック６Ｂに受信される。
Ｂ、送信制御ブロック５Ａ、５Ｂおよび受信制御ブロッ
ク６Ａ、６Ｂから構成される装置この例では、中央処理
装置１からテスト用の送信データが通信制御装置２Ａ内
のＨＤ Ｌ Ｃ手順制御ブロック４Ａに出力されると、
該ＨＤＬＣ手順制御ブロック４Ａは上記データを、送信
制御ブロック５Ａに送出するよう要求する。送信制御ブ
ロック５Ａが上記データを送出すると、該データは外部
に接続されたケーブルを通して通信制御装置２Ｂ内の受
（ｉ制御ブロック６Ｂに受信される。
受信ブロック６Ｂは受信したデータをＨＤＬＣ手順制御
ブロック４Ｂに渡す。ＨＤ Ｌ Ｃ手順制御ブロック４
Ｂが中央処理装置１にデータを受信したことを連絡する
と、中央処理装置１はＨＤＬＣ手順制御ブロック４Ｂか
ら受信したデータを読出してテスト用の送信データとの
比較検査を実施し、テストの良否の判定を行う。
ブロック４Ｂに渡す。ＨＤ Ｌ Ｃ手順制御ブロック４
Ｂが中央処理装置１にデータを受信したことを連絡する
と、中央処理装置１はＨＤＬＣ手順制御ブロック４Ｂか
ら受信したデータを読出してテスト用の送信データとの
比較検査を実施し、テストの良否の判定を行う。
しかしながら、上記方式では、通信制御装置内部で行う
内部ループテストは実施不可能であるという問題が残っ
ている。
内部ループテストは実施不可能であるという問題が残っ
ている。
本発明は上記事情に鑑みてなされたもので、その目的と
するところは、従来のループテスト方式における上述の
如き問題を解消し、ＨＤＬＣ手順を含む通信制御装置の
内部ループテストおよび外部ループテストを実施可・能
とするループテスト方式を提供することにある。
するところは、従来のループテスト方式における上述の
如き問題を解消し、ＨＤＬＣ手順を含む通信制御装置の
内部ループテストおよび外部ループテストを実施可・能
とするループテスト方式を提供することにある。
本発明の上記目的は、中央処理装置しＳ接続された、Ｔ
（Ｄ Ｌ Ｃ手順制御ブロックを有する通信制御装置の
ループテスト方式において、前記通信制御装置に内部ル
ープと外部ループとを選択的に形成するループ制御ブロ
ックと、アドレス部識別ステップで自局アドレスと相手
局アドレスとを入換えるアドレス部制御ブロックとを設
け、前記中央処理装置からのテスト命令によって前記ル
ープ制御ブロックによりテストループを形成するととも
に、前記アドレス部制御ブロックを動作させて送出メツ
セージのアドレスを入換えることを特徴とするループテ
スト方式によって達成される。
（Ｄ Ｌ Ｃ手順制御ブロックを有する通信制御装置の
ループテスト方式において、前記通信制御装置に内部ル
ープと外部ループとを選択的に形成するループ制御ブロ
ックと、アドレス部識別ステップで自局アドレスと相手
局アドレスとを入換えるアドレス部制御ブロックとを設
け、前記中央処理装置からのテスト命令によって前記ル
ープ制御ブロックによりテストループを形成するととも
に、前記アドレス部制御ブロックを動作させて送出メツ
セージのアドレスを入換えることを特徴とするループテ
スト方式によって達成される。
以下、本発明の実施例を図面に基づいて詳細に説明する
。
。
第２図は本発明の一実施例であるループテスト方式の構
成図である。図において、ＩＡは中央処理装置、２Ｃは
通信制御装置を示している。中央処理袋Ｅ１Ａと前記中
央処理装置１との相異点はその処理プログラムの相異に
ある。また、通信制御装置２Ｃと前記通信制御装置２Ａ
、’２Ｂとの相異点は、通信制御装置２Ｃが前記通信制
御装置２Ａ、２Ｂと同様にＨＤＬＣ手順制御ブロック４
Ｃ１送信制御ブロック５Ｃおよび与信制御ブロック６Ｃ
を有する他に、内部ループ制御ブロック７、アドレス部
識別テーブルブロック８およびテーブル置換ブロック９
を有する点にある。なお、入出力命令制御ブロック１０
は、前記中央処理装置ｌにも設けられているものである
が、第１図においては図示を省略したものである。
成図である。図において、ＩＡは中央処理装置、２Ｃは
通信制御装置を示している。中央処理袋Ｅ１Ａと前記中
央処理装置１との相異点はその処理プログラムの相異に
ある。また、通信制御装置２Ｃと前記通信制御装置２Ａ
、’２Ｂとの相異点は、通信制御装置２Ｃが前記通信制
御装置２Ａ、２Ｂと同様にＨＤＬＣ手順制御ブロック４
Ｃ１送信制御ブロック５Ｃおよび与信制御ブロック６Ｃ
を有する他に、内部ループ制御ブロック７、アドレス部
識別テーブルブロック８およびテーブル置換ブロック９
を有する点にある。なお、入出力命令制御ブロック１０
は、前記中央処理装置ｌにも設けられているものである
が、第１図においては図示を省略したものである。
中央処理装置ＩＡは処理プログラム１１とループ、 テ
スト用データ１２を有している。入出力命令制御ブロッ
ク１０は入出力命令を解析し、その内容により、テーブ
ル置換ブロック９．内部ループ制御ブロック７およびＨ
ＤＬＣ手順制御ブロック４Ｃを制御する機能を有するも
のである。上記テーブル置換ブロック９は入出力命令制
御ブロック１０を介して送られるテスト命令によって起
動され、内部ループ制御ブロック７は同ループ命令によ
って起動されるものである。
スト用データ１２を有している。入出力命令制御ブロッ
ク１０は入出力命令を解析し、その内容により、テーブ
ル置換ブロック９．内部ループ制御ブロック７およびＨ
ＤＬＣ手順制御ブロック４Ｃを制御する機能を有するも
のである。上記テーブル置換ブロック９は入出力命令制
御ブロック１０を介して送られるテスト命令によって起
動され、内部ループ制御ブロック７は同ループ命令によ
って起動されるものである。
アドレス部識別テーブルブロック８はＨＤＬＣ手順制御
ブロックにより参照されるテーブルを格納しているもの
であり、上記テーブル置換ブロック９により後述する如
く書換え制御される。
ブロックにより参照されるテーブルを格納しているもの
であり、上記テーブル置換ブロック９により後述する如
く書換え制御される。
第３図は第２図に示したアドレス部識別テーブルブロッ
ク８の詳細を示す構成図であり、当初は、送信用自局ア
ドレス１３（この場合、０１）と送信用相手局アドレス
１４（０３）および受信用自局アドレス１５（０１−）
と受信用相手局アドレス１６（０３）から構成されてい
る。
ク８の詳細を示す構成図であり、当初は、送信用自局ア
ドレス１３（この場合、０１）と送信用相手局アドレス
１４（０３）および受信用自局アドレス１５（０１−）
と受信用相手局アドレス１６（０３）から構成されてい
る。
第４図は上記第３図に示した受信用自局アドレス１５（
０１）と、受信用相手局アドレス１６（０３）との値を
入換えた後の状態を示すものであり、送信用自局アドレ
ス１７（０１）と送信用相手局アト”レス＋ｇ（ｏ３）
および受信用自局アドレス１９（０３）と受信用相手局
アドレス２０（０１）から構成されている状態を示して
いる。
０１）と、受信用相手局アドレス１６（０３）との値を
入換えた後の状態を示すものであり、送信用自局アドレ
ス１７（０１）と送信用相手局アト”レス＋ｇ（ｏ３）
および受信用自局アドレス１９（０３）と受信用相手局
アドレス２０（０１）から構成されている状態を示して
いる。
第５図は第２図に示した入出力命令制御ブロック１０と
テーブル置換ブロック９の動作を示すフローチャートで
ある。ステップ２１〜２３．同２５〜２７は」１記入出
力命令制御ブロック１０のテスト命令に関する処理を示
しており、ステップ２４はテーブル置換ブロック９の処
理を示している。
テーブル置換ブロック９の動作を示すフローチャートで
ある。ステップ２１〜２３．同２５〜２７は」１記入出
力命令制御ブロック１０のテスト命令に関する処理を示
しており、ステップ２４はテーブル置換ブロック９の処
理を示している。
上述の如く構成された本実施例の動作を以下説明する。
なお、以下の説明においては、ＨＤ Ｌ Ｃ手順による
動作モードの設定および情報フレームの送受信に関する
コマンド、レスポンス記号を、１九についての詳細な説
明は省略して用いることにする（日本電信電話公社刊、
「パケット交換サービスのインタフェース（第２版）」
等参照）。
動作モードの設定および情報フレームの送受信に関する
コマンド、レスポンス記号を、１九についての詳細な説
明は省略して用いることにする（日本電信電話公社刊、
「パケット交換サービスのインタフェース（第２版）」
等参照）。
まず、内部ループテストを実施する場合を説明する。処
理プログラム１１から人出カ命令制御ブロック１０に対
してループ命令が発行され、これにより、入出力命令制
御ブロック１ｏは内部ループ制御ブロック７に内部ルー
プモードに移行するよう指示する。内部ループ制御ブロ
ック７は、矢印７Ａで示される如き内部ループを形成す
る。
理プログラム１１から人出カ命令制御ブロック１０に対
してループ命令が発行され、これにより、入出力命令制
御ブロック１ｏは内部ループ制御ブロック７に内部ルー
プモードに移行するよう指示する。内部ループ制御ブロ
ック７は、矢印７Ａで示される如き内部ループを形成す
る。
次に、処理プログラム１１から入出力命令制御ブロック
１０にテスト命令が発行される。該テスト命令は第５図
に示したステップ２１で受領され、ステップ２２で命令
の判定が行われる。ここで、テスト命令であることが判
定されると、ステップ２３でテスト中フラグをセットし
、前記テーブル置換ブロック９に、先に示したテーブル
置換指示（第３図。
１０にテスト命令が発行される。該テスト命令は第５図
に示したステップ２１で受領され、ステップ２２で命令
の判定が行われる。ここで、テスト命令であることが判
定されると、ステップ２３でテスト中フラグをセットし
、前記テーブル置換ブロック９に、先に示したテーブル
置換指示（第３図。
第４図参照）を発行する。
テーブル置換ブロック９はステップ２４により、アドレ
ス部識別テーブルブロック８の受信用自局アドレス１５
の値（０１）と、受信用相手局アドレス１６の値（０３
）とを入換える。これにより、アドレス部識別テーブル
ブロック８内の受信用自動アドレス１５（０１）が受信
用自動アドレス１９（０３）に、受信用相手局アドレス
１６（０３）が受信用相手局アドレス２０（０１）に変
更される。
ス部識別テーブルブロック８の受信用自局アドレス１５
の値（０１）と、受信用相手局アドレス１６の値（０３
）とを入換える。これにより、アドレス部識別テーブル
ブロック８内の受信用自動アドレス１５（０１）が受信
用自動アドレス１９（０３）に、受信用相手局アドレス
１６（０３）が受信用相手局アドレス２０（０１）に変
更される。
この状態で、処理プログラム１１がら入出力命令制御ブ
ロック１０に通信開始要求命令が発行され、入出力命令
制御ブロック１０がＨＤＬＣ手順制御ブロック４Ｃに通
信開始を指示する。これにより、ＨＤ Ｌ Ｃ手順制御
ブロック４Ｃは送信制御ブロック５Ｃを介して、アドレ
ス部識別テーブルブロック８内の送信用自局アドレス１
７（０１）をアドレス部に付加したメツセージを送出す
る。
ロック１０に通信開始要求命令が発行され、入出力命令
制御ブロック１０がＨＤＬＣ手順制御ブロック４Ｃに通
信開始を指示する。これにより、ＨＤ Ｌ Ｃ手順制御
ブロック４Ｃは送信制御ブロック５Ｃを介して、アドレ
ス部識別テーブルブロック８内の送信用自局アドレス１
７（０１）をアドレス部に付加したメツセージを送出す
る。
−ト記メツセージは、Ｐビットが１′のＳ Ａ Ｂ Ｍ
（以下、これをｒＳＡＢＭ（Ｐ）Ｊという）メツセージ
である。送出された上記メツセージは内部ループ制御ブ
ロック７を通過し、矢印７Ａで示される経路を通って受
信制御ブロック６Ｃで受信され、上記ＨＤ Ｌ Ｃ手順
制御ブロック４Ｃに渡される。
（以下、これをｒＳＡＢＭ（Ｐ）Ｊという）メツセージ
である。送出された上記メツセージは内部ループ制御ブ
ロック７を通過し、矢印７Ａで示される経路を通って受
信制御ブロック６Ｃで受信され、上記ＨＤ Ｌ Ｃ手順
制御ブロック４Ｃに渡される。
ＨＤ Ｌ Ｃ手順制御ブロック４Ｃでは、受信したメツ
セージのアドレス部がアドレス部識別テーブルブロック
８内の受信用アドレスのいずれと一致するかの判定が行
おれる。この場合には、送信時に付加したアドレス部（
０１）により第４図に示す受信用相手局アドレス２０（
０１）と一致することから、ＨＤＬＣ手順制御ブロック
４Ｃは上記ＳＡＢＭ（Ｐ）メツセージを受信したことを
認識する。
セージのアドレス部がアドレス部識別テーブルブロック
８内の受信用アドレスのいずれと一致するかの判定が行
おれる。この場合には、送信時に付加したアドレス部（
０１）により第４図に示す受信用相手局アドレス２０（
０１）と一致することから、ＨＤＬＣ手順制御ブロック
４Ｃは上記ＳＡＢＭ（Ｐ）メツセージを受信したことを
認識する。
ＨＤＬＣ手順制御ブロック４Ｃはこの応答として送信制
御ブロック５Ｃを介して、アドレス部識別テーブルブロ
ック８内の送信用相手局アドレス１１！（０３）をアド
レス部に付加したメツセージを送出する。このメツセー
ジは、Ｆビットが１′のＵＡ（以下、これをｒＵＡ（Ｆ
）Ｊという）メツセージである。
御ブロック５Ｃを介して、アドレス部識別テーブルブロ
ック８内の送信用相手局アドレス１１！（０３）をアド
レス部に付加したメツセージを送出する。このメツセー
ジは、Ｆビットが１′のＵＡ（以下、これをｒＵＡ（Ｆ
）Ｊという）メツセージである。
」１記メツセージは内部ループ制御ブロック７を通過し
、矢印７Ａで示される経路を通って受信制御ブロック６
Ｃで受信され、ＨＤＬＣ手順制御ブロック４Ｃに渡され
る。ＨＤ Ｌ Ｃ手順制御ブロック４Ｃでは、先のＳ
Ａ Ｂ Ｍ（Ｐ）メツセージの場合と同様に、受信した
メツセージのアドレス部がアドレス部識別テーブルブロ
ック８内の受信用アドレスのいずれと一致するかの判定
が行われる。この場合には、送信時に付加したアドレス
部（０３）により第４図に示す受信用自局アドレス１９
（０３）と一致することから、ＨＤＬＣ手順制御ブロッ
ク４Ｃは上記ＵＡ（Ｆ）メツセージを受信したことを確
認する。
、矢印７Ａで示される経路を通って受信制御ブロック６
Ｃで受信され、ＨＤＬＣ手順制御ブロック４Ｃに渡され
る。ＨＤ Ｌ Ｃ手順制御ブロック４Ｃでは、先のＳ
Ａ Ｂ Ｍ（Ｐ）メツセージの場合と同様に、受信した
メツセージのアドレス部がアドレス部識別テーブルブロ
ック８内の受信用アドレスのいずれと一致するかの判定
が行われる。この場合には、送信時に付加したアドレス
部（０３）により第４図に示す受信用自局アドレス１９
（０３）と一致することから、ＨＤＬＣ手順制御ブロッ
ク４Ｃは上記ＵＡ（Ｆ）メツセージを受信したことを確
認する。
Ｍ Ｄ １． Ｃ手順制御ブロックは上記確認の終了後
、前記通信開始要求指示に対する応答として、通信開始
準備完了を入出力命令制御ブロック１０を通して処理プ
ログラム１１に連絡する。処理プログラム１１はこれに
より、ループテスト用データを送信すべく入出力命令制
御ブロック１０に対して送信要求指示を発行する。
、前記通信開始要求指示に対する応答として、通信開始
準備完了を入出力命令制御ブロック１０を通して処理プ
ログラム１１に連絡する。処理プログラム１１はこれに
より、ループテスト用データを送信すべく入出力命令制
御ブロック１０に対して送信要求指示を発行する。
入出力命令制御ブロック１０が上記送信要求指示をＨＤ
ＬＣ手順制御ブロック４Ｃに連絡すると、ＨＤＬＣ手順
制御ブロック４Ｃは第４図に示すアドレス部識別テーブ
ルブロック８内の送信用自局アドレス１７の（０１）を
アドレス部に付加したループテスト用データを、送信制
御ブロック５Ｃを通して送出する。上記送出データはＰ
ビットがｉ ０ 。
ＬＣ手順制御ブロック４Ｃに連絡すると、ＨＤＬＣ手順
制御ブロック４Ｃは第４図に示すアドレス部識別テーブ
ルブロック８内の送信用自局アドレス１７の（０１）を
アドレス部に付加したループテスト用データを、送信制
御ブロック５Ｃを通して送出する。上記送出データはＰ
ビットがｉ ０ 。
のデータ（以下、これを「工（Ｐ）０，０」という）で
ある。」１記ループテスト用データは先のコマンドと同
様に、受信制御ブロック６Ｃに受信され、ＨＤ Ｌ、
Ｃ手順制御ブロック４Ｃに渡される。
ある。」１記ループテスト用データは先のコマンドと同
様に、受信制御ブロック６Ｃに受信され、ＨＤ Ｌ、
Ｃ手順制御ブロック４Ｃに渡される。
ＨＤ Ｌ Ｃ手順制御ブロック４Ｃではアドレス部識別
テーブルブロック８を用いてアドレス部の検査を行い、
これにより、上記Ｉ（Ｐ）Ｏ，、Ｏを受信したことを認
識する。また、上記受信したループテスト用データを処
理プログラム１１に転送するとともに、上記Ｉ（Ｐ）０
．０データ受信の応答として、Ｆピッｌ−が′０′のメ
ツセージＲ’Ｒ（Ｆ）］を送信するよう送信制御ブロッ
ク５Ｃに要求する。
テーブルブロック８を用いてアドレス部の検査を行い、
これにより、上記Ｉ（Ｐ）Ｏ，、Ｏを受信したことを認
識する。また、上記受信したループテスト用データを処
理プログラム１１に転送するとともに、上記Ｉ（Ｐ）０
．０データ受信の応答として、Ｆピッｌ−が′０′のメ
ツセージＲ’Ｒ（Ｆ）］を送信するよう送信制御ブロッ
ク５Ｃに要求する。
処理プログラム１１はＨＤ Ｌ Ｃ手順制御ブロックか
ら転送されたデータと、ループテスト用データ１２とを
比較検査し、テストの良否を判定する。以上の手順によ
り内部ループテストを行うことができる。なお、上記手
順のシーケンスチャートを第６図に示した。
ら転送されたデータと、ループテスト用データ１２とを
比較検査し、テストの良否を判定する。以上の手順によ
り内部ループテストを行うことができる。なお、上記手
順のシーケンスチャートを第６図に示した。
また、外部ループテストを行う場合には、内部ループ制
御ブロック７に指示を送り、矢印７Ａで示されるケーブ
ルの代りに、矢印７Ｂで示されるケーブルを接続し、上
記内部ループテストにおける準備動作、すなわち、内部
ループを形成するためのループ命令を発行せずに、テス
トを実施すれば良い。
御ブロック７に指示を送り、矢印７Ａで示されるケーブ
ルの代りに、矢印７Ｂで示されるケーブルを接続し、上
記内部ループテストにおける準備動作、すなわち、内部
ループを形成するためのループ命令を発行せずに、テス
トを実施すれば良い。
外部ループテストを終了する場合には、処理プログラム
１１から入出力命令制御ブロック１０にテスト解除命令
が発行される。該テスト解除命令は、第５図に示したス
テップ２５で判定され、テスト中であればステップ２７
でテスト中フラグをリセツ１〜し、テーブル置換ブロッ
ク９にテーブル置換指示を発行する。これにより、アド
レス部識別テーブルブロック８内の受信用自局アドレス
１ｇ（ｏ３）力受信用自局アドレス１．５（０１）に、
受信用相手局アドレス２０ＣＯ１）が受信用相手局アド
レス１６（０３）にそれぞれ変換され、テストを終了す
ることができる。
１１から入出力命令制御ブロック１０にテスト解除命令
が発行される。該テスト解除命令は、第５図に示したス
テップ２５で判定され、テスト中であればステップ２７
でテスト中フラグをリセツ１〜し、テーブル置換ブロッ
ク９にテーブル置換指示を発行する。これにより、アド
レス部識別テーブルブロック８内の受信用自局アドレス
１ｇ（ｏ３）力受信用自局アドレス１．５（０１）に、
受信用相手局アドレス２０ＣＯ１）が受信用相手局アド
レス１６（０３）にそれぞれ変換され、テストを終了す
ることができる。
上記実施例によれば、通信制御装置内で自局と相手局の
アドレスを交換することにより、１台の通信制御装置で
ＨＤ Ｌ Ｃ手順を含めた外部ループテストが可能とな
る。また、ループ指定を変更することにより簡単に内部
ループテストを行うことも可能である。
アドレスを交換することにより、１台の通信制御装置で
ＨＤ Ｌ Ｃ手順を含めた外部ループテストが可能とな
る。また、ループ指定を変更することにより簡単に内部
ループテストを行うことも可能である。
以上述べた如く、本発明によ九ば、中央処理装置に接続
された、ＨＤＬＣ手順による制御ブロックを有する通信
制御装置のループテスト方式において、前記通信制御装
置に内部ループと外部ループとを選択的に形成するルー
プ制御ブロックと、アドレス部識別ステップで自局アド
レスと相手局アドレスとを入換えるアドレス部制御ブロ
ックとを設け、前記中央処理装置からのデスト命令によ
って前記ループ制御ブロックによりデストループを形成
するとともに、前記アドレス部制御ブロックを動作させ
て送出メソセージのアドレスを入換えるようにしたので
、ＨＤ Ｌ、 Ｃ手順を含む通信制御装置の内部ループ
テストおよび外部ループテストが実施可能なループテス
ト方式を実現できるという顕著な効果を奏するものであ
る。
された、ＨＤＬＣ手順による制御ブロックを有する通信
制御装置のループテスト方式において、前記通信制御装
置に内部ループと外部ループとを選択的に形成するルー
プ制御ブロックと、アドレス部識別ステップで自局アド
レスと相手局アドレスとを入換えるアドレス部制御ブロ
ックとを設け、前記中央処理装置からのデスト命令によ
って前記ループ制御ブロックによりデストループを形成
するとともに、前記アドレス部制御ブロックを動作させ
て送出メソセージのアドレスを入換えるようにしたので
、ＨＤ Ｌ、 Ｃ手順を含む通信制御装置の内部ループ
テストおよび外部ループテストが実施可能なループテス
ト方式を実現できるという顕著な効果を奏するものであ
る。
第１図は従来技術を説明する構成図、第２図は本発明の
一実施例を示す構成図、第３図、第４図はその要部であ
るアドレス部識別テーブルを示す図、第５図は上記テー
ブルの置換動作を示すフローチャート、第６図は全体の
シーケンスチャートである。 ＩＡ：中央処理装置、２Ｃ：通信制御装置、４Ｃ：ＨＤ
Ｌ Ｃ手順制御ブロック、５Ｃ：送信制御ブロック、
６Ｃ：受信制御ブロック、７：内部ループ制御ブロック
、８ニアドレス部識別テーブルブロック、９：テーブル
置換ブロック、１０：入出力命令制御ブロック。
一実施例を示す構成図、第３図、第４図はその要部であ
るアドレス部識別テーブルを示す図、第５図は上記テー
ブルの置換動作を示すフローチャート、第６図は全体の
シーケンスチャートである。 ＩＡ：中央処理装置、２Ｃ：通信制御装置、４Ｃ：ＨＤ
Ｌ Ｃ手順制御ブロック、５Ｃ：送信制御ブロック、
６Ｃ：受信制御ブロック、７：内部ループ制御ブロック
、８ニアドレス部識別テーブルブロック、９：テーブル
置換ブロック、１０：入出力命令制御ブロック。
Claims (1)
- （１）中央処理装置に接続された、ハイレベルデータリ
ンク制御手順による制御ブロックを有する通信制御装置
のループテスト方式において、前記通信制御装置に内部
ループと外部ループとを選択的に形成するループ制御ブ
ロックと、アドレス部識別ステップで自局アドレスと相
手局アドレスとを入換えるアドレス部制御ブロックとを
設け、前記中央処理装置からのテスト命令によって前記
ループ制御ブロックによりテストループを形成するとと
もに、前記アドレス部制御ブロックを動作させて送出メ
ツセージのアドレスを入換えることを特徴とするループ
テスト方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58186699A JPS6079852A (ja) | 1983-10-07 | 1983-10-07 | ル−プテスト方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58186699A JPS6079852A (ja) | 1983-10-07 | 1983-10-07 | ル−プテスト方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6079852A true JPS6079852A (ja) | 1985-05-07 |
Family
ID=16193082
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58186699A Pending JPS6079852A (ja) | 1983-10-07 | 1983-10-07 | ル−プテスト方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6079852A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01194635A (ja) * | 1988-01-29 | 1989-08-04 | Nec Corp | データ送・受信処理装置 |
| JPH1023103A (ja) * | 1996-06-28 | 1998-01-23 | Nec Commun Syst Ltd | 装置の試験方式 |
-
1983
- 1983-10-07 JP JP58186699A patent/JPS6079852A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01194635A (ja) * | 1988-01-29 | 1989-08-04 | Nec Corp | データ送・受信処理装置 |
| JPH1023103A (ja) * | 1996-06-28 | 1998-01-23 | Nec Commun Syst Ltd | 装置の試験方式 |
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