JPS6060719A - 化合物半導体集積回路装置の製造法 - Google Patents
化合物半導体集積回路装置の製造法Info
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- JPS6060719A JPS6060719A JP16813583A JP16813583A JPS6060719A JP S6060719 A JPS6060719 A JP S6060719A JP 16813583 A JP16813583 A JP 16813583A JP 16813583 A JP16813583 A JP 16813583A JP S6060719 A JPS6060719 A JP S6060719A
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Classifications
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
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- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
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- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は化合物半導体集積回路、特にw、WSiガどの
高融点金属をゲート金属として用いたGaAS集積回路
の製造法に関する。
高融点金属をゲート金属として用いたGaAS集積回路
の製造法に関する。
高融点金属をゲート金属として用いたGaAS集積回路
の製造法の例を第1図に示す(例えば特開昭57−11
3289 )。第1図(a)のように半絶縁性GaAS
基板1にイオン注入法で能動層2を形成した後第1図(
b)に示すようにWもしくはWSiなどのGaASと反
応しない高融点金属薄膜iを形成する。次いで該高融点
金属3を所定のパターンに加工した後第1図(C)のよ
うに該高融点金属をマスクとして、不純物をイオン注入
し、オーミック電極用低抵抗層4を形成する。次いで第
1図(d)のように5fOz 、5j3N4 などのア
ニール用のキャップ材と々る耐熱性膜5を被着してアニ
ールによる不純物の活性化を行なった後、第1図(e)
のようにオーミック電極6を形成すればGaAS FE
Tが作製される。
の製造法の例を第1図に示す(例えば特開昭57−11
3289 )。第1図(a)のように半絶縁性GaAS
基板1にイオン注入法で能動層2を形成した後第1図(
b)に示すようにWもしくはWSiなどのGaASと反
応しない高融点金属薄膜iを形成する。次いで該高融点
金属3を所定のパターンに加工した後第1図(C)のよ
うに該高融点金属をマスクとして、不純物をイオン注入
し、オーミック電極用低抵抗層4を形成する。次いで第
1図(d)のように5fOz 、5j3N4 などのア
ニール用のキャップ材と々る耐熱性膜5を被着してアニ
ールによる不純物の活性化を行なった後、第1図(e)
のようにオーミック電極6を形成すればGaAS FE
Tが作製される。
しかしこの方法によればGaAS表面の一部にW。
WSiなどの高融点金属が形成された状態(第1図(d
)でアニール等の加熱工程を経るため、熱膨張率の相異
に起因する局所的な歪等の影響が避けられずFETの特
性の劣化とくにしきい電圧値ythのばらつく等の問題
があった。
)でアニール等の加熱工程を経るため、熱膨張率の相異
に起因する局所的な歪等の影響が避けられずFETの特
性の劣化とくにしきい電圧値ythのばらつく等の問題
があった。
本発明は高融点金属を加工することなく、半導体基板全
面に被着した゛状態でアニールすることによシ歪の局所
的な集中を避け、特性の良好なFETの作製を可能とす
る方法を提供するものである。
面に被着した゛状態でアニールすることによシ歪の局所
的な集中を避け、特性の良好なFETの作製を可能とす
る方法を提供するものである。
以下本発明の実施例を第2図により説明する。
第2図(a)に示すように半絶縁性GaAS基板1にイ
オン注入法で能動層2を形成し、次いで第2図(b)の
ように高融点金属膜であるWSiSaO2び耐熱性絶縁
膜である8102膜7を公知の方法で被着する。次いで
第2図<C)のように5j02膜7をフォトレジ技術を
用いて所定のパターンに加工した後、WS1膜3を通し
て高濃度の不純物のイオン注入を行ない、オーミック電
極用の高濃度層4を形成する。この状態ですなわちWS
i膜をキャップ材として800′C20分のアニールを
行ない、領域2および4に注入された不純物の活性化を
行なう。しかる後8102膜7をマスクとしてWSiS
aO2ライエツチング法で加工し、第2図(d)のよう
にS ’ 02による保護膜5′を被着する。次いで第
2図(e)のようにオーミック電極6を形成すればGa
AS MESFETが完成する。この方法によれば従来
は第1図(d)の状態でアニールが行なわれるのに比し
、第2図(d)の状態でアニールが行なわれる。す々わ
ち従来は、GaAS基板1の表面に、加工されたWSi
の局所的に残された状態でアニールが行々われるのに比
し、本方法ではGaAS基板1の表面全面にWSiが被
着された状態でアニールが行なわれる。このため従来の
ように活性層2に局所的な歪が加わらず、歪はGaAS
基板1の全面に分散することになる。
オン注入法で能動層2を形成し、次いで第2図(b)の
ように高融点金属膜であるWSiSaO2び耐熱性絶縁
膜である8102膜7を公知の方法で被着する。次いで
第2図<C)のように5j02膜7をフォトレジ技術を
用いて所定のパターンに加工した後、WS1膜3を通し
て高濃度の不純物のイオン注入を行ない、オーミック電
極用の高濃度層4を形成する。この状態ですなわちWS
i膜をキャップ材として800′C20分のアニールを
行ない、領域2および4に注入された不純物の活性化を
行なう。しかる後8102膜7をマスクとしてWSiS
aO2ライエツチング法で加工し、第2図(d)のよう
にS ’ 02による保護膜5′を被着する。次いで第
2図(e)のようにオーミック電極6を形成すればGa
AS MESFETが完成する。この方法によれば従来
は第1図(d)の状態でアニールが行なわれるのに比し
、第2図(d)の状態でアニールが行なわれる。す々わ
ち従来は、GaAS基板1の表面に、加工されたWSi
の局所的に残された状態でアニールが行々われるのに比
し、本方法ではGaAS基板1の表面全面にWSiが被
着された状態でアニールが行なわれる。このため従来の
ように活性層2に局所的な歪が加わらず、歪はGaAS
基板1の全面に分散することになる。
GaAS基板1にCrドープ半絶縁性基板、能動層2へ
の不純物をS’とし、1.5 X I O”cm−”の
濃度で打ち込み、スパッター法で形成したWSiSaO
2さを1000人とし800tZ’、20分のアニール
を打力った場合、しきい値のウェハー内のばらつきは従
来の約30%減と寿っだ。WSiSaO200〜850
Cのアニール温度でGaASと反応しない高融点金属で
あればよく、他にTa。
の不純物をS’とし、1.5 X I O”cm−”の
濃度で打ち込み、スパッター法で形成したWSiSaO
2さを1000人とし800tZ’、20分のアニール
を打力った場合、しきい値のウェハー内のばらつきは従
来の約30%減と寿っだ。WSiSaO200〜850
Cのアニール温度でGaASと反応しない高融点金属で
あればよく、他にTa。
MON もしくはこれらの7リサイド膜が考えられる。
またオーミック電極用低抵抗層4を形成するためのイオ
ン注入のマスクとして5i02膜7を用いたが、これは
アニール温度でゲート金属材3をおかさない材料でちれ
ばよく、他に’Si3N4゜AtzO3さらにTi、A
t等の金属材でもよい。
ン注入のマスクとして5i02膜7を用いたが、これは
アニール温度でゲート金属材3をおかさない材料でちれ
ばよく、他に’Si3N4゜AtzO3さらにTi、A
t等の金属材でもよい。
またGaASに限らずInP等他の化合物半導体集積回
路にも適用できる。
路にも適用できる。
第1図は従来の高融点金属あるいはその化合物をゲート
電極材として用いる化合物半導体集積回路の製造の工程
を示す断面図、第2図は本発明による化合物半導体集積
回路の製造工程を示す断面図である。 1・・・半絶縁性化合物半導体基板、2・・・能動層、
3・・・高融点金属層、4・・・オーミック電極用低抵
抗層、5・・・アニール用キャップ膜、6・・・オーミ
ック電極、5′・・・表面保護膜、7・・・マスクとな
る耐熱性材料第 / 図 (L) (C) (洗) <b) 第1頁の続き @発明者 三島木 宏光 小平重上フ タ事業本f (来町145幡地 株式会社日立製作所コンピユーもデ
バイス開発センター内
電極材として用いる化合物半導体集積回路の製造の工程
を示す断面図、第2図は本発明による化合物半導体集積
回路の製造工程を示す断面図である。 1・・・半絶縁性化合物半導体基板、2・・・能動層、
3・・・高融点金属層、4・・・オーミック電極用低抵
抗層、5・・・アニール用キャップ膜、6・・・オーミ
ック電極、5′・・・表面保護膜、7・・・マスクとな
る耐熱性材料第 / 図 (L) (C) (洗) <b) 第1頁の続き @発明者 三島木 宏光 小平重上フ タ事業本f (来町145幡地 株式会社日立製作所コンピユーもデ
バイス開発センター内
Claims (1)
- 化合物半導体基板にイオン注入法によシネ細物を注入し
、キャップ材を被着後熱処理することにより注入不純物
の活性化をはかる、いわゆるキャップ・アニール工程に
おいて、キャップ材としてMO,W、Ta等の高融点金
属膜もしくはこれらの金属のケイ素化合物膜を用いたこ
とを特徴とする化合物半導体集積回路装置の製造法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16813583A JPS6060719A (ja) | 1983-09-14 | 1983-09-14 | 化合物半導体集積回路装置の製造法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16813583A JPS6060719A (ja) | 1983-09-14 | 1983-09-14 | 化合物半導体集積回路装置の製造法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6060719A true JPS6060719A (ja) | 1985-04-08 |
Family
ID=15862478
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16813583A Pending JPS6060719A (ja) | 1983-09-14 | 1983-09-14 | 化合物半導体集積回路装置の製造法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6060719A (ja) |
-
1983
- 1983-09-14 JP JP16813583A patent/JPS6060719A/ja active Pending
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