JPS6051047A - 情報伝送方式 - Google Patents

情報伝送方式

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Publication number
JPS6051047A
JPS6051047A JP58158801A JP15880183A JPS6051047A JP S6051047 A JPS6051047 A JP S6051047A JP 58158801 A JP58158801 A JP 58158801A JP 15880183 A JP15880183 A JP 15880183A JP S6051047 A JPS6051047 A JP S6051047A
Authority
JP
Japan
Prior art keywords
data
receiving
circuits
parallel
serial synchronous
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58158801A
Other languages
English (en)
Inventor
Akihisa Makita
牧田 明久
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP58158801A priority Critical patent/JPS6051047A/ja
Publication of JPS6051047A publication Critical patent/JPS6051047A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L5/00Arrangements affording multiple use of the transmission path
    • H04L5/20Arrangements affording multiple use of the transmission path using different combinations of lines, e.g. phantom working

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Communication Control (AREA)
  • Dc Digital Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の属する技術分野〕 本発明は並列情報を伝送するための方式に関する。
〔従来技術の説明〕
信号線を複数使用して並列伝送する従来方式では、信号
線間のスキューにより、遠く離れた場合に、転送レート
を大きくできない欠点があった。
また、信号線1本で伝送する直列同期伝送方式では、直
列同期伝送の伝送レート以上は同時にデータが転送でき
ない欠点があワた。
〔発明の目的〕
本発明の目的は、並列データを複数のインターフェイス
線上で直列同期伝送し、受信側のバッファにより、上記
複数のインタフェース間の同期を取ることにより、従来
のデータ伝送レートを飛躍的に向上できる情報伝送方式
を提供することにある。
〔発明の要点〕
送信装置と、受信装置と、この送信装置とこの受信装置
との間を接続する複数のインターフェイス線を備える情
報伝送システムにおいて、送信装置には転送すべき並列
データを区分して生成した複数個のデータに先頭データ
を付加して生成した直列同期データを送出する手段と、
受信装置には直列同期データを受信する手段と、受取デ
ータを蓄積する手段と、受取データに含まれる先頭デー
タの個数が並列データの1個に含まれる先頭データの個
数と一致することを検出する手段と、一致が検出された
ときに蓄積されている受取データを送信装置が転送する
並列データに変換する手段とを備えることにより情報伝
送レートを高める効果ををすることに特徴がある。
〔実施例による説明〕 本発明実施例方式について図面を参照して詳細に説明す
る。
本発明実施例方式を示す第1図において、本発明の情報
伝送方式は、情報を送出する手段を有する装置1と情報
を受取する手段を有する装置2と情報を伝達する複数の
インターフェイス線3とから構成される 装置1、装置2の内部のブロック構成図を示す第2図に
おいて、装置1には、並列データ、バッファ10、直列
同期データ送出制御回路12−0〜12−n、ドライバ
13−□〜13−n、データ送出制御回路14が含まれ
る。また、装置2には、レシーバ2o−1〜20−n。
直列同期データ受取制御回路21−1〜2 L、、受信
バッファ22−□〜22−n、並列データ処理回路23
、データ受信制御回路24が含まれる。
次に本発明の実施例方式の動作を第2図を参照して詳細
に説明する。まず、送信装置1の処理を実行している時
に受信装置2に対して、データを送出する必要が生じた
場合には、送信装置1内で処理していたデータを並列デ
ータ形式で並列データバッファ10に蓄え、また、デー
タ送出制御回路14には、本図では表されていない信号
線により、たとえばマイクロプログラムからの信号線に
より転送指示が与えられる。データ送出制御回路14は
、ヱ゛記転送指示を受けると、信号線1o4−i〜to
4−nを使用して、直列同期データ送出制御回路12−
□〜12−nに対して、データ転送指示を与えるととも
に信号線103を使用して、並列データバッファ10に
対して、直列同期デー、夕送出制御回路12−1〜12
−nに順次データを供給するように指示する。直列同期
データ送出制御回路12−1〜12−oでは、データ転
送指示を受けると転送データの先頭を識別するための情
報をまず送出し、その次に並列データバッファ10から
信号線100−1〜too−nを経て供給されるデータ
を送出する。直列同期送出制御回路12−□〜12−n
から送出されたデータは、信号線102−1〜102、
−TI、ドライバ13−4〜13−n 、インターフェ
イス信号線3−1〜lnを経由して受信装置2に伝送さ
れる。
受信装置2においては、インターフェイス信号線上の信
号をレシーバ20−□〜20−nで受取ると、信号線2
01.〜201−n上を伝わって、直列同期データ受取
制御回路21−□〜21−nに入力される。直列同期デ
ータ受取制御回路では、転送データの先頭を検出し、信
号線202−□〜2.02..−1を使用して、受信バ
ッファ22−□〜22−oを動作させて、データの受取
を開始させるとともにデータ受信制御回路24に先頭デ
ータを受取ったことを信号線203−1〜203−nを
使用して通知する。データ受信制御回路24はすべての
直列同期データ受取制御回路21−1〜21−nから先
頭データを受取ったことを通知されると信号線205を
使用して、並列データ処理回路23にデータ信号処理の
開始を指示する。並列データ処理回路23は、受信バッ
ファ22−1〜22−nか出力されるデータを受取って
受信データの処理を開始する。受信データには、先頭部
分にデータの属性、データ量等が指示される。
データ送出制御回路14では、並列データバッファ10
が空になったことを信号線105を通じて知らされると
データ転送の終了指示を信号線104−1〜104−n
を使って直列同期データ送出制御回路12−1〜12−
nに通知する。データのチェックは、直列同期データ受
取制御回路21−□〜21−nおよび並列データ処理回
路23で実施することができる。
〔発明の効果〕
本発明は以上説明したように、並列データを複数インタ
フェース上で直列同期伝送し、その受信データ間のズレ
を受信側のバッファにより補正するように構成すること
により、従来に比し、情報伝送レートを飛躍的に高める
ことができる効果がある。
【図面の簡単な説明】
第1図は本発明の実施例装置の構成を示す概要ブロック
構成図。 第2図は、第1図の詳細を示すブロック構成図。 1・・・送信装置、2・・・受信装置、3−□〜3−n
・・・インタフェース信号線、10・・・並列データバ
ッファ、12−1〜12−n・・・直列同期データ送出
制御回路、13−1〜13−n・・・ドライバ、14・
・・データ送出制御回路、20−1〜20−n・・・レ
シーバ、21−1〜21−0・・・直列同期データ受取
制御回路、22−1〜22−n・・・受信バッファ、2
3・・・並列データ処理回路、24・・・データ受信制
御回路。

Claims (1)

    【特許請求の範囲】
  1. (1)送信装置と、 受信装置と、 この送信装置とこの受信装置との間に接続された複数の
    インターフェイス線と を備えた装置の情報伝送方式において、上記送信装置に
    は、 送信すべき並列データを複数n個のデータに区分しそれ
    ぞれ先頭データを付加して上記インターフェイス線に直
    列同期データとして送信する手段を備え、 上記受信装置には、 上記インターフェイス線のデータを直列同期データとし
    て受信する手段と、 この手段により受信されたデータを一時蓄積する手段と
    、 上記受信データに含まれる上記先頭データの個数が上記
    複数n個に等しいことを検出する手段と、この手段の検
    出出力により上記M積する手段に蓄積されたデータを並
    列データとして読出す手段と を備えたことを特徴とする情報伝送方式。
JP58158801A 1983-08-30 1983-08-30 情報伝送方式 Pending JPS6051047A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58158801A JPS6051047A (ja) 1983-08-30 1983-08-30 情報伝送方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58158801A JPS6051047A (ja) 1983-08-30 1983-08-30 情報伝送方式

Publications (1)

Publication Number Publication Date
JPS6051047A true JPS6051047A (ja) 1985-03-22

Family

ID=15679646

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58158801A Pending JPS6051047A (ja) 1983-08-30 1983-08-30 情報伝送方式

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JP (1) JPS6051047A (ja)

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