JPS6029790A - 端末装置 - Google Patents
端末装置Info
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- JPS6029790A JPS6029790A JP58137523A JP13752383A JPS6029790A JP S6029790 A JPS6029790 A JP S6029790A JP 58137523 A JP58137523 A JP 58137523A JP 13752383 A JP13752383 A JP 13752383A JP S6029790 A JPS6029790 A JP S6029790A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は端末装置に関し、特に表示またはプリント等の
色指定を容易に変更可能とした端末装置に関するもので
ある。
色指定を容易に変更可能とした端末装置に関するもので
ある。
例えば、従来の表示端末装置においては、表示色の指定
を、フィールドの属性を決定するフィールド定義文□字
(以下、rDFCJという)の色指定によって行ってい
たので、漢字を含む文字表示とセミグラフィック表示と
を行う場合、文字表示色とセミグラフィック表示色とを
分けて表示することができないという問題があった。こ
れは、プリント端末装置においても同様であった。
を、フィールドの属性を決定するフィールド定義文□字
(以下、rDFCJという)の色指定によって行ってい
たので、漢字を含む文字表示とセミグラフィック表示と
を行う場合、文字表示色とセミグラフィック表示色とを
分けて表示することができないという問題があった。こ
れは、プリント端末装置においても同様であった。
本発明は上記事情に鑑みてなされたもので、その目的と
するところは、従来の端末装置における上述の如き問題
を解消し、簡単な構成で漢字を含む文字表示色とセミグ
ラフィック表示色とを個別に取扱うことが可酷な端書装
置を提供することにある。
するところは、従来の端末装置における上述の如き問題
を解消し、簡単な構成で漢字を含む文字表示色とセミグ
ラフィック表示色とを個別に取扱うことが可酷な端書装
置を提供することにある。
本発明の要点は5文字コートまたは表示コー1−で与え
られるデータをドツトパターンに変換して表示またはプ
リントする端末装置において、前記文字コードまたは表
示コードにより表示される文字または図形の走査線単位
に該文字または図形の色を決定する付加ビットを用意し
て、該付加ピッ1へとフィールドの属性を決定するフィ
ールド定義文字中の表示色コードとから表示またはプリ
ン1−の色制御を行う如く構成した点にある。
られるデータをドツトパターンに変換して表示またはプ
リントする端末装置において、前記文字コードまたは表
示コードにより表示される文字または図形の走査線単位
に該文字または図形の色を決定する付加ビットを用意し
て、該付加ピッ1へとフィールドの属性を決定するフィ
ールド定義文字中の表示色コードとから表示またはプリ
ン1−の色制御を行う如く構成した点にある。
以下、本発明の実施例を図面に基づいて詳細に説明する
。
。
第1図は本発明の一実施例を示す表示端末装置のブロッ
ク図である。図において、1は後述するキャラクタバッ
ファ4および画素メモリ9のリード、ライトの制御を行
うマイクロプロセッサ、2は表示アドレスを制御する表
示アミ−レスカウンタ、3はマルチプレクサ、4は前記
DFC,表示すべき文字を示すコード(以下、F文字コ
ード」という)または表示すべき図形を示すコード(以
下、「表示コード」という)を格納するキャラクタバッ
ファである。また、5は後述するキャラクタジェネレー
タ7および画素メモリ9からのデータの読出しを制御す
るメモリ制御部、6は上記キャラクタバッファ4の出力
中の前記DFCをラッチする表示制御ラッチ、7はキャ
ラクタジェネレータ、8はマルチプレクサ、9は画素メ
モリである。
ク図である。図において、1は後述するキャラクタバッ
ファ4および画素メモリ9のリード、ライトの制御を行
うマイクロプロセッサ、2は表示アドレスを制御する表
示アミ−レスカウンタ、3はマルチプレクサ、4は前記
DFC,表示すべき文字を示すコード(以下、F文字コ
ード」という)または表示すべき図形を示すコード(以
下、「表示コード」という)を格納するキャラクタバッ
ファである。また、5は後述するキャラクタジェネレー
タ7および画素メモリ9からのデータの読出しを制御す
るメモリ制御部、6は上記キャラクタバッファ4の出力
中の前記DFCをラッチする表示制御ラッチ、7はキャ
ラクタジェネレータ、8はマルチプレクサ、9は画素メ
モリである。
上記キャラクタバッファ4には、第2図にその一例を示
す如く、DFCビットA9文字コードビットBを先頭と
するデータが格納される。第2図において、DFCビン
1〜Aが1′の場合には該データがDFCであることを
示しており、C以降のビン1〜はDFCの機能を示すも
のとなる。また、上記DFGビットAが0′で文字コー
トピッl−Bが0′の場合には該データは前記文字コー
ドとして機能し、DFCピッl−Aが0′で文字ツー1
−ビットBが1′の場合には該データは前記表示コード
として機能する。
す如く、DFCビットA9文字コードビットBを先頭と
するデータが格納される。第2図において、DFCビン
1〜Aが1′の場合には該データがDFCであることを
示しており、C以降のビン1〜はDFCの機能を示すも
のとなる。また、上記DFGビットAが0′で文字コー
トピッl−Bが0′の場合には該データは前記文字コー
ドとして機能し、DFCピッl−Aが0′で文字ツー1
−ビットBが1′の場合には該データは前記表示コード
として機能する。
前記メモリ制御部5は上記キャラクタノ<ソファ4から
入力されるコードにより、キャラクタジェネレータ7ま
たは画素メモリ9のいずれかを選択する機能を有する。
入力されるコードにより、キャラクタジェネレータ7ま
たは画素メモリ9のいずれかを選択する機能を有する。
該メモリ制御部5でキャラクタジェネレータ7が選択さ
れた場合には、該キャラクタジェネレータ7の出力は後
述するバッファ10に格納され、順次シフトレジスタ1
3にパラレルセットされる。また、上記メモリ制御部5
で画素メモリ9が選択された場合には、前記キャラクタ
バッファ4の内容がマルチプレクサ8を通って画素メモ
リ9に入力される。画素メモIJ 9 を二人力された
コー1〜は該画素メモリ9のアドレスとなる。
れた場合には、該キャラクタジェネレータ7の出力は後
述するバッファ10に格納され、順次シフトレジスタ1
3にパラレルセットされる。また、上記メモリ制御部5
で画素メモリ9が選択された場合には、前記キャラクタ
バッファ4の内容がマルチプレクサ8を通って画素メモ
リ9に入力される。画素メモIJ 9 を二人力された
コー1〜は該画素メモリ9のアドレスとなる。
マイクロプロセッサlによる上記キャラクタバッファ4
へのデータの書込みは、第3図に示す如く、マイクロプ
ロセッサlから送出されるアドレス情報をマルチプレク
サ3を通して上記キャラクタバッファ4に入力すると同
時に、上記71−レス情報によって指定されるアドレス
に同じくマイクロプロセッサ1から送出される前記DF
C,文字コード等のデータを格納するものである。なお
、マルチプレクサ3のアドレス切換えは、マイクロプロ
セッサ1が上記キャラクタバッファ4にデータを書込み
たいときに該マイクロプロセッサ1が行うものとする。
へのデータの書込みは、第3図に示す如く、マイクロプ
ロセッサlから送出されるアドレス情報をマルチプレク
サ3を通して上記キャラクタバッファ4に入力すると同
時に、上記71−レス情報によって指定されるアドレス
に同じくマイクロプロセッサ1から送出される前記DF
C,文字コード等のデータを格納するものである。なお
、マルチプレクサ3のアドレス切換えは、マイクロプロ
セッサ1が上記キャラクタバッファ4にデータを書込み
たいときに該マイクロプロセッサ1が行うものとする。
上記以外の時間は前記表示アドレスカウンタ2の内容が
上記キャラクタノ(ソファ4に与えられている。
上記キャラクタノ(ソファ4に与えられている。
また、画素メモリ9へのデータの書込みは、前記キャラ
クタバッファ4へのデータ書込みと同様に行われる。す
なわち、第4図に示す如く、マイクロプロセッサ1から
出力されるアドレス情報をマルチプレクサ8を通して上
記画素メモリ9し3人力すると同時に、上記アドレス情
報[こよって4七定されるアドレスにマイクロプロセッ
サ1hNら送1]5されるデータ(ここでは、表示ドソ
トノ(ターンおよび色制御ビット)を格納する。第5図
に、」二記画素メモリ9の内容の一例を示した。第5図
番;おいては、書込みデータを16ビツ1−とし、その
l/−Jの14ビン1〜を表示ドラ1ヘノくターン、2
ピノ1−を色制御ピッ1−としている例である。
クタバッファ4へのデータ書込みと同様に行われる。す
なわち、第4図に示す如く、マイクロプロセッサ1から
出力されるアドレス情報をマルチプレクサ8を通して上
記画素メモリ9し3人力すると同時に、上記アドレス情
報[こよって4七定されるアドレスにマイクロプロセッ
サ1hNら送1]5されるデータ(ここでは、表示ドソ
トノ(ターンおよび色制御ビット)を格納する。第5図
に、」二記画素メモリ9の内容の一例を示した。第5図
番;おいては、書込みデータを16ビツ1−とし、その
l/−Jの14ビン1〜を表示ドラ1ヘノくターン、2
ピノ1−を色制御ピッ1−としている例である。
上記画素メモリ9から読出されるデータ中の表示トノ1
−パターンは前記バッファ10しこ、また、色制御ピッ
1−は色制御ラッチ11に格納さ4しる。
−パターンは前記バッファ10しこ、また、色制御ピッ
1−は色制御ラッチ11に格納さ4しる。
12は上記色制御ランチ目し格納さAしたべ・吉報と前
記表示制御ラッチ6にランチされてしsるD F Cの
色制御情報とを論理演算する色制御演算器であり、該色
制御演算器12の出力はノくノファ14番;格納される
。なお、上記バッファ14に格納された情報はアンドゲ
ート15に送られ、前記シフトレジスタ13の出力との
論理積が演算される。
記表示制御ラッチ6にランチされてしsるD F Cの
色制御情報とを論理演算する色制御演算器であり、該色
制御演算器12の出力はノくノファ14番;格納される
。なお、上記バッファ14に格納された情報はアンドゲ
ート15に送られ、前記シフトレジスタ13の出力との
論理積が演算される。
上述の如く構成された本実施例の動作を以下説明する。
なお、以下の説明においては、第6図に示す如きセミグ
ラフィック表示と漢字を含む文字表示とを行う場合を例
に挙げる。
ラフィック表示と漢字を含む文字表示とを行う場合を例
に挙げる。
まず、前記キャラクタバッファ4および画素メモリ9に
必要なデータを書込む。第6図の場合、前記DFCによ
り、4行の赤色(R)指定、5行の青色(B)指定、3
行の白色(W)指定等を行い、各色指定文字の後に表示
すべき文字コードを順次書込んで行く。キャラクタバッ
ファ4に必要な文字コードをすべて書込んだ後に、画素
メモリ9に第6図に示されるような扇形等の表示ドツト
パターンと先に第5図に示した色制御ビン1〜を書込む
。
必要なデータを書込む。第6図の場合、前記DFCによ
り、4行の赤色(R)指定、5行の青色(B)指定、3
行の白色(W)指定等を行い、各色指定文字の後に表示
すべき文字コードを順次書込んで行く。キャラクタバッ
ファ4に必要な文字コードをすべて書込んだ後に、画素
メモリ9に第6図に示されるような扇形等の表示ドツト
パターンと先に第5図に示した色制御ビン1〜を書込む
。
次に、キャラクタバッファ4がらのデータの読出しにつ
いて説明する。表示アドレスカウンタ2は表示の走査線
数をn本とした場合、第7図に示す如く構成される。な
お、上記表示アドレスカウンタ2の更新条件はT/x(
Tは1行の走査時間。
いて説明する。表示アドレスカウンタ2は表示の走査線
数をn本とした場合、第7図に示す如く構成される。な
お、上記表示アドレスカウンタ2の更新条件はT/x(
Tは1行の走査時間。
Xは1行の表示文字数)であり、更新位置はム印で示さ
れている。
れている。
前記、キャラクタバッファ4および画素メモリ9へのデ
ータの書込みが終了すると、上記表示アドレスカウンタ
2の内容をマルチプレクサ3を通してキャラクタバッフ
ァ4に入力する。キャラクタバッファ4では上記入力に
対応するアドレスの内容が読出され、これがDFCであ
る場合には前記表示制御ラッチに、また表示すべき文字
コートあるいは表示コードである場合には前記メモリ制
御部5に入力する。
ータの書込みが終了すると、上記表示アドレスカウンタ
2の内容をマルチプレクサ3を通してキャラクタバッフ
ァ4に入力する。キャラクタバッファ4では上記入力に
対応するアドレスの内容が読出され、これがDFCであ
る場合には前記表示制御ラッチに、また表示すべき文字
コートあるいは表示コードである場合には前記メモリ制
御部5に入力する。
メモリ制御部5は、キャラクタバッファ4がら入力され
たコードが文字コードである場合には、その文字コード
をキャラクタジェネレータ7に送る。キャラクタジェネ
レータ7では上記文字コードに対応する文字パターンが
取出され、前記バッファ10を介してシフトレジスタ1
3に格納される。シフトレジスタ13にセットされた情
報は、1ビツトずつシフトし、アントゲ−1−15で色
制御バッファ14の内容との論理積を取って表示部に送
り表示させる。
たコードが文字コードである場合には、その文字コード
をキャラクタジェネレータ7に送る。キャラクタジェネ
レータ7では上記文字コードに対応する文字パターンが
取出され、前記バッファ10を介してシフトレジスタ1
3に格納される。シフトレジスタ13にセットされた情
報は、1ビツトずつシフトし、アントゲ−1−15で色
制御バッファ14の内容との論理積を取って表示部に送
り表示させる。
また、メモリ制御部5は、キャラクタバッファ4から入
力されたコードが表示コードである場合には、該表示コ
ードを画素メモリ9に送る。画素メモリ9に入力された
上記コードは、前述の通り画素メモリ9のアドレスとな
り、以下に説明する如く、画素メモリ9から表示ドツト
パターンおよび色制御ピッ1−を読出すのに用いられる
。
力されたコードが表示コードである場合には、該表示コ
ードを画素メモリ9に送る。画素メモリ9に入力された
上記コードは、前述の通り画素メモリ9のアドレスとな
り、以下に説明する如く、画素メモリ9から表示ドツト
パターンおよび色制御ピッ1−を読出すのに用いられる
。
画素メモリ9からの表示ドツトパターンおよび色制御ビ
ットの読出しは、第8図に示す如く、画素メモリ9に入
力された表示コードに対応して、前記口走査の間に1番
地の割合で前記14ピノ1−の表示ドラ1〜パターンと
2ビツトの色制御ビットとを読出す如<fTう。そして
、読出した表示ドラ1−パターンを前記バッファ10に
格納すると同時に、読出した色制御ビットを色制御ラッ
チ11にl) 格納する。上記バッファ10に格納された情報は、前述
の文字情報と同様に、シフトレジスタ13にセットされ
、アンドゲート15に与えら九る。
ットの読出しは、第8図に示す如く、画素メモリ9に入
力された表示コードに対応して、前記口走査の間に1番
地の割合で前記14ピノ1−の表示ドラ1〜パターンと
2ビツトの色制御ビットとを読出す如<fTう。そして
、読出した表示ドラ1−パターンを前記バッファ10に
格納すると同時に、読出した色制御ビットを色制御ラッ
チ11にl) 格納する。上記バッファ10に格納された情報は、前述
の文字情報と同様に、シフトレジスタ13にセットされ
、アンドゲート15に与えら九る。
一方、上記色制御ラッチに格納された情報は、色制御演
算器12により前記表示制御ラッチ6に格納された情報
との間で論理演算され、色制御バッファ14に格納され
る。該色制御バッファ14に格納された情報はアンドゲ
ート15に送られ、シフトレジスタ13の内容と論理積
されてカラー表示信号として表示部に送出される。
算器12により前記表示制御ラッチ6に格納された情報
との間で論理演算され、色制御バッファ14に格納され
る。該色制御バッファ14に格納された情報はアンドゲ
ート15に送られ、シフトレジスタ13の内容と論理積
されてカラー表示信号として表示部に送出される。
表示制御ラッチ6にランチされている情報は、例えば、
第9図にAで示す如く、赤色(R)、I’M色(G)、
青色(B)の有無を1’、’O’で示したものである。
第9図にAで示す如く、赤色(R)、I’M色(G)、
青色(B)の有無を1’、’O’で示したものである。
また1色制御ラッチ11に格納さ」している情報は、例
えば、第9図にBで示す如く、上記赤色、緑色、青色の
内の2色の有無を同じ<’I’、’O’で示したもので
ある。上記色制御演算器12は、これらのデータを、例
えば第9図Cに示す如く右詰めにして加算するものであ
る。これにより、出力される色制御情報が変化する部分
については、当初、DFCで指定された表示色とは異な
る表示色の文字2図形が表示されることになる。
えば、第9図にBで示す如く、上記赤色、緑色、青色の
内の2色の有無を同じ<’I’、’O’で示したもので
ある。上記色制御演算器12は、これらのデータを、例
えば第9図Cに示す如く右詰めにして加算するものであ
る。これにより、出力される色制御情報が変化する部分
については、当初、DFCで指定された表示色とは異な
る表示色の文字2図形が表示されることになる。
第6図に示す如く、赤色指定のDFCが・1行。
青色指定のDFCが5行、白色指定のDFCが3行存在
した場合、従来の表示方式では、例えば、赤色指定の4
行は図形部分も文字もすべて赤色になってしまうのが、
本実施例によれば、第10図に示す如く、フィールドの
色指定に無関係に他の色に変更することが可能となる。
した場合、従来の表示方式では、例えば、赤色指定の4
行は図形部分も文字もすべて赤色になってしまうのが、
本実施例によれば、第10図に示す如く、フィールドの
色指定に無関係に他の色に変更することが可能となる。
すなわち、フィール1−の色指定が(R,、G、B=1
.O,O)で赤色が指定されていても、文字の色制御ビ
ットを2ピッ1−て(G、B=1.]、)とすれば白色
の文字を得ることができ、図形部分は赤色のままとする
場合にはこれに対応する色制御ピントを(G、B=O,
O)とすれば良い。
.O,O)で赤色が指定されていても、文字の色制御ビ
ットを2ピッ1−て(G、B=1.]、)とすれば白色
の文字を得ることができ、図形部分は赤色のままとする
場合にはこれに対応する色制御ピントを(G、B=O,
O)とすれば良い。
上記色制御ピノ1−は2ビツトに限られるものではなく
、1ピノ1−以上で自由に選択して用いることが可能で
あることは言うまでもない。
、1ピノ1−以上で自由に選択して用いることが可能で
あることは言うまでもない。
以」二連へた如く、本発明によれば、文字コートまたは
表示コードで与えらAしるデータをドツトパターンに変
換して表示またはプリン1−する端末装置において、前
記文字コーI・または表示コードにより表示される文字
または図形の走査線単位に該文字または図形の色を決菟
”i−’S 4’J加ビン1〜を用、びして、該付加ピ
ッ1〜とフィール1−の属性を決定するフィールド定義
文字中の表示色コードとから表示またはプリントの色制
御を行う如く構成したので、簡単な構成で漢字を含む文
字表示色とセミグラフインク表示色とを個別に取扱うこ
とが可能な端末装置を実現できるという顕著な効果を奏
するものである。
表示コードで与えらAしるデータをドツトパターンに変
換して表示またはプリン1−する端末装置において、前
記文字コーI・または表示コードにより表示される文字
または図形の走査線単位に該文字または図形の色を決菟
”i−’S 4’J加ビン1〜を用、びして、該付加ピ
ッ1〜とフィール1−の属性を決定するフィールド定義
文字中の表示色コードとから表示またはプリントの色制
御を行う如く構成したので、簡単な構成で漢字を含む文
字表示色とセミグラフインク表示色とを個別に取扱うこ
とが可能な端末装置を実現できるという顕著な効果を奏
するものである。
第1図は本発明の一実施例を示す表示端末装置のブロッ
ク図、第2図はチー外形式の−・例を示ず図、第3図は
キャラクタ八ツファへのテータ店込みを説明するための
図、第4図は画素メモリパ\のデータ書込みを説明する
ための図、第5図は画素メモリの内容の一例を示す図、
第6図、第10図はセミグラフィ、ツク表示と文字表示
とを行った表示画面を示す図、第7図は表示アドレスカ
ウンタの内容の一例を示す図、第8図は画素メモリから
のデータ読出しを説明するための図、第9図は色制御情
報を説明するための図である。 にマイクロプロセッサ、2:表示アドレスカウンタ、3
:マルチプレクサ、4:キャラクタノくソファ、5:メ
モリ制御部、6:表示制御ラッチ、7:キャラクタジェ
ネレータ、8:マルチプレクサ、9:画素メモリ、10
:バッファ、11:色制御ラッチ、12:色制御演算器
、13:シフ1へレジスタ、14:バッファ、15:ア
ンドゲート。 第 1 図 第 2 図 第 4 図 第 5 図 第 6 図 W−(× W−[ w−(× し 第 7 図 第 8 図 第 10 図 弔9図
ク図、第2図はチー外形式の−・例を示ず図、第3図は
キャラクタ八ツファへのテータ店込みを説明するための
図、第4図は画素メモリパ\のデータ書込みを説明する
ための図、第5図は画素メモリの内容の一例を示す図、
第6図、第10図はセミグラフィ、ツク表示と文字表示
とを行った表示画面を示す図、第7図は表示アドレスカ
ウンタの内容の一例を示す図、第8図は画素メモリから
のデータ読出しを説明するための図、第9図は色制御情
報を説明するための図である。 にマイクロプロセッサ、2:表示アドレスカウンタ、3
:マルチプレクサ、4:キャラクタノくソファ、5:メ
モリ制御部、6:表示制御ラッチ、7:キャラクタジェ
ネレータ、8:マルチプレクサ、9:画素メモリ、10
:バッファ、11:色制御ラッチ、12:色制御演算器
、13:シフ1へレジスタ、14:バッファ、15:ア
ンドゲート。 第 1 図 第 2 図 第 4 図 第 5 図 第 6 図 W−(× W−[ w−(× し 第 7 図 第 8 図 第 10 図 弔9図
Claims (1)
- 文字コー1−または表示コードで与えられるデータをド
ツトパターンに変換して表示またはプリントする端末装
置において、前記文字コードまたは表示コードにより表
示される文字または図形の走査線単位に該文字または図
□形の色を決定する付加ピッ1−を用意して、該付加ビ
ットとフィールドの属性を決定するフィールド定義文字
中の表示色コードとから表示またはプリントあ色制御を
行う如く構成されたことを特徴とする端末装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58137523A JPS6029790A (ja) | 1983-07-29 | 1983-07-29 | 端末装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58137523A JPS6029790A (ja) | 1983-07-29 | 1983-07-29 | 端末装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6029790A true JPS6029790A (ja) | 1985-02-15 |
Family
ID=15200664
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58137523A Pending JPS6029790A (ja) | 1983-07-29 | 1983-07-29 | 端末装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6029790A (ja) |
-
1983
- 1983-07-29 JP JP58137523A patent/JPS6029790A/ja active Pending
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