JPS602640Y2 - 減衰振動回路 - Google Patents
減衰振動回路Info
- Publication number
- JPS602640Y2 JPS602640Y2 JP16990777U JP16990777U JPS602640Y2 JP S602640 Y2 JPS602640 Y2 JP S602640Y2 JP 16990777 U JP16990777 U JP 16990777U JP 16990777 U JP16990777 U JP 16990777U JP S602640 Y2 JPS602640 Y2 JP S602640Y2
- Authority
- JP
- Japan
- Prior art keywords
- transfer gate
- circuit
- capacitor
- amplifier circuit
- conventional example
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- Electromechanical Clocks (AREA)
Description
【考案の詳細な説明】
本考案は第１のトランスファゲートＧ□にコンデンサＣ
と抵抗Ｒ□との並列回路を接続し、コンデンサＣの出力
電圧端子を第２のトランスファゲートＧ２に接続すると
共に第２のトランスファゲートＧ２を高入力インピーダ
ンスの増幅回路１を介してトランジスタ増幅回路Ｔに接
続して成る減衰振動回路に係り、その目的とするところ
は、安定した動作を行なう減衰振動回路を提供するにあ
る。
と抵抗Ｒ□との並列回路を接続し、コンデンサＣの出力
電圧端子を第２のトランスファゲートＧ２に接続すると
共に第２のトランスファゲートＧ２を高入力インピーダ
ンスの増幅回路１を介してトランジスタ増幅回路Ｔに接
続して成る減衰振動回路に係り、その目的とするところ
は、安定した動作を行なう減衰振動回路を提供するにあ
る。
第４図は従来の減衰振動回路の回路図を示すもので、入
力端子Ａには第５図イに示すような一定周期のパルスが
入力し、コンデンサＣは第１のトランスファゲートＧ１
によって第５図口に示すように充電され、抵抗Ｒ１を介
入して放電する。
力端子Ａには第５図イに示すような一定周期のパルスが
入力し、コンデンサＣは第１のトランスファゲートＧ１
によって第５図口に示すように充電され、抵抗Ｒ１を介
入して放電する。
コンデンサＣの出力電圧端子は第２のトランスファゲー
トＧ２に接続されており、入力端子Ｂから入力する第５
図へに示すような一定の振動信号によってコンデンサＣ
の出力電圧は制御されて第５図二に示すようになり、抵
抗Ｒ２を介してトランジスタ増幅回路Ｔに入力し、スピ
ーカＳＰを鳴動させるようになっている。
トＧ２に接続されており、入力端子Ｂから入力する第５
図へに示すような一定の振動信号によってコンデンサＣ
の出力電圧は制御されて第５図二に示すようになり、抵
抗Ｒ２を介してトランジスタ増幅回路Ｔに入力し、スピ
ーカＳＰを鳴動させるようになっている。
ところが、かかる従来例にあっては、トランジスタ増幅
回路ＴのトランジスタＴｒの動作点の変化で、インピー
ダンスが変化するため、抵抗Ｒ□とコンデンサＣとによ
って構成されるＣＲ時定数回路の時定数が変化し、振動
信号が不安定となる欠点があった。
回路ＴのトランジスタＴｒの動作点の変化で、インピー
ダンスが変化するため、抵抗Ｒ□とコンデンサＣとによ
って構成されるＣＲ時定数回路の時定数が変化し、振動
信号が不安定となる欠点があった。
本考案は上記従来例の欠点を解消するために考案したも
のであり、第２のトランスファゲートＧ２とトランジス
タ増幅回路Ｔとの間にＣ−ＭＯＳインバータ２と帰環抵
抗Ｒ３とよりなる高入力インピーダンスの増幅回路１を
挿入接続したが点が、第４図従来例と異なり、他の部分
は略同である。
のであり、第２のトランスファゲートＧ２とトランジス
タ増幅回路Ｔとの間にＣ−ＭＯＳインバータ２と帰環抵
抗Ｒ３とよりなる高入力インピーダンスの増幅回路１を
挿入接続したが点が、第４図従来例と異なり、他の部分
は略同である。
入力端子Ａには第２図イに示すような一定周期のパルス
Ｐが、入力端子Ｂには第２図へに示すような一定振幅の
音声周波数の信号Ｑが夫々入力する。
Ｐが、入力端子Ｂには第２図へに示すような一定振幅の
音声周波数の信号Ｑが夫々入力する。
パルスＰの到来により、コンデンサＣは第１のトランス
ファゲートＧ１のオン抵抗を通じて充電される。
ファゲートＧ１のオン抵抗を通じて充電される。
その後パルスＰが消えると、抵抗Ｒ１とコンデンサＣと
の時定数で決まる放電電圧が第２のトランスファゲート
Ｇ２に加わる。
の時定数で決まる放電電圧が第２のトランスファゲート
Ｇ２に加わる。
この第２のトランスファゲートＧ２は信号Ｑにより開閉
制御されているため、その出力端子には第２図二に示す
ように放電電圧と信号Ｑとの積の信号が発生する。
制御されているため、その出力端子には第２図二に示す
ように放電電圧と信号Ｑとの積の信号が発生する。
この信号が増幅回路１に入力すると共にトランジスタ増
幅回路Ｔに加わって、スピーカＳＰよりパルスＰの周期
で減衰振動音が発生する。
幅回路Ｔに加わって、スピーカＳＰよりパルスＰの周期
で減衰振動音が発生する。
次に、従来例と本考案例での時定数回路の差を第３図と
第６図の特定数等価回路で説明する。
第６図の特定数等価回路で説明する。
第３図は本考案、第６図は従来例を示し、等価回路での
Ｒ７は第２のトランスファゲートＧ２の等価抵抗である
。
Ｒ７は第２のトランスファゲートＧ２の等価抵抗である
。
このゲートオン抵抗ＲＴが信号Ｑの周期で挿入、切断さ
れる。
れる。
ここでトランジスタ増幅回路Ｔのベース、エミッタをダ
イオードＤで表わしている。
イオードＤで表わしている。
従来例では、直接第２のトランスファゲートＧ２にトラ
ンジスターＴｒが挿入されている為、コンデンサＣの放
電ループの中にベース低抗Ｒ２とダイオードＤが挿入さ
れ、放電特定数は、 τ１＝ＣｔＲ７／Ｒ丁十Ｒ２＋Ｄ Ｒ・・・・・・（１
）Ｒ７・・・・・・ゲートオン抵抗 ＤＲ・・・・・・ダイオード抵抗 となる。
ンジスターＴｒが挿入されている為、コンデンサＣの放
電ループの中にベース低抗Ｒ２とダイオードＤが挿入さ
れ、放電特定数は、 τ１＝ＣｔＲ７／Ｒ丁十Ｒ２＋Ｄ Ｒ・・・・・・（１
）Ｒ７・・・・・・ゲートオン抵抗 ＤＲ・・・・・・ダイオード抵抗 となる。
本考案では
τ２ ＝Ｃ、Ｒ１／ ＲＴ 十Ｒ２＋Ｒ３・・・・・・
（２）となる。
（２）となる。
ここでＲ２，Ｒ３の値はインバーター２
度、ＤＣレベルで決まる素子で、
の増幅
、Ｒ
増幅度Ａ＝Ｃ・・・・・（３）となる
従来例回路でＲ２の値を大きくするとベース電流が小さ
くなる為充分大きくとれずτ１の影響がでてくる。
くなる為充分大きくとれずτ１の影響がでてくる。
本考案では、インバーター２をＣ−ＭＯ３ＩＣ構戊より
抵抗Ｒ２，Ｒ３は大きく取れ、かっＣ−ＭＯ３ＩＣ構戒
であ構威電圧増幅より入力インピーダンスは無限大とな
りＲ□＜Ｒ２，Ｒ□＜Ｒ３となり時定数回路への影響は
問題にならなくなる。
抵抗Ｒ２，Ｒ３は大きく取れ、かっＣ−ＭＯ３ＩＣ構戒
であ構威電圧増幅より入力インピーダンスは無限大とな
りＲ□＜Ｒ２，Ｒ□＜Ｒ３となり時定数回路への影響は
問題にならなくなる。
本考案は上述のように、コンデンサの出力電圧端子を第
２のトランスファゲートに接続すると共に第２のトラン
スファゲートを高入力インピーダンスの増幅回路を介し
てトランジスタ増幅回路に接続したから、抵抗とコンデ
ンサによって構成されるＣ、 Ｒ時定数回路を高入力イ
ンピーダンスの増幅回路によってトランジスタ増幅回路
からの悪影響を防止することができて安定した充放電ル
ープを取らせることができ、正確で安定した減衰振動を
得ることができる利点を有する。
２のトランスファゲートに接続すると共に第２のトラン
スファゲートを高入力インピーダンスの増幅回路を介し
てトランジスタ増幅回路に接続したから、抵抗とコンデ
ンサによって構成されるＣ、 Ｒ時定数回路を高入力イ
ンピーダンスの増幅回路によってトランジスタ増幅回路
からの悪影響を防止することができて安定した充放電ル
ープを取らせることができ、正確で安定した減衰振動を
得ることができる利点を有する。
第１図は本考案の一実施例の回路図、第２図イル二は同
上の動作説明タイムチャート、第３図は同上の時定数等
価回路、第４図は従来例の回路図、第５図イル二は同上
従来例の動作説明タイムチャート、第６図は従来例の時
定数等価回路である。 １は増幅回路、Ｃはコンデンサ、Ｇ□は第１のトランス
ファゲート、Ｇ２は第２のトランスファゲート、Ｔはト
ランジスタ増幅回路である。
上の動作説明タイムチャート、第３図は同上の時定数等
価回路、第４図は従来例の回路図、第５図イル二は同上
従来例の動作説明タイムチャート、第６図は従来例の時
定数等価回路である。 １は増幅回路、Ｃはコンデンサ、Ｇ□は第１のトランス
ファゲート、Ｇ２は第２のトランスファゲート、Ｔはト
ランジスタ増幅回路である。
Claims (1)
- 第１のトランスファゲートにコンデンサと抵抗との並列
回路を接続し、コンデンサの出力電圧端子を第２のトラ
ンスファゲートに接続すると共に第２のトランスファゲ
ートを高入力インピーダンスの増幅回路を介してトラン
ジスタ増幅回路に接続して成る減衰振動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16990777U JPS602640Y2 (ja) | 1977-12-15 | 1977-12-15 | 減衰振動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16990777U JPS602640Y2 (ja) | 1977-12-15 | 1977-12-15 | 減衰振動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5494224U JPS5494224U (ja) | 1979-07-04 |
| JPS602640Y2 true JPS602640Y2 (ja) | 1985-01-24 |
Family
ID=29172406
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16990777U Expired JPS602640Y2 (ja) | 1977-12-15 | 1977-12-15 | 減衰振動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS602640Y2 (ja) |
-
1977
- 1977-12-15 JP JP16990777U patent/JPS602640Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5494224U (ja) | 1979-07-04 |
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