JPS60258594A - 音楽的音調発生装置 - Google Patents
音楽的音調発生装置Info
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- JPS60258594A JPS60258594A JP59281290A JP28129084A JPS60258594A JP S60258594 A JPS60258594 A JP S60258594A JP 59281290 A JP59281290 A JP 59281290A JP 28129084 A JP28129084 A JP 28129084A JP S60258594 A JPS60258594 A JP S60258594A
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- G—PHYSICS
- G10—MUSICAL INSTRUMENTS; ACOUSTICS
- G10H—ELECTROPHONIC MUSICAL INSTRUMENTS; INSTRUMENTS IN WHICH THE TONES ARE GENERATED BY ELECTROMECHANICAL MEANS OR ELECTRONIC GENERATORS, OR IN WHICH THE TONES ARE SYNTHESISED FROM A DATA STORE
- G10H7/00—Instruments in which the tones are synthesised from a data store, e.g. computer organs
- G10H7/02—Instruments in which the tones are synthesised from a data store, e.g. computer organs in which amplitudes at successive sample points of a tone waveform are stored in one or more memories
- G10H7/04—Instruments in which the tones are synthesised from a data store, e.g. computer organs in which amplitudes at successive sample points of a tone waveform are stored in one or more memories in which amplitudes are read at varying rates, e.g. according to pitch
- G10H7/045—Instruments in which the tones are synthesised from a data store, e.g. computer organs in which amplitudes at successive sample points of a tone waveform are stored in one or more memories in which amplitudes are read at varying rates, e.g. according to pitch using an auxiliary register or set of registers, e.g. a shift-register, in which the amplitudes are transferred before being read
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電子ディジタル楽音（ｔｏｎｅ）シンセサイザ
、および特に単一の主クロツク源から音階（ｓｃａβｅ
）のすべての音調（ｎｏｔｅ）を発生するための装置に
関するものである。
、および特に単一の主クロツク源から音階（ｓｃａβｅ
）のすべての音調（ｎｏｔｅ）を発生するための装置に
関するものである。
テイジタル楽音シンセサイザ形の鍵盤操作電子楽器は周
知である。複音シンセサイザ（ＰＯＬＹＰＨＯＮＩＣＴ
ＯＮＥ ５ＹＮＴＨＥＳＩＺＥＲ）という名称の、１９
７５年８月１１日出願、米国出願第６０６．７７６号（
特願昭５１−９３１５１９ ）の出願中の明細書に、多
数の楽音発生器をそなえ、各楽音発生器は主データリス
トから楽音を発生する鍵盤楽器が記載されている。デー
タリストは、発生されるべき楽音の１サイクルに対応す
るアナログ信号に沿って、等間隔に配置された点の振幅
値をあられしている。各楽音発生器に対する主データリ
ストはシフトレジスタに記憶されておシ、振幅値はシフ
ト周波数でレジスタがらＤ−Ａ （ｄｉｇｉｔａｌｌ
ｔｏ ａｎａｌ！、ｏｇ） ｌｊｊ換器ヘシフトされる
。
知である。複音シンセサイザ（ＰＯＬＹＰＨＯＮＩＣＴ
ＯＮＥ ５ＹＮＴＨＥＳＩＺＥＲ）という名称の、１９
７５年８月１１日出願、米国出願第６０６．７７６号（
特願昭５１−９３１５１９ ）の出願中の明細書に、多
数の楽音発生器をそなえ、各楽音発生器は主データリス
トから楽音を発生する鍵盤楽器が記載されている。デー
タリストは、発生されるべき楽音の１サイクルに対応す
るアナログ信号に沿って、等間隔に配置された点の振幅
値をあられしている。各楽音発生器に対する主データリ
ストはシフトレジスタに記憶されておシ、振幅値はシフ
ト周波数でレジスタがらＤ−Ａ （ｄｉｇｉｔａｌｌ
ｔｏ ａｎａｌ！、ｏｇ） ｌｊｊ換器ヘシフトされる
。
シフト周波数は、発生される音調の基本周波数に丁度比
例している。
例している。
上述の出願中の明細書に述べたごとく、シフト周波数は
可変周波数発振器から得られる。発振器の周波数は、鍵
盤上のキーを押すことによって制御される。割邑回路が
音調を定めるものをメモリに記憶していて、個々のキー
に対して楽音発生器を割当てる。音調を定めるものは、
個別にアドレスできる周波数制御数を記憶しているメモ
リのアドレスとして機能する。
可変周波数発振器から得られる。発振器の周波数は、鍵
盤上のキーを押すことによって制御される。割邑回路が
音調を定めるものをメモリに記憶していて、個々のキー
に対して楽音発生器を割当てる。音調を定めるものは、
個別にアドレスできる周波数制御数を記憶しているメモ
リのアドレスとして機能する。
発振器の周波数は、鍵盤上の押された個々のキーに対応
して、メモリから読み出された周波数ナンバーによって
設定される。楽器内の各楽音発生器は個有の発生器を有
している。このことは、和音を鳴らす時のように、それ
ぞれが異なった音の高さすなわち周波数である。多数の
音調が同時に発生することを許す。多数の発振器が制御
される仕方は、周波数ナンバーｆｌｊｌＪ御クロック装
置（ＦＲＥ−ＱＵＥＮＣＹ ＮＵＭＢＥＲＣ０ＮＴＲ０
Ｌ ＣＬＯＣＫ） という名称の、１９７５年１１月２
４日出願、米国出ａ第６３４．５５３号（％願昭５１−
１４０６１６ ）の出願中の明細書に、よシ詳細に記述
されている。鍵盤中のキーが楽音発生器に割当てられる
やシ方は、鍵盤スイッチ検出と１１１１幽装置（ＫＥＹ
ＢＯＡＲＤ ５ＷＩＴＣＨＤＥＴＥＣＴ ＡＮＤ ＡＳ
ＳＩＧＮＯＲ）という名称の、１９７５年１０月６日出
願１、米国出願第６１９．５１５号（特願昭５１−１１
０６５２ ）の出願中の明細書に１よシ詳細に記述され
ている。
して、メモリから読み出された周波数ナンバーによって
設定される。楽器内の各楽音発生器は個有の発生器を有
している。このことは、和音を鳴らす時のように、それ
ぞれが異なった音の高さすなわち周波数である。多数の
音調が同時に発生することを許す。多数の発振器が制御
される仕方は、周波数ナンバーｆｌｊｌＪ御クロック装
置（ＦＲＥ−ＱＵＥＮＣＹ ＮＵＭＢＥＲＣ０ＮＴＲ０
Ｌ ＣＬＯＣＫ） という名称の、１９７５年１１月２
４日出願、米国出ａ第６３４．５５３号（％願昭５１−
１４０６１６ ）の出願中の明細書に、よシ詳細に記述
されている。鍵盤中のキーが楽音発生器に割当てられる
やシ方は、鍵盤スイッチ検出と１１１１幽装置（ＫＥＹ
ＢＯＡＲＤ ５ＷＩＴＣＨＤＥＴＥＣＴ ＡＮＤ ＡＳ
ＳＩＧＮＯＲ）という名称の、１９７５年１０月６日出
願１、米国出願第６１９．５１５号（特願昭５１−１１
０６５２ ）の出願中の明細書に１よシ詳細に記述され
ている。
多数の可変周波数発振器の使用における１つの問題は、
楽器を適当な調整状態に保つことである。
楽器を適当な調整状態に保つことである。
各発振器は、全音階またはそのある整数倍における各音
調の周波数を、正確に再生しなければならない。しかし
ながら、可変周波数発振器は、時間とともに周波数がド
リフトする傾向がある。また周囲条件の変化は、その周
波数に影響を与え得る。
調の周波数を、正確に再生しなければならない。しかし
ながら、可変周波数発振器は、時間とともに周波数がド
リフトする傾向がある。また周囲条件の変化は、その周
波数に影響を与え得る。
鍵盤上の各キーが、どの割当てられた発振器も同じ公称
周波数に設定するように、発振器は調節されなければな
らない。さもないと、どの楽音発生器が個々のキーに割
当てられるかに応じて音の高さが変るだろう。このこと
から、非常に広い周波数範囲にわたって、正電に設定さ
れて発振できるように、極度に安定な発振器を必要とす
る。この条件は、受画な価格において獲得することは少
々困難である。
周波数に設定するように、発振器は調節されなければな
らない。さもないと、どの楽音発生器が個々のキーに割
当てられるかに応じて音の高さが変るだろう。このこと
から、非常に広い周波数範囲にわたって、正電に設定さ
れて発振できるように、極度に安定な発振器を必要とす
る。この条件は、受画な価格において獲得することは少
々困難である。
この理由から、それぞれの楽音発生器のシフトレジスタ
をシフトするためのパルス列を、単一ノ主クロックパル
ス源から発生することが望ましい。
をシフトするためのパルス列を、単一ノ主クロックパル
ス源から発生することが望ましい。
クロックパルス列を楽音周波数に合成するために、これ
までに提案された１つの方法は、オクターブ音階中の１
２音のそれぞれに対して１個のカウンタがある、１組の
部数カウンタを有する、Ｉトップオクターブシンセサイ
ザ”と呼ばれるものを使うことである。これらのカウン
タは、単一の主クロックの整数分割を作シ出す。トップ
オクターブにおける周波数に対応したクロックパルス列
を発生するためには、約ＭＨ２の主クロツク速度を必要
とする。しかしながら、前述の出願中の明細書において
記述された複音シンセサイザにおいては、シフトパルプ
周波数は発生されるべき音の周波数の６４倍でなければ
ならない。これは技術の現状に比べて、遥かに高い主ク
ロツク周波数を必要とするものである。
までに提案された１つの方法は、オクターブ音階中の１
２音のそれぞれに対して１個のカウンタがある、１組の
部数カウンタを有する、Ｉトップオクターブシンセサイ
ザ”と呼ばれるものを使うことである。これらのカウン
タは、単一の主クロックの整数分割を作シ出す。トップ
オクターブにおける周波数に対応したクロックパルス列
を発生するためには、約ＭＨ２の主クロツク速度を必要
とする。しかしながら、前述の出願中の明細書において
記述された複音シンセサイザにおいては、シフトパルプ
周波数は発生されるべき音の周波数の６４倍でなければ
ならない。これは技術の現状に比べて、遥かに高い主ク
ロツク周波数を必要とするものである。
周波数分割によって、共通のクロック源から多数の周波
数を得るためのもう１つの技術は、非整数除算器を使用
することである。しかしながら、非整数除算器はどんな
所望の平均周波数を有するパルス列でも作るが、そのパ
ルス列において、パルス間の間隔は常に同一ではない。
数を得るためのもう１つの技術は、非整数除算器を使用
することである。しかしながら、非整数除算器はどんな
所望の平均周波数を有するパルス列でも作るが、そのパ
ルス列において、パルス間の間隔は常に同一ではない。
与えられた期間中生じるパルスの数は、パルス列から選
ばれたパルス間隔でパルスを消去することによって変化
する。しかしながら、前述の願書において記述したタイ
プの多音シンセサイザにおいて、楽音発生器でシフトパ
ルス列を発生するために、非整数除算器が使われたとす
ると、パルス列中のパルスの不−同な間隔は、システム
中に非常に不快な雑音を導入する。この雑音は可聴音の
高い周波数成分の形であシ、基本周波数から広く離れて
いることと高いレベルの強度のために、不愉快な音響効
果を生じる。
ばれたパルス間隔でパルスを消去することによって変化
する。しかしながら、前述の願書において記述したタイ
プの多音シンセサイザにおいて、楽音発生器でシフトパ
ルス列を発生するために、非整数除算器が使われたとす
ると、パルス列中のパルスの不−同な間隔は、システム
中に非常に不快な雑音を導入する。この雑音は可聴音の
高い周波数成分の形であシ、基本周波数から広く離れて
いることと高いレベルの強度のために、不愉快な音響効
果を生じる。
本発明は、クロックパルス列を楽音周波数に合成するだ
めの非整数除算器に対する工夫に帰着する。これは前述
の出願中の明細書において記述されたタイプの検音シン
セサイザに使用され得るものである。上述の望ましくな
い雑音の影養は消去されるか、または大幅に減少される
。従って、本発明は、楽音発生器が単一のクロック源を
用いて、音階のすべての音調を発生することを可能にす
る。
めの非整数除算器に対する工夫に帰着する。これは前述
の出願中の明細書において記述されたタイプの検音シン
セサイザに使用され得るものである。上述の望ましくな
い雑音の影養は消去されるか、または大幅に減少される
。従って、本発明は、楽音発生器が単一のクロック源を
用いて、音階のすべての音調を発生することを可能にす
る。
その単一クロック源の周波数は、出願中の明細書におい
て述べた可変周波数発振器が動作することが必要とされ
た最高周波数よシ実際的に高くない。
て述べた可変周波数発振器が動作することが必要とされ
た最高周波数よシ実際的に高くない。
約言すれは、このことは、モジュロ１の加算累算器の形
で非整数除算器を与えることによって達成される。この
加算累算器は、記憶されている周波数ナンバーリストか
ら選はれた周波数ナンバーによって定まるある量だけ、
主クロツク速度で周期的に増加される。リストは鍵盤の
各音調の周波数と、鍵盤上の最高音よｐ上の、全音階の
次に最も高い音調の周波数との比に対応する２進数から
なる。従ってこの比は、値がすべて１よシ小さい。
で非整数除算器を与えることによって達成される。この
加算累算器は、記憶されている周波数ナンバーリストか
ら選はれた周波数ナンバーによって定まるある量だけ、
主クロツク速度で周期的に増加される。リストは鍵盤の
各音調の周波数と、鍵盤上の最高音よｐ上の、全音階の
次に最も高い音調の周波数との比に対応する２進数から
なる。従ってこの比は、値がすべて１よシ小さい。
加算累算器は、和が累算の容量を超えたとき、すなわち
和が１の値に達したとき、オーバフ四−パルスを発生す
る。オーバ７０−パルスは、発生されるべき楽音に対す
る振幅値の主データリストを記憶しているレジスタから
、連続したデータワードをシフトし、そのワードは、レ
ジスタからＤ−Ａ変換器の入力へ移送される。シフト速
度は、Ｄ−Ａ変換器からのアナログ信号によって発生さ
れる楽音の高さを決定する。非整数除算器からのパルス
の不規則なパターンによって導入される雑音を補償する
ため、主データリストにおける連続したデータワードの
振幅値の間の振幅の差は、それぞれのワードがレジスタ
からシフトされるとき生じる。
和が１の値に達したとき、オーバフ四−パルスを発生す
る。オーバ７０−パルスは、発生されるべき楽音に対す
る振幅値の主データリストを記憶しているレジスタから
、連続したデータワードをシフトし、そのワードは、レ
ジスタからＤ−Ａ変換器の入力へ移送される。シフト速
度は、Ｄ−Ａ変換器からのアナログ信号によって発生さ
れる楽音の高さを決定する。非整数除算器からのパルス
の不規則なパターンによって導入される雑音を補償する
ため、主データリストにおける連続したデータワードの
振幅値の間の振幅の差は、それぞれのワードがレジスタ
からシフトされるとき生じる。
差の情報は分数乗率回路に加えられ、分数量によって乗
率を掛けられ、それから第１のレジスタの出力に加算さ
れる。その乗率は、加算累算器における最高次のビット
によって制御される。例えば、比の２つの最高次ビット
を用いて、適用される乗率は、０．１／４．１／２およ
び６／４でおる。
率を掛けられ、それから第１のレジスタの出力に加算さ
れる。その乗率は、加算累算器における最高次のビット
によって制御される。例えば、比の２つの最高次ビット
を用いて、適用される乗率は、０．１／４．１／２およ
び６／４でおる。
本発明の目的は、符号によって結びつけられている、３
つの前述の出願中の明細書に詳細に述べられたタイプの
複音シンセサイザのための、音調クロック発生システム
の改良を提供することにある。以下の記述において、上
述の明細書において述べられたシステムのすべての部分
は、２桁の符号によって識別される。この符号は、上述
の明細書において同じ回路要素に対して使用されている
符号に対応している。３桁の符号によって表わされるす
べてのブロックは、本発明の改良を実現するためシンセ
サイザに付加された回路に対応している。
つの前述の出願中の明細書に詳細に述べられたタイプの
複音シンセサイザのための、音調クロック発生システム
の改良を提供することにある。以下の記述において、上
述の明細書において述べられたシステムのすべての部分
は、２桁の符号によって識別される。この符号は、上述
の明細書において同じ回路要素に対して使用されている
符号に対応している。３桁の符号によって表わされるす
べてのブロックは、本発明の改良を実現するためシンセ
サイザに付加された回路に対応している。
以下、実施例について詳細に説明する。
第１図は本発明の複音シンセサイザ用音調周波数発生器
の構成を示すブロック図、第２図は本発明の詳細な説明
するための波形図、第３図は周波数データワードを示す
図である。
の構成を示すブロック図、第２図は本発明の詳細な説明
するための波形図、第３図は周波数データワードを示す
図である。
第１図について詳細に説明すると、符号１１は、１２個
までの別個の可聴周波電圧信号を受け数多かつ混合でき
る。可聴周波音響システムを一般的にあられしている。
までの別個の可聴周波電圧信号を受け数多かつ混合でき
る。可聴周波音響システムを一般的にあられしている。
音響システムへの各入力信号は通常の楽器鍵盤上のキー
の操作に応じて、個有の楽音発生器によって発生する。
の操作に応じて、個有の楽音発生器によって発生する。
キーは、対応する数の鍵盤スイッチ１２を動作させる。
１２までのキーが同時に動作できて、１２個の異なる楽
音の同数を同時に発生する。１２個の楽音を有す仝多音
システムは、単に例として与えられたにすぎないことを
理解すべきである。
音の同数を同時に発生する。１２個の楽音を有す仝多音
システムは、単に例として与えられたにすぎないことを
理解すべきである。
鍵盤上のキーがスイッチを動作させると、キー検出およ
び割当回路１４は、鍵盤上の個々の音調に関する情報を
記憶し、そのキーをシステム中の１２個の楽音発生器の
現在使われていない１個に割当てる。音調の情報と、そ
れが楽音発生器に割当てられた。という事実は、キー検
出および割当回路１４内のメモリ（図示されず）に記憶
される。
び割当回路１４は、鍵盤上の個々の音調に関する情報を
記憶し、そのキーをシステム中の１２個の楽音発生器の
現在使われていない１個に割当てる。音調の情報と、そ
れが楽音発生器に割当てられた。という事実は、キー検
出および割当回路１４内のメモリ（図示されず）に記憶
される。
キー検出および割当回路の動作は、前述の米国出願第６
１９．６１５号（特願昭５ｌ−１１０６５２）の出願中
の明細書に記述されている。
１９．６１５号（特願昭５ｌ−１１０６５２）の出願中
の明細書に記述されている。
キーが操作されると、総括（ｅｗｅｒ、ｒｂｔｉｖｅ
） 制御回路１６のシーケンス論理の制御のもとに、主
データリストが計算され、主シフトレジスタ３４に記憶
される。主データリストは米国出願第６０３．７７６号
の出願中の明細書で詳細に述べたごときやシ方で演算さ
れる。そこで述べたごとく、１つの楽音に対する主デー
タリストは６４ワードからなシ、各ワードは、発生され
るべき可聴周波楽音の単一のサイクルにおける１点の振
幅をあられす。割当回路１４によってどの楽音発生器が
選択されたかによって、音調選択ゲート４０が総舌Ｕ制
御回路１６の制御に応じて、主データリストを主シフト
レジスタ３４から１２個の音調シフトレジスタの１つへ
移送する。音調シフトレジスタの２個が３５と３６で示
されている。
） 制御回路１６のシーケンス論理の制御のもとに、主
データリストが計算され、主シフトレジスタ３４に記憶
される。主データリストは米国出願第６０３．７７６号
の出願中の明細書で詳細に述べたごときやシ方で演算さ
れる。そこで述べたごとく、１つの楽音に対する主デー
タリストは６４ワードからなシ、各ワードは、発生され
るべき可聴周波楽音の単一のサイクルにおける１点の振
幅をあられす。割当回路１４によってどの楽音発生器が
選択されたかによって、音調選択ゲート４０が総舌Ｕ制
御回路１６の制御に応じて、主データリストを主シフト
レジスタ３４から１２個の音調シフトレジスタの１つへ
移送する。音調シフトレジスタの２個が３５と３６で示
されている。
楽音発生器の音調シフトレジスタが、ディジタル化され
た波形振幅データで一旦負荷されると、このデータは音
調シフトレジスタから、４７と４８で示された関連する
Ｄ−Ａ変換器へ、鍵盤上の個々のキーに応じて発生され
る楽音の高さすなわち基本周波数によって定まるシフト
速度でシフトされる。
た波形振幅データで一旦負荷されると、このデータは音
調シフトレジスタから、４７と４８で示された関連する
Ｄ−Ａ変換器へ、鍵盤上の個々のキーに応じて発生され
る楽音の高さすなわち基本周波数によって定まるシフト
速度でシフトされる。
音調クロック情報の発生に対する１つの工夫は、前述の
米国出願第６３４．５３３号（特＃Ｉ昭５ｌ−１４０６
１６）の出願中の明細書に記述されている。そこに述べ
られているごとく、１２個の楽音発生器のそれぞれは、
個有の電圧制御発振器を有する。キー検出と割当回路１
４に応じて、周波数ナンバーが、選択された音調に対応
する周波数ナンバーの記憶されているリストから選択さ
れる。この数は対応するアナログ電圧に変換され、この
アナログ電圧は電圧制御発振器に加えられて、選択され
た楽音の周波数の整数倍たとえば６４倍に対応して周波
数をセットする。音調クロックからひき出されたシフト
パルスは、音調シフトレジスタ３５から対応する速度で
データをシフトする。音調シフトレジスタは、１つの完
全なサイクルに対するデータを含んでいるので、制御さ
れた速度で音調シフトレジスタから情報を繰シ返しシフ
トして、Ｄ−Ａ変換器から出力電圧を発生する。出力電
圧の振幅は、主データリストに応じて、および音調シフ
トレジスタのレジスタからデータがシフトされる速度で
定まるある速度で変化する。
米国出願第６３４．５３３号（特＃Ｉ昭５ｌ−１４０６
１６）の出願中の明細書に記述されている。そこに述べ
られているごとく、１２個の楽音発生器のそれぞれは、
個有の電圧制御発振器を有する。キー検出と割当回路１
４に応じて、周波数ナンバーが、選択された音調に対応
する周波数ナンバーの記憶されているリストから選択さ
れる。この数は対応するアナログ電圧に変換され、この
アナログ電圧は電圧制御発振器に加えられて、選択され
た楽音の周波数の整数倍たとえば６４倍に対応して周波
数をセットする。音調クロックからひき出されたシフト
パルスは、音調シフトレジスタ３５から対応する速度で
データをシフトする。音調シフトレジスタは、１つの完
全なサイクルに対するデータを含んでいるので、制御さ
れた速度で音調シフトレジスタから情報を繰シ返しシフ
トして、Ｄ−Ａ変換器から出力電圧を発生する。出力電
圧の振幅は、主データリストに応じて、および音調シフ
トレジスタのレジスタからデータがシフトされる速度で
定まるある速度で変化する。
このシステムは、上に検討したように、欠点かめる。す
なわち、１２個１での別々の発振器を必要とし、その各
々が、鍵盤の最高音と最低音との音の高さの違いから必
要となる全範囲にわたって同調されねはならないことで
おる。どの楽音発生器も個々のキーに割当てられるので
、発振器は、１２個の楽音発生器がすべて同じキーに割
当てられたとき同じ音の高さを発生するように同調され
ねばならない。本発明社、すべての楽音発生器が、シス
テム主クロツク回路１５のような単一のクロック源から
駆動される、１つの工夫を提供するものである。
なわち、１２個１での別々の発振器を必要とし、その各
々が、鍵盤の最高音と最低音との音の高さの違いから必
要となる全範囲にわたって同調されねはならないことで
おる。どの楽音発生器も個々のキーに割当てられるので
、発振器は、１２個の楽音発生器がすべて同じキーに割
当てられたとき同じ音の高さを発生するように同調され
ねばならない。本発明社、すべての楽音発生器が、シス
テム主クロツク回路１５のような単一のクロック源から
駆動される、１つの工夫を提供するものである。
上述の出願中の明細書において述べた工夫におけるごど
く、音調情報がキー検出と割当回路１４内のメモリに記
憶された後、この音調情報はアドレス読出メモリ１８内
の周波数ナンバーをアドレスするためのアドレスとして
使用される。アドレス周波数ナンバーは、その２個が２
０と２１で示されている。１２個の周波数ナンバーレジ
スタの１つへ、総括制御回路１６の制御に応じてデータ
選択ゲート１９によって移送される。レジスタ２０と２
１ は、＠！磐上で操作されたスイッチ（個々の音調）
のおのおのに対する、それぞれの周波数ナンバーの一時
的記憶装置となる。キーが解放されて新しいキーが操作
されると、総括制御回路１６は、新しい周波数ナンバー
をレジスタ２０または２１に位置せしめる。
く、音調情報がキー検出と割当回路１４内のメモリに記
憶された後、この音調情報はアドレス読出メモリ１８内
の周波数ナンバーをアドレスするためのアドレスとして
使用される。アドレス周波数ナンバーは、その２個が２
０と２１で示されている。１２個の周波数ナンバーレジ
スタの１つへ、総括制御回路１６の制御に応じてデータ
選択ゲート１９によって移送される。レジスタ２０と２
１ は、＠！磐上で操作されたスイッチ（個々の音調）
のおのおのに対する、それぞれの周波数ナンバーの一時
的記憶装置となる。キーが解放されて新しいキーが操作
されると、総括制御回路１６は、新しい周波数ナンバー
をレジスタ２０または２１に位置せしめる。
アドレス読出メモリ１８内の周波数の表は、２−（Ｎ／
１２Ｊの値をもつ２進の形のデータワードからなってい
る。ここでＮは１，２．・・・・・２Ｍに等しく、Ｍは
楽音鍵盤上のキーの数である。従って周波数ナンバーは
、平均律音階における音調の基本周波数の比をあられし
ている。メモリ１８に含まれる周波数のデータワードは
、第１表に示される。（箆１表１３明ｋＪ名ｔＬＩＡ付
、〕第１表の最初の欄は、通常の鍵盤の音調のいくつか
を掲げたものであシ、第６オクターブの音調の全部と第
２オクターブの音調の全部を含んでいる。同表の第２の
欄は、楽音の対応する基本周波数を掲げておシ、第３の
欄は、第７オクターブのＣ＃の周波数に対する、各音調
の周波数の比を掲げている。この音調は鍵盤上の最高音
よシ高い１つの音であシ、それが１の値を持つように選
ばれている。第４の欄は比を１６ビツトの２進数として
掲げている。いくつかのオクターブに対する２進数が掃
けであるが、１オクターブに対応する周波数す／バーだ
けが実際にメモリ１８に記憶されれはよく、他のオクタ
ーブに対する数は、各オクターブの変化ごとに２進の位
を１桁ずらすことによって導かれる。
１２Ｊの値をもつ２進の形のデータワードからなってい
る。ここでＮは１，２．・・・・・２Ｍに等しく、Ｍは
楽音鍵盤上のキーの数である。従って周波数ナンバーは
、平均律音階における音調の基本周波数の比をあられし
ている。メモリ１８に含まれる周波数のデータワードは
、第１表に示される。（箆１表１３明ｋＪ名ｔＬＩＡ付
、〕第１表の最初の欄は、通常の鍵盤の音調のいくつか
を掲げたものであシ、第６オクターブの音調の全部と第
２オクターブの音調の全部を含んでいる。同表の第２の
欄は、楽音の対応する基本周波数を掲げておシ、第３の
欄は、第７オクターブのＣ＃の周波数に対する、各音調
の周波数の比を掲げている。この音調は鍵盤上の最高音
よシ高い１つの音であシ、それが１の値を持つように選
ばれている。第４の欄は比を１６ビツトの２進数として
掲げている。いくつかのオクターブに対する２進数が掃
けであるが、１オクターブに対応する周波数す／バーだ
けが実際にメモリ１８に記憶されれはよく、他のオクタ
ーブに対する数は、各オクターブの変化ごとに２進の位
を１桁ずらすことによって導かれる。
周波数ナンバーは、レジスタ２０または２１の１つへ移
送されて、音調シフトレジスタの対応する１個に加えら
れたシフトパルスの周波数を、主クロツク回路１５から
のパルスを用いて制御するのに使用される。このために
、周波数ナンバーレジスタ２０に記憶された数は加算累
算器１１０の入力に加えられる。累算器はモジュロ１の
もので、ビット容量として例えば１６ ビットのもので
ある。
送されて、音調シフトレジスタの対応する１個に加えら
れたシフトパルスの周波数を、主クロツク回路１５から
のパルスを用いて制御するのに使用される。このために
、周波数ナンバーレジスタ２０に記憶された数は加算累
算器１１０の入力に加えられる。累算器はモジュロ１の
もので、ビット容量として例えば１６ ビットのもので
ある。
総括制御回路１６によって制御されたとき、加算累算器
１１０は、主クロツク回路１５からの各クロックパルス
ごとに、レジスタ２０からの周波数ナンバーを累算器の
内容に加算する。常に１よシ小さい数である周波数ナン
バーは、累算器が１に等しいか又は１よシ大きい統計に
達するか又は超過する前に、１またはそれ以上の回数、
累算器を増加させる。モジュロフなので、累算器の内容
に対する周波数ナンバーの加算が、その内容を１に達す
るか又は超過させたときは、累算器はオーバフローパル
スを発生する。加算累算器１１０は、新しいキーが楽音
発生器に割当てられるまで周波数ナンバーで増加され続
け、総括制御回路１６は、新しい周波数ナンバーをレジ
スタ２０に移送してその時累算器はクリアされ、この手
順が新しい周波数ナンバーごとに繰シ返される。
１１０は、主クロツク回路１５からの各クロックパルス
ごとに、レジスタ２０からの周波数ナンバーを累算器の
内容に加算する。常に１よシ小さい数である周波数ナン
バーは、累算器が１に等しいか又は１よシ大きい統計に
達するか又は超過する前に、１またはそれ以上の回数、
累算器を増加させる。モジュロフなので、累算器の内容
に対する周波数ナンバーの加算が、その内容を１に達す
るか又は超過させたときは、累算器はオーバフローパル
スを発生する。加算累算器１１０は、新しいキーが楽音
発生器に割当てられるまで周波数ナンバーで増加され続
け、総括制御回路１６は、新しい周波数ナンバーをレジ
スタ２０に移送してその時累算器はクリアされ、この手
順が新しい周波数ナンバーごとに繰シ返される。
加Ｘｉ算器１１０は主クロツクパルスに対する非整数除
算器として動作する。何故ならばそれは、累算器に１を
超えさせる主クロツクパルスごとに、出力パルスを発生
するからである。たとえば、主クロックの０．６倍のク
ロック周波数が必要でおるとする。各主クロツク時ごと
に、値０．３が加算累算器の内容に加算される。各主ク
ロツク時、加算累算器１１０の内容は第２表に掲ける値
を持つ。
算器として動作する。何故ならばそれは、累算器に１を
超えさせる主クロツクパルスごとに、出力パルスを発生
するからである。たとえば、主クロックの０．６倍のク
ロック周波数が必要でおるとする。各主クロツク時ごと
に、値０．３が加算累算器の内容に加算される。各主ク
ロツク時、加算累算器１１０の内容は第２表に掲ける値
を持つ。
第２表
クロックパルス 累 算 器
０
３
２．６
３．９
４ ．２ ± ｉ−７＜’７ ロ −
５．５
６．８
７ ．１＋オーバフロー
８．４
９．７
１０ ．０＋オーツ（フロー
１１ ．３
１２ ．６
１３ ．９
１４ ．２＋オーバフロー
以下同様
Ｊ＋％３！器はモジュロ１なので、オーツ（７０−ノく
ルスはクロックパルス４，７，１０．１４等で生じる。
ルスはクロックパルス４，７，１０．１４等で生じる。
従って出力パルスの数は、１０人カッ（ルスごとに６個
である。しかしながら、出力〕くルスの間隔は均等では
ない。上側では、クロックツ（ルス４，７オヨヒ１０に
対応する出力パルスの間の時間間隔は等しく６クロツク
パルス間隔であるが、出力）くルス９と１３の間の時間
は、４クロツクツ（ルス間隔に対応する。
である。しかしながら、出力〕くルスの間隔は均等では
ない。上側では、クロックツ（ルス４，７オヨヒ１０に
対応する出力パルスの間の時間間隔は等しく６クロツク
パルス間隔であるが、出力）くルス９と１３の間の時間
は、４クロツクツ（ルス間隔に対応する。
加算累算器１１０からの出力）（ルスは、主シフトレジ
スタ３４ 内の主リストを関連する音調シフトレジスタ
３５へ移送するのに用いられる。このために、加算累算
器１１０からの出力）くルスは、総括制御回路１６の制
御のもとに、クロック選択ゲート６７を経て主シフトレ
ジスタ６４のシフト入力に加えられる。７Ｉｌ］算累算
器１１０の出カッ（ルスはまた、音調シフトレジスタ３
５のシフト入力へも加えられる。従って、２つのレジス
タは移送中同期している。音調シフトレジスタ３５が１
度負荷されると、加算累算器１１０からの出力）くルス
によって、データリストは、音調シフトレジスタ３５か
らＤ−Ａ変換器４７ヘシフトされ続ける。このようにし
て、音調シフトレジスタ６５の乎均シフト速度は、第１
表から選ばれた周波数ナンバーの値の関数となる。
スタ３４ 内の主リストを関連する音調シフトレジスタ
３５へ移送するのに用いられる。このために、加算累算
器１１０からの出力）くルスは、総括制御回路１６の制
御のもとに、クロック選択ゲート６７を経て主シフトレ
ジスタ６４のシフト入力に加えられる。７Ｉｌ］算累算
器１１０の出カッ（ルスはまた、音調シフトレジスタ３
５のシフト入力へも加えられる。従って、２つのレジス
タは移送中同期している。音調シフトレジスタ３５が１
度負荷されると、加算累算器１１０からの出力）くルス
によって、データリストは、音調シフトレジスタ３５か
らＤ−Ａ変換器４７ヘシフトされ続ける。このようにし
て、音調シフトレジスタ６５の乎均シフト速度は、第１
表から選ばれた周波数ナンバーの値の関数となる。
同様に、周波数レジスタ２１内の周波数ナンノく−は、
加算累算器１１２に加えられる。加算累算器１１２から
の出力パルスは、音調シフトレジスタ３６−へ加えられ
る。
加算累算器１１２に加えられる。加算累算器１１２から
の出力パルスは、音調シフトレジスタ３６−へ加えられ
る。
このシステムは上述のように、加算累算器による非整数
除算のために、音響システムへの入力のアナログ信号に
歪んだ、あるいは雑音を含んだ波形を生じる。この雑音
は、レベルが高く、かつ基本周波数から離れているので
、特に低音に対して、聞く者にとって耳ざわシでｓｂか
つ不快なも、のである。非整数除算器によって導入され
るこの雑音 “のレベルは、Ｄ−Ａ変換器の入力に加え
られるディジタル情報を修正する補間システムによって
最小にされる。
除算のために、音響システムへの入力のアナログ信号に
歪んだ、あるいは雑音を含んだ波形を生じる。この雑音
は、レベルが高く、かつ基本周波数から離れているので
、特に低音に対して、聞く者にとって耳ざわシでｓｂか
つ不快なも、のである。非整数除算器によって導入され
るこの雑音 “のレベルは、Ｄ−Ａ変換器の入力に加え
られるディジタル情報を修正する補間システムによって
最小にされる。
各楽音発生器と結合された補間システムは、音調シフト
レジスタ６５の出力端における、音調シフトレジスタ６
５の最初の２つのワード位置から導かれた入力を有する
。１１４と１１５で示されたようなディジタル減算回路
を含んでいる。従って、データ点Ｚｎがシフトレジスタ
の出力端にシフトされて、減算回路１１４の１人力に加
えられると、シフトレジスタ中の次の隣接のワード位置
のデータ値Ｚ、、が減算回路１１４の他の入力に加えら
れる。
レジスタ６５の出力端における、音調シフトレジスタ６
５の最初の２つのワード位置から導かれた入力を有する
。１１４と１１５で示されたようなディジタル減算回路
を含んでいる。従って、データ点Ｚｎがシフトレジスタ
の出力端にシフトされて、減算回路１１４の１人力に加
えられると、シフトレジスタ中の次の隣接のワード位置
のデータ値Ｚ、、が減算回路１１４の他の入力に加えら
れる。
減算回路は、Ｚ、、−Ｚユ＝ΔＺｎ、すなわち発生中の
波形の２つの連続したデータ点の振幅における増分差に
対応するディジタル出力を生じる。
波形の２つの連続したデータ点の振幅における増分差に
対応するディジタル出力を生じる。
減算回路１１４の出力からの増分差は、分数乗率回路１
１６に加えられる。分数乗率回路１１６は、減舞−回路
１１４の出力に０，１／４，１／２または３／４を乗す
る。乗率は、加算累算器１１０における、２つの最高次
のビットによって定まる。もしも加算４累算器の趣高次
のティジットの１０進換算値（ｅｑｕｉτα１ｅｎｔ）
が０．２５よシ小さけれは乗率０が適用され、１０進換
算値が０．２５以上０．５未満であれば乗率１／４が適
用される。もしも加算累算器の１０進換算値が０．５以
上０．７５未満であれば、乗率１／２が適用される。
１６に加えられる。分数乗率回路１１６は、減舞−回路
１１４の出力に０，１／４，１／２または３／４を乗す
る。乗率は、加算累算器１１０における、２つの最高次
のビットによって定まる。もしも加算４累算器の趣高次
のティジットの１０進換算値（ｅｑｕｉτα１ｅｎｔ）
が０．２５よシ小さけれは乗率０が適用され、１０進換
算値が０．２５以上０．５未満であれば乗率１／４が適
用される。もしも加算累算器の１０進換算値が０．５以
上０．７５未満であれば、乗率１／２が適用される。
もしも加算累算器が０．７５またはそれより大きければ
乗率６／４が適用される。
乗率６／４が適用される。
減算回路１１４の出力における増分産の乗率分数（ｓａ
ａｌｔｔ ｆｒａｃｔｉｏｎ） は、加算回路１１８に
おいて、音調シフトレジスタ３５の出力に加算され、Ｄ
−Ａ変換器４７の入力に加えられる。合成波形が第２回
に示されているが、この波形は第２表に示されたデータ
に基づくプロットである。
ａｌｔｔ ｆｒａｃｔｉｏｎ） は、加算回路１１８に
おいて、音調シフトレジスタ３５の出力に加算され、Ｄ
−Ａ変換器４７の入力に加えられる。合成波形が第２回
に示されているが、この波形は第２表に示されたデータ
に基づくプロットである。
第２図において破線は、音調シフトレジスタ３５の出力
がＤ−Ａ変換器の入力に直接結合されたとした場合の、
Ｄ−Ａ変換器の出力波形のプロットを示している。実線
は、減算回路１１４、分数乗率回路１１６および加（至
）−回路１１８によって与えられる補間を付加した、Ｄ
−Ａ変換器の出力の波形を示している。第２図は、各ク
ロックパルスごとの階段状変化を示しているが同時に、
シフトパルスの間で４個以上の主クロツクパルスが現れ
ているところで、Ｓ：率が各クロックパルスごとには変
化しないことがわかる。主データ群に含まれるデータの
間に、最もｖ！！接して１／４の間隔に直線的補間をす
ることによって、加算累算器によって発生した不均等配
置のパルスによって生じる位相誤差雑音は、十分に減少
する。本システムは、最も密接して１／４間隔に補間を
行うと述べたが、もつと小さい分数の補間も、分数乗率
回路１１６によって遂行され得る。
がＤ−Ａ変換器の入力に直接結合されたとした場合の、
Ｄ−Ａ変換器の出力波形のプロットを示している。実線
は、減算回路１１４、分数乗率回路１１６および加（至
）−回路１１８によって与えられる補間を付加した、Ｄ
−Ａ変換器の出力の波形を示している。第２図は、各ク
ロックパルスごとの階段状変化を示しているが同時に、
シフトパルスの間で４個以上の主クロツクパルスが現れ
ているところで、Ｓ：率が各クロックパルスごとには変
化しないことがわかる。主データ群に含まれるデータの
間に、最もｖ！！接して１／４の間隔に直線的補間をす
ることによって、加算累算器によって発生した不均等配
置のパルスによって生じる位相誤差雑音は、十分に減少
する。本システムは、最も密接して１／４間隔に補間を
行うと述べたが、もつと小さい分数の補間も、分数乗率
回路１１６によって遂行され得る。
たとえば、最上位桁の６ビ°ツトを使用すると、補間に
おける加算累算器１１０および１１２の内容は、主デー
タ群に含まれるデータの間の、最も密接して１／８の間
隔になシ得る。しかしながら、補間間隔の数を増しても
、必然的に本システムの性能が改善される訳ではない。
おける加算累算器１１０および１１２の内容は、主デー
タ群に含まれるデータの間の、最も密接して１／８の間
隔になシ得る。しかしながら、補間間隔の数を増しても
、必然的に本システムの性能が改善される訳ではない。
事実、補間間隔の数を増加すると、位相誤差雑音が増え
る。なぜならば、直線的補間の各補間点は、波形上の正
しい点に対応しないからである。事実、波形データは、
実際問題として第３２高調波までに限定される。補間点
における誤差は、波形が４（又は８）倍の点の数を持っ
ておシ、従って高調波のよシ高い次数に対応するという
ことを意味している。補間された点は、時系列のそれぞ
れの連続した期間に対して異なっている。周波数ナンバ
ーは無理数なので、余分の高調波は雑音を増加させる。
る。なぜならば、直線的補間の各補間点は、波形上の正
しい点に対応しないからである。事実、波形データは、
実際問題として第３２高調波までに限定される。補間点
における誤差は、波形が４（又は８）倍の点の数を持っ
ておシ、従って高調波のよシ高い次数に対応するという
ことを意味している。補間された点は、時系列のそれぞ
れの連続した期間に対して異なっている。周波数ナンバ
ーは無理数なので、余分の高調波は雑音を増加させる。
１／４間隔の補間は、申し分のない妥協を与える。
ある楽音発生器においては、データ点の間の振幅変化が
得られることに注意すべきである。このような揚台にお
いては、波形に対するΔＺの値は、別個のシフトレジス
タに記憶される。このシフトレジスタは、加算累算器１
１０からのオーバフローパルスによって、音調シフトレ
ジスタ６５と同期してシフトされる。増分データは、こ
のようなレジスタから直接分数乗率回路１１６ヘシフト
されるので、減算回路１１４は必要でなくなる。
得られることに注意すべきである。このような揚台にお
いては、波形に対するΔＺの値は、別個のシフトレジス
タに記憶される。このシフトレジスタは、加算累算器１
１０からのオーバフローパルスによって、音調シフトレ
ジスタ６５と同期してシフトされる。増分データは、こ
のようなレジスタから直接分数乗率回路１１６ヘシフト
されるので、減算回路１１４は必要でなくなる。
本発明の実施の態様を列挙すれは次のごとくである。
１、加算回路の出力に接続された、加算回路からの変化
する出力をアナログ電圧に変換するためのＤ−Ａ変換器
をさらに含むことを特徴とする特許請求の範囲第１項記
載の装置。
する出力をアナログ電圧に変換するためのＤ−Ａ変換器
をさらに含むことを特徴とする特許請求の範囲第１項記
載の装置。
２、第１のレジスタからシフトされたそれぞれの値ごと
に前記第１のセット中の連続した値の間の差に等しいデ
ィジタル的に符号化された値を発生するための手段、該
手段からの出力に迭ばれた分数量を乗率するための、前
記加算累算器に累算された値に応じて分数量を制御する
ための手段を含む分数乗率回路手段とを含み、前記手段
は第１のレジスタの出力をＤ−Ａ変換器に結合し、乗率
回路手段からのディジタル的に符号化された出力を第１
のレジスタからの出力に加算する手段を含み、和の値は
Ｄ−Ａ変換器に加えられることを特徴とする特許請求の
範囲第２項記載の装置。
に前記第１のセット中の連続した値の間の差に等しいデ
ィジタル的に符号化された値を発生するための手段、該
手段からの出力に迭ばれた分数量を乗率するための、前
記加算累算器に累算された値に応じて分数量を制御する
ための手段を含む分数乗率回路手段とを含み、前記手段
は第１のレジスタの出力をＤ−Ａ変換器に結合し、乗率
回路手段からのディジタル的に符号化された出力を第１
のレジスタからの出力に加算する手段を含み、和の値は
Ｄ−Ａ変換器に加えられることを特徴とする特許請求の
範囲第２項記載の装置。
５、乗率回路手段の前記分数量がｎ／４であシ、加算累
算器によって設定されるのに従ってｎ＝０゜１．２．ま
たは３であることを特徴とする前記第２項記載の装置。
算器によって設定されるのに従ってｎ＝０゜１．２．ま
たは３であることを特徴とする前記第２項記載の装置。
第１図は本発明の複音シンセサイザ用音調周波数発生器
の構成を示すブロック図、第２図は本発明の詳細な説明
するための波形図である。 １１・・・可聴周波音譬システム、１２・・・鍵盤スイ
ッチ、１４・・・キー検出および割当回路、１５・・・
システム主クロツク回路、１６・・・総括制御回路、１
８・・・アドレス読出しメモリ、１９・・・データ選択
ケート、２０．２１・・・周波数ナンバーレジスタ、３
４・・・主シフトレジスタ、５５．５６・・・音調シフ
トレジスタ、３７・・・クロック選択ゲート、４０・・
・音調選択ゲート、４７．４８・・・Ｄ−Ａ・・・変換
器、１１０，１１２・・・加算累算器、１１４．１１５
・・・減算回路、１１６，１１７・・・分数乗率回路、
１１８．１１９・・・加算回路、１６０・・・楽音デー
タ計算機。 出願人株式会社河合楽器製作所 代理人弁理士田坂善重 第 １ Ｃ７２０９３，００，９４３８７４３１２７Ｂ６ １９
７５．０ ０．８９０８９８７１８２ＡＩ６ １６４４
．７ ０．８４０８９６４１５３Ａ６ １７６０゜ＯＯ
，７９３７００５２６０ＧＩ６ １６６１．２ ０．７
４９１５３５３８５Ｇ６ １５６Ｂ、０ ０．７０７１
０６７８１３Ｆ＄６ １４８０．０ ０．６６７３１９
９２７２Ｆ６ １３９６．９ ０．６２９９６０５２５
１Ｅ６ １３１８．５ ０．５９４６０３５５７７ＤＩ
６ １２４４．５ ０．５６１２３１０２４４Ｄ６ １
１７４．７ ０．５２９７３１５４７４Ｃ＠６ １１０
８．７ ０．５０００００００００Ｃ６１０４６，５０
，４７１９３７１５８４Ｃ３１３０，８０，０５８９９
２１４１５Ｂ２ １２３．５ ０．０５５６８１１６９
８Ａ１２ １１６．５ ０．０５２５５６０２５９Ａ２
１１０．０ ０．０４９６０６２８２８Ｇ１２ １０
３．８ ０．０４６８２２０９６１Ｇ２ ９８．０ ０
．０４４１９４１７３８ＦＮ２ ９２．５ ０．０４１
７１３７４５４Ｆ２ ８７．３ ０．０３９３７２５３
２８Ｅ２． ８２．４ ０．０３７１６２７２２３ＤＩ
２ ７７．８ ０．０３５０７６９３９０Ｄ２ ７３．
４ ０．０３３１０８２２１７Ｃｊｔ２ ６９．３ ０
．０３１２５０００００Ｃ２６３，４０，０２９４９６
０７２３Ｒ−ＢＩＮＡＲＹ（比−２進） １１１１０００１ １０１０００１０ １１１００１００ ０００１００１０ １１０１０１１１ ０１０００１０１ １１００１０１１ ００１１００００ １０１１１１１１ １１００１００１ １０１１０１０ ｌ ０００００１０１１０１０１０１
０ １１０１１１００ １０１００００１ ０１０００１０１ １００１１０００ ００１１１０００ １０００１１１１ １０１０１１０１ １００００１１１ １００１１１００ １０００００００ ０００００’０ＯＯ０１１１１００
０１１０１０００１ ００００１１１１００，０１１０１１ ００００１１１００１００００，０１ ００００１１０１０１１１０１００ ００００１１００１０１１００１０ ００００１０１１１１１１１１０１ ００００１０１１０１０１００００ ００００１０１０１０１０１１１０ ００００１０１００００１０１００ ００００１００１１０００００１１ ００００１０００１１１１１０１１ ００００１００００１１１１０１０ ００００１０００００００００００ ０００００１１１１０００１１０１
の構成を示すブロック図、第２図は本発明の詳細な説明
するための波形図である。 １１・・・可聴周波音譬システム、１２・・・鍵盤スイ
ッチ、１４・・・キー検出および割当回路、１５・・・
システム主クロツク回路、１６・・・総括制御回路、１
８・・・アドレス読出しメモリ、１９・・・データ選択
ケート、２０．２１・・・周波数ナンバーレジスタ、３
４・・・主シフトレジスタ、５５．５６・・・音調シフ
トレジスタ、３７・・・クロック選択ゲート、４０・・
・音調選択ゲート、４７．４８・・・Ｄ−Ａ・・・変換
器、１１０，１１２・・・加算累算器、１１４．１１５
・・・減算回路、１１６，１１７・・・分数乗率回路、
１１８．１１９・・・加算回路、１６０・・・楽音デー
タ計算機。 出願人株式会社河合楽器製作所 代理人弁理士田坂善重 第 １ Ｃ７２０９３，００，９４３８７４３１２７Ｂ６ １９
７５．０ ０．８９０８９８７１８２ＡＩ６ １６４４
．７ ０．８４０８９６４１５３Ａ６ １７６０゜ＯＯ
，７９３７００５２６０ＧＩ６ １６６１．２ ０．７
４９１５３５３８５Ｇ６ １５６Ｂ、０ ０．７０７１
０６７８１３Ｆ＄６ １４８０．０ ０．６６７３１９
９２７２Ｆ６ １３９６．９ ０．６２９９６０５２５
１Ｅ６ １３１８．５ ０．５９４６０３５５７７ＤＩ
６ １２４４．５ ０．５６１２３１０２４４Ｄ６ １
１７４．７ ０．５２９７３１５４７４Ｃ＠６ １１０
８．７ ０．５０００００００００Ｃ６１０４６，５０
，４７１９３７１５８４Ｃ３１３０，８０，０５８９９
２１４１５Ｂ２ １２３．５ ０．０５５６８１１６９
８Ａ１２ １１６．５ ０．０５２５５６０２５９Ａ２
１１０．０ ０．０４９６０６２８２８Ｇ１２ １０
３．８ ０．０４６８２２０９６１Ｇ２ ９８．０ ０
．０４４１９４１７３８ＦＮ２ ９２．５ ０．０４１
７１３７４５４Ｆ２ ８７．３ ０．０３９３７２５３
２８Ｅ２． ８２．４ ０．０３７１６２７２２３ＤＩ
２ ７７．８ ０．０３５０７６９３９０Ｄ２ ７３．
４ ０．０３３１０８２２１７Ｃｊｔ２ ６９．３ ０
．０３１２５０００００Ｃ２６３，４０，０２９４９６
０７２３Ｒ−ＢＩＮＡＲＹ（比−２進） １１１１０００１ １０１０００１０ １１１００１００ ０００１００１０ １１０１０１１１ ０１０００１０１ １１００１０１１ ００１１００００ １０１１１１１１ １１００１００１ １０１１０１０ ｌ ０００００１０１１０１０１０１
０ １１０１１１００ １０１００００１ ０１０００１０１ １００１１０００ ００１１１０００ １０００１１１１ １０１０１１０１ １００００１１１ １００１１１００ １０００００００ ０００００’０ＯＯ０１１１１００
０１１０１０００１ ００００１１１１００，０１１０１１ ００００１１１００１００００，０１ ００００１１０１０１１１０１００ ００００１１００１０１１００１０ ００００１０１１１１１１１１０１ ００００１０１１０１０１００００ ００００１０１０１０１０１１１０ ００００１０１００００１０１００ ００００１００１１０００００１１ ００００１０００１１１１１０１１ ００００１００００１１１１０１０ ００００１０００００００００００ ０００００１１１１０００１１０１
Claims (1)
- 【特許請求の範囲】 （１１可聴周波波形の周波数に対応した周波数ナンバー
を発生する周波数ナンバー発生手段と、該周波数ナンバ
ー発生手段の周波数ナンバーに対応して読み出される異
なる２つの可聴周波波形の各振幅値をそれぞれ記憶する
２つの記憶手段と、 該２つの記憶手段の各出力と前記周波数ナンバー発生手
段の周波数ナンバーとで演算することによって、前記具
なる２つの可聴周波波形の振幅値間が補間された可聴周
波波形を出力する演算手段と、 を備えたことを特徴とする音楽的音調発生装置。 （２）可聴周波波形を定める各点の振幅に対応する値を
記憶する振幅記憶手段と、 多数の音楽的音調の基本周波数に対応する値を記憶する
周波数情報記憶手段と、 加算累算器手段と、 選択された基本周波数に対応する値を前記周波数情報記
憶手段から前記加算累算器手段へ周期的に移送して該加
算累算器手段の内容を前記選択された値に従って、予め
定められた速度で増分するための増分手段と、 ２つの入力を有し、第１人力は前記振幅記憶手段に接続
された加算回路と、 ２つの入力と１つの出力とを有し、該出力は前記加算回
路の第２人力に接続されると共に、第２人力の値によっ
て定められた第１人力の値の分数量となる分数乗率回路
と、 前記加算累算器手段の内容を前記分数乗率回路の第２人
力に結合して前記加算累算器手段における値に応じて乗
率を制御する制御手段と、前記可聴周波波形の各点の間
の振幅の増分変化に対応する値を発生する点間振幅変化
発生手段と、 該点間振幅変化発生手段からの値を前記分数乗率回路の
第１人力に与える手段と、 前記加算累算器手段からの出力信号に応じて前記振幅記
憶手段から前記加算回路の第１人力へ個々の値をそれぞ
れ順次読み出す読出手段と、とを備えたことを特徴とす
る音楽的音調発生装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US05/758,010 US4114496A (en) | 1977-01-10 | 1977-01-10 | Note frequency generator for a polyphonic tone synthesizer |
| US758010 | 1985-07-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60258594A true JPS60258594A (ja) | 1985-12-20 |
Family
ID=25050098
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53001041A Expired JPS6055840B2 (ja) | 1977-01-10 | 1978-01-09 | 複音シンセサイザ用楽音発生器 |
| JP59281290A Pending JPS60258594A (ja) | 1977-01-10 | 1984-12-28 | 音楽的音調発生装置 |
Family Applications Before (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53001041A Expired JPS6055840B2 (ja) | 1977-01-10 | 1978-01-09 | 複音シンセサイザ用楽音発生器 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4114496A (ja) |
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