JPS60257641A - キヤリア検出装置 - Google Patents
キヤリア検出装置Info
- Publication number
- JPS60257641A JPS60257641A JP59112969A JP11296984A JPS60257641A JP S60257641 A JPS60257641 A JP S60257641A JP 59112969 A JP59112969 A JP 59112969A JP 11296984 A JP11296984 A JP 11296984A JP S60257641 A JPS60257641 A JP S60257641A
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- Japan
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L27/00—Modulated-carrier systems
- H04L27/18—Phase-modulated carrier systems, i.e. using phase-shift keying
- H04L27/22—Demodulator circuits; Receiver circuits
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はデータの先頭に特定のフラグを所定時間（個数
）送信する伝送方式のデータ通信のキャリア検出装置に
関する。
）送信する伝送方式のデータ通信のキャリア検出装置に
関する。
従来の例えば０ｍ７アクシミリ通信のデータ伝送のうち
、制御手順に関してはＣＣＩＴＴの規格Ｔ３０で、デー
タの送信に先き立ちプリアンプルと称してＨＤＬＣフラ
グの”０１１１１１１０”を１秒±１５チ送信すること
を規定している。一方で上記制御手順の変復調について
は、ＣＣＩＴＴの規格Ｖ２１に準拠するよう規定されて
おりＣＣＩＴＴの規格Ｖ２１においては、一般交換網の
キャリア検出信号（回路１０９と称す）について以下の
規定がある。１つは、入力レベルが一４３ｔｔＥｍ以上
なら回路１０９はＯＮする。２つは、入力レベルが一４
８ｄＥｍ以下ならＯＦＦする。３つは、回路１０９のＯ
Ｎ、ＯＦＦのレベルしきい値開のヒステリシスは２ｄＥ
以上ある。４つは、回路１０９のＯＮ、ＯＦＦの遅延時
間はＯＦＦからＯＮが３００ ｍｓ −７００ｍｓで、
ＯＮからＯＦＦが２０ｍ」〜Ｆ３Ｑｍｓとすることであ
る。
、制御手順に関してはＣＣＩＴＴの規格Ｔ３０で、デー
タの送信に先き立ちプリアンプルと称してＨＤＬＣフラ
グの”０１１１１１１０”を１秒±１５チ送信すること
を規定している。一方で上記制御手順の変復調について
は、ＣＣＩＴＴの規格Ｖ２１に準拠するよう規定されて
おりＣＣＩＴＴの規格Ｖ２１においては、一般交換網の
キャリア検出信号（回路１０９と称す）について以下の
規定がある。１つは、入力レベルが一４３ｔｔＥｍ以上
なら回路１０９はＯＮする。２つは、入力レベルが一４
８ｄＥｍ以下ならＯＦＦする。３つは、回路１０９のＯ
Ｎ、ＯＦＦのレベルしきい値開のヒステリシスは２ｄＥ
以上ある。４つは、回路１０９のＯＮ、ＯＦＦの遅延時
間はＯＦＦからＯＮが３００ ｍｓ −７００ｍｓで、
ＯＮからＯＦＦが２０ｍ」〜Ｆ３Ｑｍｓとすることであ
る。
第１図は従来のこの種の伝送手順に係る変調波のキャリ
ヤ検出装置を例示する処理フロー医である。第１図にお
いて、上記の規格Ｆ２１の規定に準拠し、例えば回路１
０９０□Ｎ、ＯＦＦのしきい値と遅延時間を、ＯＦＦか
らＯＮのしきい値を−４４ｄＢｍで遅延時間を４００ｍ
５に、ＯＮからＯＦＦのしきい値を一４６ｄＢｍで遅延
時間を５０ ｍｓ （ＯＮ 。
ヤ検出装置を例示する処理フロー医である。第１図にお
いて、上記の規格Ｆ２１の規定に準拠し、例えば回路１
０９０□Ｎ、ＯＦＦのしきい値と遅延時間を、ＯＦＦか
らＯＮのしきい値を−４４ｄＢｍで遅延時間を４００ｍ
５に、ＯＮからＯＦＦのしきい値を一４６ｄＢｍで遅延
時間を５０ ｍｓ （ＯＮ 。
ＯＦＦのしきい値のヒステリシスは２ｄＢ ）に設定し
、上記遅延時間４００ｍｔと５０ ｍｓについてはＯＮ
タイマ、 ＯＦＦタイマにより与えて、図示の処理フロ
ーにしたがい回路１０９のＯＮ 、 ＯＦＦを行なって
いる。
、上記遅延時間４００ｍｔと５０ ｍｓについてはＯＮ
タイマ、 ＯＦＦタイマにより与えて、図示の処理フロ
ーにしたがい回路１０９のＯＮ 、 ＯＦＦを行なって
いる。
第２図は第１図による従来の入力変調波Ａに対するキャ
リア検出信号（回路１０９ ） Ｂを例示する信号波形
図である。第２図において、上記ＧｆｆＪファタフアク
シミでは、画データＡ１の送信のほか、その先頭にプリ
アンプルのＢＤＬＣフラグを付した伝送手順データＡ２
の送信を行なうが、この両信号は正常時なら受信部にお
いて区別可能であっても、何らかの原因で例えばノイズ
や瞬断等により正常な手順から離脱すると受信側では伝
送手順データが入力して（るのが画データが入力してく
るのか判別できないため同時受信が要求される。したが
って第１図の処理フローに従って検出されるキャリア検
出信号（回路１０９）Ｂは、入力変調波Ａの画データの
変調波Ａ１と伝送手順データの変調波Ａ２に対応するキ
ャリア検出信号（回路１ｏ９）Ｂ１とＢ２になる。これ
により画データの変調波Ａ１と伝送手順データの変調波
Ａ２のキャリア検出信号（回路１０９ ） Ｂ １とＢ
２の区別はファクシミリ制御部において行なうようにし
ている。
リア検出信号（回路１０９ ） Ｂを例示する信号波形
図である。第２図において、上記ＧｆｆＪファタフアク
シミでは、画データＡ１の送信のほか、その先頭にプリ
アンプルのＢＤＬＣフラグを付した伝送手順データＡ２
の送信を行なうが、この両信号は正常時なら受信部にお
いて区別可能であっても、何らかの原因で例えばノイズ
や瞬断等により正常な手順から離脱すると受信側では伝
送手順データが入力して（るのが画データが入力してく
るのか判別できないため同時受信が要求される。したが
って第１図の処理フローに従って検出されるキャリア検
出信号（回路１０９）Ｂは、入力変調波Ａの画データの
変調波Ａ１と伝送手順データの変調波Ａ２に対応するキ
ャリア検出信号（回路１ｏ９）Ｂ１とＢ２になる。これ
により画データの変調波Ａ１と伝送手順データの変調波
Ａ２のキャリア検出信号（回路１０９ ） Ｂ １とＢ
２の区別はファクシミリ制御部において行なうようにし
ている。
このように従来のＧｆｆｌファタフアクシミなどの入力
変調波のキャリア検出装置においては、特定のプリアン
プルのＥＤＬＣ７ラグを付した伝送手順データと画像デ
ータのキャリア検出信号を受信部で区別できないうえ、
信号レベルのみでキャリア検出信号（回路１ｏ９）のＯ
Ｎ 、 ＯＦＦを行なっていることからノイズなどによ
っても簡単にＯＮしてしまうため伝送手順の正常なシー
ケンスからの離脱の原因にもなりゃすいなどの欠点があ
った。
変調波のキャリア検出装置においては、特定のプリアン
プルのＥＤＬＣ７ラグを付した伝送手順データと画像デ
ータのキャリア検出信号を受信部で区別できないうえ、
信号レベルのみでキャリア検出信号（回路１ｏ９）のＯ
Ｎ 、 ＯＦＦを行なっていることからノイズなどによ
っても簡単にＯＮしてしまうため伝送手順の正常なシー
ケンスからの離脱の原因にもなりゃすいなどの欠点があ
った。
本発明の目的は上記した従来技術の欠点をなくし、特定
フラグを伺した伝送制御手順データなどの変調波に対し
てのみＯＮして、画データなどに対してはＯＮしないう
え、ノイズなどによってもＯＮすることのないキャリア
検出信号かえられるキャリア検出装置を提供するにある
。
フラグを伺した伝送制御手順データなどの変調波に対し
てのみＯＮして、画データなどに対してはＯＮしないう
え、ノイズなどによってもＯＮすることのないキャリア
検出信号かえられるキャリア検出装置を提供するにある
。
本発明はデータの先頭に特定フラグを付した伝送制御手
順データなどの変調波のキャリア検出において、キャリ
ア検出信号のＯＮ条件として入力信号レベルがキャリア
検出信号のＯＮしきい値を越える条件に受信データの特
定フラグを検出する条件を加えることにより、特定フラ
グを先頭に付したデータの変調波に対してのみキャリア
検出信号をＯＮして、他の画データなどの変調波やノイ
ズのレベルがＯＮ Ｌきい値を越えてもキャリア検出信
号をＯＮしないようにしたキャリア検出装置である。
順データなどの変調波のキャリア検出において、キャリ
ア検出信号のＯＮ条件として入力信号レベルがキャリア
検出信号のＯＮしきい値を越える条件に受信データの特
定フラグを検出する条件を加えることにより、特定フラ
グを先頭に付したデータの変調波に対してのみキャリア
検出信号をＯＮして、他の画データなどの変調波やノイ
ズのレベルがＯＮ Ｌきい値を越えてもキャリア検出信
号をＯＮしないようにしたキャリア検出装置である。
以下に本発明の一実施例を第３図ないし第５図により説
明する。
明する。
第３図は本発明によるＧ■スフアクシミ通信の特定フラ
グを付した伝送手順データの変調波のキャリア検出装置
（回路１０９）の一実施例を示すブロック図、第４図は
同じく処理フロー図第５図は同じ（入力変調波Ａに対す
るキャリア検出信号（回路１０９）Ｂの信号波形図であ
る。
グを付した伝送手順データの変調波のキャリア検出装置
（回路１０９）の一実施例を示すブロック図、第４図は
同じく処理フロー図第５図は同じ（入力変調波Ａに対す
るキャリア検出信号（回路１０９）Ｂの信号波形図であ
る。
第３図において、Ａは入力変調波（端子）、１は入力変
調波Ａのレベルを検出するレベル検出器、２はレベル検
出器１の検出レベルをキャリア検出信号（回路１ｏ９）
のＯＮ 、 ＯＦＦのしきい値と比較して出力するレベ
ル比較器、３，４はそれぞれレベル比較器２の出力にＯ
ＦＦからＯＮ。
調波Ａのレベルを検出するレベル検出器、２はレベル検
出器１の検出レベルをキャリア検出信号（回路１ｏ９）
のＯＮ 、 ＯＦＦのしきい値と比較して出力するレベ
ル比較器、３，４はそれぞれレベル比較器２の出力にＯ
ＦＦからＯＮ。
ＯＮからＯＦＦの変化があるとタイマが動作して遅延を
与え、変化がなければそのままレベル比較器２の出力を
出力するＯＮタイマ、 ＯＦＦタイマ、５は入力変調波
Ａを復調する復調器、６は復調器５の出力データからフ
ラグの検出を行ない、ＯＮタイマ３から該タイマ動作中
が否かの信号を受けて、該タイマ動作中のみフラグ検出
結果を出力するフラグ検出器、７はＯＮタイマ４とＯＦ
Ｆタイマ５とフラグ検出器乙の結果に基づきキャリア検
出信号（回路１０９ ） Ｂ ２を出力する出力回路で
ある。
与え、変化がなければそのままレベル比較器２の出力を
出力するＯＮタイマ、 ＯＦＦタイマ、５は入力変調波
Ａを復調する復調器、６は復調器５の出力データからフ
ラグの検出を行ない、ＯＮタイマ３から該タイマ動作中
が否かの信号を受けて、該タイマ動作中のみフラグ検出
結果を出力するフラグ検出器、７はＯＮタイマ４とＯＦ
Ｆタイマ５とフラグ検出器乙の結果に基づきキャリア検
出信号（回路１０９ ） Ｂ ２を出力する出力回路で
ある。
第３図ないし第５囚において、例えばＧｆｆＪファタフ
アクシミのデータ伝送のうち、制御手順に関しては伝送
手順データの送信に先き立ちプリアンプルとしてｌ１Ｄ
ＬＣフラグを１秒±１５チ送信することが規定されてい
る（ ＣＣＩＴＴの規格Ｔ６０）。したがって入力変調
波Ａが入力したとき、伝送手順データの変調波Ａ２が入
力したとすると、受信データとしてはまずＥＤＬＣフラ
グが検出される。この事実から伝送制御手順のキャリア
検出信号（回路１０９ ） Ｂ ２のＯＮ、 ＯＦＦ条
件を第４図の処理フローにより次のようにする。
アクシミのデータ伝送のうち、制御手順に関しては伝送
手順データの送信に先き立ちプリアンプルとしてｌ１Ｄ
ＬＣフラグを１秒±１５チ送信することが規定されてい
る（ ＣＣＩＴＴの規格Ｔ６０）。したがって入力変調
波Ａが入力したとき、伝送手順データの変調波Ａ２が入
力したとすると、受信データとしてはまずＥＤＬＣフラ
グが検出される。この事実から伝送制御手順のキャリア
検出信号（回路１０９ ） Ｂ ２のＯＮ、 ＯＦＦ条
件を第４図の処理フローにより次のようにする。
すなわち、１つは、入力変調波Ａの入力レベルが例えば
−４４ｄｌｊｍ以上で、かつ最初の受信データとしてフ
ラグが検出されたときのみ回路１０９はＯＮする。２つ
は、入力レベルが一４６ｃＬＢｒｎ以下なら回路１０９
はＯＦＦする。３つは、回路１０９のＯＮ 、 ＯＦＦ
のレベルしきい値開のヒステリシスは２ｄＢ以上とする
。４つは、回路１０９のＯＮ。
−４４ｄｌｊｍ以上で、かつ最初の受信データとしてフ
ラグが検出されたときのみ回路１０９はＯＮする。２つ
は、入力レベルが一４６ｃＬＢｒｎ以下なら回路１０９
はＯＦＦする。３つは、回路１０９のＯＮ 、 ＯＦＦ
のレベルしきい値開のヒステリシスは２ｄＢ以上とする
。４つは、回路１０９のＯＮ。
ＯＦＦの遅延時間はＯＦＦからＯＮが４００ ｍｓで、
ＯＮからＯＦＦが５０ｍｐとする。
ＯＮからＯＦＦが５０ｍｐとする。
したがって、これらの値などにそれぞれ第６図のレベル
比較器２と、 ＯＮタイマ３ 、 ＯＦＦタイマ４と、
フラグ検出器６を設定することにより入力変調波Ａの入
力レベルをレベル検出器１で検出し、この検出レベルを
レベル比較器２でキャリア検出信号（回路１０９）のＯ
Ｎ 、 ＯＦＦのしきい値−４４ｄＥｍ、−４６ｃＬＥ
ｍと比較してｏＮ、ｏｐ’ｐタイ、３，４へ出力し、Ｏ
Ｎ、ＯＦＦタイマ３，４では該出力にＯＦＦからＯＮ、
ＯＮからＯＦＦの変化があればそれぞれ遅延時間４００
ｍ５ 、５０ｍ、？のタイマを動作させて遅延を与え、
変化がなければそのまま出力回路７へ出力する。一方で
入力変調波Ａｌｄ復調器５で復調され、フラグ検出器６
でその出力データからフラグの検出を行ない、ＯＮタイ
マ３から該タイマ動作中か否かの信号を受けて、該タイ
マ動作中のみフラグ検出結果を出力回路７へ出力する。
比較器２と、 ＯＮタイマ３ 、 ＯＦＦタイマ４と、
フラグ検出器６を設定することにより入力変調波Ａの入
力レベルをレベル検出器１で検出し、この検出レベルを
レベル比較器２でキャリア検出信号（回路１０９）のＯ
Ｎ 、 ＯＦＦのしきい値−４４ｄＥｍ、−４６ｃＬＥ
ｍと比較してｏＮ、ｏｐ’ｐタイ、３，４へ出力し、Ｏ
Ｎ、ＯＦＦタイマ３，４では該出力にＯＦＦからＯＮ、
ＯＮからＯＦＦの変化があればそれぞれ遅延時間４００
ｍ５ 、５０ｍ、？のタイマを動作させて遅延を与え、
変化がなければそのまま出力回路７へ出力する。一方で
入力変調波Ａｌｄ復調器５で復調され、フラグ検出器６
でその出力データからフラグの検出を行ない、ＯＮタイ
マ３から該タイマ動作中か否かの信号を受けて、該タイ
マ動作中のみフラグ検出結果を出力回路７へ出力する。
すると出力回路７ではＯＮ 、 ＯＦＦタイマ６．４と
フラグ検出器乙の結果に基づきキャリア検出信号（回路
１０９）Ｂ２を出力する。このキャリア検出信号（回路
１０９）Ｂ２は、第５図に示すように入力変調波Ａの特
定のフラグを先頭に付した伝送手順データの変調波Ａ２
に対してのみＯＮ 、 ＯＦＦ遅延時間４００ ｒｎ
ｓ５ＱｍｓでＯＮして、画データの変調波Ａ１やノイズ
などに対してはＯＦＦする。
フラグ検出器乙の結果に基づきキャリア検出信号（回路
１０９）Ｂ２を出力する。このキャリア検出信号（回路
１０９）Ｂ２は、第５図に示すように入力変調波Ａの特
定のフラグを先頭に付した伝送手順データの変調波Ａ２
に対してのみＯＮ 、 ＯＦＦ遅延時間４００ ｒｎ
ｓ５ＱｍｓでＯＮして、画データの変調波Ａ１やノイズ
などに対してはＯＦＦする。
以上のように本実施例によれば、Ｇ■ファクシミリ通信
などのデータ伝送において、特定フラグを先頭に付した
伝送制御手順データの変調波に対してのみ確実にＯＮし
て、画データの変調波やノイズなどに対してはＯＮしな
いキャリア検出信号かえられるため、従来のファクシミ
リ制御部での画データと伝送手順データとの区別処理が
不要となるうえ、ノイズなどによる誤動作も防止できる
。
などのデータ伝送において、特定フラグを先頭に付した
伝送制御手順データの変調波に対してのみ確実にＯＮし
て、画データの変調波やノイズなどに対してはＯＮしな
いキャリア検出信号かえられるため、従来のファクシミ
リ制御部での画データと伝送手順データとの区別処理が
不要となるうえ、ノイズなどによる誤動作も防止できる
。
以上の説明のように本発明のキャリア検出装置によれば
、データの先頭に特定のフラグを所定時間（個数）送信
する伝送方式のデータ通信において、入力変調波のレベ
ルがキャリア検出信号のＯＮしきい値を越えかつ特定の
フラグが検出されたときにのみＯＮするキャリア検出信
号かえられるから、ファクシミリ通信などのデータ通信
における伝送手順データ等のキャリア検出に有効に利用
できる。
、データの先頭に特定のフラグを所定時間（個数）送信
する伝送方式のデータ通信において、入力変調波のレベ
ルがキャリア検出信号のＯＮしきい値を越えかつ特定の
フラグが検出されたときにのみＯＮするキャリア検出信
号かえられるから、ファクシミリ通信などのデータ通信
における伝送手順データ等のキャリア検出に有効に利用
できる。
第１図は従来のキャリア検出装置を例示する処理フロー
図、第２図は同じく入力変調波に対するキャリア検出信
号の波形図、第３図は本発明によりキャリア検出装置の
一実施例を示すブロック図、第４図は同じく処理フロー
図、第５区は同じく入力変調波に対するキャリア検出信
号の波形図である。 １・・・・・・・・・・・・レベル検出器２・・・・・
・・・・・・レベル比較器 ３・・・・・・・・・・・
・ＯＮタイマ４・・・・・・・・・・・・ＯＦＦタイマ
５・・・・・・・・−・・復調器６・・・・・・・・
・・・・７ラグ検出器 ７・・−・・・・・・・・出力
回路Ａ・・−・・・・・・・・入力変調波 、乙）Ｂ・
・・・・・・・・・・キャリア検出信号（回路・ｏｔｐ
） リ）第 １１ ○亡Ｄ ＄Ｚ図 ＄３ 図 募４ 回 薯５図
図、第２図は同じく入力変調波に対するキャリア検出信
号の波形図、第３図は本発明によりキャリア検出装置の
一実施例を示すブロック図、第４図は同じく処理フロー
図、第５区は同じく入力変調波に対するキャリア検出信
号の波形図である。 １・・・・・・・・・・・・レベル検出器２・・・・・
・・・・・・レベル比較器 ３・・・・・・・・・・・
・ＯＮタイマ４・・・・・・・・・・・・ＯＦＦタイマ
５・・・・・・・・−・・復調器６・・・・・・・・
・・・・７ラグ検出器 ７・・−・・・・・・・・出力
回路Ａ・・−・・・・・・・・入力変調波 、乙）Ｂ・
・・・・・・・・・・キャリア検出信号（回路・ｏｔｐ
） リ）第 １１ ○亡Ｄ ＄Ｚ図 ＄３ 図 募４ 回 薯５図
Claims (1)
- データの先頭に所定のフラグを付して伝送されるデータ
通信の変調波を入力する手段と、該入力変調波の入力レ
ベルとキャリア検出信号のＯＮ、ＯＦＦシきい値とを比
較するレベル比較器と、上記入力変調波を復調する復調
器と、該復調されたデータから上記フラグを検出するフ
ラグ検出器と、上記入力レベルがキャリア検出信号のＯ
Ｎしきい値を越えかつ上記フラグが検出された時のみキ
ャリア検出信号をＯＮにする出力手段とからなるキャリ
ア検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59112969A JPS60257641A (ja) | 1984-06-04 | 1984-06-04 | キヤリア検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59112969A JPS60257641A (ja) | 1984-06-04 | 1984-06-04 | キヤリア検出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60257641A true JPS60257641A (ja) | 1985-12-19 |
Family
ID=14600079
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59112969A Pending JPS60257641A (ja) | 1984-06-04 | 1984-06-04 | キヤリア検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60257641A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5974757A (ja) * | 1982-10-22 | 1984-04-27 | Hitachi Ltd | 同期信号検出回路 |
-
1984
- 1984-06-04 JP JP59112969A patent/JPS60257641A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5974757A (ja) * | 1982-10-22 | 1984-04-27 | Hitachi Ltd | 同期信号検出回路 |
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