JPS60208144A - 折返し試験方式 - Google Patents
折返し試験方式Info
- Publication number
- JPS60208144A JPS60208144A JP59064916A JP6491684A JPS60208144A JP S60208144 A JPS60208144 A JP S60208144A JP 59064916 A JP59064916 A JP 59064916A JP 6491684 A JP6491684 A JP 6491684A JP S60208144 A JPS60208144 A JP S60208144A
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- JP
- Japan
- Prior art keywords
- line
- loopback
- test
- bus
- reflecting
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L13/00—Details of the apparatus or circuits covered by groups H04L15/00 or H04L17/00
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Dc Digital Transmission (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は複数の通信回線を有する装置の折返し試験方式
、さらに詳しく云えば各通信回線毎に設けられた回線対
応部の折返し試験方式に関する。
、さらに詳しく云えば各通信回線毎に設けられた回線対
応部の折返し試験方式に関する。
回線対応部の折返し試験は各回線対応部内で同一回線の
送信線と受信線を折返してデータの送受信を行ない、正
常性の確認を行なうか、または固定あるいは半固定的九
回線を予じめジャンパ線等で接続して試験を行なってい
る。
送信線と受信線を折返してデータの送受信を行ない、正
常性の確認を行なうか、または固定あるいは半固定的九
回線を予じめジャンパ線等で接続して試験を行なってい
る。
上記試験方式はエラーを検出した場合、送受いずれの側
に障害が発生して因るか判定できないものであり、その
ために回線対応部を他と差し換えて再試験を繰り返して
比較する等の必要性が生じ、場合によっては判定不可能
々こともある。
に障害が発生して因るか判定できないものであり、その
ために回線対応部を他と差し換えて再試験を繰り返して
比較する等の必要性が生じ、場合によっては判定不可能
々こともある。
本発明の目的は各回線対応部に共通な折返し試頓用バス
を設け、任意の回線対応部間での折返し試験を可能にす
ることにより、エラーの原因が送受−ずれの側にあるか
を判定できるようにした折返し試験方式を提供すること
にある。
を設け、任意の回線対応部間での折返し試験を可能にす
ることにより、エラーの原因が送受−ずれの側にあるか
を判定できるようにした折返し試験方式を提供すること
にある。
前記目的を達成するために本発明による折返し試験方式
は複数の通信回線を収容する装置の、各通信回線毎に設
けられた回線対応部の折返し試験方式において、共通の
折返し試験用バスを設け、各回線対応部には、試験指示
の情報を格納するための送信折返し指示記憶部と、前記
送信折返し指示記憶部に試験指示情報が格納されたとき
、文字組立分解部等の論理回路の出力を前記折返し試験
バスに送出するバスドライバと、前記折返し試験バスか
らのデータを受信するバスレシーバと、試験指示の情報
を格納するための受信折返し指示記１１１部と、通常は
受信データ線からのデータを前記論理回路の入力に接続
しており、前記受信折返し指示記憶部に試験指示情報が
格納されたとき前記受信データ線からのデータを断にし
て前記パスレシーバの出力を前記論理回路の入力に接続
するゲート回路とをそれぞれ設け、上位制御装置より試
験対象回線対応部の送信折返し指示記憶部および受信折
返し指示記憶部に試験指示情報をセットすることにより
同一回線および任意の回線間の折返し試験を可能に構成
しである。
は複数の通信回線を収容する装置の、各通信回線毎に設
けられた回線対応部の折返し試験方式において、共通の
折返し試験用バスを設け、各回線対応部には、試験指示
の情報を格納するための送信折返し指示記憶部と、前記
送信折返し指示記憶部に試験指示情報が格納されたとき
、文字組立分解部等の論理回路の出力を前記折返し試験
バスに送出するバスドライバと、前記折返し試験バスか
らのデータを受信するバスレシーバと、試験指示の情報
を格納するための受信折返し指示記１１１部と、通常は
受信データ線からのデータを前記論理回路の入力に接続
しており、前記受信折返し指示記憶部に試験指示情報が
格納されたとき前記受信データ線からのデータを断にし
て前記パスレシーバの出力を前記論理回路の入力に接続
するゲート回路とをそれぞれ設け、上位制御装置より試
験対象回線対応部の送信折返し指示記憶部および受信折
返し指示記憶部に試験指示情報をセットすることにより
同一回線および任意の回線間の折返し試験を可能に構成
しである。
前記構成によればエラーのある部分を効率的に判定する
ことができ、本発明の目的は完全に達成できる。
ことができ、本発明の目的は完全に達成できる。
以下、図面を参照して本発明をさらに詳しく説明する。
第１図は本発明による折返し試験方式を説明するための
回線対応部の実施例を示すブロック図である。回線対応
部は収容される通信回線の数だけ設けられている。本実
施例での各回線対応部はすべて同一構成であり、その詳
細を代表しＣ】の回線対応部に示す。図中のＮはＮ番目
の回線対応部である。回線対応部ｌ〜Ｎは図示しない上
位制御装置と制御バス１００で接続され、さらに折返し
試験用バス２に共通して接続されている。さらに各回線
対応部はそれぞれの通信回線に接続されている。
回線対応部の実施例を示すブロック図である。回線対応
部は収容される通信回線の数だけ設けられている。本実
施例での各回線対応部はすべて同一構成であり、その詳
細を代表しＣ】の回線対応部に示す。図中のＮはＮ番目
の回線対応部である。回線対応部ｌ〜Ｎは図示しない上
位制御装置と制御バス１００で接続され、さらに折返し
試験用バス２に共通して接続されている。さらに各回線
対応部はそれぞれの通信回線に接続されている。
回線対応部１において、送信側は送信データ線０を介し
て回線に、送信線Ｈを介して折返し試験バス２にそれぞ
れ接続されている。、また受信側は受信データ線Ｉを介
して回線に、受信線Ｊを介して折返し試験バス２にそれ
ぞれ接続されている。インタフェース部１０１は制御バ
ス１００からの転送要求にしたがって文字組立分解部１
０２、送信折返し指示記憶部１０３、捷たは受信折返し
指示記憶部１０４にデータ転送をし、文字組立分解部１
０２からの転送要求にしたがってデータを転送する回路
である。文字組立分解部１０２は入力りのデータを文字
に組立て、上述のインタフェース回路１０１からのデー
タを分解し、出力Ｏに送出する論理回路である。文字組
立分解部１０２の出力０はライントライバ１０９および
バスドライバ１０８ Ｋ接続され、ライントライバ１０
９は文字Ｘ目立分解部１０２よりデータ出力があれば、
そのデータを送信データ線Ｇに送出する。
て回線に、送信線Ｈを介して折返し試験バス２にそれぞ
れ接続されている。、また受信側は受信データ線Ｉを介
して回線に、受信線Ｊを介して折返し試験バス２にそれ
ぞれ接続されている。インタフェース部１０１は制御バ
ス１００からの転送要求にしたがって文字組立分解部１
０２、送信折返し指示記憶部１０３、捷たは受信折返し
指示記憶部１０４にデータ転送をし、文字組立分解部１
０２からの転送要求にしたがってデータを転送する回路
である。文字組立分解部１０２は入力りのデータを文字
に組立て、上述のインタフェース回路１０１からのデー
タを分解し、出力Ｏに送出する論理回路である。文字組
立分解部１０２の出力０はライントライバ１０９および
バスドライバ１０８ Ｋ接続され、ライントライバ１０
９は文字Ｘ目立分解部１０２よりデータ出力があれば、
そのデータを送信データ線Ｇに送出する。
一方、バスドライバ１０８は送信折返し指示記憶部１０
３によって制御され、送信折返し指示記憶部１０３の出
力Ｅが′Ｏ”のときは文字組立分解部１０２の出力デー
タを送信線ＨＥ送出する。
３によって制御され、送信折返し指示記憶部１０３の出
力Ｅが′Ｏ”のときは文字組立分解部１０２の出力デー
タを送信線ＨＥ送出する。
受信データ線■はラインレシーバ１１１ Ｋ、受（％１
線Ｊはパスレシーバ１１０にそれぞれ接続さね１、ライ
ンレシーバ］１１の出力と受信折返し指示記憶部１０４
の出力Ｆとがアンドゲート１０７の入カニ接続されてｂ
る。一方、パスレシーバ１１０の出力と受信折返し指示
記憶部１０４の出力Ｆとがアンドゲート１０６の正入力
と否定入力にそれぞれ接続されている。アンドゲート１
０６ 、１０７（ｉ’）各出力はオアゲート１０５を介
して上述の文字組立分解部１０２の入力りに接続さｎ、
ている。
線Ｊはパスレシーバ１１０にそれぞれ接続さね１、ライ
ンレシーバ］１１の出力と受信折返し指示記憶部１０４
の出力Ｆとがアンドゲート１０７の入カニ接続されてｂ
る。一方、パスレシーバ１１０の出力と受信折返し指示
記憶部１０４の出力Ｆとがアンドゲート１０６の正入力
と否定入力にそれぞれ接続されている。アンドゲート１
０６ 、１０７（ｉ’）各出力はオアゲート１０５を介
して上述の文字組立分解部１０２の入力りに接続さｎ、
ている。
受信折返し指示記憶部１０４の出力Ｆが”１”の場合、
アンドゲート１０７が開となって受信データ線Ｉのデー
タがラインレシーバＩＩＩよりアントゲ−） １０７．
オアゲート１ｏ５を介して文字組立分解部１０２に送出
さハる。反対に出力Ｆが０”の場合はアントゲ−）１０
６が開となって受信線Ｊのデータがパスレシーバｘ＋ｏ
ｊリアンドゲート１０６、オアゲート１０５を介して文
字組立分解部】０２に送出される。送信折返し指示記憶
部１０３および受信折返し指示記憶部１０４の内存は上
位制御装置からの指示により書き換え可能である。
アンドゲート１０７が開となって受信データ線Ｉのデー
タがラインレシーバＩＩＩよりアントゲ−） １０７．
オアゲート１ｏ５を介して文字組立分解部１０２に送出
さハる。反対に出力Ｆが０”の場合はアントゲ−）１０
６が開となって受信線Ｊのデータがパスレシーバｘ＋ｏ
ｊリアンドゲート１０６、オアゲート１０５を介して文
字組立分解部】０２に送出される。送信折返し指示記憶
部１０３および受信折返し指示記憶部１０４の内存は上
位制御装置からの指示により書き換え可能である。
通常の状態では送信折返し指示記憶部１０３および受信
折返し指示記憶部１０４には０″がセットされていて文
字組立分解部１０２の出力Ｃが送信データ線Ｇに、受信
データ線■のデータが文字組立分解部１０２の入力りに
送出さハ、る。
折返し指示記憶部１０４には０″がセットされていて文
字組立分解部１０２の出力Ｃが送信データ線Ｇに、受信
データ線■のデータが文字組立分解部１０２の入力りに
送出さハ、る。
ここで、自己回線の折返し試験を行なう場合を説明する
。
。
上位制御装置よりインタフェース部１０１を介して送信
折返し指示記憶部１０３および受信折返し指示記憶部１
０４に指示を出し、各記憶部にｌ＃をセットする。する
と出力Ｅ、Ｆとも１１０１１になるため受信データ線Ｉ
が切離され、文字組立分解部１０２の出力Ｃはバスドラ
イバ１０８により折返しバス２に送出され、折返しバス
２からの入力データＪはバスレシーバ１１０を経てアン
トゲ−）−１０６およびオアゲート１０５を通り文字組
立分解部１０２の入力りとなる。
折返し指示記憶部１０３および受信折返し指示記憶部１
０４に指示を出し、各記憶部にｌ＃をセットする。する
と出力Ｅ、Ｆとも１１０１１になるため受信データ線Ｉ
が切離され、文字組立分解部１０２の出力Ｃはバスドラ
イバ１０８により折返しバス２に送出され、折返しバス
２からの入力データＪはバスレシーバ１１０を経てアン
トゲ−）−１０６およびオアゲート１０５を通り文字組
立分解部１０２の入力りとなる。
次に回線対応部間で折返す場合を説明する。
例えば回線対応部１からＮにデータを折返す場合、回線
対応部１の送信折返し指示記憶部】０３および回線対応
部Ｎの受信折返し指示記憶部（回線対応部１の１０４に
相当）を１″にセット、逆に回線対応部Ｎから１へ折返
す場合には回線対応部Ｎの送信折返し指示記憶部（回線
対応部ｌの１０３に相当）および回線対応部ｌの受信折
返し指示記憶部１０４を”１″にセットする。
対応部１の送信折返し指示記憶部】０３および回線対応
部Ｎの受信折返し指示記憶部（回線対応部１の１０４に
相当）を１″にセット、逆に回線対応部Ｎから１へ折返
す場合には回線対応部Ｎの送信折返し指示記憶部（回線
対応部ｌの１０３に相当）および回線対応部ｌの受信折
返し指示記憶部１０４を”１″にセットする。
このように回線対応部の送信折返し指示記憶部と受信折
返し指示記憶部を試験対象に応じて′ １＃をセットす
ることにより自体回線対応部の折返しおよび任意の回線
対応部間の折返し試験を行なうことができる。
返し指示記憶部を試験対象に応じて′ １＃をセットす
ることにより自体回線対応部の折返しおよび任意の回線
対応部間の折返し試験を行なうことができる。
本（３明方式は以上の説明で明らかなように同一同線で
の折返し試験のみでなく任意の回線間での折返し試：験
を特別に外部回路によるジャンパ線等の接続なしに上位
制御装置の指示で自由に行なえるので障害時の診断、そ
の他通常時のメンテナンスを非常に効率良く短時間に行
なえる効果がある。
の折返し試験のみでなく任意の回線間での折返し試：験
を特別に外部回路によるジャンパ線等の接続なしに上位
制御装置の指示で自由に行なえるので障害時の診断、そ
の他通常時のメンテナンスを非常に効率良く短時間に行
なえる効果がある。
第１図は本発明による折返し試験方式の実施例を示すブ
ロック図である。 １、Ｎ・・・回線対応部 ２・・・折返しバス１０１・
・・インタフェース部 １０２・・・文字組立分解部 １０３・・・送信折返し指示記憶部 １０４・・・受信折返し指示記憶部 １０５・・オアゲー） １０６，１０７・・・アンドゲ
ート１０Ｂ・・・バスドライバ １０９・・ライントラ
イバ１１０・・・パスレシーバ １１１・・・ラインレ
ンーノ（Ａ 、 Ｉ−１、０、１） 、 Ｅ 、 Ｆ
、、、出力Ｇ・・・送信データ線 Ｈ・・・送信線■・
・・受信データ線 Ｊ・・・受信線１′１Ｂ □ □ □ □ し
ロック図である。 １、Ｎ・・・回線対応部 ２・・・折返しバス１０１・
・・インタフェース部 １０２・・・文字組立分解部 １０３・・・送信折返し指示記憶部 １０４・・・受信折返し指示記憶部 １０５・・オアゲー） １０６，１０７・・・アンドゲ
ート１０Ｂ・・・バスドライバ １０９・・ライントラ
イバ１１０・・・パスレシーバ １１１・・・ラインレ
ンーノ（Ａ 、 Ｉ−１、０、１） 、 Ｅ 、 Ｆ
、、、出力Ｇ・・・送信データ線 Ｈ・・・送信線■・
・・受信データ線 Ｊ・・・受信線１′１Ｂ □ □ □ □ し
Claims (1)
- 複数の通信回線を収容する装置の、各通信回線毎に設け
られた回線対応部の折返し試験方式において、共通の折
返し試験用バスを設け、各回線対応部には、試験指示の
情報を格納するための送信折返し指示記憶部と、前記送
信折返し指示記憶部に試験指示情報が格納されたとき、
文字組立分解部等の論理回路の出力を前記折返し試験バ
スに送出するバスドライバと、前記折返し試験バスから
のデータを受信するバスレシーバと、試験指示の情報を
格納するための受信折返し指示記憶部と、通常は受信デ
ータ線からのデータを前記論理回路の入力に接続してお
り、前記受信折返し指示記憶部に試験指示情報が格納さ
れたとき前記受信データ線からのデータを断にして前記
パスレシーバの出力を前記論理回路の入力に接続するゲ
ート回路とをそれぞれ設け、上位制御装置より試験対象
回線対応部の送信折返し指示記憶部および受信折返し指
示記憶部に試験指示情報をセットすることにより同一回
線および任意の回線間の折返し試験を可能にしたことを
特徴とする折返し試験方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59064916A JPS60208144A (ja) | 1984-03-30 | 1984-03-30 | 折返し試験方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59064916A JPS60208144A (ja) | 1984-03-30 | 1984-03-30 | 折返し試験方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60208144A true JPS60208144A (ja) | 1985-10-19 |
Family
ID=13271845
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59064916A Pending JPS60208144A (ja) | 1984-03-30 | 1984-03-30 | 折返し試験方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60208144A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51134007A (en) * | 1975-05-15 | 1976-11-20 | Hitachi Ltd | Method to test communication control unit |
-
1984
- 1984-03-30 JP JP59064916A patent/JPS60208144A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51134007A (en) * | 1975-05-15 | 1976-11-20 | Hitachi Ltd | Method to test communication control unit |
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