JPS60181866A - キ−デ−タエミユレ−シヨン方式 - Google Patents
キ−デ−タエミユレ−シヨン方式Info
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- JPS60181866A JPS60181866A JP59037516A JP3751684A JPS60181866A JP S60181866 A JPS60181866 A JP S60181866A JP 59037516 A JP59037516 A JP 59037516A JP 3751684 A JP3751684 A JP 3751684A JP S60181866 A JPS60181866 A JP S60181866A
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- Japan
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- key
- keyboard
- line
- slave
- signal
- Prior art date
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F15/00—Digital computers in general; Data processing equipment in general
- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
- G06F15/163—Interprocessor communication
- G06F15/17—Interprocessor communication using an input/output type connection, e.g. channel, I/O port
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/02—Input arrangements using manually operated switches, e.g. using keyboards or dials
- G06F3/0227—Cooperation and interconnection of the input arrangement with other functional units of a computer
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- General Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
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- Human Computer Interaction (AREA)
- Software Systems (AREA)
- Input From Keyboards Or The Like (AREA)
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、唯１個のキーボードユニットによシ複数のマ
イクロプロセッサに対しそれぞれ独−立したキーデー夕
を提供する、キー人力処理システムのキーデータエミュ
レーション方式に関する。
イクロプロセッサに対しそれぞれ独−立したキーデー夕
を提供する、キー人力処理システムのキーデータエミュ
レーション方式に関する。
２種の独立したマイクロプロセ、すを内蔵し、それぞれ
に独立した入出力デバイスを接続することによシ、よシ
高性能なコンピュータシステムを構築出来ることが知ら
れている。例えば、１６ビツトアーキテクチヤを持つ高
性能ビジネスパンコンと、８ビツトアーキテクチヤを持
つグームノヤソコンとを合体させ、豊富な処理用途にシ
ステムを摘要させることが出来ると共に、ｒ−夕処理あ
るいはｒ−夕転送効率をキげることか出来る。上記プロ
セッサ間結合は近年のＬＳＩ技術の進歩によりＬＳＩ同
志を有機的に結合することで容易に達成される。
に独立した入出力デバイスを接続することによシ、よシ
高性能なコンピュータシステムを構築出来ることが知ら
れている。例えば、１６ビツトアーキテクチヤを持つ高
性能ビジネスパンコンと、８ビツトアーキテクチヤを持
つグームノヤソコンとを合体させ、豊富な処理用途にシ
ステムを摘要させることが出来ると共に、ｒ−夕処理あ
るいはｒ−夕転送効率をキげることか出来る。上記プロ
セッサ間結合は近年のＬＳＩ技術の進歩によりＬＳＩ同
志を有機的に結合することで容易に達成される。
ところで、上記システム構成において、入出力資源の有
効活用をはかるため、両マイクロプロセッサによって共
有使用される入出力デバイスが接続されることがある。
効活用をはかるため、両マイクロプロセッサによって共
有使用される入出力デバイスが接続されることがある。
例えば、キーボードユニットは、両マイクーロプロセッ
サに対し、それぞれ独立したキーーータを提供するもの
として使用されることがある。
サに対し、それぞれ独立したキーーータを提供するもの
として使用されることがある。
本発明は上述した様な、唯１個のキーボードユニットに
よシ、複数のマイクロプロセッサに対し独立したキーデ
ータを提供するキー人力処理システムにおいて、新規な
インターフェース構造を提供するものである。
よシ、複数のマイクロプロセッサに対し独立したキーデ
ータを提供するキー人力処理システムにおいて、新規な
インターフェース構造を提供するものである。
〔発明の目的）
本発明は上記背景技術に基づいてなされたものであり、
マスタプロセッサの制御の下のみにキーボードを接続し
、スレーブプロセッサニ対してもこのマイクロプロセッ
サを介しキーボードアー夕を提供する構成することによ
）唯１個のキーボードユニットにて、マスタ／スレーブ
双方のマイクロプロセッサへのキーデータの提供を可能
とし、システムの簡略化及びシステムコストの低廉化を
はかったキーデータエミュレーション方式を提供するこ
とを目的とする。
マスタプロセッサの制御の下のみにキーボードを接続し
、スレーブプロセッサニ対してもこのマイクロプロセッ
サを介しキーボードアー夕を提供する構成することによ
）唯１個のキーボードユニットにて、マスタ／スレーブ
双方のマイクロプロセッサへのキーデータの提供を可能
とし、システムの簡略化及びシステムコストの低廉化を
はかったキーデータエミュレーション方式を提供するこ
とを目的とする。
本発明は上記目的を実現するため、２個のマイクログロ
セッサユニットの間にキーボードエミュレーション回路
を付加した。このキー＆ −ドエミュレーション回路ハ
、キーボードユニットを構成するキースイッチマトリク
ス金順次スキャンする信号を発し、リターン信号により
キーコードを生成するマトリクススキャンタイプのキー
ボードコントローラと、マスクとなるマイクロプロセッ
サによシキーコードが設定されるレジスタと、このレジ
スタ出力及びスキャン信号とが入力され、これを比較す
る比較器と、この比較器による比較一致出力を上記キー
ボードコントローラへ供給するゲートで構成した。
セッサユニットの間にキーボードエミュレーション回路
を付加した。このキー＆ −ドエミュレーション回路ハ
、キーボードユニットを構成するキースイッチマトリク
ス金順次スキャンする信号を発し、リターン信号により
キーコードを生成するマトリクススキャンタイプのキー
ボードコントローラと、マスクとなるマイクロプロセッ
サによシキーコードが設定されるレジスタと、このレジ
スタ出力及びスキャン信号とが入力され、これを比較す
る比較器と、この比較器による比較一致出力を上記キー
ボードコントローラへ供給するゲートで構成した。
上記構成とすることによシ、マスクとなるマイクロプロ
セッサがスレーブとなシマイクロプロセッサのキーボー
ドインターフェースをエミュレートし、マスクとなるマ
イクロプロセッサに接続されたキーボードユニットにて
スレーブとなるマイクロプロセッサへのキー人力を行な
うものである。
セッサがスレーブとなシマイクロプロセッサのキーボー
ドインターフェースをエミュレートし、マスクとなるマ
イクロプロセッサに接続されたキーボードユニットにて
スレーブとなるマイクロプロセッサへのキー人力を行な
うものである。
このことにより、１ｌｉ１個のキーボードユニットによ
）、複数マイクロプロセッサに対しキーデー夕を提供す
ることが出来、システムコストの低減、更には操作性の
向上にも寄与する。
）、複数マイクロプロセッサに対しキーデー夕を提供す
ることが出来、システムコストの低減、更には操作性の
向上にも寄与する。
以下、図面を使用して本発明実施例につき詳細に述べる
。第１図は本発明の実施例を示す概略ブ９ツク図である
。本発明にて特徴的なことは、２個のマイクロプロセッ
サ１３．１６間にキーボードエミュレーション回路１４
を付加したことにある。図において、１ノは本システム
に唯１個存在するキーボードデータ）（ＫＢ）である。
。第１図は本発明の実施例を示す概略ブ９ツク図である
。本発明にて特徴的なことは、２個のマイクロプロセッ
サ１３．１６間にキーボードエミュレーション回路１４
を付加したことにある。図において、１ノは本システム
に唯１個存在するキーボードデータ）（ＫＢ）である。
キーボードユニット１１は、Ｘ−Ｙマトリクス上に各種
キースイッチが配置される。任意のキースイッチが押下
されるとそのＸ−Ｙマトリクスデータを検出し、内蔵の
マイクロプロセッサにてシリアルデータに変換し、マス
タプロセッサ１３のキーボードインターフェース１２へ
送信する。マスクプロセッサ１３は予め、システムプロ
グラムによシ受信されるキーボードデータがマスク又は
スレーブのいずれで使用されるか定義されているものと
する。本発明実施例ではキーデータはスレーブ側へ入力
されるものとして以下の説明がなされる。
キースイッチが配置される。任意のキースイッチが押下
されるとそのＸ−Ｙマトリクスデータを検出し、内蔵の
マイクロプロセッサにてシリアルデータに変換し、マス
タプロセッサ１３のキーボードインターフェース１２へ
送信する。マスクプロセッサ１３は予め、システムプロ
グラムによシ受信されるキーボードデータがマスク又は
スレーブのいずれで使用されるか定義されているものと
する。本発明実施例ではキーデータはスレーブ側へ入力
されるものとして以下の説明がなされる。
従って、マスタプロセッサ１３は受信したキーボードア
ー夕を、キーボードエミュレーション回路１４を介し、
スレーブプロセッサ１６にデータ入力する。スレーブ側
に位置するキーボードインターフェース１５Ｌｄ、、シ
ーケンシャルなキーボードスキャン信号を出力しておシ
、対応するキーデー夕がキーゲードエミュレーシ。
ー夕を、キーボードエミュレーション回路１４を介し、
スレーブプロセッサ１６にデータ入力する。スレーブ側
に位置するキーボードインターフェース１５Ｌｄ、、シ
ーケンシャルなキーボードスキャン信号を出力しておシ
、対応するキーデー夕がキーゲードエミュレーシ。
ン回路１４で検出されると、スレーブプロセッサ１６へ
読取＃）要求を出力する。上記概略構成動作によシキー
ボードデータがスレーブプロセッサ１６へ読込まれる。
読取＃）要求を出力する。上記概略構成動作によシキー
ボードデータがスレーブプロセッサ１６へ読込まれる。
第２図は第１図に示したキーボードエミュレーション回
路の実施例を示したものである。図において、１４１は
レジスタである。レジスタ１４ノは、マスクプロセッサ
１３に接続されるデータバスａ上を伝播するキーデータ
がセットされる８ビツトレジスタであシ、本レジスタ１
４ノへのデータセットはマスクプロセッサ１３よシ発せ
られるキーボードデータセット命令（ラインｂ）によシ
行なわれる。１４２はキーデ−トコントローラ（ＫＢＣ
）でアル。キーボードコントローラ１４２は、ｘ−ｙキ
ーマトリクススキャン信号（ラインＫ）及びリターン信
号（ラインｍ 、 ｎ ）によシキーコードを生成する
。キーが−ドコントローラ１４２は、ここで生成される
キーデートを、割込み信号（ジインｉ）によシ、データ
バスｊを介し、スレーブプロセッサ１６へ送信する。１
４３は比較器（ＣＯＭＰ ）である。比較器１４３は、
レジスタ１４１出力であるキーデータにフィンｄ）と、
上記キーデートコントローラ１４２によシ生成出力され
るスキャン信号とをコンベアする。この比較器１４３出
力はダート１４４へ供給される。ダート１４４は上記比
較器１４３の比較一致信号（ラインｈ）を、レジスタ１
４１から出力されるキーが−ドイネーブル信号（ライン
ｅ）によシ、キーデータを検出するだめの７ｃアータ、
いわゆるリターン−信号として供給する。
路の実施例を示したものである。図において、１４１は
レジスタである。レジスタ１４ノは、マスクプロセッサ
１３に接続されるデータバスａ上を伝播するキーデータ
がセットされる８ビツトレジスタであシ、本レジスタ１
４ノへのデータセットはマスクプロセッサ１３よシ発せ
られるキーボードデータセット命令（ラインｂ）によシ
行なわれる。１４２はキーデ−トコントローラ（ＫＢＣ
）でアル。キーボードコントローラ１４２は、ｘ−ｙキ
ーマトリクススキャン信号（ラインＫ）及びリターン信
号（ラインｍ 、 ｎ ）によシキーコードを生成する
。キーが−ドコントローラ１４２は、ここで生成される
キーデートを、割込み信号（ジインｉ）によシ、データ
バスｊを介し、スレーブプロセッサ１６へ送信する。１
４３は比較器（ＣＯＭＰ ）である。比較器１４３は、
レジスタ１４１出力であるキーデータにフィンｄ）と、
上記キーデートコントローラ１４２によシ生成出力され
るスキャン信号とをコンベアする。この比較器１４３出
力はダート１４４へ供給される。ダート１４４は上記比
較器１４３の比較一致信号（ラインｈ）を、レジスタ１
４１から出力されるキーが−ドイネーブル信号（ライン
ｅ）によシ、キーデータを検出するだめの７ｃアータ、
いわゆるリターン−信号として供給する。
１４５はレジスタである。し・ゾスタ１４５は、Ｘ−Ｙ
キーｉトリクス上に配置されるファンクションコード、
例エバ、コントロール、ブレーク、シヌトキー他がセッ
トされる。本レジスタ１４５へのガータ設定は、マスク
プロセッサ１３から発せられるｒ−タセット命令（ライ
ンＣ）によシなされる。１４６はデコーダ（ＤＥＣ）で
ある。デコーダ１４６は、スキャンコード（ラインｋ）
から、Ｘ−Ｙマトリクス上に定義された各種ファンクシ
ョンキーアドレスを検出する。１４７はドライバ群（Ｄ
ＲＩＶ ）である。ドライバ＃１４７は上記レジスタ１
４５出力であるファンクションキーコード信号（ライン
ｒ）と７アンクンヨンキ一スキヤンアトレス信号（ライ
ンｇ１〜ｇｎｌ ）によシファンクションキー検出信号
（ラインｎ）を出力する。各々の出力はワイヤドオアさ
れ、キーが一ドコントｏ−９１４２ヘリターン信号とし
て供給される。
キーｉトリクス上に配置されるファンクションコード、
例エバ、コントロール、ブレーク、シヌトキー他がセッ
トされる。本レジスタ１４５へのガータ設定は、マスク
プロセッサ１３から発せられるｒ−タセット命令（ライ
ンＣ）によシなされる。１４６はデコーダ（ＤＥＣ）で
ある。デコーダ１４６は、スキャンコード（ラインｋ）
から、Ｘ−Ｙマトリクス上に定義された各種ファンクシ
ョンキーアドレスを検出する。１４７はドライバ群（Ｄ
ＲＩＶ ）である。ドライバ＃１４７は上記レジスタ１
４５出力であるファンクションキーコード信号（ライン
ｒ）と７アンクンヨンキ一スキヤンアトレス信号（ライ
ンｇ１〜ｇｎｌ ）によシファンクションキー検出信号
（ラインｎ）を出力する。各々の出力はワイヤドオアさ
れ、キーが一ドコントｏ−９１４２ヘリターン信号とし
て供給される。
以下、本発明実施例の動作につき詳述する。
キーボード入力モードがスレーブプロセッサモードとし
て定義されている場合、キーボードユニット１１上の任
意のキーが押下されると、マスクプロセッサ１３はまず
対応するキーコードを検出する。そして、第３図（−）
に示す、６ビツトのキーコード（ＫＤ、〜冊。）に変換
し、レジスタ１４１にセットする。又、同時にキーコー
ドイネーブルコマンド（ラインｅ）をセットすることに
よシ、比較器１４３を動作可能状態とする。キーボード
コントローラ１４２ではデータバスｊを介し、スレーブ
プロセッサ１６から初期コマンドが入力されることによ
シ内部キーボード制御ロジックの動作が開始される。キ
ーボードスキャン信号（ラインｋ）はＳ第４図に示す様
に６ビツトのバイナリカウンタ出力信号（ＫＭ〜に０）
をシーケンシャルに出力する。スキャン信号に、〜に０
は、６４進カウンタ出力であシ、最大６４キーコードの
アドレッシングが可能でおる。
て定義されている場合、キーボードユニット１１上の任
意のキーが押下されると、マスクプロセッサ１３はまず
対応するキーコードを検出する。そして、第３図（−）
に示す、６ビツトのキーコード（ＫＤ、〜冊。）に変換
し、レジスタ１４１にセットする。又、同時にキーコー
ドイネーブルコマンド（ラインｅ）をセットすることに
よシ、比較器１４３を動作可能状態とする。キーボード
コントローラ１４２ではデータバスｊを介し、スレーブ
プロセッサ１６から初期コマンドが入力されることによ
シ内部キーボード制御ロジックの動作が開始される。キ
ーボードスキャン信号（ラインｋ）はＳ第４図に示す様
に６ビツトのバイナリカウンタ出力信号（ＫＭ〜に０）
をシーケンシャルに出力する。スキャン信号に、〜に０
は、６４進カウンタ出力であシ、最大６４キーコードの
アドレッシングが可能でおる。
マスタプロセッサ１３により与えられたキーコード（Ｋ
Ｄ、 〜ＫＤ０）とスキャン信号（Ｋｓ 〜Ｋ ｏ ）
は、比較器１４３によシ一致が検出される。ここで比較
一致が検出されるとゲート１４４に対し一致信号（ライ
ンｈ）が出力される。この信号はゲート１４４を介し、
キーコード検出１６号（ラインｍ）としてキーボードコ
ントローラ１４２へ供給される。キーデートコントロー
ラ１４２は、このことによル、キースイッチの押下があ
ったことを認知し、キーコード検出時のスキャンカウン
タ値を内蔵バッファへストアする。
Ｄ、 〜ＫＤ０）とスキャン信号（Ｋｓ 〜Ｋ ｏ ）
は、比較器１４３によシ一致が検出される。ここで比較
一致が検出されるとゲート１４４に対し一致信号（ライ
ンｈ）が出力される。この信号はゲート１４４を介し、
キーコード検出１６号（ラインｍ）としてキーボードコ
ントローラ１４２へ供給される。キーデートコントロー
ラ１４２は、このことによル、キースイッチの押下があ
ったことを認知し、キーコード検出時のスキャンカウン
タ値を内蔵バッファへストアする。
次に、ファンクションキーの処理につき述べる。いま、
仮シに、第３図（ｂ）に定義されたファンクションキー
コードを例示し説明する。キーボードユニット１ノから
、ファクションキーのいずれか送信されてくると、第３
図（ｂ）で定義されるファクションに対応する命令がレ
ジスタ１４５にセットされる。デコーダ１４６はスキャ
ン信号（ラインｋ）の上位３ピツ）Ｋ＋＋〜Ｋ。
仮シに、第３図（ｂ）に定義されたファンクションキー
コードを例示し説明する。キーボードユニット１ノから
、ファクションキーのいずれか送信されてくると、第３
図（ｂ）で定義されるファクションに対応する命令がレ
ジスタ１４５にセットされる。デコーダ１４６はスキャ
ン信号（ラインｋ）の上位３ピツ）Ｋ＋＋〜Ｋ。
（ファンクションキーのスキャンアドレスを’ ＯＦＦ
’ ｎｚｘ−＋″’３Ｆ’ＩＸと仮定する）が入力さ
れ、このことによシ、各７アクシヨンキーに対応するス
キャンアドレスを生成する。従って、レジスタ１４５に
いずれかのファンクションキーコードがセットされてい
れば、デコーダ１４６によシ生成出力されるスキャンア
ドレスｇ８〜ｇｎ＋によυ、ドライバ群１４７ （ａ
−ｎ ）を介しファンクションキー検出信号（ラインｎ
）が出力される。キーボードコントローラ１４２は、フ
ァンクションコードの検出を行ない、上記キーコードに
対応する機能を付加し、８ビツトのキーコードデータと
して生成する。ぞして割込み信号（ラインｌ）を発し、
スレーブプロセッサ１６に対し読取シを要求する。
’ ｎｚｘ−＋″’３Ｆ’ＩＸと仮定する）が入力さ
れ、このことによシ、各７アクシヨンキーに対応するス
キャンアドレスを生成する。従って、レジスタ１４５に
いずれかのファンクションキーコードがセットされてい
れば、デコーダ１４６によシ生成出力されるスキャンア
ドレスｇ８〜ｇｎ＋によυ、ドライバ群１４７ （ａ
−ｎ ）を介しファンクションキー検出信号（ラインｎ
）が出力される。キーボードコントローラ１４２は、フ
ァンクションコードの検出を行ない、上記キーコードに
対応する機能を付加し、８ビツトのキーコードデータと
して生成する。ぞして割込み信号（ラインｌ）を発し、
スレーブプロセッサ１６に対し読取シを要求する。
キーコードコントローラとして米国ＩＮ置社よシ製造販
売されている８２７９相当品を使用した場合のキーボー
ドエミュレート回路の実施例を第５図に示す。まず、マ
スクプ四セッサ１３のコントロールの下、レジスタ２４
ノに第６図（ｂ）にて定義されるキーコードがセットさ
れる。図において島ラインＰを伝播する信号は３ビツト
のＸキーコード（Ｘ−Ｙマトリクス上のＸ方向を意味す
る）、ラインｒを伝播する信号は３ビツトのＹキーコー
ド、ラインｑを伝播する信号はイネーブル信号、ライン
Ｓを伝播する（Ｈ号は３ビツトのスキャン信号である。
売されている８２７９相当品を使用した場合のキーボー
ドエミュレート回路の実施例を第５図に示す。まず、マ
スクプ四セッサ１３のコントロールの下、レジスタ２４
ノに第６図（ｂ）にて定義されるキーコードがセットさ
れる。図において島ラインＰを伝播する信号は３ビツト
のＸキーコード（Ｘ−Ｙマトリクス上のＸ方向を意味す
る）、ラインｒを伝播する信号は３ビツトのＹキーコー
ド、ラインｑを伝播する信号はイネーブル信号、ライン
Ｓを伝播する（Ｈ号は３ビツトのスキャン信号である。
キーデートコントローラ２４４はキーコード信号（ライ
ンＰ）及びイネーブル信号（ラインｑ）がセットされる
と比較器２４３によシスキャン信号との比較が行なわれ
る。ここで一致が検出されると比較一致信号（ラインｔ
）が出力される。ここで生成される比較一致重号は、デ
コーダ２４２のイネーブル端子に入力される。デコーダ
２４２へは、Ｙキーコード（ラインｒ）が既に入力され
ておシ、これに対応するリターン信号（ラインＵ）が出
力される。尚、リターン信号ラインＵは８ピツトでｋｇ
されるものとする。
ンＰ）及びイネーブル信号（ラインｑ）がセットされる
と比較器２４３によシスキャン信号との比較が行なわれ
る。ここで一致が検出されると比較一致信号（ラインｔ
）が出力される。ここで生成される比較一致重号は、デ
コーダ２４２のイネーブル端子に入力される。デコーダ
２４２へは、Ｙキーコード（ラインｒ）が既に入力され
ておシ、これに対応するリターン信号（ラインＵ）が出
力される。尚、リターン信号ラインＵは８ピツトでｋｇ
されるものとする。
キーボードコントローラ２４４はこのリターン信号を検
出し、且つデパウンスタイム経過後、内蔵するＦＩＦＯ
レジスタに対し、第６図（、）に定義する− フォーマ
ットにてキーコードをセットする。ビットＤ、〜Ｄ、に
はリターン信号（ラインＵ）検出時のスキャンカウンタ
値が、Ｄ、〜Ｄ０にはリターンアドレスがセットされる
。レジスタ２４５はコントロール及びシフト情報がマス
タＣＰＵ１３によってセットされる。ラインＶを伝播す
る信号及びラインＷを伝播する信号はキーコードと同じ
く、キーが−ドコントローラ２４４内蔵のＦＩＦＯ（ビ
ットＤ ｔ ／’Ｄ ｓ）に格納される。ＦＩＦＯにキ
ーコードが格納されるとキーコードコントローラ２４４
は割込み信号（ライン１）を発し、スレー７”ＣＰＵＪ
６ｉへ割込み、キーコードの読取シ要求を行なう。
出し、且つデパウンスタイム経過後、内蔵するＦＩＦＯ
レジスタに対し、第６図（、）に定義する− フォーマ
ットにてキーコードをセットする。ビットＤ、〜Ｄ、に
はリターン信号（ラインＵ）検出時のスキャンカウンタ
値が、Ｄ、〜Ｄ０にはリターンアドレスがセットされる
。レジスタ２４５はコントロール及びシフト情報がマス
タＣＰＵ１３によってセットされる。ラインＶを伝播す
る信号及びラインＷを伝播する信号はキーコードと同じ
く、キーが−ドコントローラ２４４内蔵のＦＩＦＯ（ビ
ットＤ ｔ ／’Ｄ ｓ）に格納される。ＦＩＦＯにキ
ーコードが格納されるとキーコードコントローラ２４４
は割込み信号（ライン１）を発し、スレー７”ＣＰＵＪ
６ｉへ割込み、キーコードの読取シ要求を行なう。
以上説明の如く本発明によれば、最小限のハードウェア
ロジックを付加し、簡単なグログラム制御を行なうこと
によシ、システム上、マスタＣＰＵに接続された唯１個
のキーデートユニットの存在よシスレープＣＰＵに対し
てもキーデータを提供できる。この様に２種のマイクロ
プロセッサを持ち、各々独立したキー人力制御が必要な
キー人力処理システムにおいて、１個のキーボードにて
独立した双方のマイクロプロセッサに対するｒ−夕の提
供が可能となシ、従ってシステムコストの低減化、更に
は操作性の向上にも寄与する。
ロジックを付加し、簡単なグログラム制御を行なうこと
によシ、システム上、マスタＣＰＵに接続された唯１個
のキーデートユニットの存在よシスレープＣＰＵに対し
てもキーデータを提供できる。この様に２種のマイクロ
プロセッサを持ち、各々独立したキー人力制御が必要な
キー人力処理システムにおいて、１個のキーボードにて
独立した双方のマイクロプロセッサに対するｒ−夕の提
供が可能となシ、従ってシステムコストの低減化、更に
は操作性の向上にも寄与する。
第１図は本発明が使用されるキー人力処理システムの構
成例を示すブロック図、第２図は第１図におけるキーボ
ードエミュレーション回路の一実施例を示すブロック図
、第３図（ａ） ｐ （ｂ）は第２図に示しだ実施例中
、レジスタに設定されるキーデータのフォーマットを示
す図、第４図はスキャン信号のタイミング波形を示す図
、第５図は第１図におけるキーボードエミュレーション
回路の他の実施例を示す図、第６図（ｓ＋） ｐ （ｂ
）は第５図に示す実施例中、レジスタに設定されるキー
データのフォーマットを示す図である。 １３・・・マスタグロセッサ、１４・・・キーボードエ
ミュレーション回路、ｉ６−・・スレーブプロセッサ、
１４１，１４５・・・レジスタ、１４２゜２４４・・・
キーピードコントローラ、１４３゜２４３・・・比較器
。 出願人代理人 弁理士 鈴 江 武 彦第１図 第２図 第３図 （ａ） （ｂ） 第４図 に５ 第５図 第６図 （ａ） （ｂ）
成例を示すブロック図、第２図は第１図におけるキーボ
ードエミュレーション回路の一実施例を示すブロック図
、第３図（ａ） ｐ （ｂ）は第２図に示しだ実施例中
、レジスタに設定されるキーデータのフォーマットを示
す図、第４図はスキャン信号のタイミング波形を示す図
、第５図は第１図におけるキーボードエミュレーション
回路の他の実施例を示す図、第６図（ｓ＋） ｐ （ｂ
）は第５図に示す実施例中、レジスタに設定されるキー
データのフォーマットを示す図である。 １３・・・マスタグロセッサ、１４・・・キーボードエ
ミュレーション回路、ｉ６−・・スレーブプロセッサ、
１４１，１４５・・・レジスタ、１４２゜２４４・・・
キーピードコントローラ、１４３゜２４３・・・比較器
。 出願人代理人 弁理士 鈴 江 武 彦第１図 第２図 第３図 （ａ） （ｂ） 第４図 に５ 第５図 第６図 （ａ） （ｂ）
Claims (1)
- 複数のマイクロプロセッサに対し、唯１個のキーボード
ユニットがそれぞれ独立したキーガータを提供するキー
人力処理システムにおいて、上記マイクロプロセッサ間
にキーデータエミュレーション回路を付加し、このキー
データエミュレーション回路ハ、上記キーボードユニッ
トを構成するキースイッチマトリクスを順次スキャンす
る信号を発し、リターン信号によシキーゴードを生成す
るマトリクススキャンタイプのキーが一ドコントローラ
と１上記複数のマイクロプロセッサのうちマスクとなる
マイクロプロセッサによってキーコードが設定されるレ
ジスタと、このレジスタ出力及び上記スキャン信号とが
入力されこれを比較する比較器と、この比較器による比
較−散出力を上記キーが−ドコントローラへ供給するダ
ートとを具備し、マスクとなるマイクロプロセッサがス
レーブとなるマイクロプロセッサのキーボードインター
フェースをエミュレートすることによシ、マスクとなる
マイクロプロセッサに接続されたキーボードユニットに
てスレーブトナルマイｐｏｆ四セッサへのキー人力を行
なうことを特徴とするキーデータエミュレーション方式
。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59037516A JPS60181866A (ja) | 1984-02-29 | 1984-02-29 | キ−デ−タエミユレ−シヨン方式 |
| US06/705,729 US4710869A (en) | 1984-02-29 | 1985-02-26 | Key input data emulation system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59037516A JPS60181866A (ja) | 1984-02-29 | 1984-02-29 | キ−デ−タエミユレ−シヨン方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60181866A true JPS60181866A (ja) | 1985-09-17 |
| JPH0120464B2 JPH0120464B2 (ja) | 1989-04-17 |
Family
ID=12499699
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59037516A Granted JPS60181866A (ja) | 1984-02-29 | 1984-02-29 | キ−デ−タエミユレ−シヨン方式 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4710869A (ja) |
| JP (1) | JPS60181866A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JP2016086239A (ja) * | 2014-10-23 | 2016-05-19 | ファナック株式会社 | キーボード |
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1984
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1985
- 1985-02-26 US US06/705,729 patent/US4710869A/en not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| JPH0120464B2 (ja) | 1989-04-17 |
| US4710869A (en) | 1987-12-01 |
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