JPS60128741A - 計算機システムの回復処理装置 - Google Patents
計算機システムの回復処理装置Info
- Publication number
- JPS60128741A JPS60128741A JP58237334A JP23733483A JPS60128741A JP S60128741 A JPS60128741 A JP S60128741A JP 58237334 A JP58237334 A JP 58237334A JP 23733483 A JP23733483 A JP 23733483A JP S60128741 A JPS60128741 A JP S60128741A
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- JP
- Japan
- Prior art keywords
- processing device
- state
- auxiliary processing
- recovery
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Debugging And Monitoring (AREA)
- Small-Scale Networks (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は計算機システム内におけるデータ転送装置に
関し、特にハングアップ（ｈｕｎｇ ｕｐ）状態からの
回復処理に関するものである。
関し、特にハングアップ（ｈｕｎｇ ｕｐ）状態からの
回復処理に関するものである。
第１図はマルチドロップ式データ伝送システムを示すブ
ロック図で、図において（Ｉ＋は中央処理装置（以下Ｃ
ＰＵと略記する）、（２υ、（２２） −（２ｎ） は
それぞれ入出力装置（以下ＩＯと略記する）、（３；は
共通の伝送路である。
ロック図で、図において（Ｉ＋は中央処理装置（以下Ｃ
ＰＵと略記する）、（２υ、（２２） −（２ｎ） は
それぞれ入出力装置（以下ＩＯと略記する）、（３；は
共通の伝送路である。
第１図のようなシステムにおける通信の開始から終了ま
での動作手順は （イ）データ伝送回線の接続 （ロ）データリンクの確立 （ハ）情報の伝送 に）データリンクの終結 （ホ）データ伝送回線の開放 であるが、ＩＯ側の何等かの事故にょシ「（ホ）データ
伝送回線の開放」が実行されない時はこのシステムはハ
ングアップの状態となり爾後のデータ転送が不能となる
。
での動作手順は （イ）データ伝送回線の接続 （ロ）データリンクの確立 （ハ）情報の伝送 に）データリンクの終結 （ホ）データ伝送回線の開放 であるが、ＩＯ側の何等かの事故にょシ「（ホ）データ
伝送回線の開放」が実行されない時はこのシステムはハ
ングアップの状態となり爾後のデータ転送が不能となる
。
このハングアップの状態からシステムを回復させるため
の回復処理として従来実行されている方法は （ａ） 各ＩＯにウォッチドッグタイマ（Ｗａｔｃｈ
ｄｏｇｔｉｍｅｒ ）回路を設け、当該■０が所定の動
作を実行するときこのタイマ回路をセットする。タイマ
回路はセットされた時点からあらがじめ定められた時間
が経過するとオーバフロー（ｏｖｅｒｆｏｗ ）信号を
出力しこのオーバフロー信号によって当該ＩＯの状態を
Ｈ［定の初期状態にリセットする。この初期状態ではデ
ータ伝送回線を開放した状態になるので、ハングアップ
状態から回復する。
の回復処理として従来実行されている方法は （ａ） 各ＩＯにウォッチドッグタイマ（Ｗａｔｃｈ
ｄｏｇｔｉｍｅｒ ）回路を設け、当該■０が所定の動
作を実行するときこのタイマ回路をセットする。タイマ
回路はセットされた時点からあらがじめ定められた時間
が経過するとオーバフロー（ｏｖｅｒｆｏｗ ）信号を
出力しこのオーバフロー信号によって当該ＩＯの状態を
Ｈ［定の初期状態にリセットする。この初期状態ではデ
ータ伝送回線を開放した状態になるので、ハングアップ
状態から回復する。
（ｂｌ 通信情報自体に回復信号を含めて伝送し、Ｉ（
１１１１１がこの回復信号を検出して初期状態にリセッ
トする。
１１１１１がこの回復信号を検出して初期状態にリセッ
トする。
従来の回復処理は上述のように実行されるので、伽）の
場合、データ伝送回線の接続ができないような事故が原
因となってハングアップ状態になっている場合は当該１
０ に通信情報を伝送することができないので、ハング
アップ状態からの回復が不能となシ、また（ａｌの場合
は１０自体で独自に回復されるためＣＰＵ ｆｉ＋では
回復が認識できないという欠点があった。
場合、データ伝送回線の接続ができないような事故が原
因となってハングアップ状態になっている場合は当該１
０ に通信情報を伝送することができないので、ハング
アップ状態からの回復が不能となシ、また（ａｌの場合
は１０自体で独自に回復されるためＣＰＵ ｆｉ＋では
回復が認識できないという欠点があった。
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、この発明では各ＩＯにそれぞれ補
助処理装置を設けてこれを当該■。
めになされたもので、この発明では各ＩＯにそれぞれ補
助処理装置を設けてこれを当該■。
と並列に伝送路に接続し、この補助処理装置をＪ夕［定
の周期で初期化して常にＣＰＵがらの信号を受信できる
状態に保ち、ＣＰＵからこの補助処理装置を介してＷｉ
望の■０を初期状態にリセットして）ｚｌアップ状態か
ら回復するのである。
の周期で初期化して常にＣＰＵがらの信号を受信できる
状態に保ち、ＣＰＵからこの補助処理装置を介してＷｉ
望の■０を初期状態にリセットして）ｚｌアップ状態か
ら回復するのである。
以下この発明の実剣例を図面について故明する。
第２図はこの発明の一実施例を示すブロック図で、第２
図において第１図と同一符号は同−又は相当部分を示し
、（４１）、（４２）、 −（４ｎ）はそれぞれｌｏ（
２１） 。
図において第１図と同一符号は同−又は相当部分を示し
、（４１）、（４２）、 −（４ｎ）はそれぞれｌｏ（
２１） 。
（２２）、・・・（２ｎ）に付属する補助処理装置（図
面記号をＡＰＣとする）、（５υ、（５２）、 ・−（
５ｎ）は各補助処理装置から対応するＩＯに回復信号を
送出する回復信号線である。
面記号をＡＰＣとする）、（５υ、（５２）、 ・−（
５ｎ）は各補助処理装置から対応するＩＯに回復信号を
送出する回復信号線である。
第３図は補助処理装置の動作を示す動作タイムチャート
であって、同図（ａｔは補助処理装置に内蔵されるタイ
マの出力パルス１６１、同図ｆｂｌはデータ伝送回線の
接続（７）、同図（ｃｌはタイマブロック信号；８１、
同図（ｄｌ ｉｌ、Ｊ：データリンク確立（９）、同図
（ｅ）はＣＰＵ ｔｌｌから補助処理装置への情報の伝
送ＵＯ＋ 、同図（ｆ＋は補助処理装置からＩＱに送出
する外部回復信号を示す。
であって、同図（ａｔは補助処理装置に内蔵されるタイ
マの出力パルス１６１、同図ｆｂｌはデータ伝送回線の
接続（７）、同図（ｃｌはタイマブロック信号；８１、
同図（ｄｌ ｉｌ、Ｊ：データリンク確立（９）、同図
（ｅ）はＣＰＵ ｔｌｌから補助処理装置への情報の伝
送ＵＯ＋ 、同図（ｆ＋は補助処理装置からＩＱに送出
する外部回復信号を示す。
各補助処理装置は内蔵タイマの出力パルス（６）によっ
て初１υＪ状態にリセットされるので、瞬間停電の場合
、或はサージ電圧が進入した場合等のように対応Ｉ（Ｊ
と同時に故障状態になったとしても、ＣＰＵ’ ｔｌｌ
からの装求イぎ号を受１６できぬ状態のままに保たれる
ことはない。
て初１υＪ状態にリセットされるので、瞬間停電の場合
、或はサージ電圧が進入した場合等のように対応Ｉ（Ｊ
と同時に故障状態になったとしても、ＣＰＵ’ ｔｌｌ
からの装求イぎ号を受１６できぬ状態のままに保たれる
ことはない。
たとえは、ＩＱ（２ｎ）が故障した場合、ＣＰＵ ｔｌ
ｌは伝送路（３）を介して補助処理装置（４ｎ）に対し
て■０（２ｎ）の回復要求信号を伝送する。この伝送は
第３図に示す手順により実行され、補助処理装置（４ｎ
）はこの回復要求信号を受信し回復信号ｍ（５ｎ）を介
しｌｏ（２ｎ）に対し外部回復信号口）を送出する。１
０（２ｎ）はこの外部回復信号（団により初期状態にリ
セットされてハングアップ状態から回復する。
ｌは伝送路（３）を介して補助処理装置（４ｎ）に対し
て■０（２ｎ）の回復要求信号を伝送する。この伝送は
第３図に示す手順により実行され、補助処理装置（４ｎ
）はこの回復要求信号を受信し回復信号ｍ（５ｎ）を介
しｌｏ（２ｎ）に対し外部回復信号口）を送出する。１
０（２ｎ）はこの外部回復信号（団により初期状態にリ
セットされてハングアップ状態から回復する。
なお、第２図はマルチドロップ式データ伝送システムの
場合を示したが、ルーフ式データ伝送システムについて
も同様である。また補助処理装置への伝送手順を第３図
に示すものよりも簡略化することもできる。
場合を示したが、ルーフ式データ伝送システムについて
も同様である。また補助処理装置への伝送手順を第３図
に示すものよりも簡略化することもできる。
以上のようにこの発明によれば、一定期間毎に初期状態
にリセットされる補助処理装置を設け、この補助処理装
置を介してｃＰＵからＩＯを初期状態にリセットするの
で、ＩＯがデータ伝送回線接続不能の状態にある場合で
も確実に回復処理を行うことができる。
にリセットされる補助処理装置を設け、この補助処理装
置を介してｃＰＵからＩＯを初期状態にリセットするの
で、ＩＯがデータ伝送回線接続不能の状態にある場合で
も確実に回復処理を行うことができる。
第１図はマルチドロップ式データ伝送システムを示すブ
ロック図、第２図はこの発明の一実施例を示すブロック
図、第３図は補助“処理装置の動作を示す動作タイムチ
ャートである。 ＋１ｌ−ＣＰＵ 、（２１）、 （２２）、−（２ｎ）
−・・それぞれＩＯ。 （、引・・・伝送路、（４１） 、 （４２）、・・・
（４ｎ）・・・それぞれ補助処理装置内、（５１）、
（ｂ’ｌ） 、・・・（５ｎ）・・・それぞれ回復信号
線。 尚、谷図中同−符号は同−又は相当部分を示す。 代理人 大岩増雄 第１図 第２図
ロック図、第２図はこの発明の一実施例を示すブロック
図、第３図は補助“処理装置の動作を示す動作タイムチ
ャートである。 ＋１ｌ−ＣＰＵ 、（２１）、 （２２）、−（２ｎ）
−・・それぞれＩＯ。 （、引・・・伝送路、（４１） 、 （４２）、・・・
（４ｎ）・・・それぞれ補助処理装置内、（５１）、
（ｂ’ｌ） 、・・・（５ｎ）・・・それぞれ回復信号
線。 尚、谷図中同−符号は同−又は相当部分を示す。 代理人 大岩増雄 第１図 第２図
Claims (1)
- 【特許請求の範囲】 中央処理装置と複数の入出力装置とが共通の伝送路を介
して相互にデータ転送を行う場合に、入出力装置１１１
１１の原因により発生したハングアップ状態を回復する
ための計算機システムの回復処理装置Ｋにおいて、 各入出力装置に付蔵してそれぞれ設けられ上記共通の伝
送路に接続される各補助処理装置と、この各補助処理装
置内にそれぞれ設けられ、所定の周期で当該補助処理装
置の状態を初期化するタイマ装置と、 上記中央処理装置から任意の補助処理装置を指定して上
記共通の伝送路を介し回復要求信号を送出する手段と、 上記回復要求信号を受信した補助処理装置が、当該補助
処理装置と対応する入出力装置との間に設けられた回復
信号線を介して同値信号を送り上記対応する入出力装置
の状態を初期状態にリセットする手段とを備えたことを
特徴とする計算機システムの回復処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58237334A JPS60128741A (ja) | 1983-12-16 | 1983-12-16 | 計算機システムの回復処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58237334A JPS60128741A (ja) | 1983-12-16 | 1983-12-16 | 計算機システムの回復処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60128741A true JPS60128741A (ja) | 1985-07-09 |
Family
ID=17013835
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58237334A Pending JPS60128741A (ja) | 1983-12-16 | 1983-12-16 | 計算機システムの回復処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60128741A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6318741A (ja) * | 1986-07-10 | 1988-01-26 | Toshiba Corp | バスインタ−フエイス回路 |
| JPS6446343A (en) * | 1987-08-13 | 1989-02-20 | Fujitsu Ten Ltd | Fail safe circuit |
| JPH01303942A (ja) * | 1988-06-01 | 1989-12-07 | Hitachi Ltd | 通信制御システム |
| JPH0289441A (ja) * | 1988-09-27 | 1990-03-29 | Toshiba Corp | 伝送制御装置 |
| JPH03265244A (ja) * | 1990-03-14 | 1991-11-26 | Fujitsu Ltd | マルチドロップ接続端末回線切離し方式 |
| AU666959B2 (en) * | 1992-11-27 | 1996-02-29 | Fujitsu Limited | Data processing apparatus with function of effecting hang-up processing |
-
1983
- 1983-12-16 JP JP58237334A patent/JPS60128741A/ja active Pending
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6318741A (ja) * | 1986-07-10 | 1988-01-26 | Toshiba Corp | バスインタ−フエイス回路 |
| JPS6446343A (en) * | 1987-08-13 | 1989-02-20 | Fujitsu Ten Ltd | Fail safe circuit |
| JPH01303942A (ja) * | 1988-06-01 | 1989-12-07 | Hitachi Ltd | 通信制御システム |
| JP2528938B2 (ja) * | 1988-06-01 | 1996-08-28 | 株式会社日立製作所 | 通信制御システム |
| JPH0289441A (ja) * | 1988-09-27 | 1990-03-29 | Toshiba Corp | 伝送制御装置 |
| JPH03265244A (ja) * | 1990-03-14 | 1991-11-26 | Fujitsu Ltd | マルチドロップ接続端末回線切離し方式 |
| AU666959B2 (en) * | 1992-11-27 | 1996-02-29 | Fujitsu Limited | Data processing apparatus with function of effecting hang-up processing |
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