JPS60122461A - 電子機器 - Google Patents
電子機器Info
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- JPS60122461A JPS60122461A JP22907083A JP22907083A JPS60122461A JP S60122461 A JPS60122461 A JP S60122461A JP 22907083 A JP22907083 A JP 22907083A JP 22907083 A JP22907083 A JP 22907083A JP S60122461 A JPS60122461 A JP S60122461A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［技術分野］
本発明は電子式卓上計算機や電子式学習機等の電子機器
に関し、特に大型の液晶表示器を備えた電子機器に関す
る。
に関し、特に大型の液晶表示器を備えた電子機器に関す
る。
［従来技術］
従来の電子式卓上計算機（以下電卓という）には票数や
演算結果を表示するのみの電卓と、置数や演算結果を表
示すると共にプリンタにも出力して記録にとどめるプリ
ンタ付電卓とがある。プリンタ付電車は近年プリンタ自
体の価格低下もあり、かつ演算の結果が記録されてその
検算等を行う際に便利な点が評価されて、特に欧米諸国
において大量に販売されている。しかしながらプリンタ
伺電卓はそのトータルコストを引き下げるためにプリン
タの印字速度や信頼性を犠牲にしており、表示のみの電
卓に比べるとプリンタを採用している分なお価格が高い
にもかかわらず、印刷処理を含めたトータルの演算速度
は遅いのが現状である。また、プリンタ伺電卓は印字紙
の送り出しや活字の印刷のために表示のみの電卓に消費
される電力に比べて数段大きい電力を消費する。表示の
みの電卓では例えば太陽電池による給電で十分まにあう
のに、プリンタ付電卓ではペンライトの電池より大きな
電力供給源を必要とする場合もある。
演算結果を表示するのみの電卓と、置数や演算結果を表
示すると共にプリンタにも出力して記録にとどめるプリ
ンタ付電卓とがある。プリンタ付電車は近年プリンタ自
体の価格低下もあり、かつ演算の結果が記録されてその
検算等を行う際に便利な点が評価されて、特に欧米諸国
において大量に販売されている。しかしながらプリンタ
伺電卓はそのトータルコストを引き下げるためにプリン
タの印字速度や信頼性を犠牲にしており、表示のみの電
卓に比べるとプリンタを採用している分なお価格が高い
にもかかわらず、印刷処理を含めたトータルの演算速度
は遅いのが現状である。また、プリンタ伺電卓は印字紙
の送り出しや活字の印刷のために表示のみの電卓に消費
される電力に比べて数段大きい電力を消費する。表示の
みの電卓では例えば太陽電池による給電で十分まにあう
のに、プリンタ付電卓ではペンライトの電池より大きな
電力供給源を必要とする場合もある。
［目自勺コ
本発明は上述従来技術に鑑みて成されたものであってそ
の目的とする所は、上述した如くトータルの演算速度、
形状、価格、信頼性、消費電力の点においてなお、優れ
ている表示式の電子機器であって、その処理の進行に伴
い実行経過の情報も−・目で知れるように複数行の表示
を可能とし、しかも表示情報の有する所定の性質につい
てその認識を容易なものとした電子機器を提供すること
にある。
の目的とする所は、上述した如くトータルの演算速度、
形状、価格、信頼性、消費電力の点においてなお、優れ
ている表示式の電子機器であって、その処理の進行に伴
い実行経過の情報も−・目で知れるように複数行の表示
を可能とし、しかも表示情報の有する所定の性質につい
てその認識を容易なものとした電子機器を提供すること
にある。
本発明の］二連した目的は例えば第１図に示す機能ブロ
ックの構成により達成される。図において、■はデータ
及びファンクションを入力するためのキーボード、２は
入力されたデータ及びファンクションに従って所定の演
算処理を実行する演算処理部、３は前記演算処理に係る
情報の表示、例えば置数や演算の実行経過、演算結果等
の情報の表示をする液晶表示器、４は演算処理部３の出
力する情報の所定の性質に従って液晶表示器３における
表示をネガティブ表示させることの可能な表示制御部で
ある。演算処理部２は具体的にはＲＡＭ 、ＲＯＭを備
えるマイクロプロセッサで構成Ｓれ、ＲＯＭに収納され
ているプログラムに従って所定の演算処理を実行し、該
演算処理に係る情報を一時的にＲＡＭに記憶させ、必要
なときに必要な部分の情報をＲＡＭより読み出して液晶
表示器３に表示させるものである。
ックの構成により達成される。図において、■はデータ
及びファンクションを入力するためのキーボード、２は
入力されたデータ及びファンクションに従って所定の演
算処理を実行する演算処理部、３は前記演算処理に係る
情報の表示、例えば置数や演算の実行経過、演算結果等
の情報の表示をする液晶表示器、４は演算処理部３の出
力する情報の所定の性質に従って液晶表示器３における
表示をネガティブ表示させることの可能な表示制御部で
ある。演算処理部２は具体的にはＲＡＭ 、ＲＯＭを備
えるマイクロプロセッサで構成Ｓれ、ＲＯＭに収納され
ているプログラムに従って所定の演算処理を実行し、該
演算処理に係る情報を一時的にＲＡＭに記憶させ、必要
なときに必要な部分の情報をＲＡＭより読み出して液晶
表示器３に表示させるものである。
［実施例］
以下、図面に従って本発明に係る一実施例の電卓を詳細
に説明する。第２図は一実施例の電卓の外観を示す斜視
図である。図において、７は電卓本体、１は置数や演算
実行指令を入力するためのキーボード、３Ｉは液晶表示
器３の表示画面であり演算実行経過を表示する表示領域
３２と置数及び演算結果を表示する表示領域３３とにそ
の使用目的が分けられている。６は電卓の給電源である
ソーラバッテリである。
に説明する。第２図は一実施例の電卓の外観を示す斜視
図である。図において、７は電卓本体、１は置数や演算
実行指令を入力するためのキーボード、３Ｉは液晶表示
器３の表示画面であり演算実行経過を表示する表示領域
３２と置数及び演算結果を表示する表示領域３３とにそ
の使用目的が分けられている。６は電卓の給電源である
ソーラバッテリである。
第３図は一実施例の電卓の構成を示すブロック図である
。図において、８は第１図の演算処理部２を具体的に実
現するマイクロプロセッサ（ＭＰＵ）であり、電卓本体
７の中に設けられている。
。図において、８は第１図の演算処理部２を具体的に実
現するマイクロプロセッサ（ＭＰＵ）であり、電卓本体
７の中に設けられている。
キー・ボードｌにはＭＰＵ８のタイミングパルスジェネ
レータＴＰＧで発生されるタイミング信号ＴＳが常に供
給され、操作者が任意のキーを押すと、信号ＴＳの１つ
がキー信号ＫＳの１つに連結されてＭＰＵ ８に押され
たキーを知らせる。ＭＰＵ８は上述のようにしてキーボ
ードｌから入力されたキー信号ＫＳを所定のコードに変
換するキー信号デコード回路ＫＤと、デコードされたコ
ード情報を−・時的に蓄えておくキーバッファレジスタ
ＫＢＲと、キーバッファレジスタＫＢＲからコード情報
を読み出し、その内容に従ってＲＯＭをアクセスし、Ｒ
ＯＭに格納されている置数命令や演算命令の処理手順に
従ってプログラムを進めるプログラムカウンタＰＣと、
プログラムカウンタＰＣによりＲＯＭから読み出された
マイクロ命令コードを一時的に記憶させるラッチ回路Ｌ
ＡＴと、及びラッチ回路ＬＡＴにあるマイクロ命令を分
解して各種ゲート回路（図示せず）、各種レジスタＡＲ
，ＢＲ，ＣＲ及び算術論理演算回路ＡＬＵに一連の制御
信号を出力するマトリックス回路ＭＡＴを含む。ここで
、レジスタＡＲ、ＢＲ。
レータＴＰＧで発生されるタイミング信号ＴＳが常に供
給され、操作者が任意のキーを押すと、信号ＴＳの１つ
がキー信号ＫＳの１つに連結されてＭＰＵ ８に押され
たキーを知らせる。ＭＰＵ８は上述のようにしてキーボ
ードｌから入力されたキー信号ＫＳを所定のコードに変
換するキー信号デコード回路ＫＤと、デコードされたコ
ード情報を−・時的に蓄えておくキーバッファレジスタ
ＫＢＲと、キーバッファレジスタＫＢＲからコード情報
を読み出し、その内容に従ってＲＯＭをアクセスし、Ｒ
ＯＭに格納されている置数命令や演算命令の処理手順に
従ってプログラムを進めるプログラムカウンタＰＣと、
プログラムカウンタＰＣによりＲＯＭから読み出された
マイクロ命令コードを一時的に記憶させるラッチ回路Ｌ
ＡＴと、及びラッチ回路ＬＡＴにあるマイクロ命令を分
解して各種ゲート回路（図示せず）、各種レジスタＡＲ
，ＢＲ，ＣＲ及び算術論理演算回路ＡＬＵに一連の制御
信号を出力するマトリックス回路ＭＡＴを含む。ここで
、レジスタＡＲ、ＢＲ。
ＣＲは四則演算時の被演算数や演算数などを保持するレ
ジスタとして用いられる。算術論理演算回路ＡＬＵはア
ダー回路を含みレジスタＡＲ。
ジスタとして用いられる。算術論理演算回路ＡＬＵはア
ダー回路を含みレジスタＡＲ。
ＢＲ、ＣＲ間のデータの加減算を実行し、またＲＡＭに
記憶されている情報とレジスタＡＲ。
記憶されている情報とレジスタＡＲ。
ＢＲ、ＣＲ間のデータの加減算を行う。ＲＯＭは読み出
し専用メモリでありこの中に所定の処理を実行するため
のマイクロ命令が収納されている。
し専用メモリでありこの中に所定の処理を実行するため
のマイクロ命令が収納されている。
ＲＡＭは読み書き可能のメモリであり、ＭＰＵ８のマト
リックス回路ＭＡＴで発生されるアドレス信号が指定す
る番地にＡＬＵで処理した情報をデータバスＤＢを介し
て書き込み、また必要に応じて、ＲＡＭに記憶されてい
る情報をデータバスＤＢを介してレジスタＡＲ，ＢＲ，
ＣＲ等に読み出す処理に用いられる。
リックス回路ＭＡＴで発生されるアドレス信号が指定す
る番地にＡＬＵで処理した情報をデータバスＤＢを介し
て書き込み、また必要に応じて、ＲＡＭに記憶されてい
る情報をデータバスＤＢを介してレジスタＡＲ，ＢＲ，
ＣＲ等に読み出す処理に用いられる。
表示制御部４は液晶表示器３に情報を表示させるための
表示制御回路ＬＤＩ、ＬＤ２を含む。実施例の表示制御
回路ＬＤＩは主に演算実行経過の表示を取り扱う。ＲＡ
Ｍに保存されている過去の演算実行経過の情報はその表
示に必要な部分がラッチ回路Ｌ Ａ ’Ｔに順々に読み
出され、図示しないが、表示制御部４の中にある表示タ
イミング処理回路の制御の下に表示制御回路ＬＤＩを介
して表示領域３２に表示される。また表示制御回路ＬＤ
２は主に置数や演算結果の表示を取り扱う。置数やＡＬ
Ｕで演算処理された結果はラッチ回路ＬＡＴを介して表
示制御部４に送られ、同様にして表示制御回路ＬＤ２を
介して表示領域３３に表示される。液晶表示器３の表示
画面は前述した如く演算実行経過を複数段に表示する表
示領域３２と置数や演算結果を表示する表示領域３３に
外見上分けられており、表示領域３２には四則演算マー
クのｒ＋Ｊ ｒ−Ｊ ｒＸＪ ｒ÷」等が演算データと
併せて表示される。ソーラバッテリ６は外部光を受けて
これを電力に変換し、演算処理部８に電力を供給する。
表示制御回路ＬＤＩ、ＬＤ２を含む。実施例の表示制御
回路ＬＤＩは主に演算実行経過の表示を取り扱う。ＲＡ
Ｍに保存されている過去の演算実行経過の情報はその表
示に必要な部分がラッチ回路Ｌ Ａ ’Ｔに順々に読み
出され、図示しないが、表示制御部４の中にある表示タ
イミング処理回路の制御の下に表示制御回路ＬＤＩを介
して表示領域３２に表示される。また表示制御回路ＬＤ
２は主に置数や演算結果の表示を取り扱う。置数やＡＬ
Ｕで演算処理された結果はラッチ回路ＬＡＴを介して表
示制御部４に送られ、同様にして表示制御回路ＬＤ２を
介して表示領域３３に表示される。液晶表示器３の表示
画面は前述した如く演算実行経過を複数段に表示する表
示領域３２と置数や演算結果を表示する表示領域３３に
外見上分けられており、表示領域３２には四則演算マー
クのｒ＋Ｊ ｒ−Ｊ ｒＸＪ ｒ÷」等が演算データと
併せて表示される。ソーラバッテリ６は外部光を受けて
これを電力に変換し、演算処理部８に電力を供給する。
また他の部分には演算処理部８を介して斥含電されてい
る。
る。
ここで、一実施例の電卓の具体的表示の−・態様を第４
図を参照して説明する。第４図（Ａ）はマイナスデータ
の表示をマイナスマークのみで表した従来の電卓に見ら
れる表示例であり、第４図（Ｂ）は本発明によりマイナ
スデータの表示をマイナスマークと共にその表示行の全
体をネガティブ表示したものである。
図を参照して説明する。第４図（Ａ）はマイナスデータ
の表示をマイナスマークのみで表した従来の電卓に見ら
れる表示例であり、第４図（Ｂ）は本発明によりマイナ
スデータの表示をマイナスマークと共にその表示行の全
体をネガティブ表示したものである。
ネガティブ表示する原理については第５図を参照して説
明する。実施例の液晶表示器３はセグメント表示方式の
液晶表示器である。勿論、ドツトマトリックス表示方式
のものについても同様にしてネガティブ表示が可能であ
る。図において、演算実行経過の正の情報は一般電卓と
同じように７つのセグメン）Ｓ＋〜Ｓ７の組合せの暗色
で表示され目、つ小数点はセグメントＳ９．３桁毎の位
取りはセグメントＳ８の夫々暗色で表示される。一方、
／へツクグラウンドになっているセグメントＳ、。は本
発明の特徴として、正の情報の表示の際にはセグメント
Ｓ１゜の電極間に電界を加え１ ず、従って液晶は光の方向と垂直に整列しており、光が
透過状態になっている。また負の情報の表示の際にはセ
グメン）Ｓｈｏの電極間に電界を加えるように制御し、
液晶は散乱状態になって光を吸収しこの部“分が暗色に
なってネガティブ表示可能となる。つまりこのような制
御をセグメ多トＳ、−Ｓ９と及びセグメン）Ｓ＋。との
間で反転制御するものである。
明する。実施例の液晶表示器３はセグメント表示方式の
液晶表示器である。勿論、ドツトマトリックス表示方式
のものについても同様にしてネガティブ表示が可能であ
る。図において、演算実行経過の正の情報は一般電卓と
同じように７つのセグメン）Ｓ＋〜Ｓ７の組合せの暗色
で表示され目、つ小数点はセグメントＳ９．３桁毎の位
取りはセグメントＳ８の夫々暗色で表示される。一方、
／へツクグラウンドになっているセグメントＳ、。は本
発明の特徴として、正の情報の表示の際にはセグメント
Ｓ１゜の電極間に電界を加え１ ず、従って液晶は光の方向と垂直に整列しており、光が
透過状態になっている。また負の情報の表示の際にはセ
グメン）Ｓｈｏの電極間に電界を加えるように制御し、
液晶は散乱状態になって光を吸収しこの部“分が暗色に
なってネガティブ表示可能となる。つまりこのような制
御をセグメ多トＳ、−Ｓ９と及びセグメン）Ｓ＋。との
間で反転制御するものである。
このようなネガティブ表示制御を具体的に可能とする表
示制御回路ＬＤＩの構成は第６図に示されている。尚、
表示制御回路ＬＤ２についても同様である。図において
、ＡＢはアドレスバスであり、必要なときにＭＰＵ８か
ら出力されるアドレス信号で表示制御回路ＬＤＩを指定
する。データバスＤＢには表示のためのデータ信号ＤＯ
〜Ｄ７が入力される。つまりＭＰＵ８がアドレスバス２ ＡＢを介して表示制御回路ＬＤＩを指定している時にデ
ータ信号Ｄｏ−Ｄ７が送られる。データ信号Ｄ７は負の
データを送る時には論理１であり正のデータを送る時に
は論理Ｏになっている。ＩＲはデータバスＤＢの情報入
力を一時的に記憶する並列入力のレジスタである。ＣＧ
は文字発生回路であり、レジスタＩＲにラッチされた情
報に応じて液晶表示器に記号表示出来る形のコードを発
生する回路である。具体的にはＲＯＭでよい。６１〜Ｇ
９は排他的論理和ゲートであり、その出力は信号■７即
ち前述した信号Ｄ７をラッチした信号の論理レベルによ
り変化させられる。つまり信号エフが論理１の時は文字
発生回路ＣＧ出力をインバートした信号を出力する。ま
た信号Ｉ７が論理０の時は文字発生回路ＣＧの出力をそ
のまま出力する。ＯＲはゲート０１〜Ｇ９の出力及び信
号エフを一時的に記憶する並列入力のレジスタである。
示制御回路ＬＤＩの構成は第６図に示されている。尚、
表示制御回路ＬＤ２についても同様である。図において
、ＡＢはアドレスバスであり、必要なときにＭＰＵ８か
ら出力されるアドレス信号で表示制御回路ＬＤＩを指定
する。データバスＤＢには表示のためのデータ信号ＤＯ
〜Ｄ７が入力される。つまりＭＰＵ８がアドレスバス２ ＡＢを介して表示制御回路ＬＤＩを指定している時にデ
ータ信号Ｄｏ−Ｄ７が送られる。データ信号Ｄ７は負の
データを送る時には論理１であり正のデータを送る時に
は論理Ｏになっている。ＩＲはデータバスＤＢの情報入
力を一時的に記憶する並列入力のレジスタである。ＣＧ
は文字発生回路であり、レジスタＩＲにラッチされた情
報に応じて液晶表示器に記号表示出来る形のコードを発
生する回路である。具体的にはＲＯＭでよい。６１〜Ｇ
９は排他的論理和ゲートであり、その出力は信号■７即
ち前述した信号Ｄ７をラッチした信号の論理レベルによ
り変化させられる。つまり信号エフが論理１の時は文字
発生回路ＣＧ出力をインバートした信号を出力する。ま
た信号Ｉ７が論理０の時は文字発生回路ＣＧの出力をそ
のまま出力する。ＯＲはゲート０１〜Ｇ９の出力及び信
号エフを一時的に記憶する並列入力のレジスタである。
またＣＯＮはレジスタＯＲの出力を時分割したタイミン
グで処理し液晶駆動に適した駆動電圧信号に変換する信
号変換回路である。
グで処理し液晶駆動に適した駆動電圧信号に変換する信
号変換回路である。
［効果］
以上述べた如く本発明によれば簡単な構成で例えばマイ
ナスデータの表示をネガティブ表示する事が可能となり
、プリンタ付電卓における赤印字処理と同様に一目瞭然
にマイナスデータの識別をする事ができる。
ナスデータの表示をネガティブ表示する事が可能となり
、プリンタ付電卓における赤印字処理と同様に一目瞭然
にマイナスデータの識別をする事ができる。
尚、上述した本発明の一実施例においては表示器にセグ
メント表示型の液晶表示器を用いた電卓について説明し
たが、ドツトマトリックス表示型の液晶表示器やディジ
トロン表示器等を使用したものでもよい。
メント表示型の液晶表示器を用いた電卓について説明し
たが、ドツトマトリックス表示型の液晶表示器やディジ
トロン表示器等を使用したものでもよい。
また文字発生回路ＣＧを表示制御部内に備えた４
場合を示したが文字発生回路ＣＧを外部の適当なＲＯＭ
で実現してもよい。
で実現してもよい。
要するに本発明の趣旨を逸脱しない範囲で種々応用可能
である。
である。
第１図は本発明の目的を達成するための−・例の機能ブ
ロック図、 第２図は本発明に係る一実施例の電卓の外観を示す斜視
図、 第３図は本発明に係る一実施例の電卓の構成を示すブロ
ック図、 第４図（Ａ）及び（Ｂ）は実施例の電卓の具体的な一表
示態様を徒来のものと対比して示す図、 第５図は本発明に係る一実施例の電卓の液晶表示器を拡
大して示す部分拡大図、 ５ 第６図は本発明に係る一実施例の電卓の表示制御回路の
構成を示す回路図である。 ここで、ｌ・・・キーボード、２・・・演算処理部、３
・・・液晶表示器、４・・・表示制御部、５・・・表示
制御信号、６・・・ソーラバッテリ、７・・・電車本体
である。 第４図 （Ａ） ’Ｂ） 一’ｑａｎ− 第６図
ロック図、 第２図は本発明に係る一実施例の電卓の外観を示す斜視
図、 第３図は本発明に係る一実施例の電卓の構成を示すブロ
ック図、 第４図（Ａ）及び（Ｂ）は実施例の電卓の具体的な一表
示態様を徒来のものと対比して示す図、 第５図は本発明に係る一実施例の電卓の液晶表示器を拡
大して示す部分拡大図、 ５ 第６図は本発明に係る一実施例の電卓の表示制御回路の
構成を示す回路図である。 ここで、ｌ・・・キーボード、２・・・演算処理部、３
・・・液晶表示器、４・・・表示制御部、５・・・表示
制御信号、６・・・ソーラバッテリ、７・・・電車本体
である。 第４図 （Ａ） ’Ｂ） 一’ｑａｎ− 第６図
Claims (4)
- （１）データ及びファンクションを入力するキーボード
と、該データ及びファンクションに従って所定の演算処
理を実行する演算処理手段と、前記演算処理に係る情報
の表示をする表示手段と、該表示手段の表示の一部又は
全部をネガティブ表示させることの可能な表示制御手段
を備え、該表示制御手段は前記演算処理手段の出力する
情報の性質に応じてその情報をネガティブ表示させるこ
とを特徴とする電子機器。 - （２）表示手段は情報を複数行に表示可能な液晶表示器
より成ることを特徴とする特許請求の範囲第１項に記載
の電子機器。 - （３）液晶表示器がセグメント表示型液晶表示器である
ことを特徴とする特許請求の範囲第２項に記載の電子機
器。 - （４）演算処理手段の出力する情報のうち負の情報であ
るものについてその表示をネガティブ表示させることを
特徴とする特許請求の範囲第１項から第３項までの何れ
かに記載の電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22907083A JPS60122461A (ja) | 1983-12-06 | 1983-12-06 | 電子機器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22907083A JPS60122461A (ja) | 1983-12-06 | 1983-12-06 | 電子機器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60122461A true JPS60122461A (ja) | 1985-06-29 |
Family
ID=16886261
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22907083A Pending JPS60122461A (ja) | 1983-12-06 | 1983-12-06 | 電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60122461A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2858695A1 (fr) * | 2003-10-10 | 2005-02-11 | Alain Henri Bernard Chemla | Calculateur personnel. |
| JP2007071237A (ja) * | 2005-09-05 | 2007-03-22 | Shibusho Kensetsu:Kk | 油圧回路及び電気制御回路並びに油圧モータ切断装置 |
-
1983
- 1983-12-06 JP JP22907083A patent/JPS60122461A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2858695A1 (fr) * | 2003-10-10 | 2005-02-11 | Alain Henri Bernard Chemla | Calculateur personnel. |
| EP1522929A2 (fr) * | 2003-10-10 | 2005-04-13 | Alain Henri Bernard Chemla | Calculateur personnel |
| EP1522929A3 (fr) * | 2003-10-10 | 2006-08-23 | Alain Henri Bernard Chemla | Calculateur personnel |
| CN100380357C (zh) * | 2003-10-10 | 2008-04-09 | 阿兰·亨利·贝尔纳·尚拉 | 个人计算器 |
| JP2007071237A (ja) * | 2005-09-05 | 2007-03-22 | Shibusho Kensetsu:Kk | 油圧回路及び電気制御回路並びに油圧モータ切断装置 |
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