JPS60121843A - デ−タ通信方式 - Google Patents
デ−タ通信方式Info
- Publication number
- JPS60121843A JPS60121843A JP58229402A JP22940283A JPS60121843A JP S60121843 A JPS60121843 A JP S60121843A JP 58229402 A JP58229402 A JP 58229402A JP 22940283 A JP22940283 A JP 22940283A JP S60121843 A JPS60121843 A JP S60121843A
- Authority
- JP
- Japan
- Prior art keywords
- transmission
- data
- bit
- control
- code
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
- H04L5/16—Half-duplex systems; Simplex/duplex switching; Transmission of break signals non-automatically inverting the direction of transmission
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Bidirectional Digital Transmission (AREA)
- Communication Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）３発明の技術分野
本発明は、データ通信方式に係り、特にコード化されて
いないバイナリデータを調歩同期方式によ喚送受信する
方式に関する。
いないバイナリデータを調歩同期方式によ喚送受信する
方式に関する。
（ｂ）、技術の背景
ディジタルｉｎ？Ｈ処理やデータ通信の対象となるデー
タには、特定のコードを適用することなく単なるビット
列で形成されるバイナリデータも多く、其のデータ伝送
に就いては低速用の手軽な方式がなく、其の出現が望ま
れていた。
タには、特定のコードを適用することなく単なるビット
列で形成されるバイナリデータも多く、其のデータ伝送
に就いては低速用の手軽な方式がなく、其の出現が望ま
れていた。
（Ｃ）、従来技術と問題点
７単位、８単位の情報交換用符号及び基本型データ伝送
制御手順はＪＩＳも制定されているが、コードに制約が
あるため任意のバイナリデータの伝送には使用不可能で
ある。一方、バイナリデータの伝送が可能な方式として
はハイレヘルデータリンク制御手順があるが、商級で複
雑なため経済的ではない場合が多々あった。従って、比
較的低速回線にも適用可能で簡易な半２重通信、 １！
ａ歩同期方式によるものが期待されていた。
制御手順はＪＩＳも制定されているが、コードに制約が
あるため任意のバイナリデータの伝送には使用不可能で
ある。一方、バイナリデータの伝送が可能な方式として
はハイレヘルデータリンク制御手順があるが、商級で複
雑なため経済的ではない場合が多々あった。従って、比
較的低速回線にも適用可能で簡易な半２重通信、 １！
ａ歩同期方式によるものが期待されていた。
（ｄ）９発明の目的
本発明の目的は、前記の問題点を解決するため、比較的
低速回線にも適用可能で簡易な、半２重通信、調歩同期
方式によるバイナリデータの伝送方式を提供することに
ある。
低速回線にも適用可能で簡易な、半２重通信、調歩同期
方式によるバイナリデータの伝送方式を提供することに
ある。
（ｅ）１発明の構成
前記の目的は、調歩同期方式により半２重通信を行うデ
ータ通信システムに於いて、伝送制御キャラクタとして
しては７単位符号にパリティビットを付加する８単位符
号を使用して８単位伝送を行い、バイナリデータは８単
位区切とし、パリティビットを付加して９単位伝送を行
うことにより、前記バイナリデータを送受信す−ること
を特徴とするデータ通信方式により達成される。
ータ通信システムに於いて、伝送制御キャラクタとして
しては７単位符号にパリティビットを付加する８単位符
号を使用して８単位伝送を行い、バイナリデータは８単
位区切とし、パリティビットを付加して９単位伝送を行
うことにより、前記バイナリデータを送受信す−ること
を特徴とするデータ通信方式により達成される。
（ｆ）０発明の実施例
本発明の実施例を図によって説明する。第１図は本発明
の実施例に使用する７単位の伝送制御キャラクタに偶数
パリティ検査のだめのパリティピッ１−（以下、パリテ
ィピノ１−と略記する）及び調歩同期のためのスター１
−ピノ（−、ストップビットを付加した場合のヒツト配
列を示し、第２図は本実施例の送受信装置の構成図、第
３図、第４図は人々本発明の実施例の正常時、界雷時の
シーゲンスチャ−１−である。
の実施例に使用する７単位の伝送制御キャラクタに偶数
パリティ検査のだめのパリティピッ１−（以下、パリテ
ィピノ１−と略記する）及び調歩同期のためのスター１
−ピノ（−、ストップビットを付加した場合のヒツト配
列を示し、第２図は本実施例の送受信装置の構成図、第
３図、第４図は人々本発明の実施例の正常時、界雷時の
シーゲンスチャ−１−である。
図に於いて、７Ｕ、８Ｕは夫々７単位、８単位モードを
示し、ＳＴ、ＳＰは夫々スタートビット。
示し、ＳＴ、ＳＰは夫々スタートビット。
ストノブピノｈ、Ｐはパリティビット、ｂｌ、ｂ２・・
・ｂ８はヒソ１−位置、ＥＮＱ、ΔＣＫ、ＮＡＫ。
・ｂ８はヒソ１−位置、ＥＮＱ、ΔＣＫ、ＮＡＫ。
１２、ＴＸは夫々間合ねセ、肯定応答、否定応答、テキ
スト終結符号、ＰＥはパリティエラー、Ｉ）Ｔばバイナ
リデータ、ＳＲ３は送受信装置、ＳＲは送受信部１Ｍば
メモリ、Ｃは制御部、ｄはデータ線。
スト終結符号、ＰＥはパリティエラー、Ｉ）Ｔばバイナ
リデータ、ＳＲ３は送受信装置、ＳＲは送受信部１Ｍば
メモリ、Ｃは制御部、ｄはデータ線。
ｉは制御線、１は伝送線を示す。
始に、本実施例に使用する伝送制御キャラクタに就いて
説明する。第１図に示す論理″０”＋ ８６理″１”に
よって表されたピッ１−配列の間合わせ符号ＭＮＱ、肯
定応答符号ΔＣＫ、否ボ応答符号ＮＡＫ、テキスト終結
符号ＥＴＸ （Ｊ Ｉ ３７単位コード）の符号（以下
、ＥＮＱ、ＡＣＫ、ＮＡＫ。
説明する。第１図に示す論理″０”＋ ８６理″１”に
よって表されたピッ１−配列の間合わせ符号ＭＮＱ、肯
定応答符号ΔＣＫ、否ボ応答符号ＮＡＫ、テキスト終結
符号ＥＴＸ （Ｊ Ｉ ３７単位コード）の符号（以下
、ＥＮＱ、ＡＣＫ、ＮＡＫ。
Ｅ Ｔ Ｘと略記する）に夫々パリティヒツト１）を付
加した符号を７単位符何と略記し、更に調歩同期のため
スター１−ビットＳＴ、ストノブビットＳＰを加えたヒ
ント列を７単位モード（図に於いては７Ｕ）と略記する
ことにする。
加した符号を７単位符何と略記し、更に調歩同期のため
スター１−ビットＳＴ、ストノブビットＳＰを加えたヒ
ント列を７単位モード（図に於いては７Ｕ）と略記する
ことにする。
７単位モードのビット列を、８単位の情報ヒツトにパリ
ティピノＩ−１）を（＝Ｊ加し更にスタートピノ）ＳＴ
、 ストップビットＳＰを加えたヒフ１−列（以］・、
８単位モード、図に於いては８Ｕと略記する）と比較す
ると、７単位モードに於けるバリティビｙ Ｉ−Ｐ 、
ストップビットＳＰは、夫々８単位モードのｂ８．パリ
ティピノ１−■）のビット位置に当たっている。従って
、７単位モードで送信される単独の前記７単位符号を８
単位モードで受信すると、７単位モードのストップビッ
トＳＰは全て論理” １ ”であるため、８単位モード
ではパリティヒツトＰが論理” １ ”であると見なさ
れるので、全てパリティエラーＰＥが発生ずることにな
る。
ティピノＩ−１）を（＝Ｊ加し更にスタートピノ）ＳＴ
、 ストップビットＳＰを加えたヒフ１−列（以］・、
８単位モード、図に於いては８Ｕと略記する）と比較す
ると、７単位モードに於けるバリティビｙ Ｉ−Ｐ 、
ストップビットＳＰは、夫々８単位モードのｂ８．パリ
ティピノ１−■）のビット位置に当たっている。従って
、７単位モードで送信される単独の前記７単位符号を８
単位モードで受信すると、７単位モードのストップビッ
トＳＰは全て論理” １ ”であるため、８単位モード
ではパリティヒツトＰが論理” １ ”であると見なさ
れるので、全てパリティエラーＰＥが発生ずることにな
る。
本発明はこの点に着目したものである。
次ぎに送受信装置について説明する、第２図に示す送受
信装置Ｓ ｌ？ Ｓば、送信時には、外部よりデータ入
出力線ｄによりメモリＭに送信ずべきデータ（バイナリ
−）を入力され、制御線ｉを経て制御部Ｃに送信指示を
受けると送信動作に入る。
信装置Ｓ ｌ？ Ｓば、送信時には、外部よりデータ入
出力線ｄによりメモリＭに送信ずべきデータ（バイナリ
−）を入力され、制御線ｉを経て制御部Ｃに送信指示を
受けると送信動作に入る。
制御部Ｃの制御により送受信部Ｓ Ｒは調歩同期方式に
より伝送制御符号は７単位モードで送受信し、データは
８単位区切とし、其の８単位毎にパリティビットＰを付
加して８単位モードで送信を行うようにモート切り替え
機能を有し、受信側から再送要求をうけた場合はメモリ
ＭからｐＪ度送信出来るようになっている。
より伝送制御符号は７単位モードで送受信し、データは
８単位区切とし、其の８単位毎にパリティビットＰを付
加して８単位モードで送信を行うようにモート切り替え
機能を有し、受信側から再送要求をうけた場合はメモリ
ＭからｐＪ度送信出来るようになっている。
受信時には、制御部Ｃの制御により送受信部ＳＲは、相
手側の送受信装置Ｓ ＲＳから伝送線ｌを経て調歩同期
方式により到来する信号に対して、伝送制御符号は７単
位モードで送受信し、データは情報ビット８単位にパリ
ティビットＰを付加し。
手側の送受信装置Ｓ ＲＳから伝送線ｌを経て調歩同期
方式により到来する信号に対して、伝送制御符号は７単
位モードで送受信し、データは情報ビット８単位にパリ
ティビットＰを付加し。
た前記８単位モードで受信を行うようにモート切り替え
が出来、偶数パリティチ検査を行いつつメモリＭにデー
タ（バイナリ−）を格納するようになっている。パリテ
ィエラーが発生した場合は相手側に回送要求を行い、相
手側の再送をメモリＭへ角度受信出来るようになってお
り、又、受信した伝送制御符号の確認のためにパリティ
エラーの発生回数の計数と発生時間間隔のチェックとを
行う機能をもっている。受信を完了すると、制御部Ｃは
、制御線ｉにより受信完了を外部に指示し、メモリＭに
受信されたデータ（バイナリ−）をデータ入出力線ｄを
経て外部へ出力するようになっている。動作に就いて以
下第３図、第４図に示すソーケンスチャー１−により説
明する。
が出来、偶数パリティチ検査を行いつつメモリＭにデー
タ（バイナリ−）を格納するようになっている。パリテ
ィエラーが発生した場合は相手側に回送要求を行い、相
手側の再送をメモリＭへ角度受信出来るようになってお
り、又、受信した伝送制御符号の確認のためにパリティ
エラーの発生回数の計数と発生時間間隔のチェックとを
行う機能をもっている。受信を完了すると、制御部Ｃは
、制御線ｉにより受信完了を外部に指示し、メモリＭに
受信されたデータ（バイナリ−）をデータ入出力線ｄを
経て外部へ出力するようになっている。動作に就いて以
下第３図、第４図に示すソーケンスチャー１−により説
明する。
正常動作のシーケンスチャートは第３図に示されている
。通信を行っていないアイドル状態では、送信、受信側
共に７単位モードになワている。重席動作では、送信側
で、メモリＭへのデータを準備し制御部Ｃが送信指示を
受けると、制御部Ｃの制御により送受信部Ｓ ＲはＥＮ
Ｑを送信する。受信側送受信装置ＳＲ８の送受信部ＳＲ
では、これを受信して制御部Ｃの制御により肯定応答符
号ＡＣＫを返信し、次いで８単位モードに切り替わる。
。通信を行っていないアイドル状態では、送信、受信側
共に７単位モードになワている。重席動作では、送信側
で、メモリＭへのデータを準備し制御部Ｃが送信指示を
受けると、制御部Ｃの制御により送受信部Ｓ ＲはＥＮ
Ｑを送信する。受信側送受信装置ＳＲ８の送受信部ＳＲ
では、これを受信して制御部Ｃの制御により肯定応答符
号ＡＣＫを返信し、次いで８単位モードに切り替わる。
送信側はＡＣＫを受信すると８単位モードに切り替わり
、次ぎに８単位モートでハイチリデ−タＤＴ（以下、デ
ータＤＴと略記する）を送信する。
、次ぎに８単位モートでハイチリデ−タＤＴ（以下、デ
ータＤＴと略記する）を送信する。
送信側はデータ送信が終わると、７単位モートにｑｊり
替わり、受信側からＡ ＣＫが返信されるまで、一定時
間（８単位モード調歩同期方式伝送に於＆Ｊる各８単位
符号の伝送時間間隔の２倍以上）置きに、Ｅ Ｔ Ｘを
繰り返し送信する。
替わり、受信側からＡ ＣＫが返信されるまで、一定時
間（８単位モード調歩同期方式伝送に於＆Ｊる各８単位
符号の伝送時間間隔の２倍以上）置きに、Ｅ Ｔ Ｘを
繰り返し送信する。
受信側では、８単位モードであるためこの７単位モード
のＥＴＸばパリティエラー（図に於いてはＰＥと略記す
る）となるか、単なるデータのパリティエラーなのかテ
キスト終結の意味でのＥＴＸであるのかを確かめるため
、パリティエラーの発生時間間隔が予め定められている
前記のＥ Ｔ Ｘの時間間隔と一致するかどうかをチェ
ックする。
のＥＴＸばパリティエラー（図に於いてはＰＥと略記す
る）となるか、単なるデータのパリティエラーなのかテ
キスト終結の意味でのＥＴＸであるのかを確かめるため
、パリティエラーの発生時間間隔が予め定められている
前記のＥ Ｔ Ｘの時間間隔と一致するかどうかをチェ
ックする。
一致した場合はく本実施例では、パリティエラーを３回
数え、其の発生時間間隔が予め定められた時間間隔であ
ることを確認するものとして図示されている）、７単位
モードに切り替えて、其の後のＥ ”Ｔ” Ｘが王宮に
受信されると、Ａ ＣＫを送信する。送ｃｄ側はこのＡ
ＣＫ受信によりメモリＭ等をリセットして送信動作を
完了しアイドル状態に戻り、受信側は制御部Ｃから外部
に制御線ｌを経て指示し、メモリＭに受信されたデータ
Ｄ Ｔを入出力線ｄから出力して、受信動作を終わり、
アイドル状態に入る。
数え、其の発生時間間隔が予め定められた時間間隔であ
ることを確認するものとして図示されている）、７単位
モードに切り替えて、其の後のＥ ”Ｔ” Ｘが王宮に
受信されると、Ａ ＣＫを送信する。送ｃｄ側はこのＡ
ＣＫ受信によりメモリＭ等をリセットして送信動作を
完了しアイドル状態に戻り、受信側は制御部Ｃから外部
に制御線ｌを経て指示し、メモリＭに受信されたデータ
Ｄ Ｔを入出力線ｄから出力して、受信動作を終わり、
アイドル状態に入る。
次ぎにデータＤＴの伝送中に受信側の送受信部ＳＲが本
物のパリティエラーを検出した場合に就いて説明する。
物のパリティエラーを検出した場合に就いて説明する。
この場合は異常状態として第４図にシーケンスチャート
がしめされている。前記１児状態の場合と同様にしてデ
ータＤＴの伝送が開始される。データＤＴの受信中に受
信側の送受信部Ｓ Ｒがパリティエラーを検出すると、
パリティエラーが発生したことを記憶して置き、データ
Ｄ′Ｆのパリディエラーなのか、Ｅ ＴＸ受信によるパ
リティエラーなのかを確認するために、受信を続りて置
く。データＤＴの伝送が終わり、送信側から一定時間間
隔でのＥ Ｔ Ｘの受信によるパリティエラーの発生を
＠認して、７単位モードに９Ｊり替える。其の後、ＥＴ
Ｘを王宮に受信ずすることによりテキスト終結符号Ｉ三
ＴＸであることを確認した時、［Ｅ Ｔ Ｘによるパリ
ティエラーの発生より以前に前記のようにパリティエラ
ーが検出されている場合は、否定応答のＮＡＫを返送し
、メモリＭ等をリセノ１−シて、４１１゛送要求を行う
。 このＮＡＫによる再送要求を受けた送信側のメモリ
Ｍは、この場合リセットされていないので、送信側は１
（１び送信動作を開始する。
がしめされている。前記１児状態の場合と同様にしてデ
ータＤＴの伝送が開始される。データＤＴの受信中に受
信側の送受信部Ｓ Ｒがパリティエラーを検出すると、
パリティエラーが発生したことを記憶して置き、データ
Ｄ′Ｆのパリディエラーなのか、Ｅ ＴＸ受信によるパ
リティエラーなのかを確認するために、受信を続りて置
く。データＤＴの伝送が終わり、送信側から一定時間間
隔でのＥ Ｔ Ｘの受信によるパリティエラーの発生を
＠認して、７単位モードに９Ｊり替える。其の後、ＥＴ
Ｘを王宮に受信ずすることによりテキスト終結符号Ｉ三
ＴＸであることを確認した時、［Ｅ Ｔ Ｘによるパリ
ティエラーの発生より以前に前記のようにパリティエラ
ーが検出されている場合は、否定応答のＮＡＫを返送し
、メモリＭ等をリセノ１−シて、４１１゛送要求を行う
。 このＮＡＫによる再送要求を受けた送信側のメモリ
Ｍは、この場合リセットされていないので、送信側は１
（１び送信動作を開始する。
以上のように本発明の方式と其の動作により、ハイチリ
データは誤り制御イ１きて伝送することができる。
データは誤り制御イ１きて伝送することができる。
一定時間間隔で７単位モー１−゛の伝送制御符ｌぺの送
信を繰り返し、前記のよ−）４こ、これを８単位モード
で受けてパリティエラーとして監視することにより、７
ｍ位モードに切り替えて正常に受信することで確認する
方法は、送信側からのＥＮＱに対する受信側からのＡＣ
Ｋの返送が送信側へ不着の場合にも通用出来、ＥＮＱを
一定時間間隔で繰り返すことにして置くことにより、受
信側にＩ’： ＮＱを再度１密に受けさせてＡ ＣＫを
返送させ、圧密状態に戻すことが出来る。
信を繰り返し、前記のよ−）４こ、これを８単位モード
で受けてパリティエラーとして監視することにより、７
ｍ位モードに切り替えて正常に受信することで確認する
方法は、送信側からのＥＮＱに対する受信側からのＡＣ
Ｋの返送が送信側へ不着の場合にも通用出来、ＥＮＱを
一定時間間隔で繰り返すことにして置くことにより、受
信側にＩ’： ＮＱを再度１密に受けさせてＡ ＣＫを
返送させ、圧密状態に戻すことが出来る。
（ｇ）１発明の効果
本発明を実施すれば、比較的低速回線にも適用可能で、
簡易な半２重通信、δＢ３歩同期方式によるハイチリデ
ータの伝送を行うことか出来、経済化の効果がある。又
、バイナリデータの伝送かμＪ能であることは、データ
に関してはコート−は自由であることを意味し、伝送さ
れるデータはヨー１：化されたデータも伝送出来るので
、多種のこコート系を混用することを可能にする効果が
ある。
簡易な半２重通信、δＢ３歩同期方式によるハイチリデ
ータの伝送を行うことか出来、経済化の効果がある。又
、バイナリデータの伝送かμＪ能であることは、データ
に関してはコート−は自由であることを意味し、伝送さ
れるデータはヨー１：化されたデータも伝送出来るので
、多種のこコート系を混用することを可能にする効果が
ある。
第１図は本発明の実施例に使用する７単位の伝送制御キ
ャラクタにパリティヒツト及び調歩同期のタメのスター
トビア１−、ストノブピッｉ 全付加した場合のビット
配列を示し、第２図は本実施例の送受信装置の構成図、
第３図、第４図は夫々本発明の実施例の王宮時、界雷時
のシーケンスチャー１−である。 図に於いて、７ｔＪ、８Ｕは夫々７単位、８単位モード
を示し、ｓ′Ｆ、ｓｐは夫々スタートピッ１−。 ストップビット、Ｐはパリティビット、ｂｌ、ｂ２・・
・ｂ８はビット位置、Ｅ Ｎ Ｑ 、 Ａ ＣＫ 、
Ｎ Ａ Ｋ 。 Ｅ Ｔ Ｘは夫々間合わせ、肯定応答、否定応答、テキ
スト終結符号、ＰＥはパリティエラー、Ｄ１′はバイナ
リデータ、ＳＲ３は送受信装置、ＳＲは送受信部９Ｍは
メモリ、Ｃは制御部、ｄはデータ線。 ｉは制御線、■は伝送線をン１〈ず。 英 １ 囚 午 ２ 図 芋 ３ 図 茅 ４． 図
ャラクタにパリティヒツト及び調歩同期のタメのスター
トビア１−、ストノブピッｉ 全付加した場合のビット
配列を示し、第２図は本実施例の送受信装置の構成図、
第３図、第４図は夫々本発明の実施例の王宮時、界雷時
のシーケンスチャー１−である。 図に於いて、７ｔＪ、８Ｕは夫々７単位、８単位モード
を示し、ｓ′Ｆ、ｓｐは夫々スタートピッ１−。 ストップビット、Ｐはパリティビット、ｂｌ、ｂ２・・
・ｂ８はビット位置、Ｅ Ｎ Ｑ 、 Ａ ＣＫ 、
Ｎ Ａ Ｋ 。 Ｅ Ｔ Ｘは夫々間合わせ、肯定応答、否定応答、テキ
スト終結符号、ＰＥはパリティエラー、Ｄ１′はバイナ
リデータ、ＳＲ３は送受信装置、ＳＲは送受信部９Ｍは
メモリ、Ｃは制御部、ｄはデータ線。 ｉは制御線、■は伝送線をン１〈ず。 英 １ 囚 午 ２ 図 芋 ３ 図 茅 ４． 図
Claims (1)
- 調歩同期方式により半２重通信を行うデータ通信システ
ムに於いて、伝送制御キャラクタとしてしては７単位符
号にパリティビン１−を付加する８単位符号を使用し゛
ζ８単位伝送を行い、ノ＼イナリデー夕は８単位区切と
し、パリティピノ１−を付加して９単位伝送を行うこと
により、前記ノ＼”イナリデータを送受信することを特
徴とするデータ通信方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58229402A JPS60121843A (ja) | 1983-12-05 | 1983-12-05 | デ−タ通信方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58229402A JPS60121843A (ja) | 1983-12-05 | 1983-12-05 | デ−タ通信方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60121843A true JPS60121843A (ja) | 1985-06-29 |
Family
ID=16891643
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58229402A Pending JPS60121843A (ja) | 1983-12-05 | 1983-12-05 | デ−タ通信方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60121843A (ja) |
-
1983
- 1983-12-05 JP JP58229402A patent/JPS60121843A/ja active Pending
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