JPS594345A - デ−タ伝送系補正装置 - Google Patents
デ−タ伝送系補正装置Info
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- JPS594345A JPS594345A JP11294982A JP11294982A JPS594345A JP S594345 A JPS594345 A JP S594345A JP 11294982 A JP11294982 A JP 11294982A JP 11294982 A JP11294982 A JP 11294982A JP S594345 A JPS594345 A JP S594345A
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1876—Interpolating methods
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
- Optical Recording Or Reproduction (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、オーディオ信号等をＰＣＭコードに変換し
、これをデジタル再生処理する場合に訂正回路で補正命
令を指示された誤りデータを補正して出力するデータ伝
送系補正装置に関するものである。
、これをデジタル再生処理する場合に訂正回路で補正命
令を指示された誤りデータを補正して出力するデータ伝
送系補正装置に関するものである。
昨今、オーディオ信号をＰＣＭコードに変換して記録再
生する装置が開発されている。このＰＣＭコードは、オ
ーディオ信号をサンプリングし、量子化し、符号化した
ものであり、この符号化のときに伝送系、特に記録系に
発生するデジタル信号のドロップアウトを再生時に訂正
するための冗長ビットを付加している。この冗長ビット
はなるべく少なくして、訂正能力の高いものであること
が望ましい。
生する装置が開発されている。このＰＣＭコードは、オ
ーディオ信号をサンプリングし、量子化し、符号化した
ものであり、この符号化のときに伝送系、特に記録系に
発生するデジタル信号のドロップアウトを再生時に訂正
するための冗長ビットを付加している。この冗長ビット
はなるべく少なくして、訂正能力の高いものであること
が望ましい。
ここで、オーディオ信号をサンプリングして量子化した
デジタル信号を、１個の情報シンポルとする。そして、
この情報シンボルを何個かまとめて演算処理し、ノ寸す
テイシンボルと呼ばれる訂正用の冗長ビラトラ付加する
。これらの情報シンボルとパリティシンボルを１つにま
とめて１ブロツクと呼ぶ。
デジタル信号を、１個の情報シンポルとする。そして、
この情報シンボルを何個かまとめて演算処理し、ノ寸す
テイシンボルと呼ばれる訂正用の冗長ビラトラ付加する
。これらの情報シンボルとパリティシンボルを１つにま
とめて１ブロツクと呼ぶ。
従来、訂正回路のパリティシンボルによって情報シンボ
ルの誤りを訂正できる能力は１ブロツク中多くとも４個
ぐらいまでで、それ以上の誤りがあるときは訂正するこ
とができない。このように訂正できない場合には誤りの
情報シンボルをそのまま出すと雑音となるので、補正回
路を通して原波形に近い信号に直して出力する。
ルの誤りを訂正できる能力は１ブロツク中多くとも４個
ぐらいまでで、それ以上の誤りがあるときは訂正するこ
とができない。このように訂正できない場合には誤りの
情報シンボルをそのまま出すと雑音となるので、補正回
路を通して原波形に近い信号に直して出力する。
つまり、訂正能力が１ブロツク中２個の情報シンボルま
でとした場合、３個以上誤りがあるとき訂正できないば
かりでなく、１ブロツク中どの情報シンボルが何個誤っ
ているのかも判別できないため、１ブロック全体を補正
してしまうのが普通である。そこで、訂正回路では誤り
が３個以上あるブロックの全ての情報シンボルに補正命
令を意味する補正フラグを付加して補正回路へ出力する
。
でとした場合、３個以上誤りがあるとき訂正できないば
かりでなく、１ブロツク中どの情報シンボルが何個誤っ
ているのかも判別できないため、１ブロック全体を補正
してしまうのが普通である。そこで、訂正回路では誤り
が３個以上あるブロックの全ての情報シンボルに補正命
令を意味する補正フラグを付加して補正回路へ出力する
。
そして、上記補正回路では、補正フラグの付いた全ての
情報シンボルを平均値補正或いは前置保持により原波形
に近い信号に補正して出力するのである。
情報シンボルを平均値補正或いは前置保持により原波形
に近い信号に補正して出力するのである。
しかし、上記訂正回路で付加した補正フラグは、訂正す
べき情報シンボルの判別が不可能であるため、ブロック
全ての情報シンボルに付けたものと同様の状態となり、
上記補正回路ではブロック中の正しい情報シンボルまで
補正してしまうことになる。したがって、伝送系でドロ
ップアウトによる誤りの情報シンボルが多発して補正フ
ラグの付く情報シンボルが多くなると補正数も多くなり
、音質も劣化してくる。
べき情報シンボルの判別が不可能であるため、ブロック
全ての情報シンボルに付けたものと同様の状態となり、
上記補正回路ではブロック中の正しい情報シンボルまで
補正してしまうことになる。したがって、伝送系でドロ
ップアウトによる誤りの情報シンボルが多発して補正フ
ラグの付く情報シンボルが多くなると補正数も多くなり
、音質も劣化してくる。
この発明は上記欠点を改善して、例えば３個以上の情報
シンボルに誤りのあるブロックの情報シンボル全てに補
正フラグが付されたような場合でも、この補正フラグの
伺加された情報シンボルのうちで誤りのない正しい情報
シンボルはそのまま出力して、誤りの情報シンボルだけ
を補正するよう番こして、例えばオーディオ再生音の音
質を良質のものとするよう番こするデータ伝送系補正装
置を提供するものである。
シンボルに誤りのあるブロックの情報シンボル全てに補
正フラグが付されたような場合でも、この補正フラグの
伺加された情報シンボルのうちで誤りのない正しい情報
シンボルはそのまま出力して、誤りの情報シンボルだけ
を補正するよう番こして、例えばオーディオ再生音の音
質を良質のものとするよう番こするデータ伝送系補正装
置を提供するものである。
即ち、この発明におけるデータ伝送系補正装置は、入力
される被補正情報シンボルの前後のデータより計算され
る平均値或いは前置保持値等の予測値を基準にして補正
範囲を設定し、この範囲に入る被補正情報シンボルを正
しいものと判断してそのまま出力し、範囲外のものを誤
りと判断して予測値として計算した補正値を出力するよ
うにしたものである０ 〔発明の実施例〕 以下、図面についてこの発明の一実施例を説明する。
される被補正情報シンボルの前後のデータより計算され
る平均値或いは前置保持値等の予測値を基準にして補正
範囲を設定し、この範囲に入る被補正情報シンボルを正
しいものと判断してそのまま出力し、範囲外のものを誤
りと判断して予測値として計算した補正値を出力するよ
うにしたものである０ 〔発明の実施例〕 以下、図面についてこの発明の一実施例を説明する。
第１図は、ＰＣＭデジタル録音再生装置の基本構成を示
すもので、集音すべき音声はマイクロフォン１１で検知
し、その検知された音声をこ対応する電気的に変換され
た信号は、入力端子１２を介して増幅回路１３で増幅さ
れた後、帯域圧縮回路１４で所定周波数帯域内の信号に
レベル圧縮され、符号化回路１５に供給される。
すもので、集音すべき音声はマイクロフォン１１で検知
し、その検知された音声をこ対応する電気的に変換され
た信号は、入力端子１２を介して増幅回路１３で増幅さ
れた後、帯域圧縮回路１４で所定周波数帯域内の信号に
レベル圧縮され、符号化回路１５に供給される。
この符号化回路１５は、例えば図示しないローパスフィ
ルタ、サンプルホールド回路、マルチプレクサ回路およ
びＡ／Ｄ変換回路等により構成されるもので、上記帯域
圧縮回路１４からの出力信号を所定周期でサンプリング
しく標本化）、このサンプリングされたパルス状信号を
そのレベルに対応したデジタル信号＝情報シンボルに変
換して（量子化）、出力するものである。そして、この
符号化回路１５から出力された情報シンボルは、誤り検
出訂正符号付加回路１６にて、前述したように１ブロツ
ク毎に訂正用の冗長ビットであるパリティシンボルを付
加されて出力され、記録装置１７に記録される。
ルタ、サンプルホールド回路、マルチプレクサ回路およ
びＡ／Ｄ変換回路等により構成されるもので、上記帯域
圧縮回路１４からの出力信号を所定周期でサンプリング
しく標本化）、このサンプリングされたパルス状信号を
そのレベルに対応したデジタル信号＝情報シンボルに変
換して（量子化）、出力するものである。そして、この
符号化回路１５から出力された情報シンボルは、誤り検
出訂正符号付加回路１６にて、前述したように１ブロツ
ク毎に訂正用の冗長ビットであるパリティシンボルを付
加されて出力され、記録装置１７に記録される。
次に、上記のようにして記録装置１７に記録された内容
を再生する場合、記録装置１７より読み出された情報シ
ンボルは、データ伝送系補正装置１８で訂正および補正
されて復号化回路１９に供給される。この復号化回路１
９は、例えば図示しないＤ／Ａ変換回路、デマルチプレ
クサ回路およびローパスフィルタ等より構成されるもの
で、入力される情報シンボルをその値に対応シたレベル
のパルス状信号に変換し、このパルス状信号のレベルを
連続させてアナログ信号に変換して出力するものである
。そして、この復号化回路Ｉ９から出力されたアナログ
信号は、帯域伸張回路２０によって上記帯域圧縮回路１
４でレベル圧縮された所定周波数帯域内にてレベル伸張
された後、増幅回路２１で増幅され、出力端子２２を介
してスピーカー２３に供給され、ここにオーディオ信号
の再生が行なわれるものである。
を再生する場合、記録装置１７より読み出された情報シ
ンボルは、データ伝送系補正装置１８で訂正および補正
されて復号化回路１９に供給される。この復号化回路１
９は、例えば図示しないＤ／Ａ変換回路、デマルチプレ
クサ回路およびローパスフィルタ等より構成されるもの
で、入力される情報シンボルをその値に対応シたレベル
のパルス状信号に変換し、このパルス状信号のレベルを
連続させてアナログ信号に変換して出力するものである
。そして、この復号化回路Ｉ９から出力されたアナログ
信号は、帯域伸張回路２０によって上記帯域圧縮回路１
４でレベル圧縮された所定周波数帯域内にてレベル伸張
された後、増幅回路２１で増幅され、出力端子２２を介
してスピーカー２３に供給され、ここにオーディオ信号
の再生が行なわれるものである。
第２図は、上記再生系におけるデータ伝送系補正装置１
８の構成を示すもので、上記記録装置１１より伝送され
た情報シンボルは訂正回路２４に供給される。この訂正
回路２４は、上記誤り検出訂正符号付加回路１６にて付
加されたパリティシンボルによって各ブロック毎に誤り
を検出して訂正し、図示しない次段の′ＩＭ号化同化回
路１９力する回路であるが、前述したようにこの訂正能
力には限界があり、例えば訂正能力が１ブロック中２個
までとすると３個以上誤りが出た場合、どの情報シンボ
ルが誤りなのか判別できない。そこで、３個以上誤りの
あるブロックの全ての情報シンボル２５に補正フラグ２
６をそれぞれ付加して、例えば情報シンボルＤ （ｎ−
１） 、 Ｄ（ｎ） 、 Ｄ （ｎ＋１） ・・・・・
・（７］１！位テ出力し、補正回路２７に伝送する。
８の構成を示すもので、上記記録装置１１より伝送され
た情報シンボルは訂正回路２４に供給される。この訂正
回路２４は、上記誤り検出訂正符号付加回路１６にて付
加されたパリティシンボルによって各ブロック毎に誤り
を検出して訂正し、図示しない次段の′ＩＭ号化同化回
路１９力する回路であるが、前述したようにこの訂正能
力には限界があり、例えば訂正能力が１ブロック中２個
までとすると３個以上誤りが出た場合、どの情報シンボ
ルが誤りなのか判別できない。そこで、３個以上誤りの
あるブロックの全ての情報シンボル２５に補正フラグ２
６をそれぞれ付加して、例えば情報シンボルＤ （ｎ−
１） 、 Ｄ（ｎ） 、 Ｄ （ｎ＋１） ・・・・・
・（７］１！位テ出力し、補正回路２７に伝送する。
この補正回路２７は入力セレクタ２８を備え、この入力
セレクタ２８には訂正回路２４からの情報シンボルと、
および後述する出力セレクタ２９からのすでに補正処理
の行なわれた情報シンボルが供給される。ここで、訂正
回路２４からの情報シンボルをＤ （ｎ）、出力セレク
タ２９からの情報シンボルをその前のＤ（ｎ−１）と仮
定すると、入力セレクタ２８では制御信号８１）こよっ
て情報シンボルＤ （ｎ）とＤ（ｎ−ｉ）を切換選 ０ 択してメモリ３０に送る。このメモリＭはそれ−ぞれ１
つの情報シンボルとこれに付加される補正フラグを記憶
するメモリ領域Ｍ１およびＭ２を備え、入力セレクタ２
８で選択された情報シンボル］）（ｎ−１）はメモリ領
域Ｍ１に、Ｄ （ｎ）はメモリ領域Ｍ２にそれぞれ記憶
設定される。そして、メモリ領域Ｍ１に記憶された補正
処理済みの情報シンボルＤ（ｎ−１）は、ラッチ３１お
よび出力用ラッチ３２に読み出しラッチ記憶され、出力
用ラッチ３２のラッチ情報シンボルＤ（ｎ−ｔ）は図示
しない復号化回路１９に制御クロックＣＰＩＪこ対応し
て送られる。
セレクタ２８には訂正回路２４からの情報シンボルと、
および後述する出力セレクタ２９からのすでに補正処理
の行なわれた情報シンボルが供給される。ここで、訂正
回路２４からの情報シンボルをＤ （ｎ）、出力セレク
タ２９からの情報シンボルをその前のＤ（ｎ−１）と仮
定すると、入力セレクタ２８では制御信号８１）こよっ
て情報シンボルＤ （ｎ）とＤ（ｎ−ｉ）を切換選 ０ 択してメモリ３０に送る。このメモリＭはそれ−ぞれ１
つの情報シンボルとこれに付加される補正フラグを記憶
するメモリ領域Ｍ１およびＭ２を備え、入力セレクタ２
８で選択された情報シンボル］）（ｎ−１）はメモリ領
域Ｍ１に、Ｄ （ｎ）はメモリ領域Ｍ２にそれぞれ記憶
設定される。そして、メモリ領域Ｍ１に記憶された補正
処理済みの情報シンボルＤ（ｎ−１）は、ラッチ３１お
よび出力用ラッチ３２に読み出しラッチ記憶され、出力
用ラッチ３２のラッチ情報シンボルＤ（ｎ−ｔ）は図示
しない復号化回路１９に制御クロックＣＰＩＪこ対応し
て送られる。
同時に、訂正回路２４から上記情報シンボルＤ （ｎｌ
につづく情報シンボルＤ（ｎ−４−＋）が入力セレクタ
２８に供給され、この情報シンポ）しｎ（ｎｌｔ）はメ
モリ３０のメモリ領域Ｍ１に記憶設定される。そして、
この情報シンボル・Ｄ（ｎ−）−１）は補正値演算回路
３３に供給する。
につづく情報シンボルＤ（ｎ−４−＋）が入力セレクタ
２８に供給され、この情報シンポ）しｎ（ｎｌｔ）はメ
モリ３０のメモリ領域Ｍ１に記憶設定される。そして、
この情報シンボル・Ｄ（ｎ−）−１）は補正値演算回路
３３に供給する。
この補正値演算回路３３には前記ラッチ３１のラッチ情
報シンボルＤ（ｎ−ｓ）も供給されており、情報シンボ
ルＤ （ｎ）の前後両側の情報シンボルＤ（ｎ−＋）と
Ｊ）（ｎモりとの平均ｉＩＸ’（−演ＨＥする。すなわ
ち、補正値演算回路３３では、Ｄ （ｎ−１）＋Ｄ （
ｎ＋１）／ ２＝Ｈ（ｎｌの平均値演算を行ない、この
演算結果による予測値Ｈ（ｎ）は減算回路３４に供給す
る。この減算回路３４にはメモリ３θのメモリ領域Ｍ１
に記憶され、た情報シンボルＴ） （ｎ）も供給して、
Ｈ（ｎｌ −１） （川＝ Ｓ （ｎ）の演算を行ない
、その差分の情報Ｓ （ｎｌ （？対値）はゲート回路
３５に制御信号として供給する。
報シンボルＤ（ｎ−ｓ）も供給されており、情報シンボ
ルＤ （ｎ）の前後両側の情報シンボルＤ（ｎ−＋）と
Ｊ）（ｎモりとの平均ｉＩＸ’（−演ＨＥする。すなわ
ち、補正値演算回路３３では、Ｄ （ｎ−１）＋Ｄ （
ｎ＋１）／ ２＝Ｈ（ｎｌの平均値演算を行ない、この
演算結果による予測値Ｈ（ｎ）は減算回路３４に供給す
る。この減算回路３４にはメモリ３θのメモリ領域Ｍ１
に記憶され、た情報シンボルＴ） （ｎ）も供給して、
Ｈ（ｎｌ −１） （川＝ Ｓ （ｎ）の演算を行ない
、その差分の情報Ｓ （ｎｌ （？対値）はゲート回路
３５に制御信号として供給する。
このゲート回路３５は、例えば第３図に示すように構成
されるもので、ＮＯＲ回路３６とＡ Ｎ Ｄ 回路３７
ライ捕え、コ（Ｄ回％３６ 、３７ニ対して、例えば
８ピツトの情報Ｓ（ｎ＞（ＭＳＢは符号ピット）の上位
５ピッｌ−％並列に供給し、それぞれの回路３６．３７
の出力をＮＯＲ回路３８に接続する。すなわち、このゲ
ート回路３５は２の補数表示のコンプリメンタリコード
（・用い基漁とする予測値Ｈ（ｎｌを０として、−８か
ら＋７までの範囲を設定している。つまり、減算回路３
４より入力されるＨ（１１）とＩ）（ｎｌとの差分の情
報Ｓ（ロ）が、 一８≦Ｓ （ｎｌ≦＋７ となるとき、情報シンボルＤ（ｎｌ−’Ｐ正１７いもの
と判断してローレベルのＬ信号を、また、８（ｎ）≦−
８．＋７≦Ｓ （Ｉｔ） となるとき、情報シンボルＤ←）を誤りであると判断し
てハイレベルのＨ（ｉ号を、それぞれ制御信号Ｓ２とし
てＮＯＲ回路３８から出力する。
されるもので、ＮＯＲ回路３６とＡ Ｎ Ｄ 回路３７
ライ捕え、コ（Ｄ回％３６ 、３７ニ対して、例えば
８ピツトの情報Ｓ（ｎ＞（ＭＳＢは符号ピット）の上位
５ピッｌ−％並列に供給し、それぞれの回路３６．３７
の出力をＮＯＲ回路３８に接続する。すなわち、このゲ
ート回路３５は２の補数表示のコンプリメンタリコード
（・用い基漁とする予測値Ｈ（ｎｌを０として、−８か
ら＋７までの範囲を設定している。つまり、減算回路３
４より入力されるＨ（１１）とＩ）（ｎｌとの差分の情
報Ｓ（ロ）が、 一８≦Ｓ （ｎｌ≦＋７ となるとき、情報シンボルＤ（ｎｌ−’Ｐ正１７いもの
と判断してローレベルのＬ信号を、また、８（ｎ）≦−
８．＋７≦Ｓ （Ｉｔ） となるとき、情報シンボルＤ←）を誤りであると判断し
てハイレベルのＨ（ｉ号を、それぞれ制御信号Ｓ２とし
てＮＯＲ回路３８から出力する。
そして、このゲート回路３５からの出力制御信号Ｓ２は
前述した出力セレクタ２９に供給される。
前述した出力セレクタ２９に供給される。
この出力セレクタ２９は、前記メモリ領賊Ｍ２からの情
報シンボルＤ（ｎ）、ｇ、補正値演算回路３３からの予
測値ＩＩ（川を人力し、ゲート回路３５からの制御信号
Ｓ２に従って、Ｄ （ｎｌとＨ（ｎｌを切換出力する。
報シンボルＤ（ｎ）、ｇ、補正値演算回路３３からの予
測値ＩＩ（川を人力し、ゲート回路３５からの制御信号
Ｓ２に従って、Ｄ （ｎｌとＨ（ｎｌを切換出力する。
例えばゲート回路３５からの指令がＬ信号のとき、被補
正データの清掃シンボルＤ （ｎｌは正しいものと判断
されるのでＤ （ｎｌをそのまま出力し、Ｈ信号のとき
被補正データの情報シンボルＤｉｌは誤りであると判断
されるので、補正値として予測値Ｈ（ｎｌを出力して、
補正処理済み情報シンボルＤ（ｎ）として入力セレクタ
２８に送る。
正データの清掃シンボルＤ （ｎｌは正しいものと判断
されるのでＤ （ｎｌをそのまま出力し、Ｈ信号のとき
被補正データの情報シンボルＤｉｌは誤りであると判断
されるので、補正値として予測値Ｈ（ｎｌを出力して、
補正処理済み情報シンボルＤ（ｎ）として入力セレクタ
２８に送る。
即ち、記録装置１７より入力されるブロック毎にパリテ
ィシンボルを付したデジタル信号は訂正回路２４に伝送
され、訂正のできたブロックは次段の復号化回路へ出力
され、訂正不可能なブロックはそのブロック中食ての情
報シンボル２５に補正フラグ２６を付加されて補正回路
２７に送られる。そして、この補正フラグ２６を付した
情報シンボル２５は入力セレクタ２８を介してメモリ３
σに記憶され、減算回路３４及びゲート回路３５によっ
て補正値演算回路３３からの予測値と比較されて正しい
情報シンボルか否かを判別される。そして、被補正情報
シンボルと予測値を入力する出力セレクタ２９から、ゲ
ート回路３５からの制御信号により正しい情報と判断さ
れる場合にはそのまま出力され、誤りの場合には予測値
を補正値として出力されて、入力セレクタ２８、メモリ
３ｏを介して出力用ラッチ３２に入り、図示しない次段
の復号化回路へ送られるのである。
ィシンボルを付したデジタル信号は訂正回路２４に伝送
され、訂正のできたブロックは次段の復号化回路へ出力
され、訂正不可能なブロックはそのブロック中食ての情
報シンボル２５に補正フラグ２６を付加されて補正回路
２７に送られる。そして、この補正フラグ２６を付した
情報シンボル２５は入力セレクタ２８を介してメモリ３
σに記憶され、減算回路３４及びゲート回路３５によっ
て補正値演算回路３３からの予測値と比較されて正しい
情報シンボルか否かを判別される。そして、被補正情報
シンボルと予測値を入力する出力セレクタ２９から、ゲ
ート回路３５からの制御信号により正しい情報と判断さ
れる場合にはそのまま出力され、誤りの場合には予測値
を補正値として出力されて、入力セレクタ２８、メモリ
３ｏを介して出力用ラッチ３２に入り、図示しない次段
の復号化回路へ送られるのである。
第４図は、以上の補正回路において、あるサンプリング
値ｎ点に対する補正を示したもので、サンプリング値ｎ
点に対応する被補正情報シンボルをＤ（ｎｌ、ｎ点の前
後のサンプリング値（ｎ−１）及び（ｎ−）−＋）に対
応する情報シンボルをそれぞれＤ（ｎ−１）、Ｄ（口＋
１）とする。また、（ｎ−１）および（ｎ−１−’ｔ）
点でつくる平均値を予測値Ｈ（ｒｌ）とし、とのＨ（ｎ
ｒを基準とした上限の範囲をＨ＋Ｃｌ１ｌ、下限の範囲
（−Ｈ，−（ｎ）とする。
値ｎ点に対する補正を示したもので、サンプリング値ｎ
点に対応する被補正情報シンボルをＤ（ｎｌ、ｎ点の前
後のサンプリング値（ｎ−１）及び（ｎ−）−＋）に対
応する情報シンボルをそれぞれＤ（ｎ−１）、Ｄ（口＋
１）とする。また、（ｎ−１）および（ｎ−１−’ｔ）
点でつくる平均値を予測値Ｈ（ｒｌ）とし、とのＨ（ｎ
ｒを基準とした上限の範囲をＨ＋Ｃｌ１ｌ、下限の範囲
（−Ｈ，−（ｎ）とする。
このとき、ｎ点の情報シンボルＤ （ｎ）カＨ＋←）と
１（−（ｎ）の間にある場合には、Ｄ（ｎｌをそのまま
出力し、また、Ｈ＋（ｎｌとＨ−（ｎｌの範囲に入らな
い場合には、その情報シンボルを切り捨てて、補正値と
して予測値Ｈ（ｎ）を出力する。この範囲の幅を小さく
すると１．平均値補正量が多くなって、補正フラグのつ
いた正常な情報シンボルが救ゎれにくくなり、逆に範囲
の幅を大きくすると平均値補正量が減って補正フラグの
付いた正常な情報シンボルは救われやすくなるが、原波
形との差が大きくなってしまうので、補正フラグの付い
た情報シンボルのエラー率を考慮してこの範囲を決定す
る。
１（−（ｎ）の間にある場合には、Ｄ（ｎｌをそのまま
出力し、また、Ｈ＋（ｎｌとＨ−（ｎｌの範囲に入らな
い場合には、その情報シンボルを切り捨てて、補正値と
して予測値Ｈ（ｎ）を出力する。この範囲の幅を小さく
すると１．平均値補正量が多くなって、補正フラグのつ
いた正常な情報シンボルが救ゎれにくくなり、逆に範囲
の幅を大きくすると平均値補正量が減って補正フラグの
付いた正常な情報シンボルは救われやすくなるが、原波
形との差が大きくなってしまうので、補正フラグの付い
た情報シンボルのエラー率を考慮してこの範囲を決定す
る。
従って、予測値を基準に範囲を定めて補正回路ζこ入力
した補正フラグの付いた情報シンボルの正否を決定する
ようにすれば、正しい情報シンボルを通過させ、誤りの
情報シンボルヲ補正値に直して出方するようになる。
した補正フラグの付いた情報シンボルの正否を決定する
ようにすれば、正しい情報シンボルを通過させ、誤りの
情報シンボルヲ補正値に直して出方するようになる。
以上のようにこの発明によれば、補正回路に入力される
補正フラグの付いた情報シンボルの前後のデータより計
算する平均値や前置保持値等の予測値を基準とした一定
の範囲を設定し、この範囲に入る情報シンボルを正しい
データと判断してそのまま出方させ、範囲外のものを誤
りと判断して補正値として予測値を出方させることによ
り、伝送系のドロップアウトによる誤りが多発して、訂
正回路より補正回路へ送られる補正フラグの付いた情報
シンボルが多くなっても、正しい情報シンボルだけを救
うことができ、補正量も少なくなるので、音質劣化を減
らずことができる。
補正フラグの付いた情報シンボルの前後のデータより計
算する平均値や前置保持値等の予測値を基準とした一定
の範囲を設定し、この範囲に入る情報シンボルを正しい
データと判断してそのまま出方させ、範囲外のものを誤
りと判断して補正値として予測値を出方させることによ
り、伝送系のドロップアウトによる誤りが多発して、訂
正回路より補正回路へ送られる補正フラグの付いた情報
シンボルが多くなっても、正しい情報シンボルだけを救
うことができ、補正量も少なくなるので、音質劣化を減
らずことができる。
第１図はＰＣＭデジタル録音再生装置の基本構成を説明
する図、第２図はこの発明に係るデータ伝送系補正装置
の構成を説明する図、第３図はゲート回路の構成を説明
する図、第４図はサンプリング値ｎ点に対する補正を説
明する図、である。 １１・・・マイクロフォン、１２・・・入力端子、１３
・・・増幅回路、１４・・・帯域圧縮回路、１５・・・
符号化回路、１６・・・誤り検出η正符号付加回路、１
７・・・記録装置、１８・・・データ伝送系補正装置、
１９・・・復号化回路、２０・・・帯域伸張回路、２１
・・・増幅回路、２２・・・出力端子、２３・・・スピ
ーカー、２４・・・訂正回路、２５・・・情報シンボル
、２６・・・補正フラグ、２１・−・補正回路、２８・
・・入力セレクタ、２９・・・出力セレクタ、３０・・
・メモリ、３１・・・ラッチ、３２・・・出力用ラッチ
、３３・・・補正値演算回路、３４・・・減算回路、３
５・・・ゲート回路、３６．３８・・・ＮＯＲ回路、３
７・・・ＡＮＤ回路、Ｄ（ｎ）・・・被補正情報シンボ
ル、Ｈ（ｎ）・・・予測値、５（ｎｌ・・・Ｄ （ｆ’
＋１とＨ（ｎ）の差分の情報、Ｓｌ 、Ｓ２．ＣＰＩ
、ＣＦ２・・・制＃信号。
する図、第２図はこの発明に係るデータ伝送系補正装置
の構成を説明する図、第３図はゲート回路の構成を説明
する図、第４図はサンプリング値ｎ点に対する補正を説
明する図、である。 １１・・・マイクロフォン、１２・・・入力端子、１３
・・・増幅回路、１４・・・帯域圧縮回路、１５・・・
符号化回路、１６・・・誤り検出η正符号付加回路、１
７・・・記録装置、１８・・・データ伝送系補正装置、
１９・・・復号化回路、２０・・・帯域伸張回路、２１
・・・増幅回路、２２・・・出力端子、２３・・・スピ
ーカー、２４・・・訂正回路、２５・・・情報シンボル
、２６・・・補正フラグ、２１・−・補正回路、２８・
・・入力セレクタ、２９・・・出力セレクタ、３０・・
・メモリ、３１・・・ラッチ、３２・・・出力用ラッチ
、３３・・・補正値演算回路、３４・・・減算回路、３
５・・・ゲート回路、３６．３８・・・ＮＯＲ回路、３
７・・・ＡＮＤ回路、Ｄ（ｎ）・・・被補正情報シンボ
ル、Ｈ（ｎ）・・・予測値、５（ｎｌ・・・Ｄ （ｆ’
＋１とＨ（ｎ）の差分の情報、Ｓｌ 、Ｓ２．ＣＰＩ
、ＣＦ２・・・制＃信号。
Claims (1)
- 連続的に伝送される多数の情報シンボルの２中の補正し
ようとする情報シンボルＤ （ｎｌおよびこの情報シン
ボルの前後の情報シンボルＤ（ｎ−１）さらに１）（ｎ
−１−ｉ）を検出する手段と、上記情報シンボルＤ（ｎ
−１）および１）（ｎ−１−ｔ）を呼び出してその間の
情報シンボルの予測値Ｈ（ｎｌを演算する補正値演算回
路と、この補正値演算回路で演算した予測値Ｈ（ｎ）と
上記情報シンボルＤ （ｎ）とを対比してその差分Ｓ
（ｎ）を算出する手段と、上記差分８ （ｎ）が特定さ
れる基準範囲内に存在するか否を判別する手段と、この
判別手段で差分ｇｎｌが基準範囲内と判断された状態で
上Ｂｅ情報シンボルとそのまま伝送する手段と、上記判
別手段で差分Ｓ （ｎ）が基準範囲外と判断された状態
で上記予測値）Ｉ （ｎ）を情報シンボルＤ（Ｉ′Ｉ）
として伝送する手段とを具備したことを特徴とするデー
タ伝送系補正装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11294982A JPS594345A (ja) | 1982-06-30 | 1982-06-30 | デ−タ伝送系補正装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11294982A JPS594345A (ja) | 1982-06-30 | 1982-06-30 | デ−タ伝送系補正装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS594345A true JPS594345A (ja) | 1984-01-11 |
| JPH0363259B2 JPH0363259B2 (ja) | 1991-09-30 |
Family
ID=14599549
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11294982A Granted JPS594345A (ja) | 1982-06-30 | 1982-06-30 | デ−タ伝送系補正装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS594345A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60226075A (ja) * | 1984-04-25 | 1985-11-11 | Sony Corp | デイジタルデ−タ再生回路 |
| EP0199563A2 (en) * | 1985-04-19 | 1986-10-29 | Sony Corporation | Method of and apparatus for error modification for video data |
| JPS62204406A (ja) * | 1986-03-04 | 1987-09-09 | Sony Corp | 回転ヘツド型デイジタルテ−プレコ−ダ |
| JP2008504749A (ja) * | 2004-06-25 | 2008-02-14 | ヒューレット−パッカード デベロップメント カンパニー エル．ピー． | 信頼性情報による離散普遍雑音除去（ｄｉｓｃｒｅｔｅｕｎｉｖｅｒｓａｌｄｅｎｏｉｓｉｎｇ） |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52150920A (en) * | 1976-06-10 | 1977-12-15 | Sony Corp | Digital signal error detection method |
| JPS5758425A (en) * | 1980-07-24 | 1982-04-08 | Licentia Gmbh | Circuit device for correcting sampled value received by disturbance in pcm transmitter |
-
1982
- 1982-06-30 JP JP11294982A patent/JPS594345A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52150920A (en) * | 1976-06-10 | 1977-12-15 | Sony Corp | Digital signal error detection method |
| JPS5758425A (en) * | 1980-07-24 | 1982-04-08 | Licentia Gmbh | Circuit device for correcting sampled value received by disturbance in pcm transmitter |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60226075A (ja) * | 1984-04-25 | 1985-11-11 | Sony Corp | デイジタルデ−タ再生回路 |
| EP0199563A2 (en) * | 1985-04-19 | 1986-10-29 | Sony Corporation | Method of and apparatus for error modification for video data |
| JPS62204406A (ja) * | 1986-03-04 | 1987-09-09 | Sony Corp | 回転ヘツド型デイジタルテ−プレコ−ダ |
| JP2008504749A (ja) * | 2004-06-25 | 2008-02-14 | ヒューレット−パッカード デベロップメント カンパニー エル．ピー． | 信頼性情報による離散普遍雑音除去（ｄｉｓｃｒｅｔｅｕｎｉｖｅｒｓａｌｄｅｎｏｉｓｉｎｇ） |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0363259B2 (ja) | 1991-09-30 |
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