JPS5925459A - トラヒツク制御方式 - Google Patents
トラヒツク制御方式Info
- Publication number
- JPS5925459A JPS5925459A JP13549082A JP13549082A JPS5925459A JP S5925459 A JPS5925459 A JP S5925459A JP 13549082 A JP13549082 A JP 13549082A JP 13549082 A JP13549082 A JP 13549082A JP S5925459 A JPS5925459 A JP S5925459A
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- Japan
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- subscriber
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q3/00—Selecting arrangements
- H04Q3/42—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker
- H04Q3/54—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised
- H04Q3/545—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised using a stored programme
- H04Q3/54541—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised using a stored programme using multi-processor systems
- H04Q3/5455—Multi-processor, parallelism, distributed systems
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- H04Q3/54—Circuit arrangements for indirect selecting controlled by common circuits, e.g. register controller, marker in which the logic circuitry controlling the exchange is centralised
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- H04Q3/54575—Software application
- H04Q3/54591—Supervision, e.g. fault localisation, traffic measurements, avoiding errors, failure recovery, monitoring, statistical analysis
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Monitoring And Testing Of Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の対象
本発明は、トラヒック制御方式に関し、？Ｍ＋にマルチ
プロセッサ制御の交換機において、特定加入者、特定中
継線に対する輻軸回避のためのトラヒック制御方式に関
するものである。
プロセッサ制御の交換機において、特定加入者、特定中
継線に対する輻軸回避のためのトラヒック制御方式に関
するものである。
従来技術
プロセッサを用いた電子交換機が使用されており、最近
は時分割スイッチを用いたディジタル交換機が開発され
ている。この場合、交換機２は、各加入者ｌと２線で接
続する加入者回路２１、時分割スイッチ部２２、往復各
２線ずつの４ｍ中継線７、プロセッサ２δ、およびメモ
リ２４を有している。１本の中継線上には、多数の加入
者１からの信号がディジタル化され、時分割的に送出さ
れるため、加入者状態の監視や呼出信号、話中信号の送
出機能は、加入者回路２１において、加入者対応に設け
られている。すなわち、加入者回路２１には、呼出信号
１話中信号等の送出と、加入者線の試験と、加入者への
給電と、加入者状態の監視（オフフック、オンフック、
地絡、電混等の監視）と、２線・４線の変換と、アナｐ
グ・ディジタル信号変換等の機能が含まれている。
は時分割スイッチを用いたディジタル交換機が開発され
ている。この場合、交換機２は、各加入者ｌと２線で接
続する加入者回路２１、時分割スイッチ部２２、往復各
２線ずつの４ｍ中継線７、プロセッサ２δ、およびメモ
リ２４を有している。１本の中継線上には、多数の加入
者１からの信号がディジタル化され、時分割的に送出さ
れるため、加入者状態の監視や呼出信号、話中信号の送
出機能は、加入者回路２１において、加入者対応に設け
られている。すなわち、加入者回路２１には、呼出信号
１話中信号等の送出と、加入者線の試験と、加入者への
給電と、加入者状態の監視（オフフック、オンフック、
地絡、電混等の監視）と、２線・４線の変換と、アナｐ
グ・ディジタル信号変換等の機能が含まれている。
プロセッサを用いる交換機では、システムの信頼性、装
置利用の融通性、処理能力の増大等を図るためマルチプ
ロセッサ制御の交換機にすることがある。その場、合、
加入者や中継線の信号処理と、制御や料金Ｎ１ｎ等の内
部処理等に分割した機能分散処理形、あるいは膨大な加
入者を分割した負荷分散処理形がある。これらのうち、
加入者線信号処理と中継線（１号処理の（幾能分散形、
あるいは加入者線のみ、あるいは中継線のみの信号処理
を行う負荷分散処理形では、各プロセッサは他のプロセ
ッサの加入者状態および呼状態には関係なく、独立して
自分の処理を実行するため、例えばプロセッサＡが収容
する特定加入者への着信が輻幀すると、発呼者を収容す
る他のプロセッサＢＣ・・・・・・からその度ごとにプ
ロセッサＡに問合わせが行われ、すでに話中である加入
者状態の判定等の無効処理が増大するため、そのプロセ
ッサＡおよびそれに関係するプ四セッサＢ、Ｃ自・自の
処理効率な着しく低下させるという欠点がある。
置利用の融通性、処理能力の増大等を図るためマルチプ
ロセッサ制御の交換機にすることがある。その場、合、
加入者や中継線の信号処理と、制御や料金Ｎ１ｎ等の内
部処理等に分割した機能分散処理形、あるいは膨大な加
入者を分割した負荷分散処理形がある。これらのうち、
加入者線信号処理と中継線（１号処理の（幾能分散形、
あるいは加入者線のみ、あるいは中継線のみの信号処理
を行う負荷分散処理形では、各プロセッサは他のプロセ
ッサの加入者状態および呼状態には関係なく、独立して
自分の処理を実行するため、例えばプロセッサＡが収容
する特定加入者への着信が輻幀すると、発呼者を収容す
る他のプロセッサＢＣ・・・・・・からその度ごとにプ
ロセッサＡに問合わせが行われ、すでに話中である加入
者状態の判定等の無効処理が増大するため、そのプロセ
ッサＡおよびそれに関係するプ四セッサＢ、Ｃ自・自の
処理効率な着しく低下させるという欠点がある。
発明の目的
本発明の目的は、このような従来の欠点を除失するため
、複数のプロセッサにより機能または負荷を分散処理す
るマルチプロセッサ制御交換機において、特定加入者へ
の着信が集中した場合、その都度、この特定加入者を収
容するプロセッサが加入者状態の判定を行うことなく、
プロセッサの無効処理による輻輪を回避し、かつスルー
プットを向Ｊ二できるトラヒック制御方式を提供するこ
とにある。
、複数のプロセッサにより機能または負荷を分散処理す
るマルチプロセッサ制御交換機において、特定加入者へ
の着信が集中した場合、その都度、この特定加入者を収
容するプロセッサが加入者状態の判定を行うことなく、
プロセッサの無効処理による輻輪を回避し、かつスルー
プットを向Ｊ二できるトラヒック制御方式を提供するこ
とにある。
本発明のトラヒック制御方式は、収容する加入者あるい
は中継線の空話中情報を各プロセッサの記憶装置に記憶
しているマルチプロセッサ制御の交換機において、各記
憶装置の空話中情報を）全プロセッサから参照あるいは
収容できる共通の記憶装置に写像しておき、各プロセッ
サは自分が収容していない加入者あるいは中継線への接
続呼を検出すると、上記共通配管装置に写像された空話
中情報を参照あるいは収集して話中を判別したならば発
呼加入者あるいは着信中継線に話中音接続することに％
黴がある。また、本発明のトラヒック制御方式は、収容
する加入者あるいは中継線の空話中情報を各プロセッサ
の記憶装置に記憶しているマルチプロセッサ制御の交換
機において、各プロセッサは収容している加入者または
中継線への接続要求回数を計数し、あらかじめ定めた値
を越えると、全プロセッサから参照あるいは収集できる
共通の着信輻輪表示装置に、該当する加入者あるいは中
継線を表示しておき、各プロセッサは自分が収容してい
ない加入者あるいは中継線への接続呼を検出すると、上
記共通着信輻幀表示装置に表示された内容を参照あるい
は収集して表示を判別したならば発呼加入者あるいは発
呼中継線に話中音接続することに特徴を有する。
は中継線の空話中情報を各プロセッサの記憶装置に記憶
しているマルチプロセッサ制御の交換機において、各記
憶装置の空話中情報を）全プロセッサから参照あるいは
収容できる共通の記憶装置に写像しておき、各プロセッ
サは自分が収容していない加入者あるいは中継線への接
続呼を検出すると、上記共通配管装置に写像された空話
中情報を参照あるいは収集して話中を判別したならば発
呼加入者あるいは着信中継線に話中音接続することに％
黴がある。また、本発明のトラヒック制御方式は、収容
する加入者あるいは中継線の空話中情報を各プロセッサ
の記憶装置に記憶しているマルチプロセッサ制御の交換
機において、各プロセッサは収容している加入者または
中継線への接続要求回数を計数し、あらかじめ定めた値
を越えると、全プロセッサから参照あるいは収集できる
共通の着信輻輪表示装置に、該当する加入者あるいは中
継線を表示しておき、各プロセッサは自分が収容してい
ない加入者あるいは中継線への接続呼を検出すると、上
記共通着信輻幀表示装置に表示された内容を参照あるい
は収集して表示を判別したならば発呼加入者あるいは発
呼中継線に話中音接続することに特徴を有する。
発明の実施例
第２図は、本発明の実施例を示すマルチプロセッサ制御
交換機のブロック図である。
交換機のブロック図である。
第２図において、２は加入者線プロセッサ、３は中継線
プロセッサ、牛は共通加入者メモリ、２５は個別の加入
者線メモリ、７は中継線、である。
プロセッサ、牛は共通加入者メモリ、２５は個別の加入
者線メモリ、７は中継線、である。
加入者線プロセッサ２は自分が収容する加入者線の信号
処理を行い、がつ加入者１の状態を検出して、加入者線
メモリ２５に加入者状態の記録を行う。中継線プロセッ
サ３は自分が収容する中継線７の信号処理を行うととも
に、中継線７の状態を検出して、中継線メモリ（図示省
略）に中継線の状態を記録する。また、各プロセッサ２
，３相互間は、通話および接続情報の送受信が可能なよ
うに、パスで結合されている。各プロセッサ２゜３と共
通加入者メモリ４間にも、参照あるいは収集が可能なよ
うに制御バスで結合されている。
処理を行い、がつ加入者１の状態を検出して、加入者線
メモリ２５に加入者状態の記録を行う。中継線プロセッ
サ３は自分が収容する中継線７の信号処理を行うととも
に、中継線７の状態を検出して、中継線メモリ（図示省
略）に中継線の状態を記録する。また、各プロセッサ２
，３相互間は、通話および接続情報の送受信が可能なよ
うに、パスで結合されている。各プロセッサ２゜３と共
通加入者メモリ４間にも、参照あるいは収集が可能なよ
うに制御バスで結合されている。
共通加入者メモリ４には、加入者線メモリ２５の内容、
つまり加入者の空き塞り情報が写像される。
つまり加入者の空き塞り情報が写像される。
先ず、各加入者プロセッサ２は、自分が収容する加入者
に発信あるいは着信があると、各自の加入者線メモリ２
５の空き塞り情報の該当加入者部分と空きから塞りに変
更した後、パスを介して共通加入者メモリ舎をアクセス
し、対応部分、つまり加入者プロセッサ２の該当する加
入者部分を空きから塞りに書き替える。発着信の度ごと
に、この操作を繰り返すことにより、共通加入者メモリ
舎には全加入者線メモリ２５の内容が正確に写像される
。
に発信あるいは着信があると、各自の加入者線メモリ２
５の空き塞り情報の該当加入者部分と空きから塞りに変
更した後、パスを介して共通加入者メモリ舎をアクセス
し、対応部分、つまり加入者プロセッサ２の該当する加
入者部分を空きから塞りに書き替える。発着信の度ごと
に、この操作を繰り返すことにより、共通加入者メモリ
舎には全加入者線メモリ２５の内容が正確に写像される
。
いま、例えばｌｉｔ線プロセッサ３が収容している中継
線７で着信を検出し、これが加入者プロセッサ（Ｔ、Ｎ
Ｐ、）２に収容されている加入者ｌｌに着信するとき、
あるいは他の加入者プロセッサ（ＬＮＰ□）２に収容し
ている加入者１の発呼を検出し、これが加入者プロセッ
サ（ＬＮＰ□）２に収容されている加入者１′に着信す
るとき、加入者プロセッサ（ＬＮＰｌ）２との情報交換
を行うことなく、直ちにパスを介して共通加入者メモリ
４にアクセスし、着信加入者の対応部分を読みとること
により、その加入者話中の場合には、自分の話中音源を
駆動して中継線あるいは発呼加入者に話中音を接続する
。もし、加入者空きの場合には、勿論、パスを介して加
入者プロセッサ（ＬＮＰｌ）２に接続し、着信を伝達す
る。したがって、着信加入者へのトラヒックが輪軸して
いる場合には、その加入者を収容するプロセッサ（ＬＮ
Ｐ、）２と情報交換する必要がなく、またプロセッサ（
ＬＮＰｌ）２が加入者状態判定等の処理を行わなくてよ
いため、輪軸を回避でき、がつ処理のスループットを上
げることができる。
線７で着信を検出し、これが加入者プロセッサ（Ｔ、Ｎ
Ｐ、）２に収容されている加入者ｌｌに着信するとき、
あるいは他の加入者プロセッサ（ＬＮＰ□）２に収容し
ている加入者１の発呼を検出し、これが加入者プロセッ
サ（ＬＮＰ□）２に収容されている加入者１′に着信す
るとき、加入者プロセッサ（ＬＮＰｌ）２との情報交換
を行うことなく、直ちにパスを介して共通加入者メモリ
４にアクセスし、着信加入者の対応部分を読みとること
により、その加入者話中の場合には、自分の話中音源を
駆動して中継線あるいは発呼加入者に話中音を接続する
。もし、加入者空きの場合には、勿論、パスを介して加
入者プロセッサ（ＬＮＰｌ）２に接続し、着信を伝達す
る。したがって、着信加入者へのトラヒックが輪軸して
いる場合には、その加入者を収容するプロセッサ（ＬＮ
Ｐ、）２と情報交換する必要がなく、またプロセッサ（
ＬＮＰｌ）２が加入者状態判定等の処理を行わなくてよ
いため、輪軸を回避でき、がつ処理のスループットを上
げることができる。
また共通加入者メモリ４をアクセスする場合、該当する
加入者の部分を読み取るだけでなく、ある加入者線メモ
リ２５に対応する部分全部を収集してプロセッサは自分
のメモリに写像しておくことも可能である。
加入者の部分を読み取るだけでなく、ある加入者線メモ
リ２５に対応する部分全部を収集してプロセッサは自分
のメモリに写像しておくことも可能である。
第５図は、本発明の他の実施例を示すマルチプロセッサ
制御交換機のブロック図である。
制御交換機のブロック図である。
第３図において、第２図と同一記号は同じものを表わし
ている。６は話中加入者への着信要求を加入者ごとに計
数する計数器であり、凸は着信輻頓加入者を登録するた
めの着信幅幀加入者表示装置であって、着信輪軸の加入
者だけが抽出されて表にされている。
ている。６は話中加入者への着信要求を加入者ごとに計
数する計数器であり、凸は着信輻頓加入者を登録するた
めの着信幅幀加入者表示装置であって、着信輪軸の加入
者だけが抽出されて表にされている。
先ず、加入者線プロセッサ２は、話中判定したときに、
話中加入者を計数器６に登録することにより、以後、引
数器６は登録された加入者ごとに単位時間当りの話中加
入者への着信要求回数を８Ｉ数する。あらかじめ、着色
幅−となる基準値を設定しておき、計数器６の計数値が
この基準値を越えたとき、プロセッサ２はこの加入者が
着信輻頓であると判断し、この加入者を着信軸重加入者
表示装置５の表に登録する。
話中加入者を計数器６に登録することにより、以後、引
数器６は登録された加入者ごとに単位時間当りの話中加
入者への着信要求回数を８Ｉ数する。あらかじめ、着色
幅−となる基準値を設定しておき、計数器６の計数値が
この基準値を越えたとき、プロセッサ２はこの加入者が
着信輻頓であると判断し、この加入者を着信軸重加入者
表示装置５の表に登録する。
各プロセッサ２でこのような操仰全繰り返ずことにより
、表示装置５には着信輻峡中である加入者のみが登録表
示される。
、表示装置５には着信輻峡中である加入者のみが登録表
示される。
いま、中継線プロセッサ３が中継線で着信を検出し、そ
れが例えば加入者線プロセッサ（ＬＮＰｌ）２に収容さ
れた加入者１′に着信する場合、あるいは他の加入者線
プロセッサ（ＬＮＰ□）２に収容された加入者１から上
記加入者１′に着信する場合、加入者プロセッサ（ＬＮ
Ｐｌ）２との情報交換を行うことなく、直ちにパスを介
して着信輻頓加入者表示装置すにアクセスする。表示装
置５にその着信加入者が登録されているか否かを参照し
、もし登録されていれば、規制中であると判断して、プ
ロセッサ（ＬＮＰｌ）２の話中判定を行うことなく、話
中音接続する。なお、登録されているが否かを参照する
だけでなく、登録されている加入者のすべであるいはそ
の一部を収集して自分のメモリに一時記憶することも可
能である。なお、表示装置５の登録加入者の解除は、そ
の加入者が空になったときに、収容している加入者線プ
ロセッサ２によって抹消される。
れが例えば加入者線プロセッサ（ＬＮＰｌ）２に収容さ
れた加入者１′に着信する場合、あるいは他の加入者線
プロセッサ（ＬＮＰ□）２に収容された加入者１から上
記加入者１′に着信する場合、加入者プロセッサ（ＬＮ
Ｐｌ）２との情報交換を行うことなく、直ちにパスを介
して着信輻頓加入者表示装置すにアクセスする。表示装
置５にその着信加入者が登録されているか否かを参照し
、もし登録されていれば、規制中であると判断して、プ
ロセッサ（ＬＮＰｌ）２の話中判定を行うことなく、話
中音接続する。なお、登録されているが否かを参照する
だけでなく、登録されている加入者のすべであるいはそ
の一部を収集して自分のメモリに一時記憶することも可
能である。なお、表示装置５の登録加入者の解除は、そ
の加入者が空になったときに、収容している加入者線プ
ロセッサ２によって抹消される。
なお、第２図、第３図では、共通加入者メモリ牛、ある
いは着信輪軸加入者表示装置δに対して、加入者の情報
のみを登録しているが、加入者のかわりに中継線の情報
を登録することもできる。その場合には、共Ｊ１υ中継
線メモリと着信輪軸中継線表示装置となる。
いは着信輪軸加入者表示装置δに対して、加入者の情報
のみを登録しているが、加入者のかわりに中継線の情報
を登録することもできる。その場合には、共Ｊ１υ中継
線メモリと着信輪軸中継線表示装置となる。
第４図、第６図は、それぞれ本発明のさらに他の実施例
を示すマルチプロセッサ制御交換機のブロック図である
。
を示すマルチプロセッサ制御交換機のブロック図である
。
第４図の場合は、加入者線プロセッサ２および中継線プ
ロセッサ３の両方から着信輻幀表示装置５に加入者と中
継線を登録するようになっている。
ロセッサ３の両方から着信輻幀表示装置５に加入者と中
継線を登録するようになっている。
すなわち、加入者線プロセッサ２のみならず、中継線プ
ロセッサ３にも計数器６を設けて、話中判定したときに
、話中加入者または話中中継線を計数器６に登録し、単
位時間当りの接続呼を計数する。あらかじめ輪軸となる
基準値を設定しておき、計数値がこの基準値を越えたと
き、プロセッサ２゜３はその加入者あるいは中継線を着
信輪軸表示装ｆｉ５に登録する。なお、基準値は、加入
者と中継線とで別の値に設定することができる。
ロセッサ３にも計数器６を設けて、話中判定したときに
、話中加入者または話中中継線を計数器６に登録し、単
位時間当りの接続呼を計数する。あらかじめ輪軸となる
基準値を設定しておき、計数値がこの基準値を越えたと
き、プロセッサ２゜３はその加入者あるいは中継線を着
信輪軸表示装ｆｉ５に登録する。なお、基準値は、加入
者と中継線とで別の値に設定することができる。
第す図の場合は、中心局、総括局等の上位局における交
換機であって、各プロセッサ凸、３′はいずれも中継線
を収容している。中継線プロセッサ３．３！に計数器６
を設けて、話中判定したときに奈り中継線をＲｒ数器０
に登録し、単位時間嘉りの接続呼を計数する。計数値が
基準値を越えると、着信幅榛中継線表示装置５に登録す
る。
換機であって、各プロセッサ凸、３′はいずれも中継線
を収容している。中継線プロセッサ３．３！に計数器６
を設けて、話中判定したときに奈り中継線をＲｒ数器０
に登録し、単位時間嘉りの接続呼を計数する。計数値が
基準値を越えると、着信幅榛中継線表示装置５に登録す
る。
発明の詳細
な説明したように、本発明によれば、特定加入者あるい
は特定中継線への接続呼が集中した場合、これを収容す
るプロセッサが状態判定することなく話中音接続ができ
るので、プロセッサの無効処理による幅着が回避できる
のみならず、処理のスルーブツトを向上することが可能
となる。
は特定中継線への接続呼が集中した場合、これを収容す
るプロセッサが状態判定することなく話中音接続ができ
るので、プロセッサの無効処理による幅着が回避できる
のみならず、処理のスルーブツトを向上することが可能
となる。
第１図はプロセッサを用いた交換機のブロック図、第２
図は本発明の実施例を示すマルチプロセッサ制御交換機
のブロック図、第３図、第４図および第５図はそれぞれ
本発明の他の実施例を示すマルチプロセッサ制御交換機
のブロック図である。 １．１’：加入者、２：加入者線プロセッサ、３゜３′
：中継線プロセッサ、４！共通メモリ、５：着信輪軸表
示装置、０：計数器、７．７’：中継線、２５：個別加
入者線メモリ、２６二個別中継線メモリ。 第 １ 図 第２図
図は本発明の実施例を示すマルチプロセッサ制御交換機
のブロック図、第３図、第４図および第５図はそれぞれ
本発明の他の実施例を示すマルチプロセッサ制御交換機
のブロック図である。 １．１’：加入者、２：加入者線プロセッサ、３゜３′
：中継線プロセッサ、４！共通メモリ、５：着信輪軸表
示装置、０：計数器、７．７’：中継線、２５：個別加
入者線メモリ、２６二個別中継線メモリ。 第 １ 図 第２図
Claims (1)
- 【特許請求の範囲】 α）収容する加入者あるいは中継線の空塞り情報を各プ
ロセッサごとの個別記憶装置に記憶するマルチプロセッ
サ制御の交換機において、上記個別記憶装置の空塞り情
報を、全プロセッサから参照ないし収集できる共通の記
憶装置に写像しておき、各プロセッサは自分が収容して
いない加入者あるいは中継線への接続呼を検出すると、
上記共通の記憶装置に写像された空塞り情報を参照ない
し収集して、該当する加入者等が塞りのときには、発呼
加入者あるいは着信中継線に話中音接続することを特徴
とするトラヒック制御方式。 （２）収容する加入者あるいは中継線の空塞り情報を各
プロセッサごとの個別記憶装置に記憶するマルチプロセ
ッサ制御の交換機において、各プロセッサは収容してい
る加入者または中継線への接続要求回数を計数し、計数
値があらかじめ定めた値を越えると、全プロセッサから
参照ないし収集できる共通の着信輻幀表示装置に該当す
る加入者または中継線を表示しておき、各プロセッサは
自分が収容していない加入者あるいは中継線への接続呼
を検出すると、上記共通の着信輻幀表示装置に表示され
た内容を参照ないし収集して、上記内容中に該当する加
入者等が存在したときには、発呼加入者あるいは着信中
継線に話中音接続することを特徴とするトラヒック制御
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13549082A JPS5925459A (ja) | 1982-08-03 | 1982-08-03 | トラヒツク制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13549082A JPS5925459A (ja) | 1982-08-03 | 1982-08-03 | トラヒツク制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5925459A true JPS5925459A (ja) | 1984-02-09 |
Family
ID=15152946
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13549082A Pending JPS5925459A (ja) | 1982-08-03 | 1982-08-03 | トラヒツク制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5925459A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6275572B1 (en) | 1998-03-10 | 2001-08-14 | Fujitsu Limited | Congestion control method and system in an exchange |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5119909A (en) * | 1974-08-12 | 1976-02-17 | Nippon Electric Co | Tokuteikanyushaheno ijochakushinfukuso kenshutsuhoshiki |
| JPS53101207A (en) * | 1977-02-16 | 1978-09-04 | Fujitsu Ltd | Electronic exchange system |
-
1982
- 1982-08-03 JP JP13549082A patent/JPS5925459A/ja active Pending
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