JPS5923944A - インタフエ−ス制御装置の自己診断方式 - Google Patents
インタフエ−ス制御装置の自己診断方式Info
- Publication number
- JPS5923944A JPS5923944A JP57133110A JP13311082A JPS5923944A JP S5923944 A JPS5923944 A JP S5923944A JP 57133110 A JP57133110 A JP 57133110A JP 13311082 A JP13311082 A JP 13311082A JP S5923944 A JPS5923944 A JP S5923944A
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- JP
- Japan
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- self
- diagnosis
- interface controller
- signal
- interface
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- Pending
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/22—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing
- G06F11/2205—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing using arrangements specific to the hardware being tested
- G06F11/2221—Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing using arrangements specific to the hardware being tested to test input/output devices or peripheral units
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- General Physics & Mathematics (AREA)
- Test And Diagnosis Of Digital Computers (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（Ａ） 発明の技術分野
本発明はイア、＋２７二−スｒ（ｔｌＪ御装置の自己診
喧豪 方式に調するものであシ、問えは公＆回−を片し゛Ｃ接
緋されるデータ処琥装【ｄと４木装置との間に網制御装
置と共に接続され、ゲータ処理装置と４木装置との間の
インタフェース制御を行なうインタフェース制御装置の
自己診断方式に関するものでるる。
喧豪 方式に調するものであシ、問えは公＆回−を片し゛Ｃ接
緋されるデータ処琥装【ｄと４木装置との間に網制御装
置と共に接続され、ゲータ処理装置と４木装置との間の
インタフェース制御を行なうインタフェース制御装置の
自己診断方式に関するものでるる。
（Ｂ） 技術の背景
近年情報処理装置の普及に伴ない、各分野でオンライン
情報処理シスデムが多く利用されている。このようなオ
ンラインシステムでは特にシステムの信頼性の要求が強
く、種々の診断機能が付〃口されるようになってきてい
る。本発明はこのような診断機能の効率的な実何にかか
わるものである。
情報処理シスデムが多く利用されている。このようなオ
ンラインシステムでは特にシステムの信頼性の要求が強
く、種々の診断機能が付〃口されるようになってきてい
る。本発明はこのような診断機能の効率的な実何にかか
わるものである。
（０） 従来技術と問題点
第１図は本発明が適用される情報処理システムの１例を
示す図で１．第２図は第１図の情報処理システムの従来
の動作を説明する動作説明図−ス変侯装置９５は網ｆｕ
制御袈−であ゛る。
示す図で１．第２図は第１図の情報処理システムの従来
の動作を説明する動作説明図−ス変侯装置９５は網ｆｕ
制御袈−であ゛る。
以ドに第１図の情報処理システムの動作について第２囲
動作説明図を用いて、データ処理装置１から発呼した場
合金側にと９説明する。
動作説明図を用いて、データ処理装置１から発呼した場
合金側にと９説明する。
■データ処理装置１が網制御装置５により端末装置２に
ダイヤリング（１）ｉａｌｉｎｇ ）する。■ダイヤリ
ング終ｒｖＬ、データ端末レディ信号凹ＲをＯＮにする
。■網制御装置５からの回線接続光ｒ信号ＯＭＬＯＩＪ
によりデータ処理装置１と端本装置２の間のデータ通信
が可能であることをボすデータセットレディ信号Ｄｉ（
がＯＮになる。■は端本装置ｓ、２から搬送波が送出さ
れていない場合を示しＣＪ）がＯＦＦとなる。■データ
処理装置１からのデータ送信−要求信号Ｒ８金ＯＮにｒ
る。■データ処ＪＭ装置上から端本装置２にデータ送信
１工能である場合、送信可信号ａＳがＯＮとなる。■は
ｆ−夕処理装置１から端本装置ば２へのデータ送信を示
す。■データ送信路ｆを示し送信安水信号ＵＳをＯＦＦ
にする。■Ｒ日信信号 Ｆ Ｆにより送信可信号ＯＩ３
が０？Ｐ゛になる。■４禾装置２から搬送波が送出され
キャリア咲出信号ＣＤがＯＮになる。
ダイヤリング（１）ｉａｌｉｎｇ ）する。■ダイヤリ
ング終ｒｖＬ、データ端末レディ信号凹ＲをＯＮにする
。■網制御装置５からの回線接続光ｒ信号ＯＭＬＯＩＪ
によりデータ処理装置１と端本装置２の間のデータ通信
が可能であることをボすデータセットレディ信号Ｄｉ（
がＯＮになる。■は端本装置ｓ、２から搬送波が送出さ
れていない場合を示しＣＪ）がＯＦＦとなる。■データ
処理装置１からのデータ送信−要求信号Ｒ８金ＯＮにｒ
る。■データ処ＪＭ装置上から端本装置２にデータ送信
１工能である場合、送信可信号ａＳがＯＮとなる。■は
ｆ−夕処理装置１から端本装置ば２へのデータ送信を示
す。■データ送信路ｆを示し送信安水信号ＵＳをＯＦＦ
にする。■Ｒ日信信号 Ｆ Ｆにより送信可信号ＯＩ３
が０？Ｐ゛になる。■４禾装置２から搬送波が送出され
キャリア咲出信号ＣＤがＯＮになる。
０端木装置２からデータ処理装置１ｔ１に対しデータの
送信が行なわれる。■データ送信が終ｒしキャリア検出
信号ＣＤがＯＦＦになる。■データ端末レディ信号ＩＤ
ＥがＯＬＩ’ Ｆとなり回線の切断が開始される。０回
祠切断によりデータセットレディ信号ＤＲがＯｆｔ’Ｆ
になる。以上、述べたように■。
送信が行なわれる。■データ送信が終ｒしキャリア検出
信号ＣＤがＯＦＦになる。■データ端末レディ信号ＩＤ
ＥがＯＬＩ’ Ｆとなり回線の切断が開始される。０回
祠切断によりデータセットレディ信号ＤＲがＯｆｔ’Ｆ
になる。以上、述べたように■。
■は呼設定′であシ、■〜０はデータ送信、■、。
は呼復旧であるが、回線切断後から次の回線接続オでの
間インタフェース制御装置４は非動作状態となる。従っ
てこの間インタフェース制御装置は無駄な待ち時間を有
することとなる。
間インタフェース制御装置４は非動作状態となる。従っ
てこの間インタフェース制御装置は無駄な待ち時間を有
することとなる。
（Ｄ） 発明の目的
＋：＠明は上述の点に着目し、インタフェース制御装置
ｉ４が非動作状態となる時間を利用し、該インタフェー
ス制御装置の自己診断を行なわせることを目的としてい
る。
ｉ４が非動作状態となる時間を利用し、該インタフェー
ス制御装置の自己診断を行なわせることを目的としてい
る。
一般に第１図のようなシステムにおい−Ｃ、データ処Ｊ
ｆｆｌｆｊｔｊｔｌに異なるインタフェース、通信手順
前を持つ端末装置２を接続する場合、これを変換するイ
ンタフェース変換機能全インタフェース制御装置に付加
することにより、接続可能とでき、この場合インタフェ
ース変換機能を容易に付加できるようマイクロプロセッ
サが利用されることが多い、本発明はこのようなマイク
ロプロセッサ又り、インタフェース１間御装置自芽がは
じめからマイクロプロセッサにより構成されている場合
のマイクロプロセッサ金利用するものである。
ｆｆｌｆｊｔｊｔｌに異なるインタフェース、通信手順
前を持つ端末装置２を接続する場合、これを変換するイ
ンタフェース変換機能全インタフェース制御装置に付加
することにより、接続可能とでき、この場合インタフェ
ース変換機能を容易に付加できるようマイクロプロセッ
サが利用されることが多い、本発明はこのようなマイク
ロプロセッサ又り、インタフェース１間御装置自芽がは
じめからマイクロプロセッサにより構成されている場合
のマイクロプロセッサ金利用するものである。
回線全ブｒして接続されるデータ処理装置と端末装置と
の間にあって、前記データ処理装置と端末装置との間の
インタフェースを制御するインタフェース市り呻装置紅
において、ＮＩＩｒＪ己インタフェース市１］御装置が
、前記データ処理装置からの回線切断指令信号を受信す
ることによシ回線を切断し、次の回線接続までに該イン
タフェース制御装置内に設けた自己診断処理部を起動し
、前記回線切断ごとに該インタフェース制御装置の自己
診断を行なうとと全特徴としている。以下実施例に従っ
て本発明の詳細な説明する。
の間にあって、前記データ処理装置と端末装置との間の
インタフェースを制御するインタフェース市り呻装置紅
において、ＮＩＩｒＪ己インタフェース市１］御装置が
、前記データ処理装置からの回線切断指令信号を受信す
ることによシ回線を切断し、次の回線接続までに該イン
タフェース制御装置内に設けた自己診断処理部を起動し
、前記回線切断ごとに該インタフェース制御装置の自己
診断を行なうとと全特徴としている。以下実施例に従っ
て本発明の詳細な説明する。
ｔＦ） 発明の実施例
第３図は本発明の一実施例を示す図であり、第１図情報
処理システムのインタフェース制御装置４の構成を示す
ブロック図である。第３図の場合、イ／り７工−ス変換
機ＭＦ、ｔマイクロプロセッサを用いて、実現した例で
ある。第４図は第３図におけるマイクロプロセッサ部の
割り込み検出を示す図であり、第５図は本発明方式の動
作を説明するためのフローチャートである。
処理システムのインタフェース制御装置４の構成を示す
ブロック図である。第３図の場合、イ／り７工−ス変換
機ＭＦ、ｔマイクロプロセッサを用いて、実現した例で
ある。第４図は第３図におけるマイクロプロセッサ部の
割り込み検出を示す図であり、第５図は本発明方式の動
作を説明するためのフローチャートである。
第３図において、４１は対データ処理装置４インタフエ
ース制御部、４２は網ｌ１ｌＩｌ＠装置インタフェース
制御部、４４は対端采装置インタフェース制御一部、４
３はマイクロプロセッサの割シ込み処理部、４５はマイ
クロプロセッサのメモリ部を示し、インタフェース手順
変換プログラム、自己診断プログラムが格納されている
。
ース制御部、４２は網ｌ１ｌＩｌ＠装置インタフェース
制御部、４４は対端采装置インタフェース制御一部、４
３はマイクロプロセッサの割シ込み処理部、４５はマイ
クロプロセッサのメモリ部を示し、インタフェース手順
変換プログラム、自己診断プログラムが格納されている
。
以ド第４図、第５図を用いて本発明実施列の動作を、説
明す暮。本発明実施列において、第２図従来列で説明し
た呼設定■、■及びデータ送信■〜０呼慎旧ｏ−■まで
は同じ動作となるが、本発明ではこの回線切断の後自己
診断プログラムを起動し、自己診断を行なうものである
。すなわち、第４図に示すマイクロプロセッサ割シ込み
処理部４３１において、回線の切断開始をボす１ｇ号、
す（第５図５３）が行なわれ、割り込み原因が回線の切
貼（第５図５４）であると自己診断プログラムが起動（
第５図５５）され、メモリ４５から自己診断プログラム
がｄ出され、自己診断が実行される。この自己診断の終
ｒにより、マ・ｆクログロセッサは回線→妾続の監視に
移り（第５図５６）、回線が接続されると手順変換プロ
グラムが実行さ゛れ（第５図５１）インタフェースメ挾
が行なわれる。すなわち、本発明は第４図に示すように
マイクロプロセッサの割込み機能を用いて少ないノーー
ド電で回巌切断畝、ただちに自己診断ができるものであ
る。
明す暮。本発明実施列において、第２図従来列で説明し
た呼設定■、■及びデータ送信■〜０呼慎旧ｏ−■まで
は同じ動作となるが、本発明ではこの回線切断の後自己
診断プログラムを起動し、自己診断を行なうものである
。すなわち、第４図に示すマイクロプロセッサ割シ込み
処理部４３１において、回線の切断開始をボす１ｇ号、
す（第５図５３）が行なわれ、割り込み原因が回線の切
貼（第５図５４）であると自己診断プログラムが起動（
第５図５５）され、メモリ４５から自己診断プログラム
がｄ出され、自己診断が実行される。この自己診断の終
ｒにより、マ・ｆクログロセッサは回線→妾続の監視に
移り（第５図５６）、回線が接続されると手順変換プロ
グラムが実行さ゛れ（第５図５１）インタフェースメ挾
が行なわれる。すなわち、本発明は第４図に示すように
マイクロプロセッサの割込み機能を用いて少ないノーー
ド電で回巌切断畝、ただちに自己診断ができるものであ
る。
（Ｇ） 発明の詳細
な説明したように本発明は回線の切断を検出することに
よって、インクフェース市り御装置の自己診断処理を行
なうものであり、インタフェース制御部の非動作となる
べき時間を有効に利用するものであり、また、マイクロ
プロセッサを利用しで自己診断プログラムを実行させる
よう構成し、マイクロプロセッサの割シ込み機能を利用
して回線切断にともなう処理プログラムの切換えを行な
うもので必９、少ないノ１−ド量で簡単に実現できるも
のである。
よって、インクフェース市り御装置の自己診断処理を行
なうものであり、インタフェース制御部の非動作となる
べき時間を有効に利用するものであり、また、マイクロ
プロセッサを利用しで自己診断プログラムを実行させる
よう構成し、マイクロプロセッサの割シ込み機能を利用
して回線切断にともなう処理プログラムの切換えを行な
うもので必９、少ないノ１−ド量で簡単に実現できるも
のである。
第１図は本発明が適用される情報処理システムの１例を
示す図であり、第２歯は第１図の１゛Ｗ報処理システム
の従来の動作を説明する動作説明図である。第３図は本
発明の一実施例を示す図であり、第１図情報処理システ
ムのインクツエース制御装置４の構成を示すブロック図
である。第４図は第３図におけるマイクロプロセッサ部
の割り込み検出を示す図であり、第５図は本発明方式の
動作を説明するためのフローチャートである。 ｆＪ３図において、４１は対データ処理装置インタフェ
ース制御部、４２は網制御装置インタフェース制御部、
４４は対端床装置ｔインタノエースｆｔｔｌＪ御部、４
３はマイクロプロセッサの刷り込み処理部、４５はイン
タフェース手順変換プログラム。
示す図であり、第２歯は第１図の１゛Ｗ報処理システム
の従来の動作を説明する動作説明図である。第３図は本
発明の一実施例を示す図であり、第１図情報処理システ
ムのインクツエース制御装置４の構成を示すブロック図
である。第４図は第３図におけるマイクロプロセッサ部
の割り込み検出を示す図であり、第５図は本発明方式の
動作を説明するためのフローチャートである。 ｆＪ３図において、４１は対データ処理装置インタフェ
ース制御部、４２は網制御装置インタフェース制御部、
４４は対端床装置ｔインタノエースｆｔｔｌＪ御部、４
３はマイクロプロセッサの刷り込み処理部、４５はイン
タフェース手順変換プログラム。
Claims (1)
- 公衆回線を介して接続されるデータ処理装置と端本装置
との間にあって、前記データ処４ｔｉ、［ｌ！と端床装
匝との間のインタフェースを制御するインクツエース市
り御装置鉦において、前１１己インタフエース＋Ｉｊｌ
Ｊ岬：８１ｍが、前記データ処理装置からの回線りｒｍ
指舎信信号１：受信することにょ９回線を切〜ｒし、次
の回訓接続までに該インタフェース訓岬装置内ｆＣ設け
た自己診帥「処理部をＩｍ−し、ｒｉｉＪ ｄピ回線切
萌ごとに該インクフェースＩｔ／ｌ制御鋏１雄の自己診
断をイｔｌうことを特徴とするインタフェースｉむυ御
装ｄの自己診断方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57133110A JPS5923944A (ja) | 1982-07-30 | 1982-07-30 | インタフエ−ス制御装置の自己診断方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57133110A JPS5923944A (ja) | 1982-07-30 | 1982-07-30 | インタフエ−ス制御装置の自己診断方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5923944A true JPS5923944A (ja) | 1984-02-07 |
Family
ID=15097039
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57133110A Pending JPS5923944A (ja) | 1982-07-30 | 1982-07-30 | インタフエ−ス制御装置の自己診断方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5923944A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60249152A (ja) * | 1984-05-25 | 1985-12-09 | Matsushita Electric Ind Co Ltd | エンドレスベルト状感光体の製造方法 |
| JPS6172346A (ja) * | 1984-09-17 | 1986-04-14 | Nec Corp | メモリ診断制御方式 |
-
1982
- 1982-07-30 JP JP57133110A patent/JPS5923944A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60249152A (ja) * | 1984-05-25 | 1985-12-09 | Matsushita Electric Ind Co Ltd | エンドレスベルト状感光体の製造方法 |
| JPS6172346A (ja) * | 1984-09-17 | 1986-04-14 | Nec Corp | メモリ診断制御方式 |
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