JPS59228750A - 混成集積回路の製造方法 - Google Patents

混成集積回路の製造方法

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Publication number
JPS59228750A
JPS59228750A JP58104591A JP10459183A JPS59228750A JP S59228750 A JPS59228750 A JP S59228750A JP 58104591 A JP58104591 A JP 58104591A JP 10459183 A JP10459183 A JP 10459183A JP S59228750 A JPS59228750 A JP S59228750A
Authority
JP
Japan
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resistor
resin
paste
resistance value
printed
Prior art date
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Pending
Application number
JP58104591A
Other languages
English (en)
Inventor
Masakazu Yamagishi
正和 山岸
Akira Kazami
風見 明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tokyo Sanyo Electric Co Ltd
Sanyo Electric Co Ltd
Sanyo Denki Co Ltd
Original Assignee
Tokyo Sanyo Electric Co Ltd
Sanyo Electric Co Ltd
Sanyo Denki Co Ltd
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Filing date
Publication date
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Priority to JP58104591A priority Critical patent/JPS59228750A/ja
Publication of JPS59228750A publication Critical patent/JPS59228750A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/702Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof of thick-or thin-film circuits or parts thereof
    • H01L21/705Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof of thick-or thin-film circuits or parts thereof of thick-film circuits or parts thereof

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  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Apparatuses And Processes For Manufacturing Resistors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ) 産業上の利用分野 本発明は混成集積回路の製造方法、特に二種類のカーボ
ンレジン印刷抵抗ペーストを用いた抵抗体を有する混成
集積回路の製造方法に関するQ(ロ)従来技術 従来の混成集積回路を第1図に示す。混成集積回路基板
(11は表面をアルマイト処理したアルミニウム基板を
用い、基板(1)上に所望の形状の銅箔より成る導電路
(2)を設け、導電路(2)間にはオーミック接触を得
るための導電ペースト(3)を介して印刷抵抗体(4)
が適宜形成されている。印刷抵抗体(4)は従来より多
く利用されているエポキシ樹脂ベースのカーボン印刷抵
抗ペーストをスクリーン印刷し焼成して形成され、広い
範囲の抵抗値をスクリ−ン印刷により形成できる点で広
く利用されている。
しかしエポキシ樹脂が耐熱性に劣るため抵抗値の変動中
が大きい欠点がある。このため焼成時間、焼成条件のば
らつきがすぐに抵抗値のばらつきとなって現れるのであ
る0そこで焼成後にトリミング等の抵抗値調整をするこ
とは不可欠となっていた。
(ハ)発明の目的 本発明は断点に鑑みてなされ、従来のエポキシ4itJ
IWペースのカーボンレジン印刷抵抗ペーストの欠点を
逆に利用して、抵抗値の一定なポリイミド樹脂ベースの
カーボンレジン印刷抵抗ペーストラ併用した、エポキシ
樹脂ベース・カーボンレジン印刷抵抗の抵抗値調整機能
を有する混成集積回路の製造方法を提供するものである
に)発明の構成 本発明は第2図に示す如く、以下の各工程より構成され
ている。
(1)混成集積回路基板<11)上に所望の導電路<1
21を形成する工程(第2図A)。
(2)導電路02間の一部にエポキシ系樹脂ベースのカ
ーボンレジン印刷抵抗ペーストをスクリーン印刷する工
程(第2図B)。
(3)導電路(121間の他の一部にエポキシ変性した
ポリイミド樹脂ベースのカーボンレジン印刷抵抗ペース
トをスクリーン印刷する工程(第2図C)。
(4)両力−ボンレジン印刷抵抗ペーストを同時に焼成
する工程(第2図D)。
(ホ)実施例 本発明の第1の工程は混成集積回路基板αυ上に所望の
導電路α2を形成することにある(第2図A)。
混成集積回路基板(11)としてはアルミニウム基板表
面をアルマイト処理したものあるいはアルミニウム基板
表面にA A’203を混入した絶縁樹脂を塗布したも
のを用い、良好な放熱特性を得ている。斯る基板aυ上
には銅箔を貼着し、所望の形状にエツチングして導電路
α2を形成する。導電路(12)は表面の酸化を防止す
るためにニッケルメッキを施している。また抵抗体(1
41(151を形成する予定の導電路(1z端には銀ペ
ースト等の導電ペースト層<131をスフI)−ン印刷
して付着する。なお導電ペースト層αJは抵抗体(14
)(15)と導電路α2とのオーミック接触をとるため
のものである。
本発明の第2の工程は導電路α力量の一部にエポキシ系
樹脂ベースのカーボンレジン印刷抵抗ペーストをスクリ
ーン印刷することにある(第2図B)。
エポキシ系樹脂ベースのカーボンレジン印刷抵抗ペース
トは従来より一般的に利用されているものである。この
カーボンレジン印刷抵抗ペーストによる抵抗体αaはエ
ポキシ樹脂が耐熱性に劣るため抵抗値の変動中は大きい
が、安価で広い範囲の抵抗値を得られる利点がある。
本発明の第3の工程は導電路(121間の他の一部にエ
ポキシ変性したポリイミド樹脂ベースのカーボンレジン
印刷抵抗ペーストをスクリーン印刷することにある(第
2図C)oエポキシ変性したポリイミド樹脂ベースのカ
ーボンレジン印刷抵抗ペーストは、エポキシ変性ポリイ
ミド樹脂100、カーボン8、無機フィラー30、有機
溶剤1100重量比で組成されている。エポキシ変性ポ
リイミド樹脂はビスマレイミド型ポリイミド樹脂に分子
量300〜3000のエポキシ樹脂を10〜80部添加
して加熱変性して共重合して形成する0斯るエポキシ変
性ポリイミド樹脂ベースのカーホンレジン印刷抵抗ペー
ストは周知のスクリーン印刷により導電ペースト層(1
21間に付着して抵抗体0Sを形成する。
なお上述した第2の工程および第3の工程は同時あるい
は逆の順序で行っても良い。
本発明の第4の工程は両力−ボンレジン印刷抵抗ペース
トを同時に焼成することにある(第2図D)。焼成は基
板qυを熱風循環炉内で約200°Cで約1時間程度行
い、両力−ボンレジン印刷抵抗ペーストの硬化をする。
第3図から明らかな様に従来より用いたエポキシ樹脂ベ
ースのカーボンレジン印刷抵抗ペーストは点線の如く焼
成時間の増加につれてその面積抵抗値が減少し、エポキ
シ変性ポリイミド樹脂ベースのカーボンレジン印刷抵抗
ペーストは実線の如く焼成時間に関係な(はぼ一定の面
積抵抗値を得られる。この特性はポリイミド樹脂の耐熱
性に寄因するものである。従って本工程では両力−ボン
レジン印刷抵抗ペーストを同時に焼成でき且つエポキシ
樹脂ベースのカーボンレジン印刷抵抗ペーストの面積抵
抗値のみで焼成時間を決定できる。
本発明の最終工程は導電路(12)上に所望の回路素子
(16)を固着することにある(第2図D)。回路素子
(16)としてはトランジスタ、集積回路、チップコン
デンサ等であり、必要な場合にはボンディングワイヤで
電気的接続を行う。なお抵抗体(14)(t5)および
回路素子(16)は保護樹脂で被覆される。
本発明に依れば抵抗体α力を精度を要求されないものに
、抵抗体aωを精度を要求されるものに適用できる。
(へ) 効果 本発明に依ればエポキシ樹脂ベースのカーボンレジン印
刷抵抗ペーストとエポキシ変性したポリイミド樹脂ベー
スのカーボンレジン印刷抵抗ペーストを用いることによ
り、要求される精度に応じて抵抗体を形成できる。また
本発明では両力−ボンレジン印刷抵抗ペーストを同時焼
成でき且つ焼成時間の調整により面積抵抗値を制御でき
るので、きわめて量産に適した製造方法を確立できろ。
【図面の簡単な説明】
第4図は従来の混成集積回路を説明する断面図、第2図
A乃至第2図りは本発明の混成集積回路の製造方法を説
明する断面図、第3図は本発明に用いるカーボンレジン
印刷抵抗ペーストの焼成特性を説明する曲線図である。 ■は混成集積回路基板、(12)は導電路、0Jは導電
ペースト層、(14)(15)は抵抗体、a6)は回路
素子である0223− 第3図 パ誠弔1

Claims (1)

    【特許請求の範囲】
  1. (1)混成集積回路基板上に所望の導電路を形成する工
    程と、該導電路間の一部にエポキシ系樹脂ベースのカー
    ボンレジン印刷抵抗ペーストを前記導電路間の他の一部
    にエポキシ変性したポリイミド樹脂ベースのカーボンレ
    ジン印刷抵抗ペーストをスクリーン印刷する工程と、前
    記両力−ボンレジン印刷抵抗ペーストを同時に焼成する
    工程とを具備することを特徴とする混成集積回路の製造
    方法。
JP58104591A 1983-06-10 1983-06-10 混成集積回路の製造方法 Pending JPS59228750A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58104591A JPS59228750A (ja) 1983-06-10 1983-06-10 混成集積回路の製造方法

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Publications (1)

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JPS59228750A true JPS59228750A (ja) 1984-12-22

Family

ID=14384672

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58104591A Pending JPS59228750A (ja) 1983-06-10 1983-06-10 混成集積回路の製造方法

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JP (1) JPS59228750A (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5274869A (en) * 1975-12-19 1977-06-23 Matsushita Electric Ind Co Ltd Method of producing printed circuit board

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5274869A (en) * 1975-12-19 1977-06-23 Matsushita Electric Ind Co Ltd Method of producing printed circuit board

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