JPS59183511A - 差動増幅回路 - Google Patents
差動増幅回路Info
- Publication number
- JPS59183511A JPS59183511A JP58057480A JP5748083A JPS59183511A JP S59183511 A JPS59183511 A JP S59183511A JP 58057480 A JP58057480 A JP 58057480A JP 5748083 A JP5748083 A JP 5748083A JP S59183511 A JPS59183511 A JP S59183511A
- Authority
- JP
- Japan
- Prior art keywords
- differential amplifier
- voltage
- circuit
- offset voltage
- difference
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/34—Negative-feedback-circuit arrangements with or without positive feedback
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は差動増幅回路に関し、特に差動増幅回路のオフ
セット電圧制御回路に関する。
セット電圧制御回路に関する。
従来複雑な差動回路は個別部品で構成したシ、混成集積
回路で構成する例が多く、また集積回路として実現され
ても小規模なものしかなかった。
回路で構成する例が多く、また集積回路として実現され
ても小規模なものしかなかった。
このため増幅回路間の結合は交流結合方式（インダクタ
ンスやキャパシタンスによる結合）が多く採用されてい
た。集積回路技術の進歩と共に大規模なアナログ回路の
集積も可能となってきているが、周知のように段間結合
にインダクタンスやキャパシタンスを用いる方法は集積
化に適していないので直流結合方式が採用される。この
場合には直流オフセット電圧の補正が問題となる。
ンスやキャパシタンスによる結合）が多く採用されてい
た。集積回路技術の進歩と共に大規模なアナログ回路の
集積も可能となってきているが、周知のように段間結合
にインダクタンスやキャパシタンスを用いる方法は集積
化に適していないので直流結合方式が採用される。この
場合には直流オフセット電圧の補正が問題となる。
本発明は１段または多段に集積化された直流結合差動増
幅回路に適した差動オフセット電圧制御回路を提供する
ことを特徴とする特に本発明では単一極性パルス信号を
増幅する差動増幅回路に適した差動オフセット電圧制御
回路を提供するものである。
幅回路に適した差動オフセット電圧制御回路を提供する
ことを特徴とする特に本発明では単一極性パルス信号を
増幅する差動増幅回路に適した差動オフセット電圧制御
回路を提供するものである。
本発明は１段又は複数段の差動増幅回路の正相出力電圧
および逆相出力電圧の振幅を検出する二つの振幅検出回
路、この二つの振幅検出回路の出力の差をと名差回路か
ら少なくとも構成され上記差回路の出力信号を利用して
上記差動増幅回路の差動オフセット電圧の制御を行うこ
とを特徴とするオフセット電圧制御回路である。
および逆相出力電圧の振幅を検出する二つの振幅検出回
路、この二つの振幅検出回路の出力の差をと名差回路か
ら少なくとも構成され上記差回路の出力信号を利用して
上記差動増幅回路の差動オフセット電圧の制御を行うこ
とを特徴とするオフセット電圧制御回路である。
一般に直流結合された差動増幅回路においては正相出力
電圧と逆相出力電圧の直流レベルは同一にならず増幅回
路内部または外部の変動要因によって差動オフセット電
圧を生ずる。特に不平衡入力の場合には入力信号の直流
レベルの変動によっても出力側に差動オフセット電圧を
生ずる。このような関係を第１図（ａ）およびΦ）に示
す。第１図は基本的な差動回路を示し、端子１０１およ
び１０２が正相および逆相入力端であり端子１０３およ
び１０４が正相および逆相出力端である。正相入力端１
０１に信号電圧が重畳する電圧〜１を与え、逆相入力端
１０２に直流電圧■Ｒを与えた場合の入力波形と出力波
形の関係を第１図の）に示す。曲線１０５および曲線１
０６は差動増幅器の正相出力および逆相出力に対する伝
達特性を示す。波形１０７が入力信号■■の波形であり
、波形１０９および１２０がこれに対する正相出力波形
（Ｖｐ）および逆相出力波形（ＶＮ）を示す。直流レベ
ル１０８は逆相入力端１０２に与えられる基準電圧レベ
ル（ＶＲ）を示す。
電圧と逆相出力電圧の直流レベルは同一にならず増幅回
路内部または外部の変動要因によって差動オフセット電
圧を生ずる。特に不平衡入力の場合には入力信号の直流
レベルの変動によっても出力側に差動オフセット電圧を
生ずる。このような関係を第１図（ａ）およびΦ）に示
す。第１図は基本的な差動回路を示し、端子１０１およ
び１０２が正相および逆相入力端であり端子１０３およ
び１０４が正相および逆相出力端である。正相入力端１
０１に信号電圧が重畳する電圧〜１を与え、逆相入力端
１０２に直流電圧■Ｒを与えた場合の入力波形と出力波
形の関係を第１図の）に示す。曲線１０５および曲線１
０６は差動増幅器の正相出力および逆相出力に対する伝
達特性を示す。波形１０７が入力信号■■の波形であり
、波形１０９および１２０がこれに対する正相出力波形
（Ｖｐ）および逆相出力波形（ＶＮ）を示す。直流レベ
ル１０８は逆相入力端１０２に与えられる基準電圧レベ
ル（ＶＲ）を示す。
介入出力の電圧を直流成分と交流成分に分は次式で表わ
す。
す。
但し■ＩＯ１■ＲＯ２■ＰＯおよびＶＮＯは正相人力逆
相入力、正相出力および！相出力の直流成分を示しｖｉ
、ｖｐおよびｖｎは正相入力、正相出力および逆相出力
の信号成分を示す。この場合入力側での直流オフセット
電圧ＶＸＳ および出力側での直流オフセット電圧Ｖ
Ｏ８は次式で表わされる。
相入力、正相出力および！相出力の直流成分を示しｖｉ
、ｖｐおよびｖｎは正相入力、正相出力および逆相出力
の信号成分を示す。この場合入力側での直流オフセット
電圧ＶＸＳ および出力側での直流オフセット電圧Ｖ
Ｏ８は次式で表わされる。
沈２図は本発明に用いる振幅検出回路の実施例を示す図
である。トランジスタ２０Ｌ２０２．抵抗２０４．２０
５が差動増幅回路を構成しトランジスタ２０３抵抗２０
６およびコンデンサ２０７が電圧保持回路を構成する。
である。トランジスタ２０Ｌ２０２．抵抗２０４．２０
５が差動増幅回路を構成しトランジスタ２０３抵抗２０
６およびコンデンサ２０７が電圧保持回路を構成する。
入力端２０８に入力する信号電圧はコンデンサ２０７が
保持する電圧よシ高い場合にのみエミッタフォロア２０
３を活性化し抵抗２０６を通して新らしい電圧をコンデ
ンサ２０７に充電し、電圧振幅を保持する。従って入力
端２０８に第１図の差動回路の正相出力Ｖｐ又は逆相出
力■Ｎが与えられると、出力端２０９には次式で与えら
れる電圧が現れる。
保持する電圧よシ高い場合にのみエミッタフォロア２０
３を活性化し抵抗２０６を通して新らしい電圧をコンデ
ンサ２０７に充電し、電圧振幅を保持する。従って入力
端２０８に第１図の差動回路の正相出力Ｖｐ又は逆相出
力■Ｎが与えられると、出力端２０９には次式で与えら
れる電圧が現れる。
但し■Ｐは正相出力電圧の最大値ＶＮは逆相出力電圧の
最大値、♀ｐは正相出力信号電圧の最大値を示す。
最大値、♀ｐは正相出力信号電圧の最大値を示す。
第３図は本発明の実施例の構成図である。３０１が一段
又は多数の直続形差動増幅回路であり、３０５および３
０６が正相および逆相入力端、３０７および３０８が正
相出力端および逆相出力端である。３０２および３０３
は第２図に示したような振幅の検出回路でおる。３０４
は差回路で、二つの振幅検出回路３０２および３０３の
出力の差をとり適嶺に増幅してその出力Δ■Ｆを差動増
幅回路３０１の逆相入力端３０６に供給する。この接続
状態で差動増幅回路３０１の差動利得をＡとし差回路３
０４の利得をβとすると次の関係式妙５導びかれる。
又は多数の直続形差動増幅回路であり、３０５および３
０６が正相および逆相入力端、３０７および３０８が正
相出力端および逆相出力端である。３０２および３０３
は第２図に示したような振幅の検出回路でおる。３０４
は差回路で、二つの振幅検出回路３０２および３０３の
出力の差をとり適嶺に増幅してその出力Δ■Ｆを差動増
幅回路３０１の逆相入力端３０６に供給する。この接続
状態で差動増幅回路３０１の差動利得をＡとし差回路３
０４の利得をβとすると次の関係式妙５導びかれる。
一β（Ｖｐｏ −ＶＮＯ＋ ｖｐ）・−・−・（４）Ｖ
ＰＯＶＮＯ＝Ａ （ＶＩＯＶＲ−ΔＶＦ ） ・・・・
・−（５）（４）式および（５）式から出力側における
差動オフセ・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・＠）・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・（７）
Ａβ〉〉１とすると 更にβが十分太きいとすると トがあることを示している。ｖｌは入力信号の最大値で
あるからこのオフセット電圧は入力信号の最大値の１／
２に等しい。この関係を図示すると第４図の如くとなる
。差動増幅回路の伝達特性４０１および４０２に対し、
正相入カ電圧■工は逆直流オフセットが与えられておシ
正相出カ電圧４０５（Ｖｐ）および逆相出力電圧４０６
（ＶＮ） ハ正相出力信号最大値ｖｐに等しい直流オ
フセントが与えられている。
ＰＯＶＮＯ＝Ａ （ＶＩＯＶＲ−ΔＶＦ ） ・・・・
・−（５）（４）式および（５）式から出力側における
差動オフセ・・・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・・・・＠）・・・・・・・・
・・・・・・・・・・・・・・・・・・・・・・（７）
Ａβ〉〉１とすると 更にβが十分太きいとすると トがあることを示している。ｖｌは入力信号の最大値で
あるからこのオフセット電圧は入力信号の最大値の１／
２に等しい。この関係を図示すると第４図の如くとなる
。差動増幅回路の伝達特性４０１および４０２に対し、
正相入カ電圧■工は逆直流オフセットが与えられておシ
正相出カ電圧４０５（Ｖｐ）および逆相出力電圧４０６
（ＶＮ） ハ正相出力信号最大値ｖｐに等しい直流オ
フセントが与えられている。
第４図から明らかなように本発明にょる差動増幅回路で
は単一極性の信号を増幅する場合に差動増幅回路の伝達
特性の直線部分を最も有効に利用することが可能となシ
歪の少ない信号増幅を行うことが可能となる。
は単一極性の信号を増幅する場合に差動増幅回路の伝達
特性の直線部分を最も有効に利用することが可能となシ
歪の少ない信号増幅を行うことが可能となる。
第１図は差動増幅回路の差動オフセット電圧を説明する
図、第２図は最大値検出回路の実施例を示す図、第３図
は本発明による差動増幅回路の構成を示す図、第４図は
本発明による差動増幅回路の差動オフセット電圧を説明
する図である。 なお図において、２０１〜２０３・・・トランジスタ、
２０４〜２０６・・・抵抗、２０７・・・コンデンサ。 ３０１・・・直結形差動増幅回路、３０２，３０３・・
・検出回路、３０４・・・差回路、である。 □□□−丁１ ろＳ 茅２田
図、第２図は最大値検出回路の実施例を示す図、第３図
は本発明による差動増幅回路の構成を示す図、第４図は
本発明による差動増幅回路の差動オフセット電圧を説明
する図である。 なお図において、２０１〜２０３・・・トランジスタ、
２０４〜２０６・・・抵抗、２０７・・・コンデンサ。 ３０１・・・直結形差動増幅回路、３０２，３０３・・
・検出回路、３０４・・・差回路、である。 □□□−丁１ ろＳ 茅２田
Claims (1)
- １段または複数段の差動増幅回路の正相出力電圧および
逆相出力電圧の振幅を検出する二つの振幅検出回路と、
該振幅検出回路の差をとる差回路とを少なくとも含み、
該差回路の出力信号を利用して上記差動増幅回路の差動
オフセット電圧の制御を行うことを特徴とするオフセッ
ト電圧制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58057480A JPS59183511A (ja) | 1983-04-01 | 1983-04-01 | 差動増幅回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58057480A JPS59183511A (ja) | 1983-04-01 | 1983-04-01 | 差動増幅回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59183511A true JPS59183511A (ja) | 1984-10-18 |
| JPH0315843B2 JPH0315843B2 (ja) | 1991-03-04 |
Family
ID=13056871
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58057480A Granted JPS59183511A (ja) | 1983-04-01 | 1983-04-01 | 差動増幅回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59183511A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61158721U (ja) * | 1985-03-26 | 1986-10-01 | ||
| US5557239A (en) * | 1994-08-12 | 1996-09-17 | Samsung Electronics Co., Ltd. | Direct current offset compensating circuit of an audio system |
-
1983
- 1983-04-01 JP JP58057480A patent/JPS59183511A/ja active Granted
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61158721U (ja) * | 1985-03-26 | 1986-10-01 | ||
| US5557239A (en) * | 1994-08-12 | 1996-09-17 | Samsung Electronics Co., Ltd. | Direct current offset compensating circuit of an audio system |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0315843B2 (ja) | 1991-03-04 |
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