JPS59149509A - プログラマブルコントロ−ラ - Google Patents
プログラマブルコントロ−ラInfo
- Publication number
- JPS59149509A JPS59149509A JP1967783A JP1967783A JPS59149509A JP S59149509 A JPS59149509 A JP S59149509A JP 1967783 A JP1967783 A JP 1967783A JP 1967783 A JP1967783 A JP 1967783A JP S59149509 A JPS59149509 A JP S59149509A
- Authority
- JP
- Japan
- Prior art keywords
- program
- application program
- ram
- rom
- memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/04—Programme control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/05—Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
- G05B19/056—Programming the PLC
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/10—Plc systems
- G05B2219/13—Plc programming
- G05B2219/13013—Transferring ram to eprom see also prom burning
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はマイクロプロセッサで制御全行なうプログラマ
ブルコントローラに関する。
ブルコントローラに関する。
一般にプログラマブルコントローラが、第1図に示すよ
うに、プロセッサ1と、装置全体の制御を行なうプログ
ラムを記憶している制御メモリ2と、外部プラント機器
に対する信号の入出力を行なう入出力回路3と、この入
出力回路3を介して入力する信号を処理して出力するこ
とによりプラント機器を制御するだめのプログラムを記
憶しているアプリケーションプログラムメモリ4とから
構成されることは周知の通りである。
うに、プロセッサ1と、装置全体の制御を行なうプログ
ラムを記憶している制御メモリ2と、外部プラント機器
に対する信号の入出力を行なう入出力回路3と、この入
出力回路3を介して入力する信号を処理して出力するこ
とによりプラント機器を制御するだめのプログラムを記
憶しているアプリケーションプログラムメモリ4とから
構成されることは周知の通りである。
このうち、アプリケーションプログラムメモリ4は、入
出力回路3に接続されるプラント機器(図示せず)の制
御態様が変れば、それに伴ってプログラムも変える必要
があるので、プログラムの書き込みが可能外もので、か
つ、装置の電源を切ってもメモリの内容が保持されてい
るものでなければならない。
出力回路3に接続されるプラント機器(図示せず)の制
御態様が変れば、それに伴ってプログラムも変える必要
があるので、プログラムの書き込みが可能外もので、か
つ、装置の電源を切ってもメモリの内容が保持されてい
るものでなければならない。
従来は、このアプリケーションプログラムメモリ4とし
てRAM (ランダムアクセスメモリ)を使用する方法
と、メモリへの書き込みが必要なアプリケーションプロ
グラムのデバッグ時はRAMを使い、デバッグ終了後に
このRAMの内容と同一の内容を書き込んだROM (
リードオンリメ鳴り)を使用する方法とが採用されてい
た。
てRAM (ランダムアクセスメモリ)を使用する方法
と、メモリへの書き込みが必要なアプリケーションプロ
グラムのデバッグ時はRAMを使い、デバッグ終了後に
このRAMの内容と同一の内容を書き込んだROM (
リードオンリメ鳴り)を使用する方法とが採用されてい
た。
しかしながら、上記従来方法によると、前者の場合には
、RAMを使用するため、(])、ノイズ、障害等によ
りメモリ内容が破壊され易い、(2λ電源断時メモリへ
バッテリーバックアップを行なう必要が生じる、(3)
、誤操作によりプログラムが書き換えられる、(4)、
また、書き換えられてもすぐに判らない等の問題点があ
った。一方、後者の場合には、(1)、アプリケーショ
ンプログラムを変更しようとするときにメモリをROM
からRAM K取り替え、変更後、再度RAMからRO
Mに取り替えねばならず、操作が煩雑になる。(2)、
また、この際には電源を切る必要があり、他のコントロ
ーラと電源を共用している場合、他のコントローラの動
作も停止してしまう、(3)、更に、ROMとRAMと
の交換時に人体等に帯電した静電気でメモリ内容が電気
的に破簿されてしまう、(41,L 7j>も、このと
きのメモリ内容の破債に気付き難い等の問題があった。
、RAMを使用するため、(])、ノイズ、障害等によ
りメモリ内容が破壊され易い、(2λ電源断時メモリへ
バッテリーバックアップを行なう必要が生じる、(3)
、誤操作によりプログラムが書き換えられる、(4)、
また、書き換えられてもすぐに判らない等の問題点があ
った。一方、後者の場合には、(1)、アプリケーショ
ンプログラムを変更しようとするときにメモリをROM
からRAM K取り替え、変更後、再度RAMからRO
Mに取り替えねばならず、操作が煩雑になる。(2)、
また、この際には電源を切る必要があり、他のコントロ
ーラと電源を共用している場合、他のコントローラの動
作も停止してしまう、(3)、更に、ROMとRAMと
の交換時に人体等に帯電した静電気でメモリ内容が電気
的に破簿されてしまう、(41,L 7j>も、このと
きのメモリ内容の破債に気付き難い等の問題があった。
本発明は上記問題点を解消し7、アプリケーションプロ
グラムの変更が容易にできる一方、その内容が破壊され
難いプログラマブルコントローラを提供することを目的
とする。
グラムの変更が容易にできる一方、その内容が破壊され
難いプログラマブルコントローラを提供することを目的
とする。
このため、本発明は同一のプログラムがロードされるR
OMとRAMと切替器とを設けてアプリケーションプロ
グラムメモリ装置を構成し、プログラム変更時にはその
RAMを用いてプログラムの変kを行ない、デバッグ完
了後はメモリを切り換えてROMにより制御動作を行な
うようにしたことを特徴としたものである。
OMとRAMと切替器とを設けてアプリケーションプロ
グラムメモリ装置を構成し、プログラム変更時にはその
RAMを用いてプログラムの変kを行ない、デバッグ完
了後はメモリを切り換えてROMにより制御動作を行な
うようにしたことを特徴としたものである。
第2図は本発明の一実施例に係るプログラマブルコント
ローラの構成図を示したものである。図中、第1図と同
一符号は同−又は相当部分を示し、本実施例の場合には
アプリケーションプログラムメモリ4をROM 4 a
と、RAM 4 bと、切換回路4Cとで構成すると共
に、更に切換回路4Cを切換動作させる切換スイッチ5
を設けた点に特徴を有する。
ローラの構成図を示したものである。図中、第1図と同
一符号は同−又は相当部分を示し、本実施例の場合には
アプリケーションプログラムメモリ4をROM 4 a
と、RAM 4 bと、切換回路4Cとで構成すると共
に、更に切換回路4Cを切換動作させる切換スイッチ5
を設けた点に特徴を有する。
以上の構成で、ROM4aとRAM 4 b−には同一
のアプリケーションプログラムが記憶されている。この
アプリケーションプログラムの変更が必要となった場合
は、切換スイッチ5を操作して切換回路4cを切り換え
、アプリケーションプログラムメモリ4iRAM4bと
して動作させる。このアプリケーションプログラムを変
更し、更にデバッグ完了後、そのプログラムをROM4
aに書き込む。また、書き込んだのちは切換回路4Cを
再度切り換えアプリケーションプログラムメモリ4をR
OM41L トして動作させる。これにより、アプリ
ケーションプログラムの変更およびデ・々、ッグが簡単
に行なえると共に、プロセス制御はそのプログラムを書
き込んだROM 4 aを用いて行なわれるため、プロ
グラム内容の破壊されることない信頼性の高い制御75
工行なわれる。
のアプリケーションプログラムが記憶されている。この
アプリケーションプログラムの変更が必要となった場合
は、切換スイッチ5を操作して切換回路4cを切り換え
、アプリケーションプログラムメモリ4iRAM4bと
して動作させる。このアプリケーションプログラムを変
更し、更にデバッグ完了後、そのプログラムをROM4
aに書き込む。また、書き込んだのちは切換回路4Cを
再度切り換えアプリケーションプログラムメモリ4をR
OM41L トして動作させる。これにより、アプリ
ケーションプログラムの変更およびデ・々、ッグが簡単
に行なえると共に、プロセス制御はそのプログラムを書
き込んだROM 4 aを用いて行なわれるため、プロ
グラム内容の破壊されることない信頼性の高い制御75
工行なわれる。
尚、RAM4bを用いてアプリケーションプログラムを
変更し、デバッグ完了後、そのプログラムをROM4a
に書き込む方法としては、fil、 RAM 4 bに
記憶されているデバッグ完了後のアプリケーションプロ
グラムを順次取り出し、これをロムライタを用いてRO
M K書き込み、その書き込んだROMをアプリケーシ
ョンプログラムメモリ4に実装する方法、あるいは、(
2)、 ROM 4 aをF ROM構成とすると共に
、ロムライタを設け、RAM 4 bから直接ROM4
aKfき込む方法等がある。
変更し、デバッグ完了後、そのプログラムをROM4a
に書き込む方法としては、fil、 RAM 4 bに
記憶されているデバッグ完了後のアプリケーションプロ
グラムを順次取り出し、これをロムライタを用いてRO
M K書き込み、その書き込んだROMをアプリケーシ
ョンプログラムメモリ4に実装する方法、あるいは、(
2)、 ROM 4 aをF ROM構成とすると共に
、ロムライタを設け、RAM 4 bから直接ROM4
aKfき込む方法等がある。
また、前述したように同一のアプリケーションプログラ
ムをROM 4 a 、 RAM 4 bに持たせ、R
OM4 mによシプロセス制御を実行中、ROM4aの
メモリ異常をプロセッサ1が診断プログラム等によシ検
出した場合は、切換回路4 c ヘROM 4 aから
RAM 4 bへ切り換えるよう指令を出す回路を設け
て、異常を検出した後のマイクロ70aセツ+j1から
アプリケーションプログラムメモリ4へのアクセスは、
RAM 4 bに対して行なわれるようにすることによ
り、アプリケーションプログラムメモリ4部分を二重化
構成として使用することもできる。
ムをROM 4 a 、 RAM 4 bに持たせ、R
OM4 mによシプロセス制御を実行中、ROM4aの
メモリ異常をプロセッサ1が診断プログラム等によシ検
出した場合は、切換回路4 c ヘROM 4 aから
RAM 4 bへ切り換えるよう指令を出す回路を設け
て、異常を検出した後のマイクロ70aセツ+j1から
アプリケーションプログラムメモリ4へのアクセスは、
RAM 4 bに対して行なわれるようにすることによ
り、アプリケーションプログラムメモリ4部分を二重化
構成として使用することもできる。
以上のように本発明によれば、極めて簡単々操作で、ア
プリケーションプログラムの変更乃至デバッグができる
と共に、デバッグ完了後は70ログラム内容が破壊され
ることのない信頼性の高いプロセス制御を保証するプロ
グラマブルコントローラが得られる。
プリケーションプログラムの変更乃至デバッグができる
と共に、デバッグ完了後は70ログラム内容が破壊され
ることのない信頼性の高いプロセス制御を保証するプロ
グラマブルコントローラが得られる。
第1図は一般的なプログラマゾルコントローラのブロッ
ク構成図、第2図は本発明の一実施例に係るプログラマ
ブルコントローラのグロック構成図である。 1・・・マイクロプロセッサ、2・・・制御メモリ、3
・・・入出力回路、4・・・アプリケーションプログラ
ムメモリ、4a・・・ROM、4b・・・RAM、4e
・・・切換回路、5・・・切換スイッチ。
ク構成図、第2図は本発明の一実施例に係るプログラマ
ブルコントローラのグロック構成図である。 1・・・マイクロプロセッサ、2・・・制御メモリ、3
・・・入出力回路、4・・・アプリケーションプログラ
ムメモリ、4a・・・ROM、4b・・・RAM、4e
・・・切換回路、5・・・切換スイッチ。
Claims (1)
- (1) 少なくともアプリケーションプログラムを記
憶するメモリ装置と、このメモリ装置と接続して前記ア
プリケーションプログラムに基づく制御動作を行なうマ
イクロプロセッサとを備えたプログラマブルコントロー
ラにおいて、前記メモリ装置を前記アプリケーションプ
ログラムを記憶するROMおよびRAMと、これらメモ
リの前記マイクロプロセッサへの接続を切シ換える切換
回路とを設けて構成し、前記アプリケーションプログラ
ムの変更乃至デバッグ時には前記メモリ装置をRAMと
して動作させる一方、デバッグ完了後は前記メモリ装置
をROMとして動作させることを特徴とするプログラマ
ブルコントローラ。 (2、特許請求の範囲第1項記載において、前記マイク
ロプロセッサが前記ROMに記憶されている前記アプリ
ケーションプログラムを実行しているときに、そのRO
Mに異常が生じた場合は前記RAMに切り換え、前記ア
プリケーションプログラムを継続実行することを特徴と
するプログラマブルコントローラ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1967783A JPS59149509A (ja) | 1983-02-10 | 1983-02-10 | プログラマブルコントロ−ラ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1967783A JPS59149509A (ja) | 1983-02-10 | 1983-02-10 | プログラマブルコントロ−ラ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS59149509A true JPS59149509A (ja) | 1984-08-27 |
Family
ID=12005856
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1967783A Pending JPS59149509A (ja) | 1983-02-10 | 1983-02-10 | プログラマブルコントロ−ラ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59149509A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1990000763A1 (en) * | 1988-07-08 | 1990-01-25 | Fanuc Ltd | Programmable controller |
WO1995034848A1 (de) * | 1994-06-16 | 1995-12-21 | Robert Bosch Gmbh | Verfahren zur optimierung von daten und/oder programmteilen für programmierte steuergeräte und steuergerät |
US9595076B2 (en) | 2013-05-08 | 2017-03-14 | Mitsubishi Electric Corporation | Programmable display configured to store screen data for debugging into volatile memory |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5344632A (en) * | 1976-10-05 | 1978-04-21 | Satoshi Takigawa | Deodrant |
JPS54116588A (en) * | 1978-03-01 | 1979-09-10 | Omron Tateisi Electronics Co | Sequence controller |
JPS56108108A (en) * | 1980-01-29 | 1981-08-27 | Mitsubishi Electric Corp | Sequence control system |
JPS57185507A (en) * | 1981-05-11 | 1982-11-15 | Sharp Corp | Sequence controller |
JPS57193805A (en) * | 1981-05-22 | 1982-11-29 | Yokogawa Hokushin Electric Corp | Parameter referring system for digital controller |
-
1983
- 1983-02-10 JP JP1967783A patent/JPS59149509A/ja active Pending
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5344632A (en) * | 1976-10-05 | 1978-04-21 | Satoshi Takigawa | Deodrant |
JPS54116588A (en) * | 1978-03-01 | 1979-09-10 | Omron Tateisi Electronics Co | Sequence controller |
JPS56108108A (en) * | 1980-01-29 | 1981-08-27 | Mitsubishi Electric Corp | Sequence control system |
JPS57185507A (en) * | 1981-05-11 | 1982-11-15 | Sharp Corp | Sequence controller |
JPS57193805A (en) * | 1981-05-22 | 1982-11-29 | Yokogawa Hokushin Electric Corp | Parameter referring system for digital controller |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1990000763A1 (en) * | 1988-07-08 | 1990-01-25 | Fanuc Ltd | Programmable controller |
US5168442A (en) * | 1988-07-08 | 1992-12-01 | Fanuc Ltd. | Programmable controller with modifiable ladder program |
WO1995034848A1 (de) * | 1994-06-16 | 1995-12-21 | Robert Bosch Gmbh | Verfahren zur optimierung von daten und/oder programmteilen für programmierte steuergeräte und steuergerät |
US9595076B2 (en) | 2013-05-08 | 2017-03-14 | Mitsubishi Electric Corporation | Programmable display configured to store screen data for debugging into volatile memory |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH0113573B2 (ja) | ||
JPS59133603A (ja) | プログラマブルコントロ−ラ | |
JPS59149509A (ja) | プログラマブルコントロ−ラ | |
JPS5822409A (ja) | シ−ケンス制御装置 | |
JPS5860318A (ja) | プログラマブルコントロ−ラ | |
JPS56140409A (en) | Processing system for power failure and power restoration in sequence control device | |
WO1989005003A1 (en) | Method of editing a program for pc | |
JP2760027B2 (ja) | I/o装置 | |
JPS61182103A (ja) | プログラマプルコントロ−ラ | |
JP2575424B2 (ja) | プログラマブルコントローラ | |
JPS5827219A (ja) | 給電装置 | |
JPS61127002A (ja) | プログラマブルコントロ−ラのバツクアツプ装置 | |
JP2754700B2 (ja) | I/o装置 | |
JPH07104822A (ja) | 数値制御システム | |
JPH04177504A (ja) | プログラマブルコントローラのバックアップ装置 | |
JPS60690B2 (ja) | 電源制御方式 | |
WO1990011556A1 (en) | Input/output signal control system | |
JPS58221405A (ja) | プログラマブル・コントロ−ラ | |
JPS5854402A (ja) | プログラマブル・コントロ−ラ | |
JPS62254251A (ja) | 不揮発性記憶装置の制御方式 | |
JPH02226307A (ja) | 数値制御装置 | |
JPS5916057A (ja) | マイクロコンピユ−タ | |
JPS5852703A (ja) | 数値制御装置 | |
JPH032902A (ja) | プログラマブルコントローラ | |
JPS63311446A (ja) | 論理装置の電源切断投入機能試験方式 |