JPS59144376A - インバ−タ装置 - Google Patents
インバ−タ装置Info
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- JPS59144376A JPS59144376A JP58019276A JP1927683A JPS59144376A JP S59144376 A JPS59144376 A JP S59144376A JP 58019276 A JP58019276 A JP 58019276A JP 1927683 A JP1927683 A JP 1927683A JP S59144376 A JPS59144376 A JP S59144376A
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- JP
- Japan
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- inverters
- inverter
- output
- voltage
- load
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- Pending
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
- H02M7/44—Conversion of dc power input into ac power output without possibility of reversal by static converters
- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/53—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M7/537—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（技術分野）
本発明は、負荷に高周波電圧全供給するインバータ装置
に関１″る。
に関１″る。
（背景技術）
第１図はプツンユブルイにノく一夕に係る回路図で、交
流或源ＶＳを全波整流器ＤＢ−ｉ介して直流′電圧全得
、該直流電圧を定電流チョークＣＵ及び発振トランスＴ
の１欠巻線ｎ＋ を介して１対のスイメチングトランジ
スタＱｔ 、 Ｑ２ を交互にオン・オフさニせること
により、発振トランスＴの出力巻ＭｎｚＫ高周波醒王を
発生させ、負荷２に高周波電カケ供給するものであＸン
。な餞、図中Ｃは共振用コンデンサ、ｎ３は発振帰還線
、Ｅはノ（イアスミ源、１モ０は起動抵抗、ｒＬｌ 、
Ｒ２は・くイアス抵抗である。
流或源ＶＳを全波整流器ＤＢ−ｉ介して直流′電圧全得
、該直流電圧を定電流チョークＣＵ及び発振トランスＴ
の１欠巻線ｎ＋ を介して１対のスイメチングトランジ
スタＱｔ 、 Ｑ２ を交互にオン・オフさニせること
により、発振トランスＴの出力巻ＭｎｚＫ高周波醒王を
発生させ、負荷２に高周波電カケ供給するものであＸン
。な餞、図中Ｃは共振用コンデンサ、ｎ３は発振帰還線
、Ｅはノ（イアスミ源、１モ０は起動抵抗、ｒＬｌ 、
Ｒ２は・くイアス抵抗である。
かかるインバータの動作を説明−ζ′乙。交流゛丸源Ｖ
ｓを投入−すると、まず起動抵抗Ｒ導通じて、トランジ
スタＱ＋、０．２にペース電流が流孔、両トランジスタ
Ｑｌ、Ｑ２が導通しようとするが、トランジスタのばら
つき等により、いずれか一方のトランジスタが先にオン
すると、発振トランスＴ Ｋ、ｆ３動電圧が発生１゛る
。、この振動゛電圧が帰還巻線ｎ３により両トラノジス
タＱ１．Ｑｚのベース端子間１（帰喰され、先にオンし
たトランジスタを強くオンし、他方のトランジスタを更
に強くオフするように動作し、振動電圧がゼロクロスす
るまで続き、その後は両トランジスタＱ１． Ｑ２のオ
ン・オフ状態が反転し、以降、交互に両トランジスタＱ
ｌ、 Ｑ２がオン・オフし、発振トランスＴに高周波電
圧が発生し、負荷２に高周波電力を供給する。
ｓを投入−すると、まず起動抵抗Ｒ導通じて、トランジ
スタＱ＋、０．２にペース電流が流孔、両トランジスタ
Ｑｌ、Ｑ２が導通しようとするが、トランジスタのばら
つき等により、いずれか一方のトランジスタが先にオン
すると、発振トランスＴ Ｋ、ｆ３動電圧が発生１゛る
。、この振動゛電圧が帰還巻線ｎ３により両トラノジス
タＱ１．Ｑｚのベース端子間１（帰喰され、先にオンし
たトランジスタを強くオンし、他方のトランジスタを更
に強くオフするように動作し、振動電圧がゼロクロスす
るまで続き、その後は両トランジスタＱ１． Ｑ２のオ
ン・オフ状態が反転し、以降、交互に両トランジスタＱ
ｌ、 Ｑ２がオン・オフし、発振トランスＴに高周波電
圧が発生し、負荷２に高周波電力を供給する。
さて、今、発振トランジスタＴの出力巻線ｎ２に接続さ
れた負荷２が重い場合、例えば、複数個の負荷が並列に
接続されたような場合、負荷２に供給される電流が増加
し、出力巻線ｎ２の電流も増え、発振トランスＴの磁束
も増大する。従って、負荷２が重い場合、すなわち負荷
２の容量が大きい場合、発振トランスＴの鉄芯の磁路飽
和を防止するために磁路断面積を大きくする必要があり
、発振トランスＴは大型化する。また、両トランジスタ
Ｑ１・Ｑ２は電婦量の大きいものを必要とする。さらに
、両トランジスタＱ夏、 Ｑｐのコレクタ・エミッタ間
には、電源電圧の３壱近くの高電圧が動作時にかかって
おり、高耐圧のものが用いられているが、高耐圧で高容
量のトランジスタは高価であり、電流に対して余裕度の
小さいものを使用した場合、信頼性が損われる。
れた負荷２が重い場合、例えば、複数個の負荷が並列に
接続されたような場合、負荷２に供給される電流が増加
し、出力巻線ｎ２の電流も増え、発振トランスＴの磁束
も増大する。従って、負荷２が重い場合、すなわち負荷
２の容量が大きい場合、発振トランスＴの鉄芯の磁路飽
和を防止するために磁路断面積を大きくする必要があり
、発振トランスＴは大型化する。また、両トランジスタ
Ｑ１・Ｑ２は電婦量の大きいものを必要とする。さらに
、両トランジスタＱ夏、 Ｑｐのコレクタ・エミッタ間
には、電源電圧の３壱近くの高電圧が動作時にかかって
おり、高耐圧のものが用いられているが、高耐圧で高容
量のトランジスタは高価であり、電流に対して余裕度の
小さいものを使用した場合、信頼性が損われる。
このように負荷２の容量が大きい場合に、発振トランス
Ｔの小型化を図り、スイッチングトランジスタＱｓ 、
Ｑａの信頼性？考慮すると、複数のインバータの出力
を合成し、個々のインバータの発振トランスＴ並びにト
ランジスタＱ１． Ｑ２の電流負担を軽減する方法が考
えられる。第２図はかかる方法による一例で、複数のイ
ンバータＩＮＶｘ、。
Ｔの小型化を図り、スイッチングトランジスタＱｓ 、
Ｑａの信頼性？考慮すると、複数のインバータの出力
を合成し、個々のインバータの発振トランスＴ並びにト
ランジスタＱ１． Ｑ２の電流負担を軽減する方法が考
えられる。第２図はかかる方法による一例で、複数のイ
ンバータＩＮＶｘ、。
ＩＮＶ２ｉ並列接続したものである。このように構成す
ることにより発振トランスの小型化が図れ、スイッチン
グトランジスタの電流容量も小さくできる。
ることにより発振トランスの小型化が図れ、スイッチン
グトランジスタの電流容量も小さくできる。
しかし、複数のインバータを並列接続しているため、次
のような欠点がある。すなわち、個々のインバータＩＮ
Ｖ１． ＩＮＶ２の発振が出力電圧を打ち消すように逆
極性で発振し、出力電圧が出ない状態で安定することが
ある。これは、個々のインバータＩＮＶ ｒ 、 Ｉ
ＮＶ ２ が、互いに独立した発振帰還巻線（トラン
ジスタのオン・オフを駆動する）を有しているからであ
り、第３図金参照してその理由を説明する。・２個のイ
ンバータＩ ＮＶ ｒ 、 Ｉ ＮＶ ｚの各発振トラ
ンスＴ１ 。Ｔｚの出力巻線には漏れインダクタンスが
存在し、該インダクタンスを図においてＬｓ 、 Ｌｚ
で表わす。今、両インバータＩ ＮＶ ｓ、 ＩＮＶ２
が図示したように、出力電圧が逆極性で発振を開始した
とすると、負荷Ｚｖこは各インノく一夕ＩＮＶ＋ 、
ＩＮＶ２ Ｊ： ＩＩ）負荷電流ｉｔ 、 ｉｚカ流れ
るが、図示の如く互いに逆極性となる。従って、両イ／
バータＩ ＮＶ 】、 ｌ ＮＶ ２が略同−の仕様と
すれば、負荷電流ｉ１． ｉ２が略等しくなり、負荷Ｚ
には電圧が発生せず、゛電力は両インバータＩＮＶＩ’
、 ＩＮＶ２より供給されない。このため、電流は図中
破線で示すｉ ｏｕｔの如く、各発振トランスＴＩ 、
Ｔｚの出力巻線を環流することになるっこれは個々の
インバータよりみ九ば負荷２より他のインバータの方が
インピーダンスが低くなることを意味しておりこの状態
で安定するわけである。
のような欠点がある。すなわち、個々のインバータＩＮ
Ｖ１． ＩＮＶ２の発振が出力電圧を打ち消すように逆
極性で発振し、出力電圧が出ない状態で安定することが
ある。これは、個々のインバータＩＮＶ ｒ 、 Ｉ
ＮＶ ２ が、互いに独立した発振帰還巻線（トラン
ジスタのオン・オフを駆動する）を有しているからであ
り、第３図金参照してその理由を説明する。・２個のイ
ンバータＩ ＮＶ ｒ 、 Ｉ ＮＶ ｚの各発振トラ
ンスＴ１ 。Ｔｚの出力巻線には漏れインダクタンスが
存在し、該インダクタンスを図においてＬｓ 、 Ｌｚ
で表わす。今、両インバータＩ ＮＶ ｓ、 ＩＮＶ２
が図示したように、出力電圧が逆極性で発振を開始した
とすると、負荷Ｚｖこは各インノく一夕ＩＮＶ＋ 、
ＩＮＶ２ Ｊ： ＩＩ）負荷電流ｉｔ 、 ｉｚカ流れ
るが、図示の如く互いに逆極性となる。従って、両イ／
バータＩ ＮＶ 】、 ｌ ＮＶ ２が略同−の仕様と
すれば、負荷電流ｉ１． ｉ２が略等しくなり、負荷Ｚ
には電圧が発生せず、゛電力は両インバータＩＮＶＩ’
、 ＩＮＶ２より供給されない。このため、電流は図中
破線で示すｉ ｏｕｔの如く、各発振トランスＴＩ 、
Ｔｚの出力巻線を環流することになるっこれは個々の
インバータよりみ九ば負荷２より他のインバータの方が
インピーダンスが低くなることを意味しておりこの状態
で安定するわけである。
もし、両インバータＩ ＮＶ’ｌ 、 Ｉ ＮＶ ２が
同極性で発振開始しようとしても、この場合は、負荷イ
ンピーダンスが負荷２で決まり、従って、逆極性で発振
する場合に比べて負荷インピーダンスが高い状態となる
。而しＣ１回路は２種の負荷インピーダンス状態をとり
得す、最も低い負荷状態で安定するため、同極性で発振
し安定動作することは第３図に示す回路ではあり得ない
ことになるからである。
同極性で発振開始しようとしても、この場合は、負荷イ
ンピーダンスが負荷２で決まり、従って、逆極性で発振
する場合に比べて負荷インピーダンスが高い状態となる
。而しＣ１回路は２種の負荷インピーダンス状態をとり
得す、最も低い負荷状態で安定するため、同極性で発振
し安定動作することは第３図に示す回路ではあり得ない
ことになるからである。
（発明の目的）
本発明は上記の点に鑑みなされたもので、その目的とす
るところは、複数個のインノ（−夕の出力電圧を並列合
成するインバーター３Ａ置において、各インバータが同
極性、同一周期で発４辰し、有効な出力電圧を得られる
インノく一夕装置を提供するためＶこある。
るところは、複数個のインノ（−夕の出力電圧を並列合
成するインバーター３Ａ置において、各インバータが同
極性、同一周期で発４辰し、有効な出力電圧を得られる
インノく一夕装置を提供するためＶこある。
（発明の開示）
本発明は、複数個のインバータの出力電圧を並列合成す
るインバータ装置にｅいて、個々のインバータの帰還巻
線と鎖交する磁束を共通化することにより、各インバー
タの発振を同極性、同一周期で発振させたことを特徴と
する特 以下、本発明を実施例に基づき説明する。第４図は本発
明に係る一実施例を示す回路図で、２個のプッシュプル
インベータＩＮＶｓ、ＩＮＶ２の各出力端を並列接続し
た出力端にトランスＴ３ｆ接続し、該トランス′Ｐ３の
２次巻線ｎ４．０５ ｋ帰還巻線とし該帰還巻線ｎ４
、 ｎ５の両端イー口、ハーニ全、前記両インバータＩ
ＮＶ１ 、ＩＮＶ２ｆ構成する各１対のスイッチングト
ランジスタＱ１．Ｑ２及びＱｓ。
るインバータ装置にｅいて、個々のインバータの帰還巻
線と鎖交する磁束を共通化することにより、各インバー
タの発振を同極性、同一周期で発振させたことを特徴と
する特 以下、本発明を実施例に基づき説明する。第４図は本発
明に係る一実施例を示す回路図で、２個のプッシュプル
インベータＩＮＶｓ、ＩＮＶ２の各出力端を並列接続し
た出力端にトランスＴ３ｆ接続し、該トランス′Ｐ３の
２次巻線ｎ４．０５ ｋ帰還巻線とし該帰還巻線ｎ４
、 ｎ５の両端イー口、ハーニ全、前記両インバータＩ
ＮＶ１ 、ＩＮＶ２ｆ構成する各１対のスイッチングト
ランジスタＱ１．Ｑ２及びＱｓ。
Ｑ４の各ベース端子間に接続する。他の構成は前記第１
図に示す構成と同等であるので説明を省略する。
図に示す構成と同等であるので説明を省略する。
而して、上記癩還巻線ｎ４ 、 ｎ５の磁束は共有化さ
れてｂるので、帰還巻線ｎａ 、 ｎｓ ノ前記ヘース
端子間への接続を適正にすることにより、２個のインバ
ータｌ１（Ｖｌ、 ＩＮＶ２のそれぞれのベース端子間
に帰還される電圧を、同一周期、同極性すなわち同位相
にすることができる。従って、前述の理由により発掘の
極性が定まるため、従来のように出力電圧を打ち消すよ
うに発振することがなくなる。
れてｂるので、帰還巻線ｎａ 、 ｎｓ ノ前記ヘース
端子間への接続を適正にすることにより、２個のインバ
ータｌ１（Ｖｌ、 ＩＮＶ２のそれぞれのベース端子間
に帰還される電圧を、同一周期、同極性すなわち同位相
にすることができる。従って、前述の理由により発掘の
極性が定まるため、従来のように出力電圧を打ち消すよ
うに発振することがなくなる。
次に、第５図は異なる実施例を示し、前記実施例と同様
に２１固のプッシュプルインバータＩＮＶ＋、ＩＮＶ２
の各出力端子全並列接続し、一方のインバータＩ Ｎ’
Ｖ Ｉの発振トランスＴ＋に巻線旧、＋１５’ｉ設は帰
還巻線とし、各インバータＩ ＮＶ １． Ｉ Ｎ’Ｖ
ｚＩ）ベース端子番で接続する。かかる実施例におい
ても前記実施例と同様に帰還巻線＋’ｕ 、 ｎ５と鎖
交する磁束は共有化さｎており、また、帰還巻線Ｈ４、
ｎｓの極性は定まっているため、各インバータＩ ＮＶ
ｒ、ＩＮＶ２の発掘は同極性で行われ、出力電圧が打
ち消されるように発振することはない。本実施例は前記
実施例と比べ帰還巻線用のトランスＴｓｆ省けるので、
小型化できる利点がある。
に２１固のプッシュプルインバータＩＮＶ＋、ＩＮＶ２
の各出力端子全並列接続し、一方のインバータＩ Ｎ’
Ｖ Ｉの発振トランスＴ＋に巻線旧、＋１５’ｉ設は帰
還巻線とし、各インバータＩ ＮＶ １． Ｉ Ｎ’Ｖ
ｚＩ）ベース端子番で接続する。かかる実施例におい
ても前記実施例と同様に帰還巻線＋’ｕ 、 ｎ５と鎖
交する磁束は共有化さｎており、また、帰還巻線Ｈ４、
ｎｓの極性は定まっているため、各インバータＩ ＮＶ
ｒ、ＩＮＶ２の発掘は同極性で行われ、出力電圧が打
ち消されるように発振することはない。本実施例は前記
実施例と比べ帰還巻線用のトランスＴｓｆ省けるので、
小型化できる利点がある。
第６図は更に異なる実施例を示し、第３図に示す出刃端
に設けたトランスｒ３に直列にコンデンサＣ３を接続し
、トランスＴ３に設けた帰還巻線１１４’＋ｎ、を、各
インバータｒ ＮＶ ｒ 、 Ｉ ＭＶ ２のスイッチ
ングトランジスターのベース端子に接続したものでかか
る実施例においても前記実施例と同様な発振動作を行う
。また、前記実施例と比べ帰還巻線電圧の位相が進んで
いるため、スイッチングトランジスタのスイッチングロ
スを低減できる利点がある。
に設けたトランスｒ３に直列にコンデンサＣ３を接続し
、トランスＴ３に設けた帰還巻線１１４’＋ｎ、を、各
インバータｒ ＮＶ ｒ 、 Ｉ ＭＶ ２のスイッチ
ングトランジスターのベース端子に接続したものでかか
る実施例においても前記実施例と同様な発振動作を行う
。また、前記実施例と比べ帰還巻線電圧の位相が進んで
いるため、スイッチングトランジスタのスイッチングロ
スを低減できる利点がある。
なお、負荷２として螢光灯、ＨＩＤランプの如き放電灯
を用いる場合、放電灯は周知のように、電圧電流特性が
負特性を有するため、管電流を安定化するための限流要
素が必要となる。このため、インバータの発振トランス
に磁気漏れを生じさせ発振トランスにインダクタンス分
を持たせることにより限流要素とする方法もあるが、多
灯並列に接続した場合、灯数変化に対して発振トランス
での漏れインダクタンスが一定であるため、各町の管電
流が灯数が増える程、漏れインダクタンスでの電圧降下
が増大し、従って、管電流が減少するという負荷変動の
問題があるが、本実施例のように、発振トランスＴ３で
の漏れインダクタンスをなくシ、各放電灯２にインダク
タンスＣＨｓ ｋ直列に挿入した場合、負荷灯数の変化
に対し、各放電灯２での管電流の変化が少なくなるとい
う効果がある。
を用いる場合、放電灯は周知のように、電圧電流特性が
負特性を有するため、管電流を安定化するための限流要
素が必要となる。このため、インバータの発振トランス
に磁気漏れを生じさせ発振トランスにインダクタンス分
を持たせることにより限流要素とする方法もあるが、多
灯並列に接続した場合、灯数変化に対して発振トランス
での漏れインダクタンスが一定であるため、各町の管電
流が灯数が増える程、漏れインダクタンスでの電圧降下
が増大し、従って、管電流が減少するという負荷変動の
問題があるが、本実施例のように、発振トランスＴ３で
の漏れインダクタンスをなくシ、各放電灯２にインダク
タンスＣＨｓ ｋ直列に挿入した場合、負荷灯数の変化
に対し、各放電灯２での管電流の変化が少なくなるとい
う効果がある。
次に、第７図に示す実施例は、出方端に並列にトランス
Ｔ４ 、 ’ｐｓを設け、各トランスＴ４ 、’Ｔｓの
２次巻線ｎ４．ｎ５を帰還巻線としたもので、各巻線！
１４ｎ５での磁束変化が共通であるため、前記実施例と
同様に同極性で発振させることができる。
Ｔ４ 、 ’ｐｓを設け、各トランスＴ４ 、’Ｔｓの
２次巻線ｎ４．ｎ５を帰還巻線としたもので、各巻線！
１４ｎ５での磁束変化が共通であるため、前記実施例と
同様に同極性で発振させることができる。
以上の各実施例では２個のインバータ出方を並列に合成
しているが、インバータの数は３台以上でもよく、また
、各実施例においては共通の′！ｌ！源Ｖｓｔ−ｔｉぞ
れ全波整流して各インバータ出方しているが、第８図に
示すように１個の全波整流器ＤＢの出力端より各インバ
ータＩ ＮＶ ｌ、 ＩＮＶ ｚに入力してもよく、更
に、第９図及び第１０図に示すように互いに異なる′電
源ＶＳ＋、Ｖｓ２から人力してもよい。
しているが、インバータの数は３台以上でもよく、また
、各実施例においては共通の′！ｌ！源Ｖｓｔ−ｔｉぞ
れ全波整流して各インバータ出方しているが、第８図に
示すように１個の全波整流器ＤＢの出力端より各インバ
ータＩ ＮＶ ｌ、 ＩＮＶ ｚに入力してもよく、更
に、第９図及び第１０図に示すように互いに異なる′電
源ＶＳ＋、Ｖｓ２から人力してもよい。
（発明の効果）
本発明は上記のように、複数個のインバータの出力電圧
を並列合成したインバータ装置において各インバータの
帰還巻線と鎖交する磁束を共通化したことにより、各イ
ンバータの発振を同極性、同一周期で行わせることがで
きる。従って、出ヵ電圧を低減することがなくなり、各
インバータにおける電流負担を軽減したインバータ装置
を提供できた。
を並列合成したインバータ装置において各インバータの
帰還巻線と鎖交する磁束を共通化したことにより、各イ
ンバータの発振を同極性、同一周期で行わせることがで
きる。従って、出ヵ電圧を低減することがなくなり、各
インバータにおける電流負担を軽減したインバータ装置
を提供できた。
なお、出力端に接続する負荷が、放電灯の並列多灯であ
る場合、灯数を変化させたときあるいは一部の放電灯が
寿命により点灯不能になったときにも、正常に動作する
個々の放電灯に供給される電流の変化を少なくすること
ができるという付加的効果を有する。
る場合、灯数を変化させたときあるいは一部の放電灯が
寿命により点灯不能になったときにも、正常に動作する
個々の放電灯に供給される電流の変化を少なくすること
ができるという付加的効果を有する。
第１図乃至第３図は従来例に係る回路図、第４図乃至第
１０図は本発明に係るそれぞれ異なる実特許出願人 松下電工株式会社 代理人弁理士 竹 元 敏 丸 （ほか２名） 第４図 ＩＮＶ２ 第６図 第７図 Ｂ２
１０図は本発明に係るそれぞれ異なる実特許出願人 松下電工株式会社 代理人弁理士 竹 元 敏 丸 （ほか２名） 第４図 ＩＮＶ２ 第６図 第７図 Ｂ２
Claims (1)
- （１）直流電圧または整流霜；圧を人力し、内蔵せるｌ
対のスー丁ツチングトランジスタのオン・オフにより発
振ｒランスを介ｌ−で高周波電圧を出力するインバータ
を複数個有し、上記各・インバータの出力端を並列接続
した出力端に負荷を・接続する。インバータ装置面に２
いて、上記インバータ・装置の出力電圧を帰還する帰還
巻線を上記各インバータに対応して設け、該各帰還巻線
の両ｉ、Ｉ昆ｉをヒ記そ；ｒＬぞ゛れの両トラノゾスタ
のベース端子ｖｃ、 接続すると共に、各帰還巻線と鎖
交する磁束全共通Ｓて１−たことを特徴とするインバー
タ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58019276A JPS59144376A (ja) | 1983-02-07 | 1983-02-07 | インバ−タ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58019276A JPS59144376A (ja) | 1983-02-07 | 1983-02-07 | インバ−タ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59144376A true JPS59144376A (ja) | 1984-08-18 |
Family
ID=11994918
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58019276A Pending JPS59144376A (ja) | 1983-02-07 | 1983-02-07 | インバ−タ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59144376A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004017508A1 (ja) * | 2002-08-06 | 2004-02-26 | Sharp Kabushiki Kaisha | インバータ回路、蛍光管点灯装置、バックライト装置及び液晶表示装置 |
| KR100749599B1 (ko) * | 2002-08-06 | 2007-08-14 | 샤프 가부시키가이샤 | 인버터 회로, 형광관 점등 장치, 백 라이트 장치 및 액정표시 장치 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50147529A (ja) * | 1974-05-17 | 1975-11-26 |
-
1983
- 1983-02-07 JP JP58019276A patent/JPS59144376A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50147529A (ja) * | 1974-05-17 | 1975-11-26 |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
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