JPS59135518U - 画像メモリの書き込み、読み出し回路 - Google Patents

画像メモリの書き込み、読み出し回路

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Publication number
JPS59135518U
JPS59135518U JP2917383U JP2917383U JPS59135518U JP S59135518 U JPS59135518 U JP S59135518U JP 2917383 U JP2917383 U JP 2917383U JP 2917383 U JP2917383 U JP 2917383U JP S59135518 U JPS59135518 U JP S59135518U
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JP
Japan
Prior art keywords
horizontal
image memory
frequency divider
phase
clock signal
Prior art date
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Pending
Application number
JP2917383U
Other languages
English (en)
Inventor
森岡　潔
Original Assignee
パイオニア株式会社
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Publication date
Application filed by パイオニア株式会社 filed Critical パイオニア株式会社
Priority to JP2917383U priority Critical patent/JPS59135518U/ja
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Pending legal-status Critical Current

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  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の画像メモリの書き込み読み出し回路のブ
ロック図、第２図はこの考案の画像メモリの書き込み、
読み出し回路の一実施例を示すブロック図である。 １・・・・・・位相検波器、２・・・・・・ＶＣＯ１３
・・・・・・分周器、４・・・・・・水平アドレスカウ
ンタ、５・・・・・・垂直アドレスカウンタ、Ａ・・・
・・・ＰＬＬ回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 位相検波器と、電圧制御発振器および分周器とにより構
    成され、水平同期信号と上記分周器の出力を位相検波し
    かつ上記電圧制御発振器よりクロック信号を出力するフ
    ェーズ・ロックド・ループ回路と、このフェーズ・ロッ
    クド・ループ回路とともに水平アドレス発生回路を構成
    し、上記分周器の出力でリセットされかつ上記クロック
    信号をカウントして水平アρレスを発生する水平アドレ
    スカウンタと、フレームの初めを示すパルスによりセッ
    トされ上記水平同期信号をクロック信号としてカウント
    して垂直アドレスを発生する垂直アドレスカウンタとよ
    りなる画像メモリの書き込み、読み出し回路。
JP2917383U 1983-02-28 1983-02-28 画像メモリの書き込み、読み出し回路 Pending JPS59135518U (ja)

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JP2917383U JPS59135518U (ja) 1983-02-28 1983-02-28 画像メモリの書き込み、読み出し回路

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JPS59135518U true JPS59135518U (ja) 1984-09-10

Family

ID=30160031

Family Applications (1)

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JP2917383U Pending JPS59135518U (ja) 1983-02-28 1983-02-28 画像メモリの書き込み、読み出し回路

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