JPS611978U - タイミング信号発生回路 - Google Patents

タイミング信号発生回路

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JPS611978U
JPS611978U JP8707984U JP8707984U JPS611978U JP S611978 U JPS611978 U JP S611978U JP 8707984 U JP8707984 U JP 8707984U JP 8707984 U JP8707984 U JP 8707984U JP S611978 U JPS611978 U JP S611978U
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JP
Japan
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pll circuit
signal generation
timing signal
generation circuit
phase comparator
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JP8707984U
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JPH048707Y2 (ja
Inventor
孝弘 布施
実 臼井
一幸 大舘
Original Assignee
カシオ計算機株式会社
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Publication date
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Publication of JPS611978U publication Critical patent/JPS611978U/ja
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  • Synchronizing For Television (AREA)
  • Transforming Electric Information Into Light Information (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図面は本考案の一実施例を示すもので、第１図は全体の
概略構成を示すブロック図、第２図は第１図におけるア
ナログ位相比較器の詳細を示す回路図、第３図は第１図
におけるデジタル位相比較器の詳細を示す回路図、第４
図は動作を説明するためのタイミングチャートである。 １０・・・自動周波数制御用ＰＬＬ回路、１１・・・ア
ナログ位相比較器、１２・・・低域通過フィルタ、１３
・・・電圧制御発振器、２０・・・周波数逓倍用ＰＬＬ
回路、２１・・・デジタル位相比較器、２２・・・低域
通過′フィルタ、２３・・・電圧制御発振器、２４・・
・分周器。

Claims (1)

    【実用新案登録請求の範囲】
  1. アナログ位相比較器を用いて構成され、テレビ映像信号
    から分離した水平同期信号が入力される第１のＰＬＬ回
    路と、デジタル位相比較器を用いて構成され、上記第１
    のＰＬＬ回路の出力信号が入力される第２のＰＬＬ回路
    と、上記第１のＰＬＬ回路で自動周波数制御を行ない、
    上記第２のＰＬＬ回路で周波数逓倍を行なわせる手段と
    を具備したことを特徴とする液晶テレビのタイミング信
    号発生回路。
JP8707984U 1984-06-12 1984-06-12 タイミング信号発生回路 Granted JPS611978U (ja)

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JP8707984U JPS611978U (ja) 1984-06-12 1984-06-12 タイミング信号発生回路

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JPS611978U true JPS611978U (ja) 1986-01-08
JPH048707Y2 JPH048707Y2 (ja) 1992-03-04

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01171369A (ja) * 1987-12-25 1989-07-06 Nec Corp 標準周波数発生回路
JPH0530521A (ja) * 1991-07-24 1993-02-05 Nec Corp サンプリングクロツク発生回路

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01171369A (ja) * 1987-12-25 1989-07-06 Nec Corp 標準周波数発生回路
JPH0530521A (ja) * 1991-07-24 1993-02-05 Nec Corp サンプリングクロツク発生回路

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JPH048707Y2 (ja) 1992-03-04

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