JPS6027572U - デジタル ビデオメモリ装置 - Google Patents
デジタル ビデオメモリ装置Info
- Publication number
- JPS6027572U JPS6027572U JP11831383U JP11831383U JPS6027572U JP S6027572 U JPS6027572 U JP S6027572U JP 11831383 U JP11831383 U JP 11831383U JP 11831383 U JP11831383 U JP 11831383U JP S6027572 U JPS6027572 U JP S6027572U
- Authority
- JP
- Japan
- Prior art keywords
- memory device
- digital video
- video memory
- signal
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来例のブロック図、第２図はそのタイムチャ
ート、第３図は本考案の１実施例を示したブロック図、
第４図はそのタイムチャートチする。 １は同期分離回路、ＰＬＬはフェーズロックループ回路
、６はＡ／Ｄ変換器、１４は遅延回路である。
ート、第３図は本考案の１実施例を示したブロック図、
第４図はそのタイムチャートチする。 １は同期分離回路、ＰＬＬはフェーズロックループ回路
、６はＡ／Ｄ変換器、１４は遅延回路である。
Claims (1)
- 同期分離回路と、フェーズロックループ回路とにより水
平同期信号を基準にクロック信号を発生させ、その整数
倍をカウントしてＡ／Ｄ変換開始信号が生成されてディ
ジタルデータが格納される型式において、遅延回路を介
挿して、水平同期信号の発生を任意に遅延させることを
特徴とする、デジタルビデオメモリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11831383U JPS6027572U (ja) | 1983-07-28 | 1983-07-28 | デジタル ビデオメモリ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11831383U JPS6027572U (ja) | 1983-07-28 | 1983-07-28 | デジタル ビデオメモリ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6027572U true JPS6027572U (ja) | 1985-02-25 |
Family
ID=30271986
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11831383U Pending JPS6027572U (ja) | 1983-07-28 | 1983-07-28 | デジタル ビデオメモリ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6027572U (ja) |
-
1983
- 1983-07-28 JP JP11831383U patent/JPS6027572U/ja active Pending
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